• 제목/요약/키워드: 로컬 시그마 필터

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윤곽선 훼손 방지 및 미세잡음 제거를 위한 Modified Sigma Filter를 이용한 적응적 잡음 제거장치 알고리즘 (Algorithm of Adaptive Noise Reduction with Modified Sigma Filter for Reduction of Edge Blurring and Minute Noises)

  • 양정주;한학용;양훈기;강봉순;이기동
    • 한국정보통신학회논문지
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    • 제14권10호
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    • pp.2261-2268
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    • 2010
  • 대부분의 이미지 센서로 촬영된 영상 정보는 데이터의 저장 혹은 전송 과정에서 외부 잡음이 유입되며, 그로 인하여 원 영상의 훼손이 발생한다. 노이즈 리덕션 (Noise Reduction, NR)은 이러한 훼손된 영상을 원 영상에 가깝도록 복원하는 기법의 하나이다. 본 논문은 기존에 제안하였던 모디파이드 시그마 필터 (Modified Sigma Filter, MSF)를 이용한 노이즈 리덕션의 성능을 검증하기 위한 것으로, 가우시안 필터 (Gaussian Filter, GF)와 로컬 시그마 필터 (Local Sigma Filter, LSF)를 이용한 노이즈 리덕션과의 성능을 비교하였다. 입력영상에 임의의 가우시안 노이즈를 추가하여 테스트 영상을 생성하였으며, PSNR 수치 비교를 통하여 세 가지 필터를 이용한 노이즈 리덕션의 성능을 비교하였다. PSNR뿐 아니라 시뮬레이션 결과 영상의 1D plot을 통하여, 평탄 영역의 노이즈 제거 기능뿐 아니라 윤곽선영역의 훼손 방지에 있어서 모디파이드 시그마 필터를 이용한 노이즈 리덕션의 성능이 우수함을 확인하였다.

이미지 센서에 의해 발생하는 노이즈 제거를 위한 영상의 조도에 따른 적응적 로컬 시그마 필터의 구현 (Implementation of the adaptive Local Sigma Filter by the luminance for reducing the Noises created by the Image Sensor)

  • 김병현;곽부동;한학용;강봉순;이기동
    • 융합신호처리학회논문지
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    • 제11권3호
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    • pp.189-196
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    • 2010
  • 본 논문에서는 이미지 센서에 의해 발생하는 노이즈를 제거하기 위한 적응적 로컬 시그마 필터 장치를 제안하였다. 이미지 센서에 의해 발생하는 작은 노이즈는 이미지 센서의 아날로그 게인과 노출시간의 증가로 인해 영상 정보와 함께 증폭되며 이러한 노이즈 제거를 목표로 시스템을 설계 하였다. Flatness Index Map 알고리즘을 사용해 영상의 윤곽선을 추출하였으며, 임계치가 영상의 휘도에 따라 적응적으로 변화하도록 설계하여 고조도 영상에서는 윤곽선 추출을 수행하지 않으며, 저조도에서만 윤곽선을 추출하도록 하였다. 추출된 윤곽선을 판단하여 그에 해당하는 픽셀에 대해서만 Local Sigma Filter 알고리즘을 사용하여 노이즈 제거를 수행 하였다. 설계된 필터의 성능 검증을 위해 윈도우 테스트 프로그램을 제작하였다. 그리고 HDL을 사용해 하드웨어로 설계하였으며, FPGA Demonstration board와 $1280{\times}720$ 이미지 사이즈, 30 frame/sec의 성능을 갖는 HD급 CMOS 이미지 센서를 사용해 하드웨어로 설계된 로컬 시그마 필터의 동작을 검증하였다.

싱글 LC-탱크 전압제어발진기를 갖는 $2{\sim}6GHz$의 광대역 CMOS 주파수 합성기 (A $2{\sim}6GHz$ Wide-band CMOS Frequency Synthesizer With Single LC-tank VCO)

  • 정찬영;유창식
    • 대한전자공학회논문지SD
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    • 제46권9호
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    • pp.74-80
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    • 2009
  • 본 논문은 싱글의 LC-탱크 전압제어발진기(VCO)를 사용한 $2{\sim}6GHz$의 CMOS 주파수 합성기에 관하여 기술하였다. 광대역에서 동작하는 주파수 합성기 설계를 위해 최적화된 로컬발진기(LO) 신호 발생기를 사용하였다. LO 신호 발생기는 LC-탱크 VCO와 이 신호를 분주하고 혼합하는 방법으로 광대역의 주파수에서 동작하도륵 구현하였다. 주파수 합성기는 3차 1-1-1 MASH 타입의 시그마-델타 모듈레이터(SDM)를 사용한 소수 분주 위상잠금루프(PLL)에 기초로 설계되었다. 제안한 주파수 합성기는 $0.18{\mu}m$ CMOS 공정기술을 사용하여 설계하였고, off-chip 루프 필터를 가지고 $0.92mm^2$의 칩 면적을 차지하며, 1.8V 전원에서 36mW 이하의 전력을 소모한다. PLL은 $8{\mu}s$보다 적은 시간에서 록킹을 완료한다. 위상 잡음은 중심 주파수 신호로부터 1MHz 오프셋에서 -110dBc/Hz보다 작다.