• 제목/요약/키워드: 디코더

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이종망 연동형 3DTV 방송시스템 설계 및 구현 (Design and Implementation for Hybrid network associated 3DTV Broadcasting System)

  • 윤국진;이진영;정원식;이광순;김규헌
    • 한국방송∙미디어공학회:학술대회논문집
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    • 한국방송공학회 2014년도 하계학술대회
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    • pp.146-149
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    • 2014
  • 최근 ATSC는 방송망 기반의 서비스호환 3DTV 방송서비스 표준완료 이후 이종망 환경에서 하이브리드 3DTV 방송서비스에 대한 표준화를 진행 중에 있다. 본 논문에서는 기존의 디지털방송 화질열화 없이 Full HD 3D 화질을 보장하기 위한 방송망 및 IP 망 연동형 3D 비디오 방송시스템을 제안한다. 특히, ISO/IEC 23009-1 DASH를 활용한 3D 부가 영상 전송, 이종망 환경하에서 안정적인 3D 비디오 동기화 및 하이브리드 3DTV 수신기 개발을 위한 시스템 타켓 디코더 모델을 기술한다. 실험결과, 제안된 기술은 하이브리드 3DTV 방송 표준화에 직접적으로 적용될 수 있으며, 하이브리드 3DTV 인코더 및 수신기 개발에 있어서 참조 모델로 활용될 수 있음을 확인하였다.

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MMT 시스템을 위한 개선된 타이밍 모델 설계 (Advanced Timing Model Design for MMT System)

  • 정태준;이홍래;서광덕
    • 한국방송∙미디어공학회:학술대회논문집
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    • 한국방송∙미디어공학회 2016년도 하계학술대회
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    • pp.68-69
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    • 2016
  • ISO/IEC 13818-1 MPEG2 시스템의 타이밍 모델은 인코더에 들어간 비디오와 오디오 샘플들이 일정한 딜레이가 지난 후 디코더에서 정확히 한 번씩 나타나는 식으로 구현된다. 해당되는 디코더는 타이밍 모델에 부합하여 대응되는 비트스트림을 전달받는다. 이를 통해서 적절하게 동기화가 이루어진 고품질 오디오와 비디오를 위한 디코더 구현을 쉽게 할 수 있다. 반면에, RTP 타이밍 모델은 실제 프리젠테이션 시간에 관한 타이밍 정보를 가지고 있지 않다. 데이터 패킷의 타임스탬프는 상대적 타이밍을 제공하고, RTCP 송신자는 스트림 간 동기화에 대한 정보를 제공하지만 RTP 수신기에서는 버퍼링의 량이나 패킷의 디코딩 시간에 대한 정보를 주지 않는다. 따라서 RTP는 유동적인 전송 지향적인 타이밍 모델을 가지고 있다. 반면에 MPEG-2 시스템은 정확한 타이밍 모델을 수신측을 위해 제공하고 있다. 본 논문에서는 MPEG-2 시스템과 RTP의 타이밍 모델의 이점을 가져와 MMT 시스템을 위한 타이밍 모델을 제안한다.

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JPEG 영상 복원에서 컬러변환의 계산 최적화 (Computation Optimization of Color Conversion in JPEG Image Decoding)

  • 김영주
    • 한국컴퓨터정보학회:학술대회논문집
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    • 한국컴퓨터정보학회 2008년도 제39차 동계학술발표논문집 16권2호
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    • pp.241-244
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    • 2009
  • 최근 모바일폰에 500만 화소 이상의 카메라 모듈이 장착되는 등 모바일 장치에서 고해상도 영상의 인코딩 및 디코딩에 대한 요구가 크게 늘어남에 따라 저성능 시스템에서 실시간으로 동작하는 영상 코덱 구현에 대한 필요성이 증대되고 있다. 본 논문은 JPEG 디코딩의 마지막 단계인 컬러변환 과정에 대해 계산 복잡도를 최적화하는 기법을 제안하고 성능을 평가하였다. 제안된 기법은 JPEG 디코딩 과정에서 IDCT(Inverse Discrete Cosine Transform) 변환과 컬러변환 간의 선형성을 바탕으로 이들 연산 순서를 재배열함으로써 컬러변환 과정에서 요구되는 계산 횟수를 줄이고, 재배열된 부동소수점 연산에 대해 정수 맵핑을 적용하여 계산 복잡도를 줄임으로써 실행시간을 최적화하였다. 임베디드 시스템 개발 플랫폼에서의 성능 평가를 통해 제안된 기법이 기존의 컬러변환 기법들과 비교하여 실행시간을 크게 단축함을 얄 수 있었으나 복원 영상의 화질이 상대적으로 저하됨을 확인하였다.

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연상메모리 설계 및 제작에 관한 연구 (A Study on the Design and Fabrication of Content Addressable Memory)

  • 박상봉;박노경;차균현
    • 한국통신학회논문지
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    • 제16권2호
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    • pp.145-154
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    • 1991
  • 본 논문에서는 데이터의 저장과 판독은 일반 SRAM과 같고 명령과 탐색을 수행하는 8비트 $\times16$ 워드 연상메모리(CAM: Content Addressable Memory)의 알고리즘과 하드웨어를 제시하였다. 설계된 연상메모리 칩은 5개의 기능별 블록(연상메모리 셀 어레이. 어드레스 디코더, 어드레스 인코터, 데이터 셀럭터, 감지 증폭기)으로 나누어서 설계하고 논리 및 회로 검증을 마친 후 3 um CMOS N Well공정을 이용하여 칩을 제작하였다

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다채널 음향 시스템 패닝기법 연구 (Panning Algorithm for Multi-channel Sound Systems)

  • 이신렬;성굉모
    • 한국음향학회:학술대회논문집
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    • 한국음향학회 2004년도 추계학술발표대회논문집 제23권 2호
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    • pp.507-510
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    • 2004
  • 본 논문에서는 다채널 음향 시스템에서 라우드 스피커 이외의 위치에 가상음상을 정위시킬 때 발생되는 음상정위 오차 및 음색왜곡을 최소화 시키는 패닝기법을 제안한다. 기존 패닝기법의 음상정위 성능을 평가하기 위해 방향심리인자를 도입하고[1], 음색왜곡을 평가하기 위해 머리전달함수를 이용하여 실제 음원과 가상 음원과의 주파수특성 차이를 분석하였다. 이러한 객관적 성능분석을 통해 음상정위 오차 및 음색왜곡을 줄일 수 있는 새로운 패닝기법을 제안한다. 향상된 다채널패닝기법은 스테레오 및 서라운드 믹싱콘솔, 음향 편집 프로그램, 음장 재생기, 가상 서라운드 디코더 등 녹음 및 재생 전 분야에 걸쳐 사용될 수 있다.

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디코더 면적을 줄이는 새로운 전류구동 셀 매트릭스 DAC 구조 (A Novel Current Steering Cell Matrix DAC Architecture with Reduced Decoder Area)

  • 정상훈;신홍규;조성익
    • 전기학회논문지
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    • 제58권3호
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    • pp.627-631
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    • 2009
  • This paper presents a novel current steering cell matrix DAC(digital-to-analog converter) architecture to reduce decoder area. The current cell matrix of a existing architecture is selected by columns and lows thermometer code decoder of input bits. But The current cell matrix of a proposal architecture is divided 2n by the thermometer code decoder of upper input bits and are selected by the thermometer code decoder of middle and lower input bits. Because of this configuration, decoder numbers have increased. But the gate number that composed of decoder has decreased. In case of the designed 8 bit current steering cell matrix DAC, the gate number of decoder has decreased by about 55% in comparison with a existing architecture.

JNI의 Native영역에서 처리하는 렌더링 기법 (Rendering Technology Processing on Native Space of JNI)

  • 신용경;박지현;김미영;정재일;이현주;김상욱
    • 한국멀티미디어학회:학술대회논문집
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    • 한국멀티미디어학회 2001년도 추계학술발표논문집
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    • pp.182-186
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    • 2001
  • 효율적인 스트리밍을 지원하기 위하여 JNI(Java Native Interface)를 이용한 플레이어를 구현한다. 미디어 플레이어는 전달 관리기, A/V 디코더, 렌더링 모듈, 자바 그래픽 라이브러리로 구성하고, 렌더링 모듈은 JNI Export Manager, Java Scene Manager, Drawing Manager,NJI API로 구성한다. 디코딩 된 스트림은 자바가 읽어들일 수 있는 객체 타입으로 변환하는 JNI Export Manager와 장면 구성하는 Java Scene Manager, 자바 그래픽 라이브러리를 이용하여 실제 화면에 드로잉하는 Drawing Manager를 통하여 재생한다. 본 논문은 Java Scene Manager를 Native 영역에서 처리하여 디코딩 된 스트림 객체를 전달받아 RGB변환하고, 장면 구성정보를 이용하여 장면을 구성하여 최종적으로 JNI Export Manager에게 전달한다. 따라서 장면을 구성하기 위한 정보를 JNI API를 통하여 전달할 필요가 없으므로 그 만큼의 성능 향상을 보이고, Native 영역에서 처리하므로 자바 언어에서 처리하는 것보다 효율적이다. 이는 성능 비교표를 통하여 재생시간 향상을 보인다.

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신호의 확률분포 예측을 통한 H 264의 Entropy Decoder 설계 (Implementation of High Speed Decoder in H 204 Using Probability Distribution of a Symbol)

  • 김충효
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 2005년도 제36회 하계학술대회 논문집 D
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    • pp.2967-2969
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    • 2005
  • 2003년에 영상압축의 표준으로 제시된 H.264/AVC의 압축성능은 대부분 Context-based Adaptive Binary Arithmetic Codes (CAHAC)라는 새로운 엔트로피 코딩에 기인한 것이다. 그러나, CABAC의 뛰어난 성능에도 불구하고 복잡한 처리과정 때문에 하드웨어로 구현하기가 상당히 곤란하다. 곱셈기가 없는 알고리즘임에도 불구하고 영역(range), 오프셋(offset), 그리고 컨텍스트 변수들(context varivales)을 순차적으로 구해야 하기 때문이다. 이 논문에서는 한번에 최대 두 비트를 디코딩 할 수 있는 예측기법을 통하여 CARAC의 전체적인 디코딩 시간을 줄일 수 있는 방법을 제안한다. 한 비트를 디코딩하기 위해서는 두 개의 심볼(a set of binary symbols)에 대한 확률분포를 사전에 알아야 하지만, 제안된 방법에서는 두 비트를 동시에 디코딩할 수 있도록 네 개의 심볼(two sets of binary symbols)에 대한 확률 분포를 예측하여 디코더에 제공한다. 제안된 예측기법을 CABAC 디코더에 적용한 결과, 기존보다 10-13%의 복호시간을 단축하는 효과를 가졌다. 논문에서 제안된 예측기법을 통한 고속디코더의 구현은 확률을 기반으로 하는 신호처리에 사용되어 고속의 시스템을 구성하는데 효과적으로 적용될 수 있다.

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아날로그 병렬 처리 망을 이용한 비터비 디코더의 기준 입력 인가위치에 따른 성능 평가 (Performance of the Viterbi Decoder using Analog Parallel Processing circuit with Reference position)

  • 김현정;김인철;이왕희;김형석
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 2006년 학술대회 논문집 정보 및 제어부문
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    • pp.378-380
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    • 2006
  • A high speed Analog parallel processing-based Viterbi decoder with a circularly connected 2D analog processing cell array is proposed. It has a 2D parallel processing structure in which an analog processing cell is placed at each node of trellis diagram is connected circulary so that infinitively expanding trellis diagram is realized with the fixed size of circuits. The proposed Viterbi decoder has advantages in that it is operated with better performance of error corrections, has a shorter latency and requires no path memories. In this parer, the performance of error correction as a reference position with the Analog parallel processing-based Viterbi decoder is testd via the software simulation

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Average 출력회로를 이용한 아날로그 병렬처리 기반 비터비 디코더 (Analog Parallel Processing-based Viterbi Decoder using Average circuit)

  • 김현정;김인철;김형석
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 2006년 학술대회 논문집 정보 및 제어부문
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    • pp.375-377
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    • 2006
  • A Analog parallel processing-based Viterbi decoder which decodes PRML signal of DVD has been designed by CMOS circuit. The analog processing-based Viterbi decoder implements are functions of the conventional digital Viterbi decoder utilizing the analog parallel processing circuit technology. The Analog parallel processing-based Viterbi decoding technology is applied for the PR(1,2,2,1) signal decoding of DVD. The benefits are low power consumption and less silicon consumption. In this paper, the comparison of the Analog parallel processing-based Viterbi Decoder which has a function of the error correction between Max operation and Average operation is discussed.

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