• Proceedings of the Korean Vacuum Society Conference
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• 2007.08a
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• pp.346-346
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• 2007

• Proceedings of the Korean Vacuum Society Conference
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• 2007.08a
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• pp.349-349
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• 2007

• Proceedings of the Korean Institute of Surface Engineering Conference
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• 2006.10a
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• pp.41-42
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• 2006

• Journal of the Korean Crystal Growth and Crystal Technology
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• v.23 no.5
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• pp.218-223
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• 2013

In this study, the reflectivity characteristics of Ag nano-coating grown by electroless plating were investigated in order to use as the reflecting plate of BLU (Back Light Unit) in the LCD (Liquid Crystal Display) or LED (Light Emitting Diode) display equipment. The microstructure of Ag nano-coating was polycrystalline nano-structure that consisted of Ag nano-crystals to be reduced and precipitated, and the size of reduced nano-crystals increased as the thickness of nano-coating increased. The reflectivity of Ag nano-coating in the visible light decreased as the thickness of nano-coating increased and the reduction of reflectivity was more severe in the short wavelength region of visible light. The decrease of reflectivity was closely related to the size of Ag nano-crystal and was thought to be due to the larger surface roughness of larger nano-coating thickness. Therefore, the finer Ag nano-crystals and thinner nano-coating thickness could be favorable for the higher reflectivity of Ag nano-coating grown by electroless plating.

• Proceedings of the Korean Vacuum Society Conference
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• 2014.02a
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• pp.308.1-308.1
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• 2014

반도체에서 양자점이 포함된 나노복합체의 전자적 구조와 성질에 대한 연구는 기본적인 양자 물리적 현상을 이해하고 전자소자 및 광소자의 다양한 응용 분야를 파생할 수 있기 때문에 많은 관심을 갖고 있다. 나노복합체를 구성하는 각각의 양자우물과 양자점에 대한 실험과 이론에 대한 연구는 많이 진행되고 있으며, 양자우물 안에 양자점이 삽입된 나노복합체에 대한 연구는 상대적으로 미흡한 상태이다. 또한 양자우물 안에 자발 형성된 양자점이 삽입된 나노복합체에 대한 전기적 특성 및 광학적 특성에 대한 연구는 많으나, 양자우물 안에 삽입된 양자점에 대한 전자적 구조에 대한 연구는 거의 없다. 양자우물 안에 양자점을 형성한 나노복합체 구조를 사용하여 제작한 전자소자와 광소자의 효율을 향상시키기 위해서는 이 복합 구조의 전자적 성질에 대한 연구가 필요하다. 본 연구에서는 단일 양자우물 안에 자발 형성된 InAs 양자점을 포함한 나노복합체의 전자적 특성을 분석하기 위하여 변형효과와 비포물선효과를 포함한 전자적 부띠 에너지에 대하여 비교 분석하였다. InAs 양자점은 20 nm의 직경을 갖고 있으며, GaAs 기판위에 버퍼층과 AlAs 층을 사용한 양자우물 구조에 삽입되었다. 단일 양자우물 안에 삽입된 양자점의 전자적 구조는 형상 의존 변형효과와 비포물선 효과를 고려한 쉬뢰딩거 방정식을 삼차원 가변 메시 유한차분법을 사용하여 수치해석 방법으로 분석하였다. 수치해석 방법으로 양자우물의 우물 폭의 영향을 받는 양자점의 크기변화에 따라 삼차원적인 전자 및 정공의 부띠 에너지와 기저상태 및 여기 상태의 파동 함수를 계산하였다. 이러한 결과는 나노복합체 안에 형성된 InAs 양자점의 전자적 특성을 이해하는데 도움을 주며, InAs가 포함된 나노복합체를 사용한 전자 소자와 광소자 연구에 기초 자료로 사용될 수 있다.

• Proceedings of the Korean Vacuum Society Conference
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• 2011.02a
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• pp.97-97
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• 2011

산화아연 (ZnO)은 넓은 에너지 밴드갭 (~3.37 eV), 큰 엑시톤 결합 에너지 (~60 meV) 그리고 높은 전자 이동도 (bulk~300 $cm^2Vs^{-1}$, single nanowire~1000 $cm^2Vs^{-1}$)를 갖고 있어, 광전자 소자 및 반도체소자 응용에 매우 널리 사용되고 있다. 특히, 산화아연 나노로드(ZnO nanorod)는 1차원 나노구조로써 더욱 향상된 전자 이동도와 캐리어의 direct path way를 제공하여 차세대 광전자소자 및 태양광 소자의 응용에 대한 연구가 매우 활발하게 이루어지고 있다. 한편, 이러한 산화아연 나노로드를 성장시키기 위하여 VLS (vapor-liquid-solid), 졸-겔 공정(sol-gel process), 수열합성(hydrothermal synthesis), 전기증착(electrodeposition)등 다양한 방법이 보고되었지만, 이러한 산화아연 나노로드의 성장방법은 실제적인 소자응용을 위한 패터닝 형성에 대하여 제약을 받는 문제점이 있다. 이들 중에서 수열합성법과 전극증착법은 ZnO 또는 AZO (Al doped ZnO) seed 층 표면과 성장용액의 화학반응에 의해서 선택적으로 산화아연 나노로드를 성장시킬 수 있다. 이에 본 연구에서는, 광전자소자의 응용을 위한 간단한 패터닝 공정을 위해, 산화인듐주석(ITO) 박막이 증착된 유리기판(glass substrate)위에 수열합성법과 전극증착법을 이용하여 산화아연 나노로드를 선택적으로 성장시켰다. 실험을 위해, ITO glass 위에 RF magnetron 스퍼터를 사용하여 AZO seed 층을 metal shadow mask를 이용하여 패터닝을 형성한 후, 질산아연과 헥사메틸렌테트라아민으로 혼합된 용액에 $85^{\circ}C$ 온도를 유지하여, 패터닝이 형성된 샘플에 전압을 인가하여 성장시켰다. 나노구조 분석을 위해, 전계주사현미경을 이용하여 수열합성법과 전기증착법에 의한 패터닝된 산화아연 나노로드를 비교하여 관찰하였다.

• Proceedings of the Korean Vacuum Society Conference
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• 2012.02a
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• pp.368-368
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• 2012

무기물 나노입자를 포함하는 유기물/무기물 나노복합체는 플렉시블 전자 소자에 적용이 가능하기 때문에 차세대 비휘발성 메모리 소자에 대한 응용연구가 활발히 진행되고 있다. 본 논문에서는 $CuInS_2$ (CIS)/ZnS 코어-쉘 나노 입자를 포함한 poly(N-vinylcarbazole) (PVK) 고분자 박막을 기억 매체로 사용하는 유기 쌍안정성 소자(organic bistable devices, OBD) 메모리 소자를 제작하고 전기적 성질에 대하여 관찰하고 전하 수송 메카니즘에 대하여 규명하였다. 화학적 방법으로 형성한 CIS/ZnS 코어-쉘 나노 입자와 PVK를 toluene 용매에 녹인 후 초음파 교반기를 사용하여 나노 복합 소재를 형성하였다. 하부 전극으로 indium-tin-oxide (ITO)가 증착되어 있는 유리 기판 위에 나노 복합 소재를 스핀코팅 방법으로 도포한 후 열을 가해 잔류 용매를 제거하였다. CIS/ZnS 코어-쉘 나노 입자가 분산되어 있는 PVK 나노 복합 소재로 구성된 박막위에 상부 전극으로 Al을 열증착하여 메모리 소자를 제작하였다. 전류-전압 (I-V) 측정 결과에서 저전압에서는 전도도가 낮은 OFF 상태를 유지하다 어느 특정 양의 전압에서 전도도가 갑자기 증가하여 높은 전도도의 ON 상태로 전이되는 쌍안정성이 관찰되었다. 전류의 ON/OFF 비율은 약 $10^3$이며 역방향 바이어스를 가해주었을 때 특정 음의 전압에서 전도도가 ON 상태에서 OFF 상태로 전환되는 전형적인 OBD 메모리 소자의 I-V 특성을 나타났다. 메모리 전하 수송 메커니즘 분석 결과 쓰기 과정은 thermionic emission (TE), space-charge-limited-current (SCLS) 모델과 지우기 과정은 Fowler-Nordheim (FN) 터널링 모델로 설명이 되었다. 제작된 소자에 대해 기억 시간 측정 결과는 ON과 OFF 상태의 전류가 장시간에도 변화가 거의 없는 소자의 안정성을 보여주었다. 이 실험 결과는 CIS/ZnS 코어-쉘 나노 입자가 분산되어 있는 PVK 나노 복합 소재를 사용하여 안정성을 가진 OBD 메모리 소자를 제작할 수 있음을 보여주고 있다.

• Proceedings of the Korean Vacuum Society Conference
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• 2011.08a
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• pp.301-301
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• 2011

최근 고밀도 메모리 반도체의 재료와 빠른 응답을 요구하는 나노입자를 이용한 비휘발성 메모리 소자의 제작에 대한 연구가 활발히 진행되고 있다. 그에 따른 기존의 플래쉬 메모리가 가지는 문제점을 개선하기 위해서 균일하고 규칙적으로 분포하는 새로운 나노소재의 개발과 비휘발성, 고속 동작, 고집적도, 저전력 소자의 공정기술이 요구되고 있다. 또한 부유게이트에 축적되는 저장되는 전하량을 증가시키기 위한 새로운 소자구조 개발이 필요하다. 한편, 실리 사이드 계열의 나노입자는 금속 나노입자와 달리 현 실리콘 기반의 반도체 공정에서 장점을 가지고 있다. 따라서 본 연구에서는 화합물 중에서 비휘발성 메모리 장치의 전기적 특성을 향상 시킬 수 있는 실리사이드 계열의 바나듐 실리사이드(V3Si) 박막을 열처리 과정을 통하여 수 nm 크기의 나노입자로 제작하였다. 소자의 제작은 p-Si기판에 실리콘산화막 터널층(5 nm 두께)을 건식 산화법으로 성장 후, 바나듐 실리사이드 금속박막을 RF 마그네트론 스퍼터 시스템을 이용하여 4~6 nm 두께로 터널 베리어 위에 증착하고, 그 위에 초고진공 마그네트론 스퍼터링을 이용하여 SiO2 컨트롤 산화막층 (20 nm)을 형성시켰다. 여기서 V3Si 나노입자 형성을 위해 급속 열처리법으로 질소 분위기에서 800$^{\circ}C$로 5초 동안 열처리하여 하였으며, 마지막으로 열 기화 시스템을 통하여 알루미늄 전극(직경 200 ${\mu}m$, 두께 200 nm)을 증착하여 소자를 제작하였다. 제작된 구조는 금속 산화막 반도체구조를 가지는 나노 부유게이트 커패시터이며, 제작된 시편은 투사전자현미경을 이용하여 나노입자의 크기와 균일성을 확인했다. 소자의 전기적인 측정을 E4980A capacitor parameter analyzer와 Agilent 81104A pulse pattern generator system을 이용한 전기용량-전압 측정을 통해 전하저장 효과 및 메모리 동작 특성들을 분석하고, 열처리 조건에 따라 형성되는 V3Si 의 조성을 엑스선 광전자 분광법을 이용하여 확인하였다.

• Journal of Convergence for Information Technology
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• v.7 no.5
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• pp.123-128
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• 2017

Nanostructured materials have received attention due to their unique electronic, optical, optoelectrical, and magnetic properties as a results of their large surface-to-volume ratio and quantum confinement effects. Thermal chemical vapor deposition process has attracted much attention due to the synthesis capability of various structured nanomaterials during the growth of nanostructures. In this study, silicon oxide nanowires were grown on Si\$SiO_2$(300 nm)\Pt(5~40 nm) substrates by two-zone thermal chemical vapor deposition with the source material $TiO_2$ powder via vapor-liquid-solid process. The morphology and crystallographic properties of the grown silicon oxide nanowires were characterized by field-emission scanning electron microscope and transmission electron microscope. As results of analysis, the morphology, diameter and length, of the grown silicon oxide nanowires are depend on the thickness of the catalyst films. The grown silicon oxide nanowires exhibit amorphous phase.

• Proceedings of the Materials Research Society of Korea Conference
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• 2009.05a
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• pp.21.1-21.1
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• 2009

상변화 메모리는 비휘발성 메모리이면서 빠른 동작 속도, 낮은 동작 전압 등 다양한 장점을 지니고 있어 차세대 메모리로 주목 받고 있다. 최근 상변화 메모리의 동작 전류를 감소시키기 위해 상변화 물질 및 전극 물질에 대한 연구를 진행하고 있으며, 소자의 크기를 최소화 하기 위한 연구가 진행되고 있다. 본 연구에서는 나노 임프린트 리소그래피와 전도성 AFM을 이용하여 나노급 상변화 물질의 특성을 평가하였다. 나노급 상변화 물질을 형성하기 위해 열경화성 나노 임프린트 리소그래피를 이용하여 $Ge_2Sb_2Te_5$(GST)/Mo/SiO2 기판 위에 200nm급 홀 패턴을 형성하였다. 홀 패턴에 Cr을 증착하여 리프트 오프 한 뒤 Cr을 하드 마스크로 사용하여 GST를 식각하였다. 그 결과, Mo 하부 전극 위에200nm 지름과 100nm 높이를 가지는 GST 나노 기둥을 형성하였다. GST 나노 기둥의 전기적 특성 평가를 위해 저항 측정 장비 및 펄스 발생기와AFM을 사용하였다. AFM은 접촉 모드로 설정하였으며, Pt가 코팅된 AFM tip을 사용하여 Cr 하드 마스크와 함께 상부 전극으로 사용하였다. GST 나노 기둥을 초기화 시키기 위해 I-V sweep을 하였으며, 그 결과 $1M\Omega$에서 $10\;k\Omega$으로 저항이 변화함을 확인하였다. GST 나노 기둥은 2V, 5ns의 리셋 펄스에서 비정질로 변화하였으며, 1.3V, 150ns의 셋 펄스에서 결정질로 변화하였다. 이 동작 전압으로 5번의 스위칭 특성을 평가하였으며, 이 결과는 소자 형태의 200nm 급GST의 특성과 유사하여 나노급 상변화 물질을 테스트하는 새로운 방법으로 사용될 수 있을 것이다.