시스템 연결에 사용되는 프로토콜이 고속, 직렬화 됨에 따라 CDR이 내장된 SERDES 칩의 사용이 늘어나고 있다. 이에 Xilinx 나 Altera 사 등 FPGA 업체들이 SERDES를 FPGA 내장시킨 제품을 출시하기 시작하였다. 이러한 SERDES 임베디드 FPGA는 PCB 설계의 단순화와 신호무결성의 큰 이점이 있다. 본 고에서는 Altera 사의 SERDES 임베디드 FPGA, Stratix-GX 디바이스의 기가비트 트랜시버 ALTGXB 블록의 테스트에 관해 살펴본다.
본 연구에서는 4차 산업기술에 대한 소비자들의 인지 정도를 살펴보고 이러한 기술들이 향후 인간의 삶에 미칠 위험에 대해 어떻게 지각하는지를 탐색하고자 한다. 즉, 4차 산업기술로 대표되는 5G, 블록체인, 인공지능, 10기가 인터넷, 증강현실·가상현실, 사물인터넷, 양자 컴퓨팅 등이 인간의 삶을 이롭게 할 것이라 믿는지에 대한 의문에서 출발한다. 분석결과, 7가지 신기술 중 10기가 인터넷과 양자 컴퓨팅을 제외한 5G, 블록체인, 인공지능, 증강현실·가상현실, 사물인터넷 등에 대한 소비자들의 인지 정도가 높을수록 해당 기술의 위험지각은 낮아지는 것으로 나타났다. 본 연구는 4차 산업기술이 우리의 소비생활에 보다 잘 융화될 수 있도록 하는 정책적 단초를 제공할 것으로 기대된다.
Great number of ships has been built by Korean Shipyards since early of 2,000 due to the expanding worldwide trade. Most of shipyards have enlarged the weight of erection block and many blocks have been assembled in block fabrication factories outside the shipyards to reduce the shipbuilding period. Especially, Giga blocks that exceed 2,000 tons are often assembled by the block fabrication factories outside the shipyard. Generally, the blocks are transported to building dock in shipyard by towing barges. Accident can be occurred during the sea transportation and it may bring about not only the delay of delivery but also a disaster on the ocean environments. Transportation condition of GPE (Grand Pre-Erection) block differs from the ocean going conditions of marine vessels. Special consideration should be included before transportation work in order to guarantee the safety of GPE blocks and barge carriers. In this paper, several examples, which have been investigated to set up the safety standard of transportation of the GPE blocks on coastal routes, are introduced. For the barge transportation on coastal sea route, the design criteria are discussed, considering the design wave, the acceleration induced by wave, structural strength, and the fixture condition of blocks.
60GHz 멀티-기가비트 WPAN 시스템을 위한 고속 QC-LDPC 복호기의 구조를 제안한다. 제안한 QC-LDPC 복호기 설계를 위하여 4 블록-병렬 계층 복호 기술과 fixed wire network 기술이 적용 되었다. 2단 파이프라이닝과 4 블록-병렬 계층 복호기술은 동작 주파수와 데이터 처리량을 개선시키는데에 큰 효과가 있다. 또한 본 제안한 복호기 구조에서 스위치 네트워크를 구현하여 위하여 fixed wire network로 간단하게 구현될 수 있으면 하드웨어 복잡도를 크게 감소시킬 수 있다. 제안한 672-비트, rate-1/2인 QC-LDPC 복호기 구조는 90-nm CMOS 표준 셀을 이용해 설계 및 합성하였다. 성능 분석 결과 제안한 QC-LDPC 복호기 구조는 794K 게이트를 가지며 클락 속도 290MHz 에서 작동한다. 12-iteration일 때 데이터 처리율은 3.9 Gbps 이며 60GHz WPAN 시스템에 적용되어 사용 될 수 있다.
iSCSI(Internet Small Computer Systems Interface)프로토콜은 TCP/IP 네트워크를 통해 블록 중심형 스토리지 데이터에 접근을 가능하게 하는 SCSI 전송프로토콜이다. iSCSI는 서버에서 스토리지장치로의 데이터 전송을 위해 표준 이더넷 스위치와 라우터를 사용하며, 또한 기존의 IP 네트워크를 사용하여 SAN 의 확장이 가능하다. 본 논문에서는 이러한 iSCSI 를 사용하여 여러가지 다른 환경에서 iSCSI 프로토콜의 성능을 분석한다. 첫째는 스토리지 장치에 따른 iSCSI 의 성능변화와 둘째는 현재의 네트웍 망에서의 변화이다. 이더넷에서 스토리지 데이터를 액세스하는데 있어서 시급했던 문제중에 하나는 충분한 대역폭과 낮은 지연율을 제공하는 것이었다. 최근의 이더넷 기술의 발전은 IP 네트워크를 통해 스토리지 장치를 액세스하는 것이 가능해졌으며 백본망을 비롯한 기가비트 이더넷이 활성화된 오늘날의 네트워크 망에서 iSCSI를 이용한 스토리지 서비스가 활성화 될 것이다. 본 논문에서는 iSCSI의 기반이 되는 IP네트워크에서의 iSCSI의 성능을 분석한 내용을 기술한다.
본 논문은 FPGA 임베디드 기가비트 트랜시버의 테스트에 관한 방법과 측정 결과를 다룬다. 실험에 사용한 디바이스는 Altera 사의 Stratix GX 디바이스로 범용 고속 프로토콜을 지원하는 트랜시버(GXB)이다. 본 논문은 차세대 IO 버스로 대두되는 PCI Express 직렬 프로토콜을 GXB에 구현하였다. PCI Express 규격에 맞게 생성된 GXB 모듈은 타이밍 시뮬레이션을 거쳐 하드웨어 구현과 테스트를 수행하였다. 트랜시버 테스트 방법으로 GXB 내부 블록 테스트, GXB 신호 무결성 테스트, GXB 입출력 버퍼 및 온칩 터미네이션 테스트, GXB 프로토콜 테스트의 네 가지 검증 절차를 거쳤다. 본 논문을 통해 FPGA 임베디드 트랜시버의 설계방법과 테스트 절차, 측정 결과를 제시한다.
최근 디스플레이 기기의 발전과 기가 네트워크 등의 전송 대역폭 확대로 인해 대형 파노라마 영상, 4K Ultra High-Definition 방송, Ultra-Wide Viewing 영상 등 2K 이상의 초고해상도 영상의 수요가 폭발적으로 증가하고 있다. 이러한 초고해상도 영상은 데이터양이 매우 많기 때문에 부호화 효율이 가장 높은 High Efficiency Video Coding(HEVC) 비디오 부호화 표준을 사용하는 추세이다. HEVC는 가장 최신의 비디오 부호화 표준으로 다양한 부호화 툴을 이용하여 높은 부호화 효율을 제공하지만 복잡도 또한 이전 부호화 표준과 비교하여 매우 높다. 특히 초고해상도 영상을 HEVC 복호기로 실시간 복호화 하는 것은 매우 높은 복잡도를 요구한다. 따라서 본 논문에서는 고해상도 및 초고해상도 영상에 대한 HEVC 복호기의 복호화 속도를 개선시키고자 HEVC에서 지원하는 슬라이스(Slice)와 타일(Tile) 부호화 툴을 사용하여 각 슬라이스 혹은 타일을 동시에 처리하며 디블록킹 필터 과정에서도 소정의 블록 크기만큼 동시에 처리하는 데이터-레벨 병렬 처리 방법을 소개한다. 이는 독립 복호화가 가능한 타일, 슬라이스, 혹은 디블록킹 필터에서 동일 연산을 다중 스레드에 분배하는 방법으로 복호화 속도를 향상 시킬 수 있다. 실험에서 제안 방법이 HEVC 참조 소프트웨어 대비 4K 영상에 대해 최대 2.0배의 복호화 속도 개선을 얻을 수 있음을 보인다.
고속 네트워크 장비에 네트워크프로세서의 사용이 보편화되고 라우팅 기능과 패컷처리 기능을 분리하는 분산형 시스템 구조가 이용됨에 따라 대용량의 트래픽을 매우 빠르게 처리하는 향상된 성능을 보일 수 있으나, 제어평면과 데이터 평면 사이에 추가 메시지 교환이 필요하여 시스템 내부 통신 지연이 증가하는 문제가 발생한다. 본 논문에서 제안한 구조는 이더넷 프로텍션 스위칭 기술에 필요한 패킷 처리 기능 블록들을 효율적으로 배치하여 설계함으로써, 메시지 교환에 따른 지연의 증가에도 불구하고 단일 링크의 장애 발생 시 50 msec급 수준의 빠른 절체 성능을 보인다. 이에 따라 높은 신뢰성과 수십 기가비트의 광대역 전송이 요구되는 캐리어 이더넷 시스템에 적합한 선형 프로텍션 스위칭 기술의 설계 및 구현 방안을 제공할 수 있다.
플래시 메모리는 휴대폰과 PDA 와 같은 이동 기기에서 저장 장치로 널리 사용되고 있다. 또한 기가바이트(GB) 단위의 대용량화로 인해 노트북과 개인용 컴퓨터에서 보조기억장치로 사용되고 있다. 요즘에는 대용량의 데이터를 효율적으로 다루기 위한 B+트리와 같은 자료구조를 플래시 메모리상에서 저비용의로 구현하려는 연구들이 이루어지고 있다. 지금까지의 연구에서는 플래시 메모리에서 B+트리를 구축할 때 노드 크기를 플래시 메모리의 섹터(sector) 크기로 사용해왔다. 본 논문에서는 노드 크기가 플래시 메모리의 섹터 크기보다 더 커졌을 경우, 플래시 메모리에서 구현되는 B+트리의 구축성능과 검색성능 그리고 저장 공간 사용량을 비교 분석한다. 키 삽입 시 정렬 알고리즘과 비정렬 알고리즘을 각각 사용해 구축비용을 측정하였으며 효율적인 노드 검색을 위해 인덱스 노드 헤드 구조를 사용한다. 그리고 이러한 실험결과는 B+트리 노드 크기를 섹터 크기보다 블록 크기로 할당할 때 B+트리 성능의 우수성을 보인다.
본 연구에서는 병렬 연결된 해상 크레인을 이용하여 5,000ton 이상의 기가 블록급 대형 중량물을 인양할 때 해상 크레인과 대형 중량물 사이에 연결된 와이어 로프에 작용하는 장력을 계산하기 위해 다물체계 동역학 시뮬레이션을 수행하였다. 이를 위해, 해상 크레인, 바지선, 대형 중량물은 각각 6 자유도 운동을 하고, 이들 사이에는 서로간의 구속에 의한 연성을 가지도록 모델링 하였다. 또한 해상 크레인 및 바지선에 작용하는 외력으로 유체 정역학 힘과 유체 동역학 힘을 고려하였고, 각각의 물체에 독립적으로 작용한다고 가정하였다. 본 시뮬레이션 결과, 향후 해상크레인을 병렬 연결하여 대형 중량물을 인양하는 공법의 안정성을 확인하고 공학적인 지침을 마련할 수 있는 근간이 될 수 있으리라 예상한다.
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[게시일 2004년 10월 1일]
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