서지환경이 링크드 데이터, 시맨틱웹 기반으로 전환됨에 따라 국내에서도 RDA를 기반으로 한 KCR5 개정 작업을 진행 중에 있다. 변화하는 서지환경에서도 전거형 접근점은 자원의 식별 및 자원 간의 연계에 중요한 역할을 하고 있으나, KCR5가 준용하는 원본 RDA는 모든 개체에 대한 전거형 접근점이 마련되지 않은 상황이다. 이에 본 연구에서는 RDA 2020의 구현형의 전거형 접근점 분석을 토대로 국내 서지환경 및 원본 RDA에 적용 가능한 구현형의 전거형 접근점의 속성을 선정하고 연계 구조를 제안하였다. 구현형의 전거형 접근점은 지적 측면과 물리적 측면을 모두 고려한 접근점으로, 실제 자원의 연계와 식별이 더욱 원활해지는 토대를 마련할 수 있다. 또한 국내 서지환경에 적합한 구현형의 전거레코드 연계 구조 구성은 향후 구현형의 전거형 접근점의 실제적인 적용에 도움이 될 것으로 기대된다.
최근에는 전문가의 지식과 경험정보가 데이터베이스로 구축된 전문가 시스템의 정보를 이용하여 처리된 결과를 판단하여 안전하고 효율적인 선박운항이 가능하도록 한 지능형 선박에 관한 연구가 활발하게 진행되고 있다. 본 논문에서는 지능형 선박을 구현하기 위한 연구의 일환으로써, 선박의 조타기를 제어하기 위한 지능형 조타 조작 모델을 구현한다. 지능형 시스템을 구현하기 위해서 자연언어를 사용하는 인간의 학습 방법에 기초한 언어지시기반학습(LIBL)기법을 적용하고. 퍼지이론을 이용하여 승선경력이 풍부한 조타수의 경험을 조사 및 분석하여 그 결과를 바탕으로 퍼지 추론에 의해 타각을 제어하기 위한 퍼지 조타 조작 모델을 구현하여 그 효용성을 살펴보았다.
본 논문에서는 컴퓨터 시스템에서 정보보호를 위해 가장 많이 사용하고 있는 DES(Data Encryption Standard)암호알고리즘을 시스템 설계 기술언어인 VHDL(Vhsic Hardware Description Language)로 설계하고 이것을 칩으로 합성하여 하드웨어에서 차지하는 면적과 속도를 비교 분석하였다. 설계방법에 있어서는 구현하는 방법에 따라 전 라운드 구현형, S-box 공유형 그리고 단일 라운드 반복형 범용성을 갖도록 하여 FPGA로 구현한다. 본 논문에서 구현한 단일 라운드 반복형 설계는 Synopsys의 EDA 툴을 이용하여 시뮬레이션 및 합성을 하였고, Xilinx사의 xdm을 이용하여 XC4052XL 칩에 구현하였다. 그 결과 입력 클록 50MHz상에서 100Mbps의 암,복호화 속도를 갖는 범용성 암호칩을 설계 및 구현한다.
본 논문에서는 PC 기반 지상파 DMB(Terrestrial Digital Multimedia Broadcasting, T-DMB) 수신기를 위한 대화형 방송 수신 SW 구현에 대해 설명한다. T-DMB 표준에 의하면, MPEG-4 BIFS(Binary Format for Scene)를 옵션으로 사용한 수 있게 되어 있는데, 이를 이용하면, 여러 가지 형태의 대화형 방송 기능을 실현할 수 있다. 본 논문에서는 이러한 BIFS 데이터가 포함된 비트스트림을 수신하여 이를 복호한 후, 화면에 동영상과 함께 디스플레이 하는 대화형 방송 수신 기능을 구현하였다. 또한 이를 활용하여 쉽게 구현할 수 있는, 화면상의 클릭 가능한 객체, 즉 "핫 스팟(hot-spot)"을 이용한 대화형 방송 시나리오와 예제 구현에 대해 설명한다.
연구는 FRBR과 FRAD 모형, ICP, RDA, NCR 개정안의 분석 결과를 토대로 KCR4 개정판의 구성 방안을 다음과 같이 제시하였다. 1) 개체는 저작, 표현형, 구현형, 개별자료, 개인, 가족, 단체, 개념, 대상, 사건, 장소로 구분한다. 2) 규칙 전체는 '속성'과 '관계'로 대별하며 '속성'은 다시 속성 기술과 접근점 구축으로 구분한다. 3) 속성 기술은 1집단 개체는 저작, 표현형, 구현형, 개별자료의 순으로, 2집단 개체는 개인, 가족, 단체의 순으로 배열한다. 4) 접근점 구축은 저작과 표현형의 접근점 구축, 개인, 가족, 단체의 접근점 구축 순으로 배열한다. 5) '관계'는 저작, 표현형, 구현형, 개별자료 간의 기타 관계와 개인, 가족, 단체 간의 관계에 대한 규칙을 둔다.
내장형 시스템에서 XML 데이터의 역할과 데이터베이스의 지원이 중요해지면서, 내장형 XML DBMS에 대한 연구가 활발해지고 있다. 버클리 DB는 SleepyCat에서 개발한 것으로 내장형 데이터베이스를 구현하는데 적합한 데이터베이스 시스템이다. XML은 메모리에서 DOM 트리로 구성되어, DOM API를 통해서 조작될 수 있다. 본 논문에서는 내장형 시스템의 부족한 리소스를 고려하여DOM 트리를 메모리가 아닌 데이터베이스에 구성하는 시스템을 구현하고, 이를 확장하여 내장형 XML DBMS로 발전시킬 수 있는 방안을 검토해 보고자 한다.
내장형 시스템은 산업 전반에 다양한 방법으로 응용되고 있다. 하지만 항공 분야나 원자력 분야의 내장형 시스템은 안정성과 신뢰성이 절대적으로 보장되어야 하는 시스템으로 피 설계부터 구현에 이르기까지 다양한 방법으로 검사되고 검증되어야 한다. 본 논문에서는 내장형 시스템의 통합설계를 위한 기반으로 하드웨어 설계 언어인 Verilog를 입력 언어로 받아들여 이를 정형검증 도구인 VIS를 통하여 검증한 다음 이를 바로 구현하는 방법론 및 예를 보이고자 한다. 이러한 방법을 통해 내장형 시스템의 안정성과 신뢰성의 수준을 향상시키고자 한다.
본 논문은 지능형 Gadget 시스템의 개발환경 구현에 관한 논문이다. 지능형 Gadget 시스템에서 사용된 임베디드시스템 응용 프로그램과 리눅스 커널의 구조 및 동작에 대해 논하고 지능형 Gadget 시스템에 필요한 기능 및 구성 요소에 대해 조사 및 분석을 통한 리눅스 커널과의 동작 및 기능 검증 구현을 보인다. 새로운 지능형 임베디드 시스템의 하나인 Gadget 시스템에 적용 가능하도록 요구되는 기능과 동작을 구현하고 새로운 소형 운영 체제를 위한 개발에 적용 가능하다. 그러한 소형 운영체제는 지능형 개인정보서비스를 위한 임베디드 Gadget 시스템으로써 지능형 정보화 기능을 지원하고 새로운 소형 운영 체제를 탑재한 시스템의 개발에 적용 가능하다. 본 논문에서는 그러한 지능형 임베디드 Gadget 시스템과 응용 개발을 위한 개발환경 구현에 대하여 기술한다.
디지털 신호처리 알고리즘의 구현은 속도나 메모리의 사용측면에서 고정 소수점 구현이 필요하다. 특히, 정수형 연산 프로세서에서는 소프트웨어에 의한 부동 소수점보다는 고정 소수점 구현이 훨씬 성능이 뛰어나다. 디지털 신호처리 알고리즘의 복잡함과 일반 프로세서의 처리능력의 부족으로 이제까지는 신호처리 알고리즘의 실시간 구현을 위하여 대개 전용 프로세서나 디지털 신호처리를 위한 전용 명령어가 하드웨어적으로 구현되어 있는 프로세서를 사용하여 왔다. 하지만 현재 범용 프로세서의 주파수 속도가 빨라짐에 따라 복잡한 디지털 신호처리 알고리즘을 실시간에 처리할 수 있게 되었다. 하지만 정수형 연산 프로세서에서의 부동 소수점 연산은 프로세서에서 실시간 처리에 많은 어려움을 주게 된다. 본 연구에서는 데이터 타입이 고정된 범용 정수형 연산 프로세서(ARM RISC 32bit CPU)를 가지고 부동 소수점 연산 알고리즘을 고정 소수점 연산형으로 바꾸어서 속도측면과 메모리 측면의 성능을 비교해 보았다.
본 논문에서는 인텔사의 StrongARM 프로세서에 내장형 리눅스 운영 시스템을 실장하여 내장형 웹 서버를 구현하고 ARM프로세서에 연결된 병렬포트의 입 출력을 HTTP 프로토콜을 이용하여 범용 웹 브라우저에 의하여 제어하는 초소형 웹 서버 시스템을 구현함을 다루었다. 이를 위하여 리눅스 운영 시스템의 HTTP를 실장하고 CGI에 의한 병렬포트 제어 프로그램을 구현하여 프로세서 보드의 메모리에 실장한다. 프로세서의 병렬포트에 입 출력을 제어하는 하드웨어 기능을 웹 서버와 브라우저를 이용하여 원격에서 제어할 수 있도록 구현하고 실험을 통하여 내장형 웹 서버의 구현을 보였다.
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[게시일 2004년 10월 1일]
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