This study presents the recursive constraint bounding(RCB) method to reduce the cycle time in internal cylindrical plunge grinding process. This method can cope with process noise as well as modeling bias. The main features of RCB method are its utilization of measurements at the end of each cycle and its use of monotonicity analysis for determining the extremes of bias and noise. This method is investigated in simulation and evaluated by experiment in internal cylindrical plunge grinding operation. The results from simulation and experiment show that it is effective in reducing cycle time in spite of modeling uncertainty in the forms of process noise and modeling bias.
이 논문은 영상처리기법을 이용하여 자동차 엔진 조림공정에 대한 통합적인 자동검사시스템의 개발에 관한 연구이다. 본 시스템은 머신비전에 의한 검사데이터를 통계적 공정관리시스템으로 직접 입력이 가능하며, 이러한 특성은 품질 이상이나 공정에 문제가 발생하였을 때 즉각적인 수정 조치가 가능한 기술이다. 검사부분에 대한 영상처리는 PC 내부에 설치되어 있는 IVP-150 머신비전 보드에 의하여 이루어지며, 품질요소를 정확히 확인하기 위해 템플리트 매칭 기술이 적용되었다. 본 시스템을 생산현장에 적용한 결과, 잡음이나 영상의 삐뚤어짐 흑은 방향성 등의 문제에도 적응력이 강함이 입증되었다.
본 연구를 통해서 정전용량 방식의 이차원 마이크로볼로미터를 위한 저잡음 신호취득 회로를 연구하였다. 잡음 대역폭이 매우 낮고 픽셀 면적이 작기 때문에 비 적분형 방식의 간단하고 효과적인 픽셀 단위의 회로를 사용했다. 또한, 가장 문제가 되는 kT/C 잡음을 줄이고 전력소모를 낮추기 위해 새로운 CDS 방식을 열 단위의 회로에 사용했다. 제안하는 회로는 $0.35-{\mu}m$ 2-poly 4-metal CMOS 공정을 이용하여 설계했고, 마이크로볼로미터의 픽셀 크기는 $50{\mu}m{\times}50{\mu}m$이다. 제안하는 신호취득회로는 볼로미터의 kT/C 잡음 등을 포함한 저주파 잡음을 효과적으로 제거하며, 제작된 칩에 대한 잡음 측정을 통하여 이를 검증하였다. 제안하는 회로는 간단한 신호취득 회로에 비해 그 잡음을 30 %에서 55 % 이하까지 개선할 수 있으며, 전체 감지시스템의 잡음등가온도차(NETD)를 21.5 mK 정도로 낮출 수 있다.
30dB의 선형이득과 2.6dB의 잡음지수 성능을 갖는 위성통신중계기용 30GHz대 저잡음증폭기 모듈이 MMIC와 박막 MIC기술로 개발되었다. 두 종의 MMIC 회로가 저잡음증폭기 모듈에 사용되었는데, 하나는 초저잡음용 MMIC 회로이고, 다른 하나는 광대역 고이득용 MMIC 회로이다. MMIC 회로 제작에 사용된 증폭소자는 0.15$mu extrm{m}$게이트 길이를 갖는 pHEMT이다. 두 개의 MMIC 회로를 상호 연결하고 저잡음증폭기 모듈을 완성하기 위하여 박막기술을 이용하여 마이크로스트립 선로를 구현하였으며, 안정된 DC 전원 공급을 위하여 후막기술을 이용한 바이어스 회로를 개발하였다. 저잡음증폭기 모듈의 입력측은 위성중계기의 안테나로부터의 신호를 받아들이기 위하여 도파관 형태로 설계되었으며, 출력측은 주파수변환부와의 접속을 위하여 K-컨넥터로 구현되었다. 모든 제작 공정에는 실제 위성용 부품 제작 기술이 도입되었으며, 위성중계기에 탑재되는 부품에 요구되는 온도시험 및 진동시험을 실시하였다. 제작된 저잡음증폭기 모듈은 동작목표 대역인 30~31GHz에서 30dB 이상의 이득, $\pm$0.3dB의 이득평탄도, 그리고 2.6dB이하의 우수한 잡음지수를 가진 것으로 측정되었다.
본 논문에서는 130nm 이하의 초미세 공정을 위한 저전력 32비트$\times$32비트 곱셈기를 제안한다. 공정이 미세화 되어감에 따라 누설 전류에 의한 정적 전력이 급격하게 증가하여 동적 전력에 비해 무시하지 못할 수준에까지 이르게 된다. 최근 들어 동적 전력과 정적 전력을 동시에 줄일 수 있는 방법으로 MTCMOS에 기반하는 전원 차단 방법이 널리 쓰이고 있지만, 대규모 블록의 전원이 복귀될 때 심각한 전원 잡음이 발생하는 단점이 있다. 따라서 제안하는 곱셈기는 파이프라인 스테이지를 따라 순차적으로 전원을 차단하고 복귀함으로 전원 잡음을 완화시킨다. $0.35{\mu}m$ 공정에서 칩 제작 후 측정하고 130nm 및 90m 공정에서 게이트-트랜지션 수준 모의실험을 실시한 결과 유휴 상태에서의 전력 소모는 $0.35{\mu}m$, 130nm 및 90nm 공정에서 각각 $66{\mu}W,\;13{\mu}W,\;6{\mu}W$이었으며 동작 시 전력 소모의 $0.04\sim0.08%$에 불과하였다. 기존의 클록 게이팅 기법은 공정이 미세화되어감에 따라 전력 감소 효율이 떨어지지만 제안하는 곱셈기에서는 이러한 문제점이 발생하지 않았다.
섬유금속적층판은 우수한 피로특성, 내부식성, 충격저항 등으로 인하여 항공우주산업에서 널리 사용되고 있다. 본 논문에서는 다구찌 기법을 사용하여 섬유금속적층판의 내부 에너지 해방률을 향상시킬 수 있는 공정 조건을 도출하는 절차에 대해 실험적 연구가 수행되었다. 내부 접착력 향상을 위한 제조공정을 도출하기 위해서, 표면처리, 접착필름의 용융점 유지시간 및 초기 압력이 서로 다르다는 조건하에서 제작한 시편들에 대해서 Double cantilever beam과 End-notched flexure 시험을 수행하였다. 시험으로부터 모드 I과 모드 II의 에너지 해방률을 측정한 후, 다구찌 기법의 망대특성에 의한 신호 잡음비를 비교하여 효율적인 제조공정을 도출하였다.
본 논문에서는 비트라인간의 커플링 캐패시터에 의해서 발생하는 커플링 노이즈를 최소화 한 비트 라인구조를 제시하였다. DRAM의 비트 라인간에는 반드시 커플링 캐패시터가 존재한다. 서브마이크론 공정에서는 비트 라인간의 간격이 줄어듦으로써 비트 라인간의 커플링 캐패시터는 증가하게 되고 이 커플링 캐패시터에 의해서 크로스 토크잡음이 급격히 증가한다. 본 논문에서는 비트라인간의 크로스 토크잡음을 줄이기 위해 인접한 비트 라인에 사용하는 금속배선의 층을 서로 다르게 함으로써 비트라인간의 캐패시터를 줄인 새로운 비트 라인구조를 제안하고 검증한다.
본 논문에서는 DVB-T 표준안의 모든 동작모드를 지원하며 임펄스 잡음 제거, 안테나 diversity 수신, 향상된 채널추정방법을 적용한 유럽향 디지털 TV 수신용 채널 칩셋의 설계에 관한 내용이다. 설계된 칩은 여러 개의 구성 블럭으로 구성되어있는데 여기에는 여러 가지의 향상된 알고리즘과 설계 아키텍쳐가 사용되었다. 가정용 가전기기들이 발생시키는 일정주기의 임펄스 잡음을 제거하기 위하여 임펄스 잡음 제거 블록을 AGC뒤에 사용하였다. 동기부는 대략적 주파수동기, 미세 주파수동기, 대략적 타이밍동기, 미세 타이밍 동기 등으로 이루어져 있으며 본 설계의 주파수 보상 영역은 $\pm$280Khz, 타이밍 보상 영역은 $\pm$500ppm이다. 파일럿 신호를 이용하여 채널추정과 보상을 수행하며 기존의 선형 보간기법과 함께 4개의 파일럿 신호를 이용한 보간기법을 사용하여 이동수신환경에 대응할 수 있도록 하였다. 이와 함에 수신성능을 개선할 수 있다고 알려진 안테나 diversity 기능을 채용하여 고정 및 이동 수신시의 수신성능을 향상시켰다. 안테나 diversity를 위해서 2개 이상의 수신 칩이 사용되며 이를 위해서 본 설계에서는 MRC(Maximum Ratio Combining)알고리즘을 사용하였다 본 설계는 5층 메탈 0.18um 공정을 사용하였으며 2.7Mbit 의 메모리 소자를 포함하여 대략 300 만 게이트의 회로크기를 갖으며 100 핀 PQFP로 제작되었다. 본 논문에서는 설계된 회로의 각 블록별 기능에 대한 설명과 함께 시뮬레이션 결과와 ASIC설계결과를 기술하였다.
본 논문에서는 고주파 영역에서의 전원잡음제거 (PSR) 특성이 개선된 low drop-out (LDO) 레귤레이터를 제안한다. 특히, PMOS 전력 스위치의 유한한 출력저항을 관통하는 고주파 전원잡음을 상쇄하기 위해 출력저항이 큰 NMOS 트랜지스터를 보상 회로로 추가하였다. 보상 트랜지스터에 의한 전원잡음제거는 해석적으로 설명하여 개선에 대한 방향을 제시하였다. $0.35{\mu}m$ 표준 CMOS 공정으로 회로를 제작하고 Spectre 시뮬레이션을 수행하여 10MHz에서 기존의 LDO 레귤레이터 대비 26dB의 PSR 개선을 확인하였다.
생산 공정의 다변량 데이터에 기반한 지능적 공정 감시 및 진단 시스템은 조업의 안정성과 고품질의 제품을 달성하고 경쟁력을 유지하기 위해서는 필수적인 업무 중 하나로 간주되고 있는데, 이와 같은 추세는 공정 이상이 발생하는 경우 안정적이고 경제적인 조업에 큰 영향을 미치는 것에 기인한다. 본 연구에서는 다변량 공정 데이터에 기반한 진단기법을 제시하고 이를 시뮬레이션 공정 데이터를 활용하여 그 성능을 평가하고자 한다. 또한 원 데이터의 전처리 과정의 유무와 비선형 방법론의 활용이 진단 성능에 마치는 영향을 시뮬레이션 공정에서 제시된 15개의 공정 이상에 대해 평가하였다. 그 결과 제안된 방법론이 신뢰할 만한 결과를 주었으며 다른 비교 방법론인 전처리 과정이 없거나 선형 방법론을 사용한 타 방법론 대비 우월한 성능을 보여주었다. 제시된 방법론은 공정 데이터에 기반한 방법론으로서 공정에 대한 수학적 모델이나 지식 모델에 비하여 상대적으로 모델링이 간편하며 공정 데이터의 잡음에 강건하다는 장점을 가진다.
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[게시일 2004년 10월 1일]
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