• The Transactions of the Korea Information Processing Society
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• v.5 no.1
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• pp.249-257
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• 1998

다층 인쇄회로기판에서 고속 신호를 정확하고 신속하게 배선 설계하려면, 물리적 설계 규칙과 신호 잡음을 고려한 전기적 설계 규칙을 정립하고, 적용할 신호 검증 도구를 사용하여 신호의 충실성을 검증하여야 한다. 본 논문은 현재 개발 제작되어 동작 중에 있는 HIPSS(High Performance Storage System)보드에 대한 전기적 설계 규칙과 고속 신호의 배선에 따른 일부 고속 신호의 신호 검증 방법을 설명한다. 또한 전기적 설계 규칙을 적용하여 인쇄회로기판을 설계하는 경우, 발생하는 신호 지연, 반사 그리고 누화 등의 신호 잡음을 검증 도구를 이용하여 시뮬레이션 하고, 분석한 결과를 보이며, 수정된 고속 신호의 배선 설계를 확인한다.

• Proceedings of the Korea Information Processing Society Conference
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• 2009.11a
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• pp.401-402
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• 2009

4-2 compressor는 곱셈기의 부분 곱 합 트리(partial product summation tree)의 기본적인 구성요소이다. 본 논문은 고속 연산이 가능한 4-2 compressor 구조를 제안한다. 제안한 회로는 최적화된 XORXNOR와 MUX로 구성하였다. 이 회로는 기존의 회로와 비교하였을 때 회로 구성에 필요한 트랜지스터수가 12개 감소하였으며, 지연시간이 32.2% 감소하였다. 제안한 회로는 Samsung 0.18um CMOS 공정을 이용하여 HSPICE로 시뮬레이션 하였다.

• Proceedings of the KIPE Conference
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• 2005.07a
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• pp.424-426
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• 2005

운전 속도 영역이 넓은 응용분야에서 극수가 많은 전동기를 설계하는 경우, 고속 운전 영역에서는 동기 좌표계 회전 주파수가 샘플링 및 스위칭 주파수에 가까워진다. 이 경우 하위 전류 제어 회로(inner current control loop)가 불안정해지면서 전류가 발산하는 현상이 발생한다. 본 논문에서는 전동기의 고속 운전 영역에서 하위전류 제어 회로가 불안정해지는 이유를 분석하고, 기존에 쓰이던 전류 제어기의 구조를 개선하여 고속에서도 전류 제어를 안정화시키는 방법을 제안한다.

• Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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• 2010.10a
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• pp.274-277
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• 2010

본 논문에서는 다층 퍼셉트론 신경회로망을 사용하여 각 프레임에서 유성음, 무성음, 그리고 묵음 구간을 검출하는 구간검출 알고리즘을 제안한다. 신경회로망의 입력으로는 고속 푸리에변환에 의한 전력스펙트럼 및 고속 푸리에변환 계수가 사용되어 네트워크가 학습된다. 본 실험에서는 원 음성에 백색잡음이 중첩된 음성을 신경회로망에 입력함으로서 각 프레임에서의 유성음, 무성음, 묵음 구간의 검출성능 결과를 나타낸다.

• 전기의세계
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• v.10
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• pp.62-71
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• 1963

공업계측분야에 대한 계수기술은 최근획기적인 발전을 거두고있다. 계수화된 계측기는 측정정도에 있어서 개인차나 오산이 없으므로 과거의 눈금식의 계측방식은 이로 대치되어 갈것인데 그 계측 가능한 속도에 있어서 종래의 진공관보다 Transistor식이 되면 훨씬 고속도까지도 계수가 쉽게 되고 장치 및 계수표시용소비전력도 개량되어가고 있다. 이러한것이 되므로서 높은 주파수측정, 짧은 시간측정은 물론이고 전기적인 진폭의 크기를 Analog to Digital 변환기로서 정밀도가 높은 계측을 가능하게 하고 특히 방사능 측정에 있어서 종래의것보다 더 고속화되므로서 방사능의 완전한 성질을 파악할 수 있을 것이다. 그것은 1Cure의 방사능이 3.7*$10^{10}$dps의 붕괴수를 갖고 있으나 현재는 약 2.8*$10^{7}$ cps정도의 계측이 가능할 따름이다. 따라서 계측속도를 더 향상시키므로서 강한 방사능계측도 가능하게 된다. 이러한 고속계수문제의 해결을 하기 위하여 Transistor회로로서 두가지면으로 추구되고 있다. 그 하나는 고속도용 Transistor자체의 개발이며 또하나는 회로적인 개량연구이다. 여기서는 후자에 관해서만 생각하고, 거기에 적합한 Transistor를 얻었을때의 설계기준과 기본적인 실험결과에 관해서 논하기로 한다.

• Journal of the Korea Institute of Information and Communication Engineering
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• v.21 no.5
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• pp.885-892
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• 2017

In this paper, we proposed a novel crowbar circuit for high-speed discharge charge switching to solve discharge charge-time delay of supply voltage in the conventional crowbar circuit. The proposed circuit is designed to increase the charge-speed after high-speed discharge of supply voltage, thereby reducing the time exposed to radiation damage and, the normal operation time of electronic system after passing the pulse radiation. The simulation of the discharge charge-times before the implement of the hardware is conducted using Cadence's pspice tool, and DUT (Device Under Test) board is fabricated in the device level. The comparison measurement of the crowbar circuits is performed on the satellite-electronic device for 24V. As the result, we confirmed the high-speed function of the proposed circuit by improvement of the discharge-speed 96.8% and the charge-speed 27.3% as compared with the conventional circuit.

• Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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• 2010.05a
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• pp.809-811
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• 2010

In most floating-point operations related with 3D graphic applications for mobile devices, properly approximated data calculations with reduced complexity and low power are preferable to exactly rounded floating-point operations with unnecessary preciseness with cost. Among all the sophisticated floating-point arithmetic operations, multiplication and division are the most complicated and time-consuming, and they can be transformed into addition and subtraction repectively by adopting the logarithmic conversion. In this process, the most important factor for performance is how high we can make an approximation of the logarithm conversion. In this paper, we cover the trends in studying the logarithm conversion circuit designs. We also discuss the important factor in design issues and the applicable fields in detail.

• Journal of the Institute of Electronics Engineers of Korea SD
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• v.44 no.6 s.360
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• pp.89-93
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• 2007

This paper presents the design and the implementation of input/output (I/O) interface circuits for 2.5 Gbps operation in a 3.3V 0.35um CMOS technology. Due to the differential transmission technique and low voltage swing, LVDS(low-voltage differential signaling) has been widely used for high speed transmission with low power consumption. This interface circuit is fully compatible with the LVDS standard. The LVDS proposed in this paper utilizes a telescopic amplifier. This circuit is operated up to 2.3 Gbps. The circuit has a power consumption of 25. 5mW. This circuit is designed with Samsung $0.35{\mu}m$ CMOS process. The validity and effectiveness are verified through the HSPICE simulation.

• Proceedings of the Korean Information Science Society Conference
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• 2000.04a
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• pp.21-23
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• 2000

고속 회로 합성에 있어서, Wallace 트리 스타일은 연산을 위한 가장 효율적인 수행방식의 하나로 인식되어 졌다. 그러나, 이러한 방법은 빠른 곱셈기의 수행이나 여러 가지 연산수행에 있어, 입력 시그널을 고려하지 않은 일반적인 구조로 수행되어졌다. 본 논문은 연산기에 있어서 이러한 제한점을 극복하는 문제를 다룬다. 우리는 캐리-세이브 방법을 덧셈, 뺄셈, 곱셈이 혼합되어 일T는 일반적인 연산 회로에 적용한다. 그 결과 효율적인 회로를 생성하며, 시그널들이 임의의 도달시간에 대해 회로의 도달시간을 최적화 한다. 또한, 우리는 최적 지연시간의 캐리-세이브 가산회로를 생성하는 효율적인 알고리즘을 제안하였다. 우리는 이러한 최적화 방법을 여러 고속 디지털 필터에 적용시켜 보았고 이는 기존의 비트 단위가 아닌 캐리-세이브 수행방법보다 5%에서 30%사이의 수행시간 향상을 가져왔다.

• Proceedings of the KIEE Conference
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• 2000.07d
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• pp.2551-2553
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• 2000

고속 신호처리 및 실시간 제어 분야에 적합한 제어성능을 발휘하기 위해서는 신호처리전용 마이크로프로세서인 DSP(Digital Signal Processor)를 이용한 제어용 보드가 널리 활용되고 있다. 본 연구를 통하여 전기도금용 전원장치의 고성능화를 위하여 DSP제어용 보드를 개발하였으며, 전체구성은 고속 신호처리를 위한 메인 마이크로프로세서로서 경제성과 응용범위가 넓은 TMS320C32 DSP CHIP, Wait없는 프로그램 및 데이터 처리를 위한 고속 SRAM, 외부 디지털 입출력을 위한 인터페이스 회로, 아나로그 입출력 회로 및 PC 혹은 다른 마이크로컴퓨터와의 통신을 위한 직렬 통신 회로 등으로 구성하였다. 개발된 DSP 보드는 시제품 제작을 완료하여 그 성능 및 신뢰성을 검증하였으며, 전기도금장치의 고성능 제어처리를 위하여 채용하여 상품화 개발을 완료하였다.