본 논문에서는 전원전압 0.5V의 심전도 검사기(ECG)를 설계하고 칩으로 제작하여 성능을 확인하였다. ECG는 계측 증폭기, 6차 gm-C 저역 통과 필터 그리고 가변이득증폭기로 구성되어 있다. 계측증폭기는 이득이 34.8dB, 6차 gm-C 저역 통과 필터는 400Hz의 차단주파수를 가지게 설계되었다. 저역 통과 필터의 연산 트랜스컨덕턴스 증폭기는 저전압 동작을 위하여 차동 바디 입력 방법을 사용하였다. 가변이득증폭기의 이득 범위는 6.1~26.4dB로 설계되었다. 설계된 심전도 검사기는 TSMC $0.18{\mu}m$ CMOS 공정을 이용하여 $858{\mu}m{\times}580{\mu}m$의 칩크기로 제작되었다. 측정은 입력 신호를 포화시키지 않도록 외부 연결 저항을 조절하여 이득을 낮춘 상태에서 진행한바, 중간 주파수 이득 28.7dB, 대역폭은 0.5 - 630Hz을 얻었으며, 전원전압 0.5V에서 동작함을 확인하였다.
본 논문은 뇌전도 신호 처리를 위한 아날로그 전단부를 제시한다. 일반적으로 뇌전도 신호는 낮은 주파수 대역에 존재하고 신호의 크기가 미약하므로 이를 처리하기 위한 아날로그 전단부는 높은 전압 이득 및 공통모드 제거비를 가져야 하며 저주파 잡음을 효과적으로 억제해야 한다. 본 논문에서 제시하는 아날로그 전단부는 가변 이득 계측 증폭기와 대역통과 필터로 구성되어 있다. 낮은 주파수의 잡음을 제거하기 위하여 주파수 chopping을 적용하였다. 본 논문의 회로는 0.18um CMOS 공정을 이용하여 제작하였으며 측정 결과 최대 60dB의 전압이득과 100dB 이상의 공통모드 제거비를 내는 것을 확인하였다.
본 논문에서는 INMARSAT-M형 송신기에 사용되는 L-BAND(1626.5-1646.5 MHz)용 2단 가변이득 전력 증폭기를 연구 개발하였다. 2단 가변이득 전력증폭기는 구동증폭단과 전력증폭단에 의해 고출력 모드일 때 +42 dBm, 저출력 모드일 때는 +36 dBm의 전력으로 증폭되며, 각각에 대해 상한 +1 dBm과 하한 -2 dBm의 오차를 허용한다. 제작의 간편성 때문에 전체 2단 가변이득 전력증폭기를 크게 구동증폭단과 전력증폭단 두 부분으로 나누어 구현하였으며, 전력증폭부를 구동하기 위한 구동단은 HP사의 MGA-64135와 Motorola사의 MRF-6401을 사용하였으며, 전력증폭단은 ERICSSON사의 PTE-10114와 PTF-10021을 사용하여 RF부, 온도보상회로 및 출력 조절회로를 함께 집적화 하였다. 이득조절은 구동증폭단의 MGA-64135의 바이어스 전압을 조절하는 방법을 제시하였으며, 실험 결과와 잘 일치하였다. 제작된 2단 가변이득 전력증폭기는 20 MHz대역폭 내에서 소신호 이득이 42 dB와 36 dB 이상, 입ㆍ출력 정재파비는 1.5:1 이하, 5 dBm의 $P_{1dB}$. $P_{ldB}$출력레벨에서 3 dB Back off 시켰을 때 32.5 dBc의 I $M_3$를 얻었다. 1636.5 MHz 주파수에 대해 출력전력은 43 dBm과 37 dBm으로서 설계시 목표로 했던 최대 출력전력 20 Watt를 얻었다.다.다.
본 연구에서는 방향성 결합기의 특성과 PIN다이오드의 특성을 이용하여 가변 감쇠기를 구현하였다. 기존의 Even-Odd Mode해석법이 아닌 간단한 2-port 기법으로 감쇠기를 분석하였으며, 산란 파라미터는 결합포트의 종단 임피던스가 동일한 경우와 동일하지 않은 경우에 있어서의 감쇠기의 동작특성을 평가하였다. 방향성 결합기의 결합포트는 가변종단을 HP사의 전류제어 소자인 HSMP-3864 PIN다이오드를 사용하였다. 구현된 가변감쇠기는 PCS 송신주파수 1.9 GHz에서 감쇠 범위가 30 dB 이상, 삽입손실 5 dB 이하, 입·출력 반사계수 -25 dB 이하의 특성을 나타내었으며, 이는 PCS와 셀룰러 이동통신 기지국용 전력 증폭기를 온도 등과 같은 외부의 환경변화에 따라서 이득을 가변 시킬 수 있으며, 또한 증폭기의 선형성을 향상시킬 것으로 사료된다.
본 논문에서는 통신위성시스템 탑재를 위한 Ku-Band 선형화 채널증폭기 비행모델의 설계와 제작된 결과를 고찰하였다. 정착된 모든 서브모듈, 즉 가변이득증폭기, 가변전압감쇠기, 그리고 전치왜곡 보상회로를 위한 브랜치 라인 결합기와 검출기는 Thin-Film Hybrid 작업으로 제작되었다. 제작된 모듈의 성능은 초고주파 회로분석 시뮬레이션 툴과 우주환경에서의 전기적인 성능시험을 통하여 검증하였다.
본 논문에서는 CMOS 스위치를 이용한 디지털 이득 제어 구조를 가진 이득 조절 증폭기 (PGA, Programmable Gain Amplifier)를 제안한다. 기존의 아날로그 이득 제어 방식에서는 가변적인 트랜스 컨덕턴스를 활용하는 과정에서 바이어스 전류나 전압에 의해 이득이 변하게 되어 순간적으로 구성회로의 바이어스 포인트가 변하기 때문에 왜곡이 발생하게 되는 문제점이 있다. 본 논문에서는 이러한 문제점을 해결하기 위해 기존의 gm-boosting 증폭기를 변형한 디지털 이득 제어 방식으로 설계되어 있기 때문에 우수한 선형성을 가지며 특수 목적에 맞도록 그 이득을 6dB에서 60dB까지 7가지 단계로 조절 가능하다. 제안한 PGA는 기존 회로에 비해 0.2dB 보다 작은 이득오차와 0.47mW의 낮은 소비전력 특성을 보였다.
생체 임피던스 측정에 사용되는 프론트 엔드의 입력 커패시턴스를 상쇄시키며, 편하고, 작은 이득 여유로도 안정하게 동작하는 제안된 네가티브 커패시턴스 회로를 제안하였다. 기존의 회로를 사용하기 위해서는 적절한 이득-대역폭 적을 갖는 연산 증폭기를 선택해야 하는데 비하여 제안하는 회로는 광대역 연산 증폭기를 사용하므로 연산 증폭기의 선택이 쉽다. 또한 이득 여유가 귀환 커패시터에 직렬로 연결된 귀환 저항에 의하여 조절되므로 이득 여유를 가변 저항기로 튜닝할 수 있다. 제안된 회로의 입력 임피던스는 기존회로의 임피던스보다 2배 크며 네가티브 커패시턴스 회로를 채용하지 않았을 때에 비하여 40배 크다. 나아가서 제안된 회로의 폐루프 위상 응답은 기존의 회로와 네가티브 커패시턴스 회로를 채용하지 않았을 때에 비하여 좋다. 무엇보다도 이득 피킹이 발생하더라도 제안된 회로에서 이득 피킹의 주파수는 루프 이득이 최대로 되는 주파수 보다 높으므로, 이득 여유가 이득 피킹의 영향을 거의 받지 않는다. 따라서 제안된 회로는 매우 작은 이득 여유로도 안정하게 동작할 수 있다.
본 논문은 Ku-Band 선형화 채널증폭기를 위한 비행 모델의 설계 및 측정에 관한 것이다. 모든 MMICs, 가변이득증폭기, 가변전압감쇄기, 전치왜곡 보상회로를 위한 브랜치 라인 결합기와 검출기는 Thin-Film Hybrid 작업으로 제작되었다. 제작된 모듈의 성능은 초고주파 회로분석 시뮬레이션 틀과 우주환경에서의 전기적인 성능 시험을 통하여 검증하였다.
CMOS technology 기반의 고주파 직접회로에서는 충분한 이득과 안정성을 얻기 위하여 inductor, capacitor와 같은 수동 소자를 적절히 사용하여 설계하여야 한다. 이와 같은 수동 소자는 CMOS 집적회로에서 넓은 면적을 차지하는 단점이 있다. 고주파 증폭기의 부하를 능동 소자로 대체하게 되면 작은 크기로 회로의 제작이 가능하게 되나, 능동 소자는 수동 소자에 비하여 선형 특성이 좋지 않기 때문에 실제로 고주파 증폭기 설계에 사용하지 않는다. 본 논문에서는 이와 같은 능동 소자의 비선형성을 억제하면서, 동시에 회로의 크기를 줄일 수 있는 기능성 능동 부하를 적용한 고주파 증폭기를 설계하였다. 기능성 능동 부하는 2개의 MOSFET은 대칭으로 연결된 구조를 가지며, 하나의 MOSFET은 일반적인 load로 동작하며, 다른 MOSFET은 gate에 가변 전압을 인가함으로써, 증폭기의 전달함수를 변화시킬 수 있다. 이와 같은 특성을 이용하여 고주파 증폭기의 선형성을 보상할 수가 있다.
본 논문은 디지털 능동형 가변 축전기를 사용한 적응형 이퀄라이저를 제안하고 있다. Equalizing amplifier는 주 증폭기와 source degeneration RC 필터로 구성되어 있으며, RC필터를 디지털 능동형 가변 축전기로 구현함으로써 면적 효율을 높이고 선형적인 손실 보상 영역을 확보했다. 능동형 가변 축전기는 miller effect에 의한 임피던스 증가 효과를 사용하였으며, 증폭기 이득 조정을 통해 capacitance의 가변성을 가질 수 있도록 하였다. 시뮬레이션 결과, 능동형 축전기의 선형적 가변 특성을 통해 입력 데이터의 고주파 손실을 보상하여 2Gb/s 전송속도에 대해 0.31 UI의 입력 eye 너비를 0.64 UI로 약 2배 증가시켰다. 적응형 이퀄라이저는 $0.13-{\mu}m\;CMOS$ 공정 값을 사용하여 설계 되었으며, 0.412 mm2 의 레이아웃 면적을 사용한다.
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[게시일 2004년 10월 1일]
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