• 제목/요약/키워드: second-order loop filter

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9600 BPS Modem의 복조기와 Equalizer에 관한 연구 (On the Design of Demodulator and Equalizer of 9600 BPS Modem)

  • 장춘서;은종관
    • 대한전자공학회논문지
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    • 제20권4호
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    • pp.10-15
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    • 1983
  • 본 논문에서는 전송 속도가 9600 bps인 data modem의 복조기와 equalizer의 효과적인 구성에 대하여 연구하였으며, finite word length 효과가 equalizer 동작에 미치는 영향을 제시하였다. 복조기에는 tap수가 37개인 decimation filter를 사용해서 symbol당 곱셈 횟수를 크게 줄였는데 이때 equalizer 동작에 있어 충분한 결과를 얻을 수 있음을 알 수 있었다. 주파수 offset이 존재할 때 1차 반송파 위상 추적 loop와 2차 반공파 위상 추적 loop의 성능을 비교하였고, word length를 각각 8 bit, 12 bit 및 16bit로 변화시켰을 경우 equalizer 평형상태 MSE(mean square error)의 변화 및 tap 적응을 위한 최적 step see와 lap수를 제시하였다.

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DS-CDMA 시스템을 위한 비동기식 동기 추적 회로의 성능 비교 분석 (Analysis and Comparison of Noncoherent Code Tracking Loops for DS-CDMA Systems)

  • 이경준;박형래;채수환
    • 한국항행학회논문지
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    • 제1권1호
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    • pp.70-80
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    • 1997
  • 본 논문에서는 CDMA 이동전파 환경에서 두 가지 비동기식 동기 추적 회로 즉, TCTL과 MCTL의 성능을 비교, 분석한다. 먼저, 두 가지 방식에 대해 안정 상태에서의 지터 분산을 펄스 성형 필터, 타이밍 오프셋, 신호 대 잡음 비 및 루우프 대역폭의 함수로 이론적으로 유도한다. 또한, 루우프 필터의 설계 방법에 대해 2차 동기 추적회로를 중심으로 고찰한다. 끝으로, 동기 추적 오차에 의한 BER 성능 저하를 ETRI 에 의해 IMT-2000용으로 설계된 CDMA 시스템의 역방향 링크에 대해 분석한다.

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도플러 효과에 의한 지연 동기 루프의 추적 성능분석 (Infulence of doppler effects on the tracking performance of a dely locked loop)

  • 임성준;유흥균
    • 한국통신학회논문지
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    • 제23권4호
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    • pp.857-864
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    • 1998
  • 본 논문은 도플러 효과가 GPS 수신기용 비동기 2차 DLL(noncoherent second-order delay locked loop)의 추적 성능에 미치는 영향을 분석하였다. 성능 분석을 위하여 선형 DLL의 추적 정확도(steady state error and jitter)와 비선형 루프의 신뢰도를 고려하였다. 루프의 신뢰도에 관한 비선형 분석은 MTLL(mean time to lose lock)에서 근사 확장법을 사용하였다. 특히, 최대 MTLL을 얻기 위하여 loop에서 대역 여파기의 최적 대역폭과 최적 루프 파라미터를 제안하였다. 저궤도 위성의 경우는 도플러 영향이 크게 나타나므로 MTLL을 최대로 추적 오차를 최소 하는 효과를 기대할 수 있다. 시뮬레이션 결과로부터 설계된 디지탈 지연동기 루프 시스템이 정확히 동작함을 확인하기 위해 GPS 신호를 발생시키는 시뮬레이터인 STR-2770을 사용, 도플러 주파수를 첨가하여 실제 상황과 같은 환경에서 FPGA로 구현된 DLL회로의 성능을 검증하였다.

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이중루프 위상.지연고정루프 설계 (A Design of an Integer-N Dual-Loop Phase.Delay Locked Loop)

  • 최영식;최혁환
    • 한국정보통신학회논문지
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    • 제15권7호
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    • pp.1552-1558
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    • 2011
  • 본 논문에서는 전압제어지연단(Voltage Controlled Delay Line : VCDL)을 이용하여 기존의 위상고정루프와 다른 형태의 위상 지연고정루프(Phase Delay Locked Loop)를 제안하였다. 이 구조를 이용하여 기존의 위상고정루프의 2차 또는 3차 루프필터(Loop Filter)를 단하나의 커패시터로 구현하여 칩의 크기를 크게 줄였다. 새로이 제안하는 듀얼루프 위상 자연고정루프에서는 전압제어지연단 경로의 커패시터와 전하펌프의 전류 크기를 조절함으로서 작은 이득 값을 가지는 전압제어지연단을 사용할 수 있다. 제안된 회로는 $0.18{\mu}m$ CMOS 공정의 파라미터를 이용하여 Hspice로 시뮬레이션을 수행하고 회로의 동작을 검증하였다.

Double-Frequency Jitter in Chain Master-Slave Clock Distribution Networks: Comparing Topologies

  • Piqueira Jose Roberto Castilho;Caligares Andrea Zaneti
    • Journal of Communications and Networks
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    • 제8권1호
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    • pp.8-12
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    • 2006
  • Master-slave (M-S) strategies implemented with chain circuits are the main option in order to distribute clock signals along synchronous networks in several telecommunication and control applications. Here, we study the two types of masterslave chains: Without clock feedback, i.e., one-way master-slave (OWMS) and with clock feedback, i.e., two-way master-slave (TWMS) considering the slave nodes as second-order phase-locked loops (PLL) for several types of loop low-pass filters.

위상지연을 이용한 Integer-N 방식의 위상.지연고정루프 설계 (Design of an Integer-N Phase.Delay Locked Loop)

  • 최영식;손상우
    • 대한전자공학회논문지SD
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    • 제47권6호
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    • pp.51-56
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    • 2010
  • 본 논문에서는 전압제어위상지연단(Voltage Controlled Delay Line : VCDL)을 이용하여 기존의 위상고정루프와 다른 형태의 위상 지연고정루프(Phase Delay Locked Loop)를 제안 하였다. 이 구조는 기존의 위상고정루프의 2차 또는 3차 루프필터(Loop Filter)를 단하나의 커패시터로 구현하여 넓은 면적을 차지하던 루프필터의 면적을 크게 줄여 전체 칩을 $255{\mu}m$ $\times$ $935.5{\mu}m$ 크기로 집적하였다. 제안된 회로는 1.8V $0.18{\mu}m$ CMOS 공정의 파라미터를 이용하여 HSPICE로 시뮬레이션을 수행하고 회로의 동작을 검증하였다.

WCDMA 시스템을 위한 판정궤환 동기식 동기추적 회로의 설계 및 성능분석 (Design and Performance Analysis of a Decision-feedback Coherent Code Tracking Loop for WCDMA Systems)

  • 박형래;양연실;김영선;김창주
    • 한국통신학회논문지
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    • 제29권4A호
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    • pp.429-438
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    • 2004
  • 본 논문에서는 WCDMA 시스템을 위한 판정궤환 동기식 동기추적 회로 (decision-feedback coherent code tracking loop)를 설계하고 AWGN 환경과 페이딩 환경에서 위상 에러와 심볼 에러의 영향을 고려하여 지터 분산을 해석한다. 먼저, AWGN 환경에서의 지터 분산을 위상 에러와 비트 오율을 포함하여 펄스성형 필터(pulse-shaping filter), 타이밍 오프셋 (timing offset), 신호 대 잡음비 (signal-to-interferences ratio), 루우프 대역폭(loop-bandwidth)에 대한 일반식으로 유도하고 페이딩 환경에서 지터 분산의 상한치 (upper bonnd)를 유도한다. 끝으로, WCDMA 순방향 링크의 DPCH 프레임 포맷 #13을 목표 시스템(target system)으로 설정하여 2차 동기식 등기추적 회로를 설계하고 AWGN 환경과 Rayleigh 페이딩 환경에서 지터 분산의 이론치와 시뮬레이션 결과를 비교, 분석한다.

목표함수를 이용한 IMC-PID 제어기 설계 (Design of IMC-PID Controller via Target Function)

  • 최인혁;서병설
    • 전자공학회논문지SC
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    • 제43권3호
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    • pp.1-7
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    • 2006
  • 본 논문에서는 폐 루프 전달함수로부터 제어기를 얻는 방법에 기초한 IMC-PID 제어기 동조방법을 제안하였다. 플랜트는 시간 지연항을 갖는 2차 모델을 고려하고 목표함수로서 시간 지연항을 갖는 3차의 전달함수를 선택하였다. 필터 함수는 설계사양을 만족시키도록 하는 적절한 목표함수로부터 유도된다. 또한 강인-안정성을 입증하기 위한 강인성을 조사하였다.

A Multistage In-flight Alignment with No Initial Attitude References for Strapdown Inertial Navigation Systems

  • Hong, WoonSeon;Park, Chan Gook
    • International Journal of Aeronautical and Space Sciences
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    • 제18권3호
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    • pp.565-573
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    • 2017
  • This paper presents a multistage in-flight alignment (MIFA) method for a strapdown inertial navigation system (SDINS) suitable for moving vehicles with no initial attitude references. A SDINS mounted on a moving vehicle frequently loses attitude information for many reasons, and it makes solving navigation equations impossible because the true motion is coupled with an undefined vehicle attitude. To determine the attitude in such a situation, MIFA consists of three stages: a coarse horizontal attitude, coarse heading, and fine attitude with adaptive Kalman navigation filter (AKNF) in order. In the coarse horizontal alignment, the pitch and roll are coarsely estimated from the second order damping loop with an input of acceleration differences between the SDINS and GPS. To enhance estimation accuracy, the acceleration is smoothed by a scalar filter to reflect the true dynamics of a vehicle, and the effects of the scalar filter gains are analyzed. Then the coarse heading is determined from the GPS tracking angle and yaw increment of the SDINS. The attitude from these two stages is fed back to the initial values of the AKNF. To reduce the estimated bias errors of inertial sensors, special emphasis is given to the timing synchronization effects for the measurement of AKNF. With various real flight tests using an UH60 helicopter, it is proved that MIFA provides a dramatic position error improvement compared to the conventional gyro compass alignment.

Performance Analysis of Three-Phase Phase-Locked Loops for Distorted and Unbalanced Grids

  • Li, Kai;Bo, An;Zheng, Hong;Sun, Ningbo
    • Journal of Power Electronics
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    • 제17권1호
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    • pp.262-271
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    • 2017
  • This paper studies the performances of five typical Phase-locked Loops (PLLs) for distorted and unbalanced grid, which are the Decoupled Double Synchronous Reference Frame PLL (DDSRF-PLL), Double Second-Order Generalized Integrator PLL (DSOGI-PLL), Double Second-Order Generalized Integrator Frequency-Lock Loop (DSOGI-FLL), Double Inverse Park Transformation PLL (DIPT-PLL) and Complex Coefficient Filter based PLL (CCF-PLL). Firstly, the principles of each method are meticulously analyzed and their unified small-signal models are proposed to reveal their interior relations and design control parameters. Then the performances are compared by simulations and experiments to investigate their dynamic and steady-state performances under the conditions of a grid voltage with a negative sequence component, a voltage drop and a frequency step. Finally, the merits and drawbacks of each PLL are given. The compared results provide a guide for the application of current control, low voltage ride through (LVRT), and unintentional islanding detection.