• 제목/요약/키워드: pn junction

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고집적 회로를 위한 경사면 SWAMI 기술과 누설전류 분석 (The Technology of Sloped Wall SWAMI for VLSI and Analysis of Leakage Current)

  • 이용재
    • 한국통신학회논문지
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    • 제15권3호
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    • pp.252-259
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    • 1990
  • 本 論文은 기존 LOCOS工程의 張點을 모두 겸비한 側面璧 SWAMI 技術에 대한 새로운 構造를 提示한다. 새로운 SWAMI공정은 순수 窒化膜 壓力과 體積 膨腸에 기인한 壓力을 크게 줄이기 위해서 側面璧 주위에 얇은 질화막과 反應性이온 飾刻으로 기울어진 실리콘 측면벽을 結合시켰따. 製作된 結果에 의하면, 缺陷이 없는 완전히 새부리 모양이 形成되지 않는 局地的 酸化 공정은 기울어진 面의 異方性 산화 隔離에 의해 實現시킬 수 있었다. 추가적인 마스크 段階는 要求되지 않는다. 이 工程에서 PN 다이오드의 漏泄電流는 기존 LOCOS 공정 보다 減少되었다. 한편 가장자리 部位는 漏泄電流 密度에서 평편한 接合 부위 보다 높게 分析되었다.

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이면전계(BSF)에의한 solar cell의 효율개선효과 (Efficiency improvement of solar cell by back surface field)

  • 소대화;강기성;박정철
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 1990년도 추계학술대회 논문집
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    • pp.88-90
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    • 1990
  • In this study, PN junction solar cell and P$\^$+/-N-N$\^$+/ BSF solar cell, using N-type(111), 10$\^$16/[atoms/cm$\^$-3/] wafer, were fabricated applying that ion implant method whose dose are 1E14, 1E15, 3E15 and its acceleration energy is 50Key, 100Key respectively. The impurity concentration of two types of front-side are 10$\^$18/[atoms/cm$\^$-3/] and back-side concentration for BSF solar cell is 10$\^$17/[atoms/cm$\^$-3/]. As a result of comparison for 2 typical types of cells out of various fabricated samples, open circuit voltage (Voc), short circuit current(Isc) of BSF solar cell are larger than those of PN solar cell by 48[%], 14[%]. Considering that the efficiency of BSF cell is 2.5[%] as well as PN solar cell's is 7.5[%], 10.0[%] of efficiency improvement effect can be obtained from BSF solar cell. Futhermore, in consequence of front-side impurity concentration change from 10$\^$17/[atoms/cm$\^$-3] to 10$\^$20/[atoms/cm$\^$-3/] alternately, the most ideal result can be expected when it is 10$\^$18/[atoms/cm$\^$-3/].

전력 반도체 소자의 설계에 있어서 FLR의 Design 및 Process Parameter에 따른 PN접합의 항복특성에 관한 고찰 (A Study on the PN Junction Breakdown Characteristics with Design and Process Parameters of FLR in Power Device Design)

  • 송대식;강이구;황상준;성만영;이철진
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 1995년도 하계학술대회 논문집 C
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    • pp.1146-1148
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    • 1995
  • To improve the breakdown characteristics of vertical power devices, field limiting ring(FLR) is popularly used. In this paper, at vertical power device having $300{\sim}600V$ breakdown voltage, FLR thecnique is considered, by two dimensional computer simulator, with the various of parameters; number of FLR, seperation distance of first FLR from the main juncton and second FLR from the first FLR, doping concentration and thickness of epi-layer, etc.. Below $40{\mu}m$ epi thickness, and for the case of one FLR, the maximum breakdown voltage, 580V is obtained.

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Doping된 Ⅲ-Ⅴ族 化合物 半導體 界面에서 空間電荷效果 (Space Charge Effects at Doped Ⅲ-Ⅴ Compound Semiconductor Interfaces)

  • 천장호
    • 대한전자공학회논문지
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    • 제27권2호
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    • pp.93-97
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    • 1990
  • 도핑된 半導體 界面의 界面電荷 近似式과 構造를 提案하였다. III-V族 化合物 半導體인 p-GaP,p-InP,n-GaAs와 $C_sNO_3$ 水性 電解質 界面에서 整流現象은 循環電流-電壓特性으로 定性的 解析을 하였다. 半導體 界面의 電流-電壓 特性曲線, 이온 吸着과 電位障壁 過程은 連續循環電壓方法으로 實證하였다. 도핑된 半導體-電解質 界面에서 pn 또는 np 接合構造와 그에 따른 整流形은 空間電荷에 의하여 決定된다.

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PSG막의 급속열처리 방법을 이용한 LDD-nMOSFET의 구조 제작에 관한 연구 (A Study on the Structure Fabrication of LDD-nMOSFET using Rapid Thermal Annealing Method of PSG Film)

  • 류장렬;홍봉식
    • 전자공학회논문지A
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    • 제31A권12호
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    • pp.80-90
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    • 1994
  • To develop VLSI of higher packing density with 0.5.mu.m gate length of less, semiconductor devices require shallow junction with higher doping concentration. the most common method to form the shallow junction is ion implantation, but in order to remove the implantation induced defect and activate the implanted impurities electrically, ion-implanted Si should be annealed at high temperature. In this annealing, impurities are diffused out and redistributed, creating deep PN junction. These make it more difficult to form the shallow junction. Accordingly, to miimize impurity redistribution, the thermal-budget should be kept minimum, that is. RTA needs to be used. This paper reports results of the diffusion characteristics of PSG film by varying Phosphorus weitht %/ Times and temperatures of RTA. From the SIMS.ASR.4-point probe analysis, it was found that low sheet resistance below 100 .OMEGA./ㅁand shallow junction depths below 0.2.mu.m can be obtained and the surface concentrations are measured by SIMS analysis was shown to range from 2.5*10$^{17}$ aroms/cm$^{3}$~3*10$^{20}$ aroms/cm$^{3}$. By depending on the RTA process of PSG film on Si, LDD-structured nMOSFET was fabricated. The junction depths andthe concentration of n-region were about 0.06.mu.m. 2.5*10$^{17}$ atom/cm$^{-3}$ , 4*10$^{17}$ atoms/cm$^{-3}$ and 8*10$^{17}$ atoms/cm$^{3}$, respectively. As for the electrical characteristics of nMOS with phosphorus junction for n- region formed by RTA, it was found that the characteristics of device were improved. It was shown that the results were mainly due to the reduction of electric field which decreases hot carriers.

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SiO2 절연박막에 의해서 바나듐옥사이드 박막이 전도성이 높아지는 원인분석 (Analysis of Increasing the Conduction of V2O5 Thin Film on SiO2 Thin Film)

  • 오데레사
    • 한국산학기술학회논문지
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    • 제19권8호
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    • pp.14-18
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    • 2018
  • 일반적으로 반도체소자의 이동도를 높이기 위하여 반도체소자에서 옴접촉이 중요하게 다루어진다. 반도체 구조의 PN접합은 공핍층을 포함하고 있으며, 공핍층은 전기적인 비선형을 유도하고 쇼키접압을 만들어내는 반도체 고유의 물리적인 특징이다. 본 연구에서는 절연막이 전도성에 미치는 효과를 조사하기 위해서 $SiO_2$ 박막과 $V_2O_5/SiO_2$ 박막의 전기적인 특성을 비교하여 조사하였다. 미소전계영역에서 $SiO_2$ 절연막의 전기적인 특성으로부터 비선형 쇼키접합을 이루고 있는 것을 확인하였으며, 그 위에 증착된 $V_2O_5$ 박막은 오믹특성을 갖는 것을 확인하였다. 절연막의 PN 접합에 의한 쇼키접합 특성이 누설전류를 차단하여 $V_2O_5$ 박막의 전도성을 우수하게 만들었다. 양의 전압에서 $SiO_2$ 박막의 커패시턴스 값은 매우 낮았으나 $V_2O_5$ 박막의 커패시턴스 값은 전압이 증가할수록 증가하였다. 일반적인 전계영역에서 $SiO_2$ 박막의 절연 효과에 의해 $V_2O_5$ 박막의 전도성이 증가하는 것을 확인하였다. 절연박막은 공핍층의 효과를 이용하는 쇼키접합을 갖게 되며, 반도체에서의 쇼키접합은 전도성을 높이는 효과가 있는 것을 확인하였다.

Thermal Characteristics: Gap of LED Devices and LED's Lighting Application

  • Liu, Muqing;Zhang, Wanlu;Zhu, Xiaojing
    • 한국정보디스플레이학회:학술대회논문집
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    • 한국정보디스플레이학회 2008년도 International Meeting on Information Display
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    • pp.1347-1348
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    • 2008
  • The efficacy and its degradation of light emitting diode(LED) are related to its PN junction's temperature(Tj). Currently efficacy in certain temperature and thermo-resistant are defined for the depending. However, the definitions are quite inconvenient for lighting application. The paper focuses on the issue and presents a method to evaluate the thermal characteristics of LED efficay.

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p형 GaP 반도체 계면의 전류 특성 (Current Characteristics at p-GaP Semiconductor Interfaces)

  • 김은익;천장호
    • 대한전자공학회논문지
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    • 제26권9호
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    • pp.1369-1374
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    • 1989
  • Electrical characteristics at the p-GaP semiconductor/CsNO3 electrolyte interfaces were investigated. It is found that such interfacial phenomena are well analyzed by semiconductor-semiconductor pn junction diode models and image charge effects of semiconductor-vacuum interfaces. The formation processes of electrical double layers and their potential variations are verified using cyclic voltammetric methods. The interfacial current are influenced by Cs+ ion coverage onto the semiconductor electrode surface and structure of electrical double layer.

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A 150-Mb/s CMOS Monolithic Optical Receiver for Plastic Optical Fiber Link

  • Park, Kang-Yeob;Oh, Won-Seok;Ham, Kyung-Sun;Choi, Woo-Young
    • Journal of the Optical Society of Korea
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    • 제16권1호
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    • pp.1-5
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    • 2012
  • This paper describes a 150-Mb/s monolithic optical receiver for plastic optical fiber link using a standard CMOS technology. The receiver integrates a photodiode using an N-well/P-substrate junction, a pre amplifier, a post amplifier, and an output driver. The size, PN-junction type, and the number of metal fingers of the photodiode are optimized to meet the link requirements. The N-well/P-substrate photodiode has a 200-${\mu}m$ by 200-${\mu}m$ optical window, 0.1-A/W responsivity, 7.6-pF junction capacitance and 113-MHz bandwidth. The monolithic receiver can successfully convert 150-Mb/s optical signal into digital data through up to 30-m plastic optical fiber link with -10.4 dBm of optical sensitivity. The receiver occupies 0.56-$mm^2$ area including electrostatic discharge protection diodes and bonding pads. To reduce unnecessary power consumption when the light is not over threshold or not modulating, a simple light detector and a signal detector are introduced. In active mode, the receiver core consumes 5.8-mA DC currents at 150-Mb/s data rate from a single 3.3 V supply, while consumes only $120{\mu}W$ in the sleep mode.

Characterization of EFG Si Solar Cells

  • 박세훈
    • 센서학회지
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    • 제5권5호
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    • pp.1-10
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    • 1996
  • EFG Si 태양전지를 전류-전압, 표면광전압, 전자빔유도_전류, 전자미세프로브, 전자역산란의 여러 가지 기술을 이용하여 분석하였다. 전류-전압 그래프를 여러 온도에서 측정한 결과 EFG-Si 태양전지는 전압에 따라 변하는 shunt 저항을 가진 것이 밝혀졌다. 이러한 shunt 저항은 precipitate와 grain boundary에 의해 생긴 것으로 공간전하영역 내의 불순물 에너지 준위로 tunneling에 의해 이동한 캐리어의 재결합으로 일어난 결과이다. 전류-전압 과 표면광전압 기술을 결합하면 태양전지의 pn접합과 기판 (substrate)을 동시에 분석할 수 있다. Diode ideality factor와 표면 광전압은 Pn접합의 특성을, 소수캐리어 확산거리는 substrate특성을 표시한다. EFG 태양 전지를 분석한 결과, 전압에 따라 변하는 shunt 저항은 효율에 따라 정도 차이는 있지만 모든 시편에서 발견되며, 태양전지의 성능을 저하시키는 중요한 원인 중의 하나가 된다.

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