본 연구는 서울시 도심보행공간에서가로수녹음이보행자열쾌적성에미치는영향을WBGT(Wet Bulb Globe Temperature-습구흑구온도) 분석을 통하여 밝히고자 하였다. 일사 영향을 많이 받아 열쾌적성이 저하되는 여름철(8월)에 측정하였으며, 보행공간 WBGT 지수는 한국표준협회 "KS A ISO 7243: 고온환경 WBGT 지수에 의한 열 스트레스 추정"과 일본국립환경연구소의 작업환경, 일상생활 및 운동 WBGT 지침을 활용하여 결과를 해석하였다. 강남구 테헤란로 4개 구간에 대해 측정한 결과, 가로수에 의해 일사가 차단된 녹음(shade)지점 WBGT 지수는 최저 $27.40^{\circ}C$~최고 $30.60^{\circ}C$로 나타났으며, 일사(sun)지점은 최저 $28.45^{\circ}C$~최고 $34.2^{\circ}C$로 나타났다. 모든 녹음 지점에서 보행환경에 적합한 열쾌적성을 보였으며, 구간 최고값을 비교해 보았을 때 녹음(shade)지점이 일사(sun)지점에 비해 $4^{\circ}C$ 낮은 WBGT 지수를 나타내 가로수 녹음의 열쾌적성 개선 효과가 크다는 것을 알 수 있었다. 보행자를 대상으로 실시한 설문 및 행태조사 결과, 대부분 보행자는 일사를 피해 수목 하부 그늘 쪽 보행공간을 이용하는 것으로 나타났으며, 그늘을 이용하는 보행자의 75% 이상 녹음의 쾌적함을 보통 이상 쾌적하다고 평가하였다. 본 연구를 통해 가로수 녹음의 열쾌적성 향상 효과를 확인하였으며, 향후 가로수 식재시 열환경을 고려하여 연속적인 녹음이 형성될 수 있도록 정책적 변화가 필요하다.
Journal of information and communication convergence engineering
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제11권3호
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pp.190-198
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2013
Recently, one of the most vital advancement in the field of finance is high-performance trading using field-programmable gate array (FPGA). The objective of this paper is to design high-performance Black Scholes option trading system on an FPGA. We implemented an efficient Black Scholes Call Option System IP on an FPGA. The IP may perform 180 million transactions per second after initial latency of 208 clock cycles. The implementation requires the 64-bit IEEE double-precision floatingpoint adder, multiplier, exponent, logarithm, division, and square root IPs. Our experimental results show that the design is highly efficient in terms of frequency and resource utilization, with the maximum frequency of 179 MHz on Altera Stratix V.
본 논문에서는 두 개의 17비트 오퍼랜드를 radix-4 Booth's algorithm을 이용하여 곱셈 연산을 수행하는 곱셈기에 대한 효율적인 풀커스텀 디자인에 대한 테스트 방법을 제안하였다. 클럭 속도를 빠르게 하기 위하여 2단 파이프라인 구조로 설계하였고 Wallace tree 부분의 레이아웃을 규칙적으로 하기 위해서 4:2 CSA(Carry Save Adder)를 사용하였다. 회로는 하이닉스반도체의 0.6-um 3-Metal N-well CMOS 공정을 사용하여 칩으로 제작되었다. 제안된 테스트 방법을 사용하여 관찰해야 하는 노드의 수를 약 88% 줄여 효율적으로 고장 시뮬레이션을 수행하였다. 설계된 곱셈기는 9115개의 트랜지스터로 구성되며 코어 부분의 레이아웃 면적은 약 $1135^*1545$ um2 이다. 칩은 전원전압 5V에서 약 24MHz의 클럭 주파수로 동작한다. 제안된 테스트 방법은 풀커스텀 방식의 곱셈기를 비롯한 대부분의 커스텀 설계 회로에 적용이 가능하다.
영상 압축을 위하여 제시된 JPEG, MPEG 등과 같은 표준에서는 영상 자료의 허프만 부호화를 위하여 한쪽으로 기운 허프만 트리를 사용하고 있다. 본 논문에서는 이러한 허프만 트리에 대하여 효율적인 새로운 허프만 부호 복원방법을 제안한다. 제안한 허프만 부호 복원방법에서는 입력된 비트열로부터 미리 결정된 수 만큼의 연속된 비트를 반복적으로 취하여 이를 토대로 심볼 정보가 저장된 테이블을 참조함으로써 부호회된 심볼을 복원한다. 이러한 복원방법은 주어진 허프만 트리가 한쪽으로 기울어진 경우에 복원을 위한 테이블의 크기를 작게 할 수 있으며 실제로 본 논문에서는 이의 상한값을 제시한다. 또 한, 이 방법은 한 클릭에 여러 비트를 동시에 처리하기 때문에 실시간 동작이 가능하며 이에 대한 평가 결과를 보인다.
Leaf movements in nyctinastic plants are produced by changes in the turgor of extensor and flexor cells, collectively called motor cells, in opposing regions of the leaf movement organ, the pulvinus. In Samanea saman, a tropical tree of the legume family, extensor cells shrink and flexor cells swell to bend the pulvinus and fold the leaf at night, whereas extensor cells swell and flexor cells shrink to straighten the pulvinus and extend the leaf in the daytime. These changes are caused by ion fluxes primarily of potassium and chloride, across the plasma membrane of the motor cells. These ion fluxes are regulated by exogenous light signals and an endogenous biolgical clock. Inward-directed K$^+$ channels are closed in extensor and open in flexor cells in the dark period, while these channels are open in extensor and closed in flexor cells in the light period. Blue light opens the closed K$^+$ channels in extensor and closes the open them in flexor cells during darkness. Illumination of red light followed by darkness induces to open the closed K$^+$ channels in flexor and to close the open K$^+$ channels in extensor cells in the light. The dynamics of K$^+$ channels in motor cells that are controlled by light signals are consistent with the behavior of the pulvini in intact plants. Therefore, these cell types are an attractive model system to elucidate regulations of ion transports and their signal transduction pathways in plants. This review is focused on light-controlled ion movements and regulatory mechanisms involved in phosphoinositide signaling in leaf movements in nyctinastic plants.
This study is about the passive cooling effects of three outdoor solar shading facilities as trees, pergola with wistaria vine and membrane shading structure, which are expected to provide cool spots in the summer. Field observations of measuring thermal environment of selected facilities is executed. Thermal environment measuring was categorized as short wave radiation, long wave radiation, net radiation, globe temperature, surface temperature measured by infrared camera. Heat transfer mechanism is analyzed with overall data from field measurement. Results from this study are as below; 1) Radiation balance measured on shaded surface under membrane shading structure was 17%($86W/m^2$) of the unshaded surface radiation balance($511W/m^2$). 2) Surface temperature comparison between vegetation and membrane of the shading structure is performed at 3 o'clock in the afternoon. Surface temperature of vegetation was same as air temperature and that of membrane was $5^{\circ}C$ higher than air temperature. Vegetation transpiration is considered as the causing factor which make those differences. 3) Results from this study could be used as fundamental data for reducing heat island phenomena and continuos research on this subject would be needed.
본 논문에서는 암호 응용을 위한 $CF(2^m)$상의 새로운 디지트 시리얼 시스톨릭 곱셈기를 제안한다. 제안된 곱셈기는 연속적인 입력 데이터에 대해 ${\lceil}m/D{\rceil}$ 클럭 사이클마다 곱셈 결과를 출력한다. 여기서 D는 선택된 디지트 크기이다. 기존에 제안된 구조들은 선형의존성 때문에 디지트 크기 D가 증가하면 최대 처리기 지연시간 역시 선형으로 증가하지만 제안된 곱셈기는 이진트리 형태의 내부 구조를 가지기 때문에 D에 대해 로그단위로 증가한다. 따라서 제안된 구조는 기존에 제안된 디지트 시리얼 시스톨릭 곱셈기에 비해 계산지연을 상당히 감소시킨다. 뿐만 아니라 제안된 곱셈기는 규칙성, 모듈성, 단방향 신호 흐름의 특성을 가지기 때문에 VLSI 구현에 매우 적합하다.
본 논문에서는 VHDL을 이용하여 MPEG-2 AAC 복호화기에 사용되는 필수 모듈을 구현하였다. AAC 복호화기에는 허프만 복호화기, 역양자화기, 고해상도 필터뱅크 등의 툴들이 필수적으로 사용된다. 8진 트리 검색 알고리즘을 사용하여 고속의 허프만 복호화기를 설계하였고, IFFT를 이용하여 필터뱅크의 연산량을 줄였다. 또한, 고정소수점 방식의 하드웨어에서 역양자화기의 지수연산을 위하여 미리 계산된 값을 테이블로 처리하였고, 테이블의 크기를 줄이기 위하여 선형보간법을 사용하였다. 최적화를 통해 하드웨어로 구현된 각 모듈은 낮은 클럭 주파수에서 실시간 동작할 수 있고, 시스템의 크기를 작게 할 수 있다.
본 논문에서는 유한체 GF($2^m$)상의 다항식 기저를 이용한 디지트 시리얼 시스톨릭 곱셈기를 제안한다. 제안된 곱셈기는 MSD(Most Significant Digit) 우선 곱셈 알고리즘에 기반하며, 연속적인 입력 데이터에 대해 "m/D" 클럭 사이클마다 곱셈 결과를 출력한다. 여기서 D는 선택된 디지트 크기이다. 기존에 제안된 구조들은 선형의존성 때문에 디지트 크기 D가 증가하면 최대 처리기 지연시간 역시 선형으로 증가하지만 제안된 곱셈기는 이진트리 형태의 내부 구조를 가지기 때문에 D에 대해 로그단위로 증가한다. 따라서 제안된 구조는 기존에 제안된 디지트 시리얼 시스톨릭 곱셈기에 비해 계산지연시간을 상당히 감소시킨다. 뿐만 아니라 제안된 곱셈기는 높은 규칙성, 모듈성, 단방향 신호 흐름의 특성을 가지기 때문에 VLSI 구현에 매우 적합하다.
ASIC(application specific integrated circuit) 과정은 칩을 제작하기 위한 다양한 기술들의 집합이다. 일반적으로 RTL 설계, 합성, 배치 및 배선, 저전력 기법, 클록 트리 합성, 및 테스트와 같은 대표적인 과정들에 대해서는 많은 연구가 진행 되었고, 지금도 많은 연구가 진행 중이다. 본 논문에서는 이러한 ASIC 방법론에서 전력 플랜과 관련하여 경험적이고 실험적인 전력 스트랩 배선(power strap routing) 방법 기법에 대해서 제안하고자 한다. 먼저 수직 VDD 및 VSS와 수평 VDD 및 VSS를 위한 스트랩의 배선을 수행하고, 이 과정에서 발생하는 문제를 해결하기 위한 기법을 제안한다. 배선 가이드를 생성해서 의도하지 않는 배선을 방지하고, 차후를 위해서 배선 가이드에 대한 정보를 저장한다. 다음으로 불필요한 전력 스트랩을 제거하고, 매크로 핀에 대해 미리 배선을 수행한다. 마지막으로 배선 가이드를 이용하여 최종적인 전력 스트랩 배선을 완료한다. 이러한 과정을 통해서 전력 스트랩이 효율적으로 배선되는 것을 확인하였다.
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[게시일 2004년 10월 1일]
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