This paper has been studied about UWB(Ulra wide-band)'s LNA(Low Noise Amplifier) and Mixer. The UWB is a new technology that is being pursed for both commercial and military purposes. Direct conversion architectures that convert RF signals have potential to achieve such terminals, because they eliminate the need for non-programmable image-rejection filters and IF channel filters. And this architecture promises better performance in power, size, and cost than existing heterodyne - based receivers. This Receiver architectures combines low-noise amplifier, mixer. And then this paper has designed suitable UWB's LNA and Mixer.
MC-DS-CDMA 시스템의 상$\cdot$하향링크에서 비선형 전력 증폭기와 반송파 주파수 편차의 영향을 고려하여 데이터가 주파수 선택적 Rayleigh 페이딩 채널을 통하여 전송될 때 비트 오류율을 분석한다. 분석 결과, 여러 명 사용자 경우에 상향링크가 하향링크 경우에 비하여 비트 오류율 특성이 우수하다. 본 논문에서는 우수한 비트 오류율 특성을 위하여 상$\cdot$하향링크에서 사용자 수에 따라 요구되는 비선형 증폭기의 최대 출력 전력 대 평균 출력 전력 비(OBO)와 반송파 주파수 편차의 크기를 구한다.
The binary clipping PW/CDMA system is considered. This system can be constructed with effective cost. leading to reduce the influence of the non-linear amplifier because of converting multi-level signals into constant envelope signals. In addition, the clipping method which is to clip out signal amplitude at some level when multi-level signals are converted into constant envelope signals is used. The multi-level signals are clipped at 1 and -1 to limit the extension of bandwidth and to maintain the bandwidth after clipping. In this paper, the performance of the binary clipping PW/CDMA system with the non-linear amplifier analyzed by simulation over AWGN and flat fading channels respectively. The binary clipping PW/CDMA system with the non-linear amplifier is 2.2dB and 0.9dB better than conventional DS/CDMA system over the flat fading channels when the number of users are 9 and 17 respectively.
In magnetic flux measurement, output voltage drift of electronic integrator is an essential problem. In this work, we have developed a new kind of Miller type integrator using a sample and hold amplifier. Input bias current was measured and this value was hold in the sample and hold amplifier, after that input bias current of Miller integrator was compensated automatically using the value which holds in the sample and hold amplifier. Developed flux-meter shows the drift of flux-meter are smaller than 10$^{-5}$ Wb/min in full scale of 10$^{-2}$, and we could also measure multi-channel magnetic flux simultaneously.
For multi-carrier communication system, power amplifier generate intermodulation products caused by their nonlinear characteristics. Intermodulation products arised around the carrier frequency cannot be filtered out, operate as noise source for tile adjacent channel and thus degrades the quality of communication. In this paper, the 1850MHz-band RF linear power amplifier has been designed and fabricated with feedforward loop. The error signal loop consists of several key components such as phase shifter and attenuator, subtracter. The proposed Linearizer was tested with two-tone signals separated 10MHz apart at the center frequency of 1850MHz. The experimental results show C/I improvement by 14.5${\~}$20dB over 15dB dynamic range(33${\~}$47.8dBm) which gave IMD of 53.25${\~}$59dBc for the designed LPA.
본 논문에서는 입력신호의 Peak to Average Power Ratio (PAR) 에 따라 원하는 출력전력 백-오프 (Output Power Back-Off, OPBO) 구간에서 최적의 효율특성을 가지는 반전 타입의 비대칭 도허티 전력증폭기의 설계 방법을 제안하였다. 원하는 OPBO 구간에서 비대칭 도허티 전력증폭기의 최적 효율특성을 얻기 위해 주 증폭기와 피킹 증폭기의 피크 전력비를 결정하였고 피크 전력비에 따른 $90^{\circ}$ 임피던스 변환기의 정확한 임피던스 값을 도출 하였다. 또한 비대칭 도허티 전력증폭기 설계시 최적의 성능을 얻기 위해 오프셋 라인의 길이와 전력 분배비를 계산하였다. 측정결과, 비대칭 도허티 전력증폭기는 CDMA 2000 1x 3-FA 테스트 신호에 대해서 평균 출력 전력 48.7 dBm에서 40%의 전력 효율과 -35 dBc의 인접 채널전력비를 얻었다.
본 논문에서는 K대역의 신호를 수신하여 저잡음 증폭 및 L대역으로 하향 변환하는 다채널 전단 수신기를 설계 및 제작하였다. 제작된 다채널 전단 수신기는 잡음지수 2.3 dB 이하의 특성을 가지는 GaAs-HEMT 기반의 저잡음 증폭소자, 이미지 성분의 억제를 위한 IR(Image Rejection) Filter, 이미지 성분 억제와 IMD (Intermodulation Distortion) 특성 개선을 위한 IR(Image rejection) 믹서를 포함한다. 제작된 다채널 전단 수신기의 시험결과, 3.8 dB 이하의 잡음지수와 27 dB 이상의 변환이득을 가지며 입력신호 기준 -9.5 dBm 이상의 P1dB(1dB Gain Compression Point) 특성을 나타내었다.
JSTS:Journal of Semiconductor Technology and Science
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제17권4호
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pp.561-567
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2017
This paper presents a 4-channel common-cathode VCSEL driver array operating up to 6.25 Gb/s per channel for the applications of HDMI 2.0 active optical cables. The proposed VCSEL driver consists of an input buffer, a modified Cherry-Hooper amplifier as a pre-driver, and a main driver with pre-emphasis to drive a common-cathode VCSEL diode at high-speed full switching operations. Particularly, the input buffer merges a linear equalizer not only to broaden the bandwidth, but to reduce power consumption simultaneously. Measured results of the proposed 4-channel VCSEL driver array implemented in a $0.13-{\mu}m$ CMOS process demonstrate wide and clean eye-diagrams for up to 6.25-Gb/s operation speed with the bias current 2.0 mA and the modulation currents of $3.1mA_{PP}$. Chip core occupies the area of $0.15{\times}0.1{\mu}m^2$ and dissipate 22.8 mW per channel.
Short channel IC circuits become increasingly important in modern high performance electronic systems. In this paper, parts of an analog hearing aid, an amplifier and a regulator, which are implemented with short channel CMOS devices, are designed and optimized in its performance.
In this paper, we describes RF receiver module for IMT-2000 handset with 5MHz channel bandwidth. The fabricated RF receiver module consists of Low Noise Amplifier-, RF SAW filter, Down-converter, IF SAW filter, AGC and PLL Synthesizer. The NF and IIP3 of LNA is 0.8㏈, 3㏈m at 2.14㎓, conversion gain of downconverter is l0㏈, dynamic range of AGC is 80㏈, and phase noise of PLL is -100 ㏈m, at 100KHz. The receiver sensitivity is -110㏈m, adjacent channel selectivity is -48㏈m.
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[게시일 2004년 10월 1일]
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