부임피던스 변환기를 사용한 능동 RC 여파기의 RC 회로망의 극의 최적치 선정방법과 안정도 개선책을 논했다. 아울러 실제예로 차단주파수 3.4KC, 모듈라각 55°인 2차연린 Chebyshev 특성을 갖는 저주파 능동 RC 여파기를 설계하여 실험한 결과 이론치와 잘 일치했으며 동작 또한 안정했다.
직접 변환 방식의 IEEE 802.11a 무선랜 수신기에 사용되는 아날로그 채널 선택 필터에 대하여 기술한다. 채널 선택필터는 10MHz의 차단주파수를 갖는 5차의 체비셰프 필터이며 active-RC 구조로 설계되었다. 2단의 연산증폭기를 사용하였는데, 전력 소모를 최소화하기 위하여 전류재사용 feedforward 주파수 보상 방법을 사용하였다. 필터는 $0.l8{\mu}m$ CMOS 공정을 사용하여 제작하였으며 1.8V의 전원 전압에서 20mW의 전력 소모를 갖고 있으며 19dBV의 out-of-band iIP3를 갖는다.
All the resitors in the active RC filter networks can be relplaced by the switched capacitors. Therefore, An SC filter circuit can be fully integrated using MOS technology. A switched capacitor is much better than a resistor in temperature and linearity characteristics, and the former can be fabricated on the much smaller area then the latter. In this paper, It is given the generalized disign method of the active SC filter from the active RC filter using Bilinear Z-transformation. By SC filtering Techniques using Bilinear Z-transform, It enalbes us to realize the FDNR and Gyrator filters, which could not be realized in the exsisting designs, and it permits the processing of signals at much higher frequenies that many previous designs do. Experiments show that the response of the SC active filter is similiar to that of its prototype active RC filter.
본 논문은 LTE-Advanced 시스템을 위한 멀티채널을 선택할 수 있는 저역통과 필터를 제안한다. 제안하는 저역통과 필터는 5 MHz, 10 MHz, 그리고 40 MHz의 3가지 모드의 차단주파수를 제공하며 Active-RC 5차 Chebyshev 구조로 설계되었다. 저전력을 확보하면서 40 MHz의 높은 차단 주파수를 확보하기 위해서 부성 저항을 가지는 PMOS Cross-Connection Load를 사용한 연산증폭기를 필터에 적용하였다. 더불어 공정, 전압, 그리고 온도에 의한 각각의 차단주파수 변화에 대응할 수 있도록 각각 3-bit 제어 가능한 튜닝회로를 추가하였다. 제안하는 필터는 0.13-${\mu}m$ CMOS 공정을 사용하여 설계하였으며 1.2 V 전압에서 총 20.9 mW 전력을 소모한다.
indefinite admittance matrix 회로해석법을 써서 2개의 연산증폭기를 갖는 능동 RC여파기의 합성방법을 제시하였고, 이 방법에 의하여 중심각파수와 대역폭을 독립적으로 제어할 수 있는 대역통과 능동여파기를 실현하였다. 보현된 회로에 대한 주파수특성의 이론치와 실험치는 좋은 일치를 보였다. Employing indefinite admittance matrix analysis method, a novel synthesis procedure of general active-RC filters using 2 operational amplifiers has been shown in this paper. With this procedure, a stable active-RC bandpass filter hart been designed, which provides for independent adjustment of the uning and band-width control. The predicted and actual performance is in good agreement.
능동RC여파기회로내의 모든 저항은 SC로 대체할 수 있다. SC는 저항에 비해 온도특성 및 선형특성이 좋고 실리콘 면적이 훨씬 적게 소요된다. 본 논문에서는 Bilinear Z -변환을 사용해서 능동RC여파기로부터 제동SC여파기를 실현할 수 있는 일반적 방법이 제시되었다. Bilinear Z-변환을 사용한 SC여파법은 기존 방법으로 실현이 곤란했던 FDNR여파기나 Gyrator여파기도 실현할 수 있으며 사용 주파수가 높아진다. 실험결과를 통해 능동RC여파기의 응답특성과 능동SC여파기의 응답특성이 비슷함을 확인하였다.
최근 이동통신 시장의 급속한 증가에 따라 단말기 설계는 다표준 방식으로 발전하고 있다. 본 논문에서는 다표준 이동통신 시스템에 적용할 수 있는 주파수 가변형 능동 RC 대역통과 필터를 능동 인덕터를 사용하여 설계하였다. 기존의 대역통과 필터 설계법에서는 저지대역의 감쇠 특성과 통과대역의 주파수 선택도를 향상시키기 위하여 필터의 차수를 높게 하거나 극점 Q를 증가시키는 설계법을 사용한다. 본 논문에서는 극점 Q가 높은 능동 인덕터로 대역통과 필터를 설계하여 주파수 특성이 향상되었다. 또한 설계된 대역통과 필터는 튜닝 회로를 이용하여 필터의 중심주파수와 이득을 간단히 조절할 수 있도록 제안하였다. 설계된 능동 RC 대역통과 필터 특성은 TSMC $0.18{\mu}m$ 공정 파라미터를 이용하여 해석하였다. 시뮬레이션 결과, Q=20.5를 갖는 능동 인덕터를 이용한 필터는 1.86GHz 중심주파수에서 90MHz의 대역폭을 갖고, 튜닝 회로의 커패시터 값으로 중심주파수를 1.86~2.38GHz 범위까지 튜닝이 가능하여 다표준 무선통신 시스템에 적용할 수 있다.
본 논문에서는 고차 inverse Chebyshev 함수를 이용하여 능동 RC필터로 설계할 때 최대 동적범위를 갖고, 감도가 낮은 종속연결법으로 실현하는 방법을 제시하였다. 이때, 최대 동적범위를 만족시키도록 평탄행렬에 의한 최적 극점-영점 결합과 종속 연결순서 및 이득 분배에 대한 알고리즘을 제시하였으며, 능동 RC 회로의 단점인 감도 문제를 향상시키기 위하여 부 궤환을 갖는 2차 블록과 1차 블록을 설계하였다. 제시된 설계 방법을 이용하여 규준화된 7차 inverse Chebyshev함수의 능동 RC저역통과 필터를 설계한 결과 주어진 설계 명세조건과 일치함을 보였다.
본 논문은 LTE-Advanced 시스템을 위한 멀티채널을 선택할 수 있는 저역통과필터를 제안한다. 제안하는 필터는 5 MHz, 10 MHz, 그리고 40 MHz의 3가지 모드의 차단주파수를 제공하며 Active-RC 5차 Chebyshev 구조로 설계되었다. 저전력을 확보하면서 40 MHz의 높은 차단 주파수를 확보하기 위해서 부성 저항을 가지는 PMOS Cross-Connection Load를 사용한 연산증폭기를 필터에 적용하였다. 더불어 공정, 전압, 그리고 온도에 의한 각각의 차단주파수 변화에 대응할 수 있도록 각각 3-bit 제어 가능한 튜닝회로를 추가하였다. 제안하는 필터는 $0.13-{\mu}m$ CMOS 공정을 사용하여 설계하였으며 1.2V 전압에서 총 20.2 mW 전력을 소모한다.
본 논문에서는 40MHz의 대역폭과 개선된 선형성을 가지는 active-RC channel selection filter (CSF)가 제안된다. 제안되는 CSF는 5차 butterworth 필터로써 한 단의 1차 low pass 필터와 두 단의 biquad 기반의 2차 low pass 필터, 그리고 DC offset 제거를 위한 DC 피드백 회로로 구성된다. CSF의 선형성을 개선하기 위해 스위치로 사용되는 MOSFET의 body를 source 노드로 연결한다. 설계된 CSF의 대역폭은 10MHz, 20MHz, 그리고 40MHz로 선택될 수 있으며, 전압 이득은 0dB에서 24dB까지 6dB의 단위로 조정된다. 제안된 CSF는 1.2V 40nm의 1-poly 8-metal CMOS 공정에서 설계된다. 설계된 CSF가 40MHz의 대역폭과 0dB의 gain을 가질 때, OIP3는 31.33dBm이고 in-band ripple은 1.046dB, IRN는 39.81nV/sqrt(Hz)로 시뮬레이션 검증되었다. CSF의 면적과 전력소모는 각각 $450{\times}210{\mu}m^2$와 6.71mW 이다.
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[게시일 2004년 10월 1일]
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