The electrical characteristics of band-gap engineered tunneling barriers consisting of thin $SiO_2$ and $Si_3N_4$ dielectric layers were investigated for nonvolatile memory device applications. The band structure of band-gap engineered tunneling barriers was studied and the effectiveness of these tunneling barriers was compared with the conventional tunneling $SiO_2$ barrier. The band-gap engineered tunneling barriers composed of thin $SiO_2$ and $Si_3N_4$ layers showed a lower operation voltage, faster speed and longer retention time than the conventional $SiO_2$ tunnel barrier. The thickness of each $SiO_2$ and $Si_3N_4$ layer was optimized to improve the performance of non-volatile memory.
We fabricated Au/PI/Pb and Au/PI/1-layer Arachidic acid/Pb structures in order to electron transport properties through the junctions. It was found that 9-layer PI LB films function as a good tunneling barrier from the I-V properties. And several peaks originating in the vibrational modes of the constituent molecules of 1-layer arachidicacid LB films were clearly observed in $d^2V/dI^2-V$ curves.
Using Polyimide Langmuir-Blodgett(LB) films as a tunneling barrier, Current -Voltage(I-V) characteristics and inelastic electron tunneling spectroscoupy(IETS) of the junctions incorporating 1-layer orgainc monolayer were invesgated. Several peaks originating in vibrational modes of constituted molecules of 1-layer monolayers were clearly observed in the IET spectra.
The tunnel barrier engineered charge trap flash (TBE-CTF) non-volatile memory using CRESTED tunneling barrier was fabricated by stacking thin $Si_3N_4$ and $SiO_2$ dielectric layers. Moreover, high-k based $HfO_2$ charge trap layer and $Al_2O_3$ blocking layer were used for further improvement of the NVM (non-volatile memory) performances. The programming/erasing speed, endurance and data retention of TBE-CTF memory was evaluated.
A ramp-type tunneling magnetoresistance (TMR) junction having structure NiO(60 nm)/pinned Co(10 nm)MiO(60 nm)/barrier SrTiO$_3$(2-10 nm)/free NiFe(10 nm) with the 15 degree slope was investigated. We obtained nonlinear I(V) characteristics for ramp-type tunneling junctions that have distinctive difference with and without applied magnetic field. In the barrier SrTiO$_3$ thickness of 4 nm, the TMR was about 52% at a bias voltage of 50 mV. (omitted)
Ultra-thin $SiO_2/ZrO_2$ dielectrics were deposited by atomic layer chemical vapor deposition (ALCVD) method for non-volatile memory application. Metal-oxide-semiconductor (MOS) capacitors were fabricated by stacking ultra-thin $SiO_2$ and $ZrO_2$ dielectrics. It is found that the tunneling current through the stacked dielectric at the high voltage is lager than that through the conventional silicon oxide barrier. On the other hand, the tunneling leakage current at low voltages is suppressed. Therefore, the use of ultra-thin $SiO_2/ZrO_2$ dielectrics as a tunneling barrier is promising for the future high integrated non-volatile memory.
Using polyimide Langmuir-Blodgett(LB) films as a tunneling harrier, we fabricated Au/Polyimide/1-layer arachidic acid/Pb structure in order to investigate electron transport properties through a junction. It was found that 9-layer polyimide LB films function as a good tunneling harrier in a study of current-voltage(I-V) chararteristics. And several peaks originating in the vibrational modes of the constituent molecules of 1-layer arachidic acid LB films were clearly observed in d$^2$V/dI$^2$- V corves.
We have studied electrical properties and luminous efficiency of organic light-emitting diodes(OLEDs) with different buffer layer and cathodes in a temperature range of 10 K and 300 K. Four different device structures were made. The OLEDs are based on the molecular compounds, N,N'-diphenyl-N,N'-bis(3-methylphenyl)-1,1'-biphenyl-4,4'-diamine (TPD) as a hole transport, tris(8-hydroxyquinolinato) aluminum(III) (Alq$_3$) as an electron transport and omissive layer, and poly(3,4-ethylenedioxythiophene) :poly (styrenesulfonate) (PEDOT:PSS ) as a buffer layer. And LiAl was used as a cathode. Among the devices, the ITO/PEDOT:PSS/TPD/Alq$_3$/LiAl structure has a low energy-barrier height for charge injection and show a good luminous efficiency. We have got a highly efficient and low-voltage operating device using the conductive PEDOT:PSS and low work-function LiAl. From current-voltage characteristics with temperature variation, conduction mechanisms are explained SCLC (space charge limited current) and tunneling one. We have also studied energy barrier height and luminous efficiency at various temperature.
The Spin-dependent tunneling magnetoresistance (TMR) effect was observed in $NiFe/Al_2O_3$/Co thin films. The samples were prepared by magnetron sputtering in a system with a base pressure of $3\times10^{-6}$Torr. the insulating $Al_2O_3$layer was prepared by r.f. plasma oxydation method of a metallic Al layer. The ferromagnetic and insulating layers were deposited through metallic masks to produce the cross pattern form. The junction has an active area of $0.3\times0.3\textrm{mm}^2$ and the $Al_2O_3$layer is deposited through a circular mask with a diameter of 1mm. It is very important that insulating layer is formed very thinly and uniformly in tunneling junction. The ferromagnetic layer was fabricated in optimum conditions and the surface of that was very flat, which was observed by AFM. Tunneling junction was confirmed through nonlinear I-V curve. $NiFe/Al_2O_3$/Co junction was observed for magnetization behavior and magnetoresistance property and magnetoresistance property is dependent on magnetization behavior and magnetoresistance property and magnetoresistance property is dependent on magnetization behavior of t재 ferromagnetic layer. The maximum magnetoresistance ratio was about 6.5%.
The annealing effects of $SiO_2/Si_3N_4$ stacked tunneling dielectrics were investigated. I-V characteristics of band gap engineered tunneling gate stacks consisted of $Si_3N_4/SiO_2/Si_3N_4$(NON), $SiO_2/Si_3N_4/SiO_2$(ONO) dielectrics were evaluated and compared with $SiO_2$ single layer using the MOS(Metal-Oxide-Semiconductor) capacitor structure. The leakage currents of engineered tunneling barriers (ONO, NON stacks) are lower than that of the conventional $SiO_2$ single layer at low electrical field. Meanwhile, the engineered tunneling barriers have larger tunneling current at high electrical field and improved electrical characteristics by annealing processes than $SiO_2$ layer.
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[게시일 2004년 10월 1일]
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