• 한국통신학회논문지
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• 제34권3A호
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• pp.265-271
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• 2009

본 논문은 위성방송 표준인 DVB-S2 (Digital Video Broadcasting - Second Generation)의 복조기 설계에서 중요한 부분 중의 하나인 초기 주파수 추정 회로를 효율적으로 설계하는 방법을 제안한다. DVB-D2에서 초기 주파수 오차는 심볼 전송률의 20%에 해당하며 심볼 전송률이 25Msps일 경우 ${\pm}5MHz$에 달한다. 이와 같이 큰 초기주파수 오차를 추정하기 위해서는 추정 범위가 넓은 알고리즘이 요구된다. 본 논문에서는 데이터 도움 방식의 알고리즘들을 분석하고 성능 비교한 결과 M&M (Mengali & Moreli) 알고리즘이 낮은 SNR에서 우수한 추정 성능을 보여줌을 확인하였다. M&M 알고리즘을 적용한 기존의 주파수 추정 회로는 하드웨어 복잡도가 높기 때문에 자기 상관기와 역 탄젠트기의 수를 줄임으로서 전체 초기 주파수 추정기의 하드웨어 복잡도를 낮추는 방법을 제안한다. 제안된 구조는 기존의 구조에 비해 하드웨어 복잡도가 약 64.5%정도 감소하였으며 Xilinx Virtex II FPGA 검증 보드를 이용하여 제안된 구조를 검증하였다.

• 대한전기학회:학술대회논문집
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• 대한전기학회 1998년도 하계학술대회 논문집 A
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• pp.260-262
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• 1998

A new method of induction motor drive, which requires not shaft encoder, is presented. This system has both torque and speed controls that are performed by vector control. The scheme is on the basis of a rotor flux speed control, which is performed by torque producing current and rotor flux, derived from the stator voltages and currents. But, there is a problem with respect to the calculated rotor flux vector, which is an integrating operation by which the rotor induced voltage is converted into the rotor flux. The calculated rotor flux does not work so that it is unstable in initial operation, as motor speed approaches zero. For the proposed rotor flux estimator, a lag circuit is employed, to which both the motor-induced voltage and rotor flux command are imposed, and it is possible to calculate even a low frequency down to standstill. We show the validity of the proposed control method through several computer simulations.

• 전력전자학회논문지
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• 제18권3호
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• pp.232-239
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• 2013

This paper proposes an improved stator flux estimator through ensuring conventional PLPF to act as a pure integrator for sensorless control of induction motors. Conventional PLPF uses the estimated synchronous speed as a cut-off frequency and has the gain and phase compensators. The gain and phase compensators are determined on the assumption that the estimated synchronous angular speed is coincident with the real speed. Therefore, if the synchronous angular speed is not same as the real speed, the gain and phase compensation will not be appropriate. To overcome the problem of conventional PLPF, this paper analyzes the relationship between the synchronous speed error and the phase lag error of the stator flux. Based on the analysis, this paper proposes the synchronous speed error compensation scheme. To achieve a start-up without speed sensor, the current model is used as the stator flux estimator at the standstill. When the motor starts up, the current model should be switched into the voltage model. So a stable transition between the voltage model and the current model is required. This paper proposes the simple transition method which determines the initial values of the voltage model and the current model at the transition moment. The validity of the proposed schemes is proved through the simulation results and the experimental results.

• 한국산학기술학회논문지
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• 제20권3호
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• pp.455-464
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• 2019

영구자석동기전동기의 쇄교자속 기반 센서리스 제어는 저속에서 위치추정 특성이 우수 하지만 계측된 전류가 ADC를 통해 변환되는 과정에서 발생한 DC offset에 의하여 쇄교자속 추정기의 적분기가 포화되는 문제점을 가지고 있습니다. 이러한 현상을 방지하기 위해 낮은 차단주파수를 갖는 HPF를 사용하여 DC offset 성분을 제거하는 방법이 사용되나, HPF의 낮은 차단주파수로 인해 고속에서 추정 성능이 저하되는 문제점이 있다. 반면 HPF의 차단 주파수를 높이게 되면, 저속에서 위상 앞섬 및 초기기동 실패의 문제가 발생한다. 본 논문에서는 HPF의 차단주파수를 영구자석동기전동기의 운전주파수에 동기화함으로써 낮은 속도에서는 HPF의 차단주파수를 낮게 하여 HPF에 의한 위상 앞섬을 줄이고, 높은 속도에서는 HPF의 차단주파수를 높게 함으로써 높은 DC offset 제거 성능을 통해 운전영역을 200% 확대한다. 또한, 추가적인 위상 보상 알고리즘을 통해 전 운전영역에서 HPF의 위상 앞섬이 1.5도 미만으로 감소되는 방법을 제안한다. 제안된 센서리스 제어 알고리즘은 세탁기용 영구자석동기전동기를 이용한 실험을 통해 검증한다.

• 한국통신학회논문지
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• 제22권6호
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• pp.1210-1230
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• 1997

본 논문에서는 기준신호를 나타내는 하나의 파일럿채널과 다수의 트래픽채널을 갖는 DS/CDMA용 송수신기구조를 제안한다. 파일럿채널은 데이타 변조가 되지 않은 순수 PN 부호성분을 전송하며 수신단에서 PN 동기 및 동기복조의 기준신호로 이용한다. 또한 이러한 구조는 순방향뿐만 아니라 역방향 링크에도 적용된다. 제안된 DS/CDMA 방식의 특징은 다음과 같다. 첫째, 트래픽채널의 확산 방식은 I-phase 및 Q-phase의 확산부호를 파일럿채널의 그것과 교차하게 배치한 interlaced quardrature-spreading(IQS) 구조를 갖는데 이는 기존의 확산방식에 비해 데이타 신호의 영교차율을 줄여 송신단 출력신호 레벨의 변화를 작게한다. 둘째, PN부호의 초기동기 및 동기초적시 임계값을 적응적으로 자동설정하며, 초기동기시 PN 부호를 한 칩씩 이동하게 하여, 기존의 방식에 비해 초기동기 시간을 절반으로 줄이게 했으며, 수신부에서 PN 부호 발생기를 하나만 사용하여 초기동기 및 동기추적이 되게했다. 또한 state machine을 이용하여 재동기 timing을 자동설정 하도록 설계했다. 셋째, 본 방식에서는 자동주파수조절(automatic frequency control: AFC)기능, 입력신호의 크기에 따라 능동적으로 유효한 출력 레벨을 조절하는 자동 레벨조절(automatic level control: ALC)기능, bit-error-rate(BER)을 자동계산하는 기능, 인접 채널과의 간섭을 최소화하기 위한 스펙트럼 성형기능 등을 도입하여 사용자 편의를 도모했다. 넷째, 데이타 전송속도를 16Kbps~1.024Mbps로 가변이 되게함으로써 다양한 응용에 대처할 수 있게 설계했다. 한편, 본 논문에서 제안한 DS/CDMA 모뎀구조는 다양한 simulation을 통하여, 알고리즘 검증 과정을 거쳤으며, 제안된 DS/CDMA 모뎀 구조는 VHDL을 이용하여 ASIC으로 구현하였다. DS/CDMA용 ASIC은 송신부 ASIC과 수신부 ASIC으로 나누어 개발 하였으며, 한개의 ASIC당 3개의 채널을 동시에 수용할 수 있으며, 다수의 ASIC을 사용하여 여러 채널의 다중접속이 가능하다. 제작완료된 ASIC은 기능시험을 완료했으며 실제 line-of-sight(LOS) 시스템 구현에 적용중이다.