본 논문에서는 극저주파 자계 세기를 원격으로 측정하기 위한 장치를 설계하고 제작하였다. 자계 측정기는 자계를 등방적으로 측정하기 위하여 3축 자계 센서를 사용하였으며, 측정 대역내 주파수에서 주파수 특성을 보상하기 위하여 등화기를 사용하였다. 3축 자계 센서의 출력 신호를 시간적으로 다중화 시켜, 3축간 균일한 이득 및 주파수 특성을 얻었다. 자계 측정 레벨 범위는 $0.01{\sim}10.0\;uT$이며, 측정 주파수 대역은 $40{\sim}180\;Hz$이 되도록 설계하였다. 제어 시스템은 무선으로 자계 측정기에 접근하며, 최대 접근 거리는 1.0 km이다. 제작된 장치의 측정 레벨 오차는 5% 이내이다. 제작된 장치는 고전압 송전선이 지나는 골프 연습장에 설치되었다.
수중에서의 음향 통신의 성능은 신호의 다중경로 전달과정에 의해 발생하는 지역 확산 현상으로 인하여 인접간섭의 영향을 받는다. 그리고 음파를 이용한 주파수의 제한으로 인하여 낮은 전송 속도로 통신을 한다. 따라서 전송속도의 향상과 함께 인접간섭을 제거하기 위하여 수중 통신에 적합한 시공간 부호화 기술과 등화기 기술, 채널 부호화 기술이 필요하다. 본 논문에서는 이러한 기술들을 시뮬레이션을 통하여 MIMO 수중 통신 시스템에서 최적의 터보 등화 기법을 이용한 복호구조를 제안한다. 각 모듈별 시뮬레이션을 통한 성능결과 본 논문에서 제안한 계층적 시공간 부호화 방식 기반의 터보 등화 기법을 이용하면 일반적인 수중 통신 보다 성능이 우수함을 알 수 있다.
JSTS:Journal of Semiconductor Technology and Science
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제12권4호
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pp.433-448
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2012
A source-synchronous receiver based on a delay-locked loop is presented. It employs a shared global calibration control between channels, yet achieves channel expandability for high aggregate I/O bandwidth. The global calibration control accomplishes skew calibration, equalizer adaptation, and phase lock of all the channels in a calibration period, resulting in the reduced hardware overhead and area of each data lane. In addition, the weight-adjusted dual-interpolating delay cell, which is used in the multiphase DLL, guarantees sufficient phase linearity without using dummy delay cells, while offering a high-frequency operation. The proposed receiver is designed in the 90-nm CMOS technology, and achieves error-free eye openings of more than 0.5 UI across 9-28 inch Nelco4000-6 microstrips at 4-7 Gb/s and more than 0.42 UI at data rates of up to 9 Gb/s. The data lane occupies only $0.152mm^2$ and consumes 69.8 mW, while the rest of the receiver occupies $0.297mm^2$ and consumes 56.0 mW at the 7- Gb/s data-rate and supply voltage of 1.35 V.
최근 레벨계는 산업현장의 안전 및 유지관리와 연관되어 넓은 측정범위가 요구되는 추세이다. 일반적으로 레벨계의 측정범위를 확보하기 위해 측정환경을 개선하여 잡음을 감소시키거나 신호처리를 통해 신호의 왜곡을 보상하게 된다. FMCW 레이다 레벨계의 잡음과 신호의 왜곡은 레벨계의 근거리 특성에 영향을 주어 최소탐지거리가 감소되는 결과를 갖게 한다. 본 논문에서는 레벨계의 근거리 영역의 잡음을 제거하기 위해 window 함수와 비트 스펙트럼의 특성을 고려한 Equalizer 필터를 적용하여 최소탐지거리 성능을 개선하며 탐지가 상대적으로 어려운 레벨계 근거리의 측정 신뢰도를 높이고 탐지영역내의 측정 범위를 향상 시키고자 한다.
본 논문에서는 이중 채널 CIS(CMOS Image Sensor) 인터페이스를 위한 수신기 설계에 대해서 기술한다. 두 채널은 각각 CTLE(Continuous-Time Linear Equalizer)를 포함하며 샘플러, 병렬 변환기 그리고 clocking 회로로 구성되어 있다. Clocking 회로는 PLL, PI, CDR을 포함한다. CDR은 PI 기반이며 OSPD(Over Sampling Phase Detector)와 FSM(Finite State Machine)을 추가하여 빠른 락 소요 시간과 지연 시간, 향상된 jitter tolerance를 갖도록 하였다. CTLE는 3 GHz에서 -6 dB 손실을 갖는 채널의 ISI(Inter Symbol Interference)를 제거하며 CDR은 8000 ppm 이하의 주파수 오프셋에 대해 1 baud period 이내의 빠른 락 소요 시간을 갖는다. 65 nm CMOS 공정을 이용하여 설계하였으며 eye diagram에서 최소 368 mV의 전압 마진과 0.93 UI의 시간 마진을 갖는다.
MIMO-OFDM 기술은 시 공간만이 아니라 주파수 영역을 활용할 수 있기 때문에 기존의 시 공간 MIMO 시스템을 유연하게 확장하여 OFDM에 적용시킬 수 있다. 무선 이동 통신에서 발생되는 페이딩은 이동체의 속도, 전송 주파수, 수신 안테나 및 주위 자연 환경에 의해 발생한다. 또한, 무선 이동 통신 채널에 가장 심각하게 나타나는 현상인 다중 경로 페이딩은 각각 다른 지연 시간에 의해 주파수 선택적 페이딩이 발생하게 되며, 이때 ISI로 인해 무선 이동 통신 채널의 성능을 저하시키게 되며, 데이터 전송 속도에 제약을 준다. OFDM은 심벌 사이에 채널의 지연 확산보다 긴 보호 구간을 삽입하여 ISI를 제거할 수 있다. 그러나 대역폭 등의 문제로 일반적으로 보호 구간은 심벌 주기의 1/4 정도로 설정하며, 따라서 다중경로의 채널 지연이 보다 심각해질 경우, 보호 구간 만으로는 ISI을 모두 제거할 수 없다 이 경우 채널에서의 전송시간 지연에 의한 왜곡은 등화기를 사용하여 보상해 주어야 하며, 특히 데이터 전송 속도가 고속이 될수록 등화기의 사용이 절대적으로 필요하게 된다. 본 논문에서는 MIMO-OFDM 시스템에서 사전 등화를 이용한 BER 성능을 분석하였다.
자동차의 점화계통에서 발생하는 전자파 잡음을 측정하고 통계확률적인 방법을 이용하여 모델링을 하였다. 낮은 크기의 잡음도 측정이 가능하도록 수신기와 3축 안테나의 사이에 저잡음증폭기와 대역통과필터를 연결 구성하고, 800 MHz 대역의 진폭확률분포(APD)와 펄스간격분포(PSD)를 측정하였다. 측정된 APD 곡선을 3개(A급) 또는 6개(B급)의 변수로 모형화하였으며, 변수의 최적치를 쉽게 계산할 수 있는 합성근사화 알고리즘을 사용하였다. 진폭확률분포에 관한 모형변수를 추출함으로써 전자파환경의 데이터 베이스화가 가능하며, 송.수신기의 출력 및 감도의 마진 결정에 기초적인 자료로 이용이 가능하다.
수중에서의 음향 통신의 성능은 신호의 다중경로 전달과정에 의해 발생하는 지역 확산 현상으로 인하여 인접간섭에 영향을 받는다. 그리고 음파를 이용한 주파수의 제한으로 인하여 낮은 전송 속도로 통신을 한다. 따라서 전송속도의 향상과 함께 인접간섭을 제거하기 위하여 수중 통신에 적합한 시공간 부호화 기술과 등화기 기술, 채널 부호화 기술이 필요하다. 본 논문에서는 이러한 기술들을 시뮬레이션을 통하여 수중 통신 시스템에 대한 분석을 하였다. 시뮬레이션 결과 본 논문에서 제시한 시공간부호화 기술, 터보부호화 기술, Zero Forcing 검출 기법을 이용하면 일반적인 수중 통신 보다 성능이 우수함을 알 수 있다.
광대역 무선 디지털 통신 시스템용 파이프라인 적응 결정귀환 등화기 (pipelined adaptive decision- feedback equalizer; PADFE)를 0.25-$\mu\textrm{m}$ CMOS 공정을 사용하여 full custom 단일 칩으로 설계하였다. ADFE의 동작속도를 향상시키기 위해 DLMS (delayed least-mean-square)을 적용한 2-stage 파이프라인 구조로 설계하였다. PADFE의 필터와 계수갱신 블록 등 모든 연산을 redundant binary (RB) 수치계로 처리하였으며, 2의 보수 수치계를 사용하는 기존의 방식에 비해 연산량의 감소와 동작속도의 향상이 얻어졌으며, 또한 전체적인 구조의 단순화에 의해 VLSI 구현이 용이하다는 장점을 갖는다. COSSAP을 이용한 알고리듬 레벨 시뮬레이션을 통해 파이프라인 stage 수, 필터 tap 수, 계수 및 내부 비트 수 등의 설계 파라메터 결정과 bit error rate (BER), 수렴속도 등을 분석하였다. 설계된 PADFE는 약 205,000개의 트랜지스터로 구성되며, 코어의 면적은 1.96$\times$1.35-mm$^{2}$이다. 시뮬레이션 결과, 2.5-V 전원전압에서 200-MHz의 클록 주파수로 안전하게 동작할 수 있을 것으로 예상되며, 평균 전력소모는 약 890-mW이다.
본 논문에서 2008년에 발사될 통신해양기상 위성탑재용 Ka 대역 멀티플렉서의 인증모델 결과를 보였다. 이들은 위성통신에서 주파수 자원을 효율적으로 사용하기 위한 위성중계기용 입력 및 출력 멀티플렉서와 반사판 안테나를 송수신 대역에서 공용으로 상요하기 위한 급전용 다이플렉서이다. 4개의 주파수채널을 지닌 중계기 입력부에서 사용되는 입력 멀티플렉서는 높은 주파수 선택도 특성을 지닌 협대역 8차 타원형 필터와 2차 군지연등화기를 갖는 독립 채널 필터들로 이루어져 있다. 출력 멀티플렉서는 저손실 특성을 갖고, 무게 및 부피가 적은 매니폴드 형태가 이용되었다. 급전부에 사용되는 다이플렉서의 송수신 포트는 E 평면 T 접합부를 이용하여 분기되었고, 수신부 필터는 튜닝이 용이하도록 비대칭 유도성 아이리스를 이용한 필터가 적용되었다. 제작된 인증모델 멀티플렉서들은 요구 규격에 맞도록 전기적 성능시험, 진동시험, 기계적 충격시험, 열진공 시험, EMC 시험 등이 실시되었고, 시험결과 비행모델에 적용 가능한 성능을 보였다.
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[게시일 2004년 10월 1일]
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