In this paper, the second order time mean forces acting on the circular cylinder floating on the free surface of a finite water depth are calculated. Under the assumption that fluid is idea and the wave the linear gravity wave, the velocity potential is calculated by the source distribution method, and the second order time mean lateral and vertical drifting forces are calculated by the direct integration of fluid pressures over the immersed body surface. The comparison of the lateral drifting forces with Rhee's results by momentum theorem shows good agreements. And it is shown that the second order time sinkage forces of a floating circular cylinder cross zero for all water depths.
This paper describes transient responses of a very floating structure subjected to dynamic load induced by waves. A time domain method is applied to the hydroelastic problems for this purpose. The method is based on source-dipole and FEM scheme and on Newmark $\beta$ method to pursuit time step process taking advantage of memory effect. The present procedure is carried out to analyze hydroelastic responses in regular waves and impact responses due to dropping aircraft.
This paper is transient motions of a very large floating structure subjected to dynamic load induced by wave. A time domain method is applied to the hydroelasticity problems for this purpose. The method is based on source-dipole and FEM scheme and on Newmark $\beta$ method to pursuit time step process taking advantage of the memory effect. The present method is appied to hydroelastic response analysis in regular waves and impact responses due to dropping aircraft.
최근 생산 부분에 집중되어 있던 국내 해양플랜트 산업구조를 엔지니어링 분야로 확대하기 위한 노력이 지속되어왔다. 하지만 부유식 해양플랜트 엔지니어링 기술의 핵심 중 하나인 시간대역에서의 운동해석의 경우 국외 회사에서 제공되는 정보에 거의 전적으로 의존하여 왔다. 특히 동적 위치 유지 시스템은 초기 설계에서 해외 선진사가 제공하는 정보에 기반하며, 그 결과를 선형에 반영하기 위해서는 시간적으로나 비용 면에서 많은 손실을 감수해야 한다. 본 논문에서는 동적위치유지시스템 (Dynamic Positioning System, DPS)을 사용하는 부유식 해양구조물의 시간대역 운동 해석에 필요한 프로그램의 프레임워크를 다룬다. 개발된 프레임워크는 시간대역 해석을 쉽게 수행할 수 있도록 해석에 필요한 입력 데이터를 생성하고, DPS의 제어 알고리즘 및 성능을 평가할 수 있도록 모듈화 하였다. 이를 통해 DPS의 배치 및 용량결정과 여러 가지 제어 알고리즘의 테스트가 쉽게 이루어지도록 하였다. 실제 모델 선박을 이용한 시뮬레이션을 통해 개발된 프레임워크의 실효성을 검증하였으며 전체 작업에 걸리는 시간이 50% 이상 감소하는 것을 확인하였다.
In general, the line balancing problem is defined as of finding an assignment of the given jobs to the workstations under the precedence constraints given to the set of jobs. Usually, the objective is either minimizing the cycle time under the given number of workstations or minimizing the number of workstations under the given cycle time. In this paper, we present a new type of an assembly line balancing problem which occurs in an electronics company manufacturing home appliances. The main difference of the problem compared to the general line balancing problem lies in the structure of the precedence given to the set of jobs. In the problem, the set of jobs is partitioned into two disjoint subjects. One is called the set of fixed jobs and the other, the set of floating jobs. The fixed jobs should be processed in the linear order and some pair of the jobs should not be assigned to the same workstations. Whereas, to each floating job, a set of ranges is given. The range is given in terms of two fixed jobs and it means that the floating job can be processed after the first job is processed and before the second job is processed. There can be more than one range associated to a floating job. We present a procedure to find an approximate solution to the problem. The procedure consists of two major parts. One is to find the assignment of the floating jobs under the given (feasible) assignment of the fixed jobs. The problem can be viewed as a constrained bin packing problem. The other is to find the assignment of the whole jobs under the given linear precedence on the set of the floating jobs. First problem is NP-hard and we devise a heuristic procedure to the problem based on the transportation problem and matching problem. The second problem can be solved in polynomial time by the shortest path method. The algorithm works in iterative manner. One step is composed of two phases. In the first phase, we solve the constrained bin packing problem. In the second phase, the shortest path problem is solved using the phase 1 result. The result of the phase 2 is used as an input to the phase 1 problem at the next step. We test the proposed algorithm on the set of real data found in the washing machine assembly line.
본 연구는 해양에 유입되는 부유폐기물을 효과적으로 수거할 수 있는 시스템을 개발하고자, 우기철에 폐기물의 성상을 조사한 전보의 예비조사와 기초실험 결과를 바탕으로 각 장치의 구조와 규격을 확정하고 해상에서 그 성능 검증을 수행하였다. 그 결과 본 시스템의 구집기구는 전개장치의 전개력에 의해 선박 진행시 1회에 수평방향으로 15m이상의 해역을 소해하는 것으로 나타나 현행 폐기물 수거선박보다는 수거 효율이 매우 높았으며, 폐기물이 최종적으로 유입되는 Net의 수면상 높이는 예인속도 5kt이내에서 50cm이상을 유지하여 폐기물의 유입성능이 우수함을 알 수 있었다. 또한 부유 폐기물 수거실험에서는 매 실험 당 평균 약 200kg 정도의 폐기물이 그물망을 가득 채워 본 연구에서 고안한 수거시스템의 성능은 매우 양호한 것을 확인할 수 있었다.
해중철도 부근에서 테러나 사고에 의해 수중폭발이 발생하였을 경우, 함체에 치명적인 손상을 가할 수 있으므로, 충분한 강도를 확보해야 한다. 본 연구에서는 설계 목적으로 해중철도 인근에서 수중폭발이 발생한 경우, 경험에 기초한 공식을 이용하여 충격압을 추정하고, 충격압에 의한 해중철도의 응답을 해석할 수 있는 간이 해석 방법을 제안하였다. 해중철도 함체를 탄성 지지된 보로 이상화하고, 초기 최대 충격압이 작용하는 보에 대해 정적 유한요소해석을 실시한 후, 동하중 계수와 조합함으로 최대 변위 및 굽힘 모멘트를 계산한다. 간이해석 결과는 상용 유한요소해석 소프트웨어를 이용한, 시간에 따른 과도응답해석 결과와 비교하여 양호한 일치를 보임을 확인하였다.
본 논문에서는 고성능 수퍼스칼라 마이크로프로세서에 적합하고, IEEE 754 표준을 준수하는 고성능 부동 소수점 유닛의 구조를 설계한다. 부동 소수점 AU에서는 비정규화 수 처리를 모두 하드웨어적으로 지원하면서 추가적인 지연 시간이 생기지 않도록 점진적 언더플로우 예측 기법을 제안 구현한다. 부동 소수점 제산/제곱근기는 기존의 고정적인 길이의 몫을 구하는 방식과 달리 매 사이클마다 가변적인 길이의 몫을 구하는 구조를 채택하여 성능과 설계 복잡도 면에서 SRT 알고리즘에 의한 구현 보다 우수하도록 설계한다. 또한, 수퍼스칼라 마이크로프로세서에 이식이 용이하도록 익셉션 예측 기법을 세분화하여 적용하며, 제산 연산에서의 익셉션 예측에 필요한 스톨사이클을 제거하도록 한다. 설계된 부동 소수점 AU와 제산/제곱근기는 부동 소수점 유닛의 구성요소인 명령어 디코더, 레지스터 파일, 메모리 모델, 승산기 등과 통합되어 기능과 성능을 검증하였다.
Recently, many complex DSP (Digital Signal Processing) algorithms have being realized on RISC CPU due to good compilation, low power consumption and large memory space. But, real-time implementation of multiple DSP algorithms on RISC requires the minimum and efficient memory usage and the lower occupancy of CPU. In this thesis, the original floating-point code of MPEG-1 audio decoder is converted to the fixed-point code and then optimized to the efficient assembly code in time-consuming function in accord with RISC feature. Finally, compared with floating-point and fixed-point, about 30 and 3 times speed enhancements are achieved respectively. And 3~4 times memory spaces are spared.
Finite wordlength effects of the FS-1016 CELP(Code Excite Linear Prediction) vocoder algorithm) is analyzed, and a block floating-Point implementation method is employed to improve the fixed-point performance. An efficient run-time integer wordlength estimation algorithm is developed, and the overall system performance. An efficient run-time integer wordlength estimation algorithm is developed, and the overall system performance is verified in real-time using a TMS320C50 emulation board. Autoscaler software that conducts simulation-based automatic scaling to provide a floating-point like programming environment is used for this application development.
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[게시일 2004년 10월 1일]
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