• 한국정보통신학회:학술대회논문집
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• 한국해양정보통신학회 2007년도 춘계종합학술대회
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• pp.175-178
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• 2007

3GPP에서는 이동망에서 QoS를 관리하기 위하여 트래픽 조절기가 포함된 QoS 구조에 대해서 정의하고 있다. 본 논문에서는 3GPP에서 정의하는 트래픽 조절기에 적용 가능한 영상 전송 알고리즘을 제안한다. 제안하는 알고리즘은 토큰 버킷을 이용하여 가변적인 트래픽을 제어하는 트래픽 조절기에서 영상의 품질 변화를 최소화 한다. 제안하는 알고리즘은 반복적인 최적화 방법을 사용하지 않고 프레임 레이어에서 전송률을 제어하는 방법으로 영상 프레임간의 왜곡의 변화를 최소화한다. 그리고 전처리가 필요하지 않은 슬라이딩 윈도우 기법을 사용하기 때문에 영상을 압축할 때 추가적인 지연을 발생시키지 않는다. 따라서 제안하는 알고리즘은 낮은 계산량을 필요로 하는 실시간 영상 코덱에 적당한 알고리즘이다.

• 한국정보통신학회논문지
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• 제20권7호
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• pp.1229-1236
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• 2016

수중 음향 다중경로 채널에서 수중음향 통신 시스템의 성능은 채널의 시변적 경계면 상태 변동에 의해 영향을 받는다. 이러한 채널에서 시공간적 변동에 의해 송신 신호와 수신 신호의 위상과 주파수가 일치하지 않아 반송 주파수 옵셋이 발생되고 위상편이키잉 방식의 수중음향통신시스템의 성능을 저하시킨다. 본 논문에서는 수중 음향 통신 채널의 시 공간적 변동 채널에서 위상 코드를 적용한 반송 주파수 옵셋 보상 추정 기법의 성능을 평가하였다. 위상 코드는 주파수 옵셋을 추정하고 보상하기 위한 코드로 CAZAC를 적용하였으며, 실내 수조에서 성능을 평가하였다. QPSK 시스템에 위상코드를 적용한 결과는 적용하지 않은 경우보다 약 4-6배 비트오류율이 개선되었다.

• 대한전자공학회논문지TC
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• 제39권4호
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• pp.173-179
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• 2002

본 논문은 DFE (Decision Feedback Equalizer)구조와 CMA (Constant Modulus Algorithm), 그리고 LMS (Least Mean Square) 알고리즘을 이용한 등화기에 대하여 기술한다. DFE 구조는 기존의 transversal 구조의 등화기에 비하여 빠른 채널 적응 속도와 낮은 BER (Bit Error Rate) 값을 가지며 ISI(Intersymbol Interference)가 심한 환경에서도 좋은 성능을 나타낸다. 본 등화기는 16/64 QAM(Quadrature Amplitude Modulation) 변복조 방식에 적용할 수 있으며, 고속으로 동작할 수 있도록 고속의 곱셈기와 많은 수의 CSA (Carry Save Adder)를 사용하였다. COSSAP/sup TM/ 캐드 툴을 사용하여 부동 소수점 모델과 고정 소수점 모델을 개발하였으며, VHDL 모델을 개발하였다. 시뮬레이션 결과에 따라 feedback 부분과 feedforward 부분에 각각 12개와 8개의 탭을 사용하였으며, 다중 경로 페이딩 채널에서 BER이 10-6일 때를 기준으로 보면 등화기를 사용하지 않은 채널의 BER 보다 SNR(Signal to Noise Ratio)이 4dB 정도 향상되었다. SYNOPSYS/sup TM/ 캐드 툴과 삼성의 0.5 ㎛ standard cell library (STD80) 를 이용하여 로직 합성을 수행하였으며, 전체 게이트 카운트는 약 13만개를 보였다.

• 디지털콘텐츠학회 논문지
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• 제12권4호
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• pp.485-490
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• 2011

스무딩은 가변 비트율로 저장된 비디오 데이터를 클라이언트로 전송할 때 일련의 고정 비트율로 전송할 수 있도록 전송 계획을 세우는 것으로 이러한 스무딩 알고리즘에는 CBA, MCBA, MVBA 등이 있다. 그러나, 이 알고리즘들은 프레임 단위로 전송 계획을 세우므로 프레임 버스트 또는 GOP 버스트가 발생할 수 있다. 이를 개선하기 위하여 MVBAG 알고리즘에서는 GOP 단위로 전송률을 계산한다. 그러나, 이 알고리즘에서는 계산된 전송률보다 급격히 프레임의 크기가 작거나 큰 경우에는 QoS를 보장하지 못할 수 있다. 본 논문에서는 MVBAG 알고리즘의 문제점을 개선하는 알고리즘을 제안하고 QoS를 만족시키지 못하는 프레임 개수, 프레임당 평균 전송률 변화량, GOP당 평균 전송률 변화량과 같은 평가 요소를 사용하여 성능을 평가한다. 실험 결과, 제안 알고리즘은 QoS를 만족하는 프레임 개수 비교에서 우수함을 보인다.

• 한국환경과학회지
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• 제25권2호
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• pp.231-238
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• 2016

In this study, we have investigated to find optimal pre-treatment flocculation condition by analyzing the floc growth rate with mixing conditions and the membrane permeation flux for pre-treatment step of the membrane process. The higher mixing intensity showed a constant floc size index (FSI) values, and lower mixing intensity increased the degree of dispersion of the FSI values. Results of comparing the distribution characteristics of the FSI value and the permeation flux were more effective in increasing flux when the FSI values were 0.2 or higher. The degree of dispersion of FSI was relatively large in 40 rpm mixing condition compared to 120 rpm. In 40 rpm mixing condition, it decreased the permeation flux compared to 120 rpm because various sizes of flocs were distributed. Coagulation-UF membrane process enhanced 30%~40% of the flux rate compare to UF alone process, and the coagulation-MF process increased up to 5% of the flux rate compare to MF alone process. Pre-treatment, that is, coagulation process, has been found to be less effects on relatively larger pore size for MF membrane. For UF membrane, the flux was a little bit same when applying only the rapid mixing process or rapid mixing with slow mixing processes together. In case of MF membrane, the flux was improved when rapid mixing process applied with slow mixing process together.

• 한국정보통신학회논문지
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• 제20권1호
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• pp.123-130
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• 2016

본 논문에서는 멀티미디어용 알고리즘을 고속으로 처리하기 위한 고성능 연산 회로를 설계하였다. 3단 파이프라인 구조로 동작하는 연산회로는 4개의 16-비트${\times}$16-비트 곱셈기의 효율적인 구성, 캐리 보존 형식 데이터에 대한 새로운 부호 확장 기법과 다수 개의 부분 곱셈 결과의 통합과정에 부호 확장을 제거하는 교정 상수 기법을 사용하여 복소수 데이터와 가변 길이 고정 소수점 데이터에 대한 38개의 연산을 처리할 수 있다. 설계한 프로세서는 45nm CMOS 공정에서 최대 동작 속도는 300 MHz이며 약 37,000 게이트로 구성되며 300 MCOPS의 연산 성능을 갖는다. 연산 프로세서는 높은 연산 속도와 응용 분야에 특화된 다양한 연산 지원으로 멀티미디어 프로세서에 효율적으로 응용 가능하다.

• 대한전자공학회논문지TC
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• 제43권12호
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• pp.31-41
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• 2006

이동통신망을 통한 인터넷 접속은 제한된 대역폭 및 무선 접속 링크에서의 높은 bit 오류율로 인하여 병목현상을 야기시킨다. 이러한 병목현상에 따른 TCP 통신의 성능저하를 막기 위해 TCP 연결의 여러 파라미터를 최적화시키는 작업은 필수적이다. 본 논문에서는 모바일 컨텐츠 서버와의 통신시에 무선링크의 이용 효율을 최대화시키기 위한 최적의 TCP 세그먼트 길이에 대한 알고리즘을 제시한다. 또한 본 논문에서는 제시된 알고리즘에 대한 몇 가지의 예를 제시한다. 제시된 예에서 보듯이 TCP 세그먼트 길이는 TCP 윈도우 사이즈가 어느 임계값 이상이 되면 더 이상 변하지 않고 고정된 값을 갖음을 알 수 있다. 본 논문의 결과를 이용하면, 단순히 TCP 세그먼트 길이만을 조정하므로서, 모바일 컨텐츠 서버 접속시에, 값비싼 무선 링크의 이용 효율을 최대화시킬 수 있을 것이다.

• 대한전자공학회논문지TC
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• 제49권8호
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• pp.1-11
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• 2012

직교코드를 다중화하여 데이터 비트열을 확산시켜 전송하는 멀티코드 대역확산 통신 시스템은 고속의 데이터 전송에도 높은 확산이득을 유지할 수 있다는 장점이 있다. 그러나 여러 코드의 합을 더해서 전송하는 송신기의 구조 상 송신기 출력의 진폭 변화가 커서 선형성이 좋은 증폭기가 요구된다는 단점이 있다. 이러한 단점을 극복하기 위하여 Walsh 코드를 확산코드로 사용하고 부호화 하는 방식을 사용하여 송신기 출력의 진폭을 일정하게 만드는 시스템이 제안되었으며, 최근에는 확장 m-시퀀스를 확산코드로 사용하는 정진폭 멀티코드 대역확산 통신 시스템이 제안되어 있다. 이 시스템에서 전체 코드집합을 4개로 분할하여 코드 선택을 하고 부호화하는 방식을 사용하면 송신기의 구조가 간단해지고 수신기에서 복호를 위한 연산량이 크게 감소한다. 코드집합 분할 방식을 적용한 확장 m-시퀀스 기반 시스템에서 정진폭 부호화를 위해 송신기에서 추가로 전송하는 동반 코드를 수신기에서 검출하여 다른 코드와 함께 패리티 검사를 함으로써 코드검출 오류를 보정하여 비트오율 성능을 개선시킬 수 있다. 본 논문에서는 기존에 제안된 패리티 검사 기반 수신기에 비해 비트오율 성능이 우수한 개선된 패리티 검사 기반 수신기 구조를 제안하고, 시뮬레이션을 통하여 성능을 비교 분석하였다.

• 한국전자파학회논문지
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• 제15권3호
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• pp.265-270
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• 2004

본 논문에서는 group delay가 위성 통신 시스템에 미치는 영향을 분석한다. 일정한 상수가 아닌 group delay에서는 신호의 위상 왜곡이 발생한다. Group delay는 특성에 따라 linear, parabolic, cubic으로 모델링할 수 있다. 각각의 group delay 특성을 위성통신 시스템에 적용하여 BER(bit error rate)을 분석한다. Group delay는 신호의 대역폭이 커질수록 신호에 미치는 영향이 커지는 특성을 갖고 있으며, 위성 통신 시스템의 정보 전송속도가 1Mbps, 4Mbps, 8Mbps 의 세 가지인 경우에 대하여 BER을 분석한다. 이때 channel coding으로는 구속장이 7이고, code rate 1/2인 convolution coding과 7/8 punctured convolution coding 를 이용한다. BER = $10^{-5}$을 만족하는 요구 SNR을 관찰하였을 때, group delay의 영향을 받는 데이터는 group delay의 영향을 받지 않은 데이터에 비해 요구 SNR은 최소 0.3㏈에서 최대 4.4㏈으로 증가한다. 이들 중 group delay에 의한 영향이 가장 큰 경우는 group delay의 특성이 linear 특성이고 channel coding이 7/8 puncture convolution coding, 전송속도가 8 Mbps인 경우로서 이때 요구 SNR은 4.4㏈증가한다.

• JSTS:Journal of Semiconductor Technology and Science
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• 제16권3호
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• pp.274-286
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• 2016

This paper presents a 4-channel multi-rate vertical-cavity surface-emitting laser (VCSEL) driver. In order to keep the output power constant with respect to the process, voltage, temperature (PVT) variations, this research proposes automatic power and magnitude. For the fast settling time, the high-speed 10-bit time-interleaved Flash-successive approximation analog to digital converter (Flash-SAR ADC) is proposed and shared for automatic power and magnitude calibration to reduce the die area and power consumption. This chip is fabricated using $0.13-{\mu}m$ CMOS technology and the die area is $4.2mm^2$. The power consumption is 117.84 mW per channel from a 3.3 V supply voltage at 10 Gbps. The measured resolution of bias /modulation current for APC/AMC is 0.015 mA.