• 대한전자공학회:학술대회논문집
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• 대한전자공학회 2006년도 하계종합학술대회
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• pp.511-512
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• 2006

Three stage(CIC-FIR-FIR) decimation filter in delta-sigma A/D converter for audio is designed. A canonical signed digit(CSD) code method is used to minimize area of multipliers. This filter is designed in 0.25um CMOS process and incorporates $1.36\;mm^2$ of active area. Measured results show that this decimation filter is suitable for digital audio A/D converters.

• 한국인터넷방송통신학회논문지
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• 제10권3호
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• pp.43-50
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• 2010

무선통신 시스템마다 다르게 적용되는 주파수를 해당 통신 규격에 따라 변환하는 기술인 DDC(Digital Down Converter)는 향후 통신 기술 발달을 위해 필요한 기술로 무선 통신 및 SDR(Software Defined Radio) 시스템에서 필수적인 구성 요소로 인식되고 있다. 또한, 주파수 자원 부족 현상으로 인해 기존 서비스에 간섭을 주지 않고 효율적인 통신 환경을 구성하는 스펙트럼 센싱에 대한 연구가 이루어지고 있다. 본 논문에서는 DDC 시스템을 구성하는 CIC(Cascaded Integrator Comb) 필터, WDF(Wave Digital Filter), SRC(Sample Rate Conversion)의 각 모듈을 세부적으로 분석하였으며, 주파수의 사용 효율을 높이기 위해 DDC 시스템과 스펙트럼 센싱을 효과적으로 연동하는 방안을 제안하고 모의실험에서 검증하였다. 모의실험결과 DDC 시스템의 각 모듈에 스펙트럼 센싱 기능을 적용하여 성능 및 복잡도의 결과를 도출하여 제안한 시스템의 결과를 확인하였다.

• ETRI Journal
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• 제26권6호
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• pp.555-559
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• 2004

We propose an efficient digital IF down converter architecture for dual-mode WCDMA/cdma2000 based on the concept of software defined radio. Multi-rate digital filters and fractional frequency conversion techniques are adopted to implement the front end of a dual-mode receiver for WCDMA and cdma2000. A sub-sampled digital IF stage was proposed to support both WCDMA and cdma2000 while lowering the sampling frequency. Use of a CIC filter and ISOP filter combined with proper arrangement of multi-rate filters and common filter blocks resulted in optimized hardware implementation of the front end block in 292k logic gates.

• 대한전기학회:학술대회논문집
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• 대한전기학회 2006년 학술대회 논문집 정보 및 제어부문
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• pp.388-390
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• 2006

This paper presents a hybrid SoC design for phase detection of single tone signal. The designed hybrid SoC is composed of three functional blocks, i.e., an analog to digital converter module, a phase detection module and a controller module. A design of the controller module is based on a 16-bit RISC architecture. An I/O interface and an LCD control interface for transmission and display of phase measurement values are included in the design of the controller module. A design of the phase detector is based on a recursive sliding-DFT. The recursive architecture effectively reduces the gate numbers required in the implementation of the module. The ADC module includes a single-bit second-order sigma-delta modulator and a digital decimation filter. The decimation filter is designed to give 98dB of SNR for the ADC. The effective resolution of the ADC is enhanced to 98dB of SNR by the incorporation of a pre FIR filter, a 2-stage cascaded integrator- comb(CIC) filter and a 30-tab FIR filter in the decimation. The hybrid SoC is verified in FPGA and implemented in 0.35 CMOS Technology.

• 한국정보통신학회논문지
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• 제14권8호
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• pp.1776-1782
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• 2010

간섭형 Fiber optic gyroscope(FOG)는 Sagnac 효과를 이용한 회전센서로 알려져 있으며, 성능 개선을 위한 연구가 수행되어 왔다. 본 논문은 개루프 방식의 FOG 개발과 FPGA를 이용한 디지털 신호처리 기술을 다루고 있다. 첫 번째 목표는 양호한 bias stability(0.22deg/h), Scale factor stability, 단일모드 광섬유를 이용한 낮은 Angle randomwalk(0.07deg/$\sqrt[]{h}$)와 저가의 중급 자이로(Pointing grade)의 설계를 목표로 하고 있다. 두 번째 목표는 광검출기의 출력신호를 고속 ADC로 직접 변환 후 디지털 신호처리를 하는 FOG용 FPGA 개발이다. 본 연구에서 사용한 Cascaded integrator-comb(CIC)타입의 데시메이션 필터는 Adder와 Shift register만으로 구성되어 적은 계산량을 요구하므로 모든 디지털 FOG 프로세서를 저가의 프로세서로도 사용이 가능하다.

• 한국항행학회논문지
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• 제11권1호
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• pp.9-16
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• 2007

본 논문에서는 VDL(VHF Digital Link) 모드-2에 적용되는 D8PSK 변조 방식의 비트 오율(BER)을 송 수신기간 채널 필터의 정합여부 그리고 반송파 주파수 및 위상 오프셋에 따른 영향을 분석하였다. 일반적으로 디지털 전송 방식에서는 채널 필터로 Root Raised Cosine 필터를 송신기와 수신기에 모두 적용하여 ISI 경감 효과를 얻는다. 그러나 VDL 모드-2에서는 송신기에만 Raised Cosine 필터를 사용하고 수신기에서는 저역통과필터(LPF)를 사용하기 때문에 ISI 경감 효과는 없으나 스펙트럼 특성은 더 좋아진다. 모의실험 결과 비정합 채널 필터의 사용으로 오류 확률이 약간 증가(1~2dB)함을 확인 하였고, 반송파 위상 오프셋은 비트 오율에 대해 영향이 거의 없으나, 주파수 오프셋의 영향은 심각하다는 결론을 얻었다. 그리고 협대역(Narrow Band) D8PSK 변조 신호를 디지털 방식으로 생성하고 아날로그 방식과 비교하였다.

• 한국산학기술학회논문지
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• 제18권5호
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• pp.336-342
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• 2017

최근 해양 자원 개발뿐만 아니라 지구 온난화에 따른 해양 환경 모니터링 및 해양 재난 대비 등을 위하여 수중 무선통신에 대한 연구가 요구되고 있다. 대부분의 수중 무선 통신에서는 수중에서의 매질 특성 및 환경 변화 특성을 고려하여 수십 KHz 대역의 음파를 이용하며, 특히 DSP를 비롯한 프로세서를 기반으로 하여 모뎀 연구가 진행되고 있다. 본 연구에서는 수중 관측 및 제어를 위한 수중 음향 통신 시스템 중 수중기지제어국과 수중기지국 간의 음향 통신을 위한 Digital Up Converter(DUC)와 Digital Down Converter(DDC)를 연구하였다. 수중 음향 통신 시스템은 사용 환경의 제약 때문에 소형 및 저전력 시스템을 추구한다. 따라서, 본 연구에서는 DUC 및 DDC 전용 하드웨어 모듈을 설계하였다. 수중 음향 통신 시스템의 4개의 링크를 지원하며, 각각 샘플링 레이트 및 주파수를 변환하였다. Verilog-HDL를 사용하여 설계하였으며, ModelSim 환경에서 수중 음향 통신 시스템의 베이스밴드 신호를 이용하여 동작을 검증하였다.