하드웨어 기반 동적 전압 및 주파수 제어 시스템은 전역 비동기 지역 동기 시스템 설계 방식을 이용하여 동종의 멀티 코어 혹은 이종의 멀티 코어 시스템을 저전력으로 설계하기 위한 핵심 기술 중의 하나이다. 본 논문에서 하드웨어 기반 동적 주파수 제어 시스템의 FPGA 프로토타입 설계를 위해서 동적 주파수 제어기를 제안하고, 이를 FIFO 기반 멀티코어를 이용한 소프트웨어 정의 무선 설계와 네트워크 온 칩 기반의 하드웨어 HPEG2 인코더 설계에 적용하였다. 기존의 단일 주파수 시스템에 비해서 소프트웨어 정의 무선 설계의 경우 성능이 5.9% 하락하였지만, 전력소모는 78% 감소하였다. MPEG2 인코더 설계의 경우에 성능은 0.36% 하락하고 전력소모는 29.1% 감소하였다.
A discrete event systems (DES) is a physical system that is discrete in time and state space, asynchronous (event rather than clock-driven), and in some sense generative(or nondeterministic). This paper presents the design of fifteen modular supervisors to control an experimental CIM testbed. These supervisors are nonblocking, controllable and nonconflicting. After verification of the supervisors by simulation, the supervisors for AGV system have been implemented to demonstrate their efficacy.
Orthogonal Variable Spreading Factor codes are used as channelization codes in WCDMA. In this particular paper, we present a new OVSF codes which is generated from the Jacket Matrices for DS-CDMA systems. The simulations result shows that the purposed OVSF can efficiently reduce the peak values of the correlations than the conventional HOVSF without orthogonality loss. It will be useful to detect the multi-user system under the asynchronous system and save the power of transmission.
A wireless communication module for multiple nearfiled measurement and control module was developed. The function of the developed system are dual communication, concurrent multiple communication, PLC control, and A/D, D/A converting. The multiple communication approach is based on master-slave with sub-polling scanning concept.
본 논문에서는 서로 다른 네트워크간의 다양한 프로토콜과 이종의 트래픽을 동시에 처리할 수 있는 네트워크용 SoC (System-on-a-Chip) 프로세서를 구현하였다. 제작된 네트워크 SoC 프로세서는 ARM 프로세서 코어와 ATM(Asynchronous Transfer Mode) 블록, 10/100 Mbps 이더넷 볼록, 스케쥴러, UART 등을 이용하였고 각 블록은 AM8A (Advanced Microcontroller Bus Architecture) 버스로 연결하였다. SoC 프로세서는 CADENCE사의 VerilogHDL을 이용하여 설계하였고 0.35$\mu\textrm{m}$ 셀 라이브러리를 이용하여 검증하였다. 구현된 칩은 총 게이트수가 312,000개이며 칠의 최대 동작 주파수는 50MHz 이다.
비동기 양상태 소나는 음원 방향에서 수신되는 직접파를 탐지하고 직접파가 수신된 시간을 추정하여 반사파의 거리를 산출한다. 따라서 동기식에 비해 직접파 수신 시간 추정 오차가 표적 거리 추정 오차에 더하여 나타난다. 특히, 직접파는 다중경로 신호에 의해 정합필터 출력이 여러 개의 첨두치로 나타나는데 문턱치를 넘는 첫 번째 첨두치로 직접파 도달시간을 추정하는 기법과 가장 큰 첨두치로 직접파 도달시간을 추정하는 기법에 대하여 분석하였다. 실험은 공간적으로 분리된 음원과 해저에 매설된 선배열 수신센서로 구성된 양상태 소나를 이용하여 모의 반향기에서 반향되는 유사 표적 신호를 획득하는 방식으로 진행되었다. 실험결과 첫 번째 첨두치로 직접파 도달시간을 추정하는 기법이 표적 거리 추정 오차가 더 작은 것을 확인하였다. 도출된 결과는 비동기 양상태 소나의 표적 추적 기법에 활용할 예정이다.
고정형 센서 노드(고정노드)와 이동형 센서 노드(이동노드)가 상존하는 형태로 무선 센서 네트워크를 구축할 경우 고정노드는 단위공간의 환경 데이터 수집 및 이동 노드를 위한 액세스 포인트 역할, 그리고 이동노드는 이동체에 부착하여 이동체의 실시간 위치인식 및 이동체 내부 상태 정보 실시간 감시가 가능해져 다양한 새로운 서비스가 창출될 수 있다. 이러한 환경에서 이동노드 간 메시지 전송 서비스는 중요한 핵심기술 이나 기존 센서 네트워크 환경에서 이동노드들의 위치 변화는 빈번한 네트워크 토폴로지 재구성을 유발하여 불안정한 통신 환경과 낮은 메시지 전송율의 문제점을 가지고 있다. 본 논문에서는 다수 이동노드의 이동성을 보장하면서 고정 노드를 경유하는 이동노드 간 비동기 메시지 전송의 확률을 높이기 위한 세 가지 방법을 제안한다.
본 논문에서는 비동기 논리 회로 합성을 위해서 신호천이 그래프 상에서 직접 펑션 해저드를 제거하고 신호선의 추가에 따른 면적의 오버헤드를 최소화하는 새로운 알고리듬을 제안한다. 기존의 펑션 해저드 제거방법은 신호선 사이의 전이 관계를 나타내는 신호천이 그래프로부터 상태를 할당하여 얻어지는 상태 그래프를 이용하였다. 이 방법은 해저드의 제거를 위해 동기 시스템에서 사용하는 방법을 그대로 적용할 수 있으나, 상태 그래프의 구성과 조작에 많은 시간이 소요되는 단점이 있다. 이에 따라 신호천이 그래프를 직접 이용하는 방법이 제시되었으나 해저드의 제거에 따른 면적의 오버헤드는 고려되지 않았다. 본 논문에서는 신호천이 그래프로부터 직접 해저드를 제거함으로써 기존의 상태 그래프를 이용하는 방법에 비해 계산량을 줄이고, 추가되는 신호를 구현하기 위한 논리회로의 크기는 최소항과 적항의 개수를 조절하여 최소화하였다. 제안하는 알고리듬을 벤치마크 데이터로 실험한 결과 면적의 오버헤드가 평균 15%이상 감소함을 확인하였다.
본 논문은 동기식 이더넷 시스템의 구현 시 고려해야 할 다음과 같은 두 가지의 사항에 대한 해결방안을 제시한 것이다. 첫째, 실시간 및 비실시간 트래픽을 모두 지원하기 위하여 일정주기의 사이클 기반으로 동작하는 동기식 이더넷 시스템은 이미 송신이 진행 중인 비실시간 프레임 때문에, 사이클의 시작 시점이 지연됨으로서 실시간 트래픽의 전송이 지연되는 문제점을 가지고 있다. 이 점에 착안하여, 기존 방식의 지터 성능을 분석한 후, 다음 사이클의 시작 시점을 참조하여 비실시간 프레임을 여러 사이클에 분할하여 전송함으로써 실시간 트래픽에 대하여 지터가 전혀 없는 엄격한 전송을 보장하는 방법을 제안하고, 또 다른 지터 억제 방식인 전송보류(hold) 방식과의 프레임 전송지연 특성을 비교 분석하였다. 두 번째는 한 사이클 내의 실시간 트래픽 전송 구간에는 비실시간 프레임을 전승할 수 없기 때문에, 신속히 송신되어야 할 링크 계층에서의 흐름제어용 IEEE 802.3x 중지(pause) 프레임의 전송이 지연됨으로써 과도한 비실시간 프레임의 손실을 초래하는 문제점이 있다. 이 점에 착안하여 실시간 트래픽 전송 구간에서도 흐름제어용 프레임의 전송을 허용하도록 하는 새로운 흐름제어 방법을 제안하고 이에 따른 비실시간 트래픽의 손실률을 분석하였다.
본 논문에서는 직교 주파수 분할 다중화 기법을 이용하는 비동기 협력 통신 시스템에서 낮은 릴레이 복잡도를 갖는 새로운 Alamouti 시공간 전송 기법을 제안한다. 기존 기법은 릴레이 노드에서의 상수 곱 연산 외에도 추가적인 시간 반전 연산을 필요로 하므로 릴레이 노드에서의 시스템 복잡도가 크다는 문제점을 가지고 있다. 이와 달리 제안한 기법은 소스 노드에서의 간단한 심볼 조합과 릴레이 노드에서의 상수 곱만을 이용하여 목적지 노드에서 Alamouti 부호 구조를 획득함으로써 2차 다이버시티 이득을 달성한다. 모의실험 결과를 통하여 제안한 기법이 2차 다이버시티 이득을 달성하며, 릴레이 노드의 복잡도를 줄이면서도 기존 기법과 동일한 비트오류율 성능을 갖는 것을 확인한다.
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[게시일 2004년 10월 1일]
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