터빈은 원자력발전소의 주요기기로서 고온 고압하에서 고속회전으로 인해 신뢰성 있는 검사가 요구된다. 터빈의 가동중검사의 경우 블레이드가 조립된 상태에서 검사가 수행되며 구조적 복잡성으로 인하여 탐촉자의 접근이 제한되며, 신호 해석이 매우 어렵다. 본 연구에서는 신뢰성 높은 신호해석을 위하여 실제 터빈과 크기 및 형상이 동일한 mock-up을 제작하였다. 터빈의 key와 내표면부의 결함탐상을 위해 pulse-echo 및 TOFD 기법을 개발하였고, dovetail 검사를 위하여 위상배열 초음파탐상기법을 개발하였다. 개발된 기법들을 가동중 터빈 검사에 효율적으로 적용하기 위해 자동화 검사 scanner를 제작하였으며, 현장적용을 통하여 신뢰성을 검증하였다.
Recently, wave propagation imaging based on laser scanning-generated elastic waves has been intensively used for nondestructive inspection. However, the proficiency of the conventional software based system reduces when the scan area is large since the processing time increases significantly due to unavoidable processor multitasking, where computing resources are shared with multiple processes. Hence, the field programmable gate array (FPGA) was introduced for a wave propagation imaging method in order to obtain extreme processing time reduction. An FPGA board was used for the design, implementing post-processing ultrasonic wave propagation imaging (UWPI). The results were compared with the conventional system and considerable improvement was observed, with at least 78% (scanning of $100{\times}100mm^2$ with 0.5 mm interval) to 87.5% (scanning of $200{\times}200mm^2$ with 0.5 mm interval) less processing time, strengthening the claim for the research. This new concept to implement FPGA technology into the UPI system will act as a break-through technology for full-scale automatic inspection.
A torsional guided wave mode in a tubular structure has many advantages in obtaining a higher sensitivity and lower attenuation for a defect, because it shows no dispersion characteristics and no radial displacement for a tubular structure. Many attempts have been made to excite and receive torsional guided waves by conventional piezoelectric transducers, but only a few examples are used during a practical field inspection. In this study, an array of electromagnetic acoustic transducers (EMATs) were for an excitation and reception of the torsional guided waves in a pipe was designed and fabricated. The signal patterns were analyzed based on various beam path length. The feasibility of detecting the defects was investigated through a series of experiments with artificial notches on a pipe.
This paper proposes the self test method for 16 point FFT processor with systolic array architecture. To test efficiently and solve the increased hardware problems due to built-in self test, we change the normal registers into Linear Feedback Shift Registers(LFSR). LFSR can be served as a test pattern generator or a signature analyzer during self test operation, while LFSR a ordering register or a accumulator during normal operation. From the results of logic simulation for 16 point FFT processor by YSLOG, the total time is estimated in about. 21.4 [us].
International Journal of Naval Architecture and Ocean Engineering
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제12권1호
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pp.578-595
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2020
Submarine pressure hulls must withstand high hydraulic pressure and be free of defects. To improve the precision of defect detection, we herein examined different probes for optimal defect assessment by applying the Phased Array Ultrasonic Testing (PAUT) method. Two sets of probe design parameters were selected by considering pressure hull characteristics and analyzed through modeling. PAUT probes were applied, and defect assessment results were compared based on ultrasonic signals of various simulated defects in specimens designed to be the same as actual pressure hulls. The final selected design parameters for the submarine probe, which were designed to minimize the grating lobe of wave interference effect and improve the ultrasonic resolution of pressure hull welds, were identified through the experiment. The improvement in the probe's ability to detect defects in a pressure hull was verified. Furthermore, the accuracy of defect length measurement was improved, enhancing the applicability of the technique.
본 논문에서는 외부에서의 탐촉자 스캐닝이 어려운 금속배관의 긴 축방향 결함이나 두께감육 등과 관련된 건전성을 감시하기 위하여 펄스와전류 신호의 피크치와 피크(발생)시간을 이용하는 배열형 탐촉자를 제안하였다. 탐촉자는 관을 따라 외삽형 코일들을 배열하고, 금속배관의 상태를 반영하는 자계는 와전류에 의해 생성되는 자계이므로 원천자계가 직접적으로 센서신호에 영향을 미치는 것을 막기 위하여 코일의 외부를 페라이트로 차폐하였다. 여자코일과 센서코일은 자동적으로 연속해서 위치를 이동하게 되므로 사람이 직접 탐촉자를 주사할 필요는 없다. 두 코일의 위치가 고정되어 있을 때 센서에서 감지되는 펄스와전류 신호에서 피크치와 피크시간을 추출하고, 모든 위치에서 추출되는 이 데이터들을 축적하여 배열형 피크치 신호와 배열형 피크시간 신호를 생성하였다. 수치 모사는 시간영역은 후향차분법으로, 공간은 유한요소법을 사용하여 수행되었다. 모사 결과는 결함의 깊이나 길이가 증가함에 따라 펄스와전류 신호에서 피크치가 증가하며 피크는 더 일찍 나타난다는 것을 보여 주었으며, 이를 활용하여 본 연구에서 제안한 배열신호들은 배열형 탐촉자 내부에서 결함의 깊이나 길이 변화뿐만 아니라 결함의 위치를 반영하는데에도 탁월함을 증명하였다.
본 논문에서는 Monte-Carlo 방법으로 빔패턴 오차의 허용범위를 만족하는 개별소자의 허용오차를 규정하였다. 일반적으로 사용되는 통계적인 방법은 불규칙한 특성을 갖는 랜덤오차를 정규분포를 갖는 랜덤 변수로 모델링을 하여 개별소자의 오차범위를 규정하는데, 이러한 방법은 해석하고자 하는 배열소자의 개수증가에 따라 계산량이 지수승으로 늘어나게 되어 많은 소자배열에는 적합하지 않게 된다. 이러한 단점을 보완하기 위해서 이 논문에서는 Monte-Carlo 방법을 사용하여 배열소자의 증가에 따른 계산량의 증가를 줄이는 새로운 알고리즘을 제안하였다. 그리고 이렇게 규정된 오차의 범위를 간단한 모의실험을 통해서 검증하였다.
Flexible ECT (eddy current array) probe를 사용하여 판재 및 용접부에 존재하는 notch 결함을 MS-5800E와 OmniScan MX 장비로 검출능력을 비교하고, 주파수와 lift-off를 변수로 신호의 특성을 비교하고자 하였다. 실험 결과, 500, 1000, 1500 kHz를 사용하였을 때 notch 깊이가 증가할수록 신호의 진폭이 증가하는 것으로 나타났고, lift-off 변화에 따른 신호의 진폭은 선형적으로 감소하였다. 또한 용접부 결함은 probe와 시험체의 접촉면에 밀접한 관계가 있다. Probe와 시험체의 접촉면이 양호한 경우 검출감도가 우수하고 그렇지 않은 경우에는 검출감도가 떨어지는 것을 알 수 있었다.
Currently the variety of governmental business support and research for supplying solar energy have been actively progressed. As of now, however, There are no practical testing infrastructures of grid-connected photovoltaic system which test performance of solar power facility in domestic. Therefore, in KEPRI, there is in progress construction of practical testing ground of 500 kW class grid-connected PV System for developing the evaluation of the performance technology including the Module, PCS, and etc, that is the important instrument of the PV System, in Gochang area. It analyzed the site creation work for constructing the practical testing ground and new construction of control room and the unit standards, specifications and capacity of required equipment. For the system detailed design, configuration, instrument-specific parameters established, power generation predictions of Array Type and the components of testing ground are needed to build.
This paper presents the implementation of comparator which is self-testing with respect to the faults caused by any single physical defect likely to occur in NMOS and CMOS integrated circuit. The goal is to use it for the fault-tolerant system. First, a new fault model for PLA(Programmable Logic Array) is presented. This model reflects several physical defects in VLSI circuits. It focuses on the designs based on PLA because VLSI chips are far too complex to allow detailed analysis of all the possible physical defects that can occur and of the effects on the operation of the circuit. Second, this paper shows that these design, which has been implemented with 2 level AND-ORor NOR-NOR circuit, are optimal in term of size. And it also presents a formal proof that a comparator implemented using NOR-NOR PLA, based on these design, is sol f-testing with respect to most single faults in the presented fault model. Finally, it discusses the application of the self-testing comparator as a building block for the implementation of the fault-tolerant system.
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[게시일 2004년 10월 1일]
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