밀러 사이클은 흡입밸브 닫힘 시기 조정을 통해 압축비를 줄임으로써 NOx의 저감과 연료소비율 개선이 동시에 가능하다는 점(밀러 효과)에서 디젤엔진에 매우 활발하게 채택되어지고 있다. 밀러 사이클은 흡입 밸브를 BDC 이전에 닫는 Early 밀러 방식과 BDC 이후에 닫는 Late 밀러 방식으로 나눌 수 있다. 저속에서는 체적효율의 증가를 꾀할 수 있는 Late Miller가 유리한 반면, 중속, 고속에서는 IVC 이후 BDC 까지의 피스톤 하강 과정의 흡기의 팽창에 따른 내부 온도 감소 효과 높은 Early 밀러가 유리하다. 따라서 Early 밀러와 Late 밀러의 효과를 고려하여 운전 조건에 적합한 밀러 구현 방법을 채택할 필요가 있다. 본 연구에서는 4행정 엔진을 대상으로 2단 과급 시스템의 적용하고 흡·배기 밸브 오버랩(valve overlap)의 감소를 통해 밀러 효과를 강화하는 과정과 밸브 조정 기구를 통한 밸브 조건의 변화가 밀러 효과에 미치는 영향을 고찰하였다. 결과적으로 2단과급과 밀러사이클, 밸브 오버랩 감소와 흡입밸브 리프트 증가를 통해 연료소 비율과 최고연소온도 감소의 효과를 확인하였다.
본 연구에서는 천연가스 액화 플랜트 산업에서의 핵심 기술인 액화공정 개발을 위해 두 가지 2단 압축 방식의 액화 사이클의 성능을 시뮬레이션 하였다. Process1은 케스케이드 액화공정을 기초로 하여 프로판, 에틸렌, 메탄 사이클 모두 인터쿨러가 적용된 것이다. Process 2는 위의 공정에 메탄과 에틸렌 사이클 사이에 액-가스 열교환기를 적용하였고, Process 3은 위의 공정에 에틸렌과 프로판 사이클 사이에 액-가스 열교환기를 추가로 적용하였으며, 인터쿨러를 적용한 케스케이드 공정과 성능을 비교하였다. Process 2의 COP는 Process 1보다 14.0%정도 높게 나타났고, LNG 단위 생산량 당 소비 동력은 11.5% 정도 낮게 나타났다.
본 논문에서는 고성능 H.264/AVC 복호기 설계를 위해 디블록킹 필터의 수행시간 단축과 저전력 설계를 위한 필터링 순서 및 효율적인 메모리 구조를 제안하고 5단 파이프라인으로 구성된 필터의 설계에 대해 기술한다. 디블록킹 필터는 블록 경계에서 발생하는 왜곡을 제거하여 영상의 화질을 개선시키지만 하나의 경계에 여러 번 필터링을 수행하여 많은 메모리 접근과 반복되는 연산과정이 수반된다. 따라서 본 논문에서는 메모리 접근과 필터 수행 사이클을 최소화하는 새로운 필터 순서를 제안 하고 반복되는 연산의 효율적 관리를 위해 파이프라인 구조를 적용하였다. 제안하는 디블록킹 필터는 메모리 읽기, 임계값 계산, 전처리 연산, 필터 연산, 메모리 쓰기로 구성된 5단 파이프라인으로 구현되어 순차적인 필터 연산에 병렬적 처리가 가능하며 각 단계에 클록 게이팅을 적용하여 하드웨어 자원에 불필요한 전력을 감소시켰다. 또한, 적은 내부 트랜스포지션 버퍼를 사용하면서 필터링 순서를 효율적으로 개선하여 필터 수행을 위한 메모리 접근과 수행 사이클을 감소시켰다. 제안하는 디블록킹 필터의 하드웨어는 Verilog HDL로 설계 하였으며 기존의 복호기에 통합하여 Modelsim 6.2g 시뮬레이터를 이용해 검증하였다. 입력으로는 표준 참조 소프트웨어 JM9.4 부호기를 통해 압축한 다양한 QCIF영상 샘플을 사용하였다. 기존 필터들과 수행 사이클을 비교한 결과, 제안하는 구조의 설계가 비교적 적은 트랜스포지션 버퍼를 사용했으며 최소 20%의 수행 사이클이 감소함을 확인하였다.
In this paper, two different types of natural gas liquefaction process are simulated and designed for secure a competitiveness in the industry of natural gas liquefaction plant. These processes are based on basic cascade process, and one of these is improved with two staged intercooler and the other is modified two staged intercooler. These processes are compared characteristics of performance with basic process. COP of cascade process with two staged intercooler and modified two staged intercooler showed about 13.74% and 21.64% higher than basic process, and yield efficiency of modified process improved comparing with the basic process by 25.93% lower specific power, respectively.
본 논문에서는 반도체형 전력 증폭기의 바이어스를 개선하기 위하여 순차 제어 회로와 펄스 폭 가변 회로를 적용한 X-대역 60 W 고효율 전력 증폭 모듈을 설계하였다. 순차 제어 회로는 전력 증폭 모듈을 구성하는 각 증폭단의 GaAs FET의 드레인 전원을 순차적으로 스위칭하도록 회로를 구성하였다. 드레인 바이어스 전원의 펄스 폭을 RF 입력 신호의 펄스 폭보다 넓게 하여 전력 증폭 모듈의 입력 신호가 있을 때만 스위칭 회로를 순차적으로 구동시킴으로써 전력 증폭 모듈의 열화에 따른 출력 신호의 왜곡과 효율을 향상시킬 수 있다. 60 W 전력 증폭 모듈은 고출력 GaAs FET를 이용하여 전치 증폭단, 구동 증폭단과 주전력 증폭단으로 구성하였으며, 주전력 증폭단은 전력결합기를 이용한 평형증폭기 구조로 구현하였다. 설계된 전력 증폭 모듈은 9.2~9.6 GHz에서 듀티사이클 10 %로 동작시켰을 때 50 dB의 전력 이득, 펄스 주기 1 msec, 펄스 폭 100 us, 출력 전력 60 W에서 동작함에 따라 펄스-SSPA 형태로 반도체 펄스 압축 레이더 등에 적용할 수 있다.
본 논문에서는 필터 계수를 효율적으로 추출하기 위한 고성능 ALF(Adaptive Loop Filter)의 하드웨어 구조를 제안한다. HEVC의 ALF 기술은 고해상도 및 고화질의 영상을 높은 효율로 압축하고 주관적 화질을 향상시키기 위해 영상의 통계적인 특성을 이용한 필터 계수를 추출하여 필터링을 수행한다. 제안하는 ALF 하드웨어 구조는 필터 계수를 추출하기 위한 촐레스키 분해의 연산 관계를 분석하여 2단 파이프 구조로 설계함으로써 수행 사이클을 감소시켰다. 또한, 촐레스키 분해의 연산 과정에서 필요한 루트 연산은 멀티플렉서와 뺄셈기, 비교기 등을 이용하여 설계함으로써 적은 면적과 연산량, 복잡도를 갖는 하드웨어 구조로 설계하였다. 제안한 하드웨어는 Xilinx ISE 14.3 Vertex-7 XC7VCX485T FPGA 디바이스를 사용하여 합성한 결과 4K(3840x2160)@40fps의 영상을 실시간 처리할 수 있고, 최대 동작주파수는 186MHz이다.
콘크리트의 낮은 인장강도 및 균열제어 능력 등의 약한 재료성질을 개선하기 위하여 수년간 하이브리드 섬유보강 콘크리트에 관한 많은 연구가 진행되어 왔다. 그러나 비정질 강섬유와 유기섬유를 이용한 하이브리드 섬유보강 콘크리트에 관한 연구는 이루어지지 않은 실정이다. 따라서, 본 연구의 목적은 비정질 강섬유와 유기섬유로서 폴리아미드 섬유를 이용한 하이브리드 섬유보강 콘크리트의 압축강도, 장기 건조수축 및 내동해성을 평가하는 것이다. 이를 위하여 목표 압축강도 40 및 60 MPa 각각에 대해서 하이브리드 섬유 혼입률을 전체 체적비로 1.0%로 설정하여 비정질 강섬유와 폴리아미드 섬유를 이용한 하이브리드 섬유보강 콘크리트를 제작하였다. 제작된 하이브리드 섬유보강 콘크리트의 장기 건조수축 및 내동해성을 평가한 결과, 재령 365일 및 730일에서의 장기 길이변화율은 플레인 콘크리트보다 각각30%, 25% 이상 감소된 것으로 나타났으며, 동결융해 300 사이클 후의 내구성 지수는 90% 이상으로, 내동해성이 있는 것으로 나타났다.
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[게시일 2004년 10월 1일]
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