방전 현상을 에너지로 이용하여 금속을 가공하는, 특히 초경 및 난삭 소재의 가공과 정밀가공에 효과적인 방전가공 시 빠른 가공속도와 향상된 정밀도 및 면조도를 달성하기 위하여 효율적인 아크의 검출과 제어방법에 대해 연구하였다. 단일 방전 파형을 Td(Time-Delay), Ton(Time-on), Toff(Time-off)의 세 가지 구간으로 나누어 HDL 언어를 이용하여 게이트 제어 타이밍을 시뮬레이션 하고, 실제 방전가공기에 적용하여 파형을 실측하였으며, 비교기 회로를 통한 Td 구간의 샘플링을 통해 서보기구의 동작을 결정함으로써 전극과 가공물 간의 간격 제어와 가공 결과에 미치는 영향을 분석하였다. 분석결과 형성되는 파형의 Td 구간을 보다 정밀하게 고속으로 샘플링하여 이를 토대로 전극과 가공물 간의 gap 제어에 적용하였을 때 보다 향상된 결과를 나타내었다.
본 논문에서는 디지털 논리회로의 스캔(scan) 방식에 기초한 효율적인 테스터블(testable) 스캔 셀(cell)을 제안하며 타이밍과 관련된 지연고장(delay fault)을 검출하기 위한 Mux-based 스캔 셀 설계와 테스트방식을 제안한다. 이로 인해 설계와 검증 시 소요되는 테스트 시간과 비용을 단축하고, LOC(Launch-off-Capture)와 LOS(Launch-off-Shift)방식의 지연고장 테스트 방안도 제안한다. 제안된 테스트방식은 스캔 입력에서 거리가 먼 마지막 스캔 셀까지의 전역 제어신호(global control signal)가 늦게 도달하는 문제점을 클럭(clock) 신호를 이용하여 동기화시킴으로써 보다 빠르게 구동시켜 고속의 테스트가 가능하다. 또한, 테스트 벡터 입력 시 대상회로의 논리 값 인가를 차단하여 테스트 벡터 입력동안의 스캔 전력소모를 효과적으로 줄이도록 한다. 스캔 셀 설계의 논리 동작과 타이밍 시뮬레이션을 통해 제안된 방식의 동작을 증명 한다.
본 논문에서는 상향링크 협력 기지국 통신 시스템에서 사용자 간 시간 동기오차에 강한 OFDMA 기법을 제안한다. 상향링크에서는 하향링크와 달리 각 사용자 신호들의 신호가 각각 다른 타이밍으로 수신되어 간섭이 발생하는 문제점이 있다. 이러한 문제점을 해결하기 위해 각 사용자들의 신호의 송신 타이밍을 제어하는 과정이 필요하다. 하지만, 협력 기지국 통신에서는 각 기지국들에 대한 각 사용자의 상대적 위치가 각각 다르기 때문에 동기화 과정이 제대로 수행되기 어렵다. 즉, 한 기지국에 맞춰 각 사용자들의 동기화 과정을 수행하더라도 다른 기지국에서는 동기오차가 발생할 수밖에 없다. 본 논문에서는 한 칩의 시간 동기 오차가 존재하더라도 영상관도를 유지하는 ZCZ 부호를 시간축으로 스프레딩 하는 기법을 적용함으로써 상향링크 협력 시스템에서 모든 기지국에 대해 완벽한 동기화가 가능하게 한다. 제안하는 방식의 성능이 시간 동기 오차가 존재하지 않는 기존의 협력 기지국 OFDMA 기법의 성능에 도달함을 실험결과를 통해 보인다.
송수신(T/R) 모듈은 능동 위상 배열 시스템에서 핵심 부품이다. 현재 가장 널리 적용되고 있는 모듈 구조는 Brick 형태로서 이를 소형화 하는 것은 전체 시스템 구성의 유연성을 확보할 수 있는 중요한 요소가 된다. 소형화를 위하여 MMIC 갯수를 최소화 할 수 있는 Common leg 구조를 갖는 MFC(Multi Fuction Chip) 사용이 유리하며, 이득이 높은 T/R 모듈을 고밀도로 구현하기 위하여 송수신간 격리도의 확보가 필수적이다. 본 논문에서는 Common leg 구조에서 불가피하게 발생하는 궤환 경로 문제와 이로 인한 송수신 격리도의 한계를 개선하기 위하여 바이어스 전압 제어 방법을 제안하고, 측정 결과를 기반으로 최적 바이어스 타이밍을 설계하였다. 본 논문에서 제작/측정된 TR 모듈은 일반 T/R 모듈에 비하여 약 1/2의 크기($140{\times}80{\times}16mm^3$)를 가지며, 높은 출력(채널당 7 W)과 높은 송수신 이득(35 dB 송신 이득과 30 dB 수신 이득)의 구현이 가능하였다.
현재 교차로에서의 보행자 교통흐름이나 비동력차 교통흐름의 신호제어에 대한 연구는 비교적 적다. 교통 흐름 신호 제어의 최적화 방안을 연구하여 보행자, 비동력차, 자동차 등의 전체적인 교통 흐름을 조화롭게 통제할 수 있게 하는 것은 교차로의 정체 상황을 개선하는 데 중요한 의의가 있다. 교차로의 교통 최적화를 위해 본 논문은 채널화 최적화와 위상 설계의 두 가지 측면에서 출발하며, 교차로에서의 충돌점의 수를 공간적, 시간적 할당으로부터 각각 감소시킨다. 고전적인 신호 타이밍 방법을 이론적 기반으로하고, 교통 여행객의 안전과 시간 적 이익 보장을 목표로 교차로의 채널화 최적화 및 신호 제어 방안을 제안한다. 자동차, 비자동차, 보행자를 객체로 하는 교차로의 채널화 및 위상 설계방법에 대해 논의하고, 교차로의 채널화 최적화 개선 방안을 제안한다. 교차로 신호제어의 다목적 최적화 모델을 구축하였으며, NSGA-II 알고리즘을 기반으로 모델을 해결하였다.
본 논문에서는 (초)소형 위성에 탑재할 수 있는 영상레이다용 Backend 유닛의 제작 및 시험 결과를 제시한다. 영상레이다용 Backend 유닛은 (초)소형 위성 탑재를 목적으로 제어/저장보드, 송수신보드 및 전원보드를 하나의 박스 유닛으로 설계하였다. 제어/저장보드는 RFSoC를 이용하여 광대역 신호의 생성, 운용 타이밍 생성 및 영상레이다 운용을 위한 제어 및 연산을 수행하고, 자체적으로 저장기를 보유할 수 있도록 설계하였다. 송수신보드는 제어보드에서 생성되는 광대역 신호를 주파수 상향변환을 통해서 X-대역 운용주파수로 변환할 수 있도록 설계하였다. (초)소형 위성은 소형/경량/저비용이 중요한 고려요소 이므로 MIL, Industrial 등급의 부품을 적절히 적용하고 동시에 방사선 시험, 해석 및 우주환경 시험을 통해서 임무 수명을 보장할 수 있도록 설계 하였다.
본 논문에서는 마이크로프로세서의 기능을 수행하는 데 필수적이며 사용빈도가 높은 총 64개의 명령어를 정의한 후 이를 처리할 데이터패스를 구성해 스테이트 머쉰으로 제어하는 방식으로 실용적 8비트 마이크로프로세서를 VHDL로 설계를 하고 FPGA로 구현했다. 통상 마이크로프로세서 관련 논문에서는 기능적 시뮬레이션까지만 했거나, 인터럽트 기능이 없든지, 하드웨어로 구현을 하지 않았거나, 또는 개발 관련 내용이 자세히 제시되지 않았었다. 본 논문에서는 데이터 이동, 논리, 가산 연산뿐만 아니라 분기, 점프 연산도 실행할 수 있도록 해 연산 및 제어용도에 적합하도록 하였고, 스택, 외부 인터럽트 기능까지도 지원하도록 해 그 자체로서 완전한 실용적 마이크로프로세서가 되도록 하였다. 또한 프로그램 ROM까지도 칩 안에 넣어 전체 마이크로프로세서를 단일 칩으로 구현하였다. 타이밍 시뮬레이션으로 검증 후 제작 과정을 통해, 설계된 마이크로프로세서가 정상적으로 동작함을 확인하였다. Altera MAX+.PLUS II 통합개발환경 하에서 EP1K50TC144-3 FPGA 칩으로 구현을 하였고 최대 동작주파수는 9.39MHz까지 가능했고 사용한 로직 엘리먼트의 개수는 2813개로서 논리 사용률은 97%이었다.
정보화 사회가 진행되어감에 따라 카메라 센서, 디지털 카메라, 휴대폰, 영상 관련디지털 기기들이 증가하고 이로 인하여 영상정보 서비스 기술의 중요성이 크게 부각되었다. 특히 멀티미디어 응용서비스 기술에서는 영상 정보가 필수적인데, 그 영상 정보의 양이 너무 방대하여 압축 부호화를 하여 사용되고 있다. 본 논문에서는 정지영상압축 방법 중 JPEG표준에서 제시한 4가지 동작 모드 중 베이스라인을 기반으로 하는 JPEG 알고리즘을 연구하여 허프만코팅 기반의 엔트로피 디코더의 불규칙적인 데이터 입출력타이밍의 효과적인 제어를 통해 Motion JPEG에서 동작 가능한 디코더를 C언어를 통해 시뮬레이션하고 최적화된 결과를 VHDL로 구현하였다.
유비쿼터스라는 새로움 페러다임의 도래로 인해 많은 IT산업이 이를 중심으로 많은 발전을 하고 있다. 이러한 유비쿼터스 관련 산업에 있어서 상당 부분 무선 통신기술인 RF를 기반으로 하고 있으며, 이를 활용하여 RFID 시스템 및 센서 네트워크 등이 발전하고 있는 추세이다. 본 논문에서 이러한 무선 통신기술에 적합한 저전력 저전압 Wireless UHF 트렌시버인 CC1020 칩을 이용하여 무선통신시스템을 구현하였다. 이 시스템을 제어하기 위해 MCU와의 Interface를 구성하고 CC1020 칩의 레지스터를 설정하기 위해 4선의 직렬 구성 인터페이스로 모토로라사에서 개발된 근거리용 고속 직렬 동기식 통신규격인 SPI 방식을 이용하였다. 따라서 레지스터 종류 및 설정순서와 타이밍에 대한 내용과 MCU와의 인터페이스 중심으로 설명하였으며, 시스템을 구현하고 실험을 통해 신호의 파형과 데이터 송수신을 확인하였다.
SoC 프로그램은 타겟 시스템의 자원과 타이밍에 민감하여 실제 타겟 시스템과 동일한 환경에서 디버깅해야 하므로 호스트 시스템과 타겟 시스템간의 원격 접속을 위한 Adapter가 필수적으로 요구된다. 그러나 기존의 디버깅 도구에 사용되는 고가의 Adapter들은 도구에 제한적이기 때문에 다른 도구와의 연동이 불가능하다. 본 논문에서는 산업표준인 JTAG을 기반으로하는 SoC를 원격으로 제어하기 위한 고속의 USB-JTAG Adapter를 개발하여 GDB 기반의 경제적 원격 디버깅 도구를 개발할 수 있음을 보인다.
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[게시일 2004년 10월 1일]
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