• 기술표준
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• 통권68호
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• pp.11-12
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• 2007

모든 일에는 타이밍이 중요하다. 지금이야 말로 끊임없는 자기혁신과 도전을 통해 아시아를 넘어 세계최고의 글로벌 종합 에너지기업으로 도약할 시점이다.

• 한국통신학회:학술대회논문집
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• 한국통신학회 1996년도 추계종합학술발표회 논문집
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• pp.352-356
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• 1996

• 오리마을
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• 통권75호
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• pp.87-88
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• 2009

• 한국통신학회논문지
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• 제26권8A호
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• pp.1367-1377
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• 2001

고전력 증폭기의 비선형성, 수신 주파수 편차 및 심볼 타이밍 편차가 모두 존재하는 실제 IEEE 802.11a 무선 LNA 시스템의 성능을 분석하였다. 이러한 시스템에서 데이터가 OFDM 변조된 후 주파수 선택적 Rayleigh 페이딩 채널을 통하여 전송될 때의 비트 오류율을 구하였다. 증폭기의 최대 출력 전력 대 평균 출력 전력비가 6dB이며 주파수 편차가 0.01이고 심볼 타이밍 편차가 2 샘플링 주기 시간인 경우에, 이 무선 LAN 시스템에서 10-5의 비트 오류율을 얻기 위하여 필요한 $E_{b}$ /$N_{o}$ 의 크기는 대략 20~24dB로 분석되었다. 이와 같은 실제 시스템과 정확한 채널 추정, 선형 증폭기, 정확한 주파수 동기 및 심볼 동기 가정의 이상적인 시스템간의 성능을 비교한 결과, 같은 크기의 비트 오류율을 얻기 위하여 이 실제 시스템에서 대략 1~3dB 정도의 $E_{b}$ /$N_{o}$ 가 더 소요된다.

• 한국정보처리학회논문지
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• 제4권4호
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• pp.1004-1012
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• 1997

본 논문은 1치 논리 시뮬레이션 환경에서 효율적인 헤저드 분석을 위한새로운 TRF( Transition Rise/Fall)지연모델을 제안한다. 주어진 회로에 있어서 헤저드 분석을 수행 하기 위해 우선 응답시간 지연과 천이시간 지연을 허용하는 5치 논리 시뮬레이터 에 의해서 타이밍 분석이 수행되고, 이미 수행된 타이밍 관계를 조사하므로써 헤저드 를 검출할 수 있다.몇 개의 예제회로에 대해서 시뮬레이션을 수행한 결과를 통하여 제안한 방법을 실용성을 입증하였다.

• 한국방송∙미디어공학회:학술대회논문집
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• 한국방송공학회 1999년도 학술대회
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• pp.239-242
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• 1999

본 논문에서는 8VSB수신기가 다중경로신호에 따른 성능이 나쁜 것에 대한 원인 분석과 나아가 개선책을 제시하기 위해 다중경로 신호가 디지털 지상파 TV의 수신성능에 미치는 영향에 대해 수신단의 STR(Symbol Timing Recovery)과 등화기를 중심으로 분석한다. 첫째 등화기의 성능 분석을 위해 에코의지연시간이 7.5 $\mu$sec일 때 시불변 환경에서 전산 모의 실험을 하였다. 등화기 수렴후의 에로 레벨에 따른 TOV(Threshold of Visibility) S/N(Signal to Noise)를 구해보면 호주의 실험실 측정과는 달리 0dB에서도 S/N이 26dB 정도이면 등화기는 안정적으로 수렴한다. 둘째 세그먼트 동기 복원을 세그먼트 싱크 필터(Segment Sync:+1, +1. -1, -1)를 사용했을 때 짧은 시간 지연 에코와 긴 시간 지연 에코에 대해 S 커브를 보면 짧은 시간 지연에코에서는 심볼 타이밍이 어긋났으며 긴 시간 지연 에로에서는 문제가 없이 타이밍 동기가 된다. 셋째 짧은 시간 지연 에코신호가 있을 때 세그먼트 동기 복원과 등화기를 연동한 전산 모의 실험을 하여 에코의 영향을 분석하고 FSE(Fractionally Spaced Equalizer) 등화기 사용에 따른 장점을 분석한다.

• 한국정밀공학회:학술대회논문집
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• 한국정밀공학회 2004년도 추계학술대회 논문집
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• pp.973-976
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• 2004

So far, this report is written by knowledge and standard through several reference drawing and experienced contents with drawing hemming die. The contents about actual design is so huge that I will write about it next time. Timing chart is important to hemming die because of link position and numbers. Timing chart need a very much design time because link number and position have to applied for each case. In this paper developed an automatic timing chart and link position by relation and Pro/Program of Pro/Engineer. The method used relation rule of design parameter for timing chart. In the future, I believe that simple easy to correct and reasonable price hemming die will be producted.

• 한국정밀공학회지
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• 제25권9호
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• pp.53-58
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• 2008

The traditional engine valve train in a combustion engine is the mechanically driven camshaft system that provides one-fixed valve timing. The variable valve timing (VVT), however, is highly required to achieve the significant improvement in fuel economy. To achieve VVT in combustion engine, the solenoid type of actuator had been developed in past years, but it requires current in all operation period, the starting is difficult and the efficiency is low. In this paper, a new linear actuator using permanent magnet (PM) is proposed and verified its feasibility by finite element (FE) analysis.

• 정보와 통신
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• 제15권7호
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• pp.169-179
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• 1998

본 논문에서는 현재 연구 개발되고 있는 Fiber-to-the-curb / Very high-rate digital subscriber line(FTTC/VDSL) 시스템의 DAVIC 표준 가입자 전송 기술인 51.84 Mb/s 16-CAP (Carrierless AM/PM) 전송시스템 (downstream)과 1.62 Mb/s QPSK burst-mode TDMA 전송시스템 (upstream)및, 타이밍 복원회로 등의 동작 원리 및 구조를 간략하게 기술하였다. 본 논문은 FTTC/VDSL 전송시스템 개발을 위하여 전체시스템이 운영될 환경, 즉 채널에 대하여 기술한 후, 주어진 채널에 적합한 down-stream전송시스템 알고리즘 및 구조를 설명하였으며, 타이밍 복원 시스템을 기술하였다. FTTC/VDSL시스템은 네트워크의 한 개의 송수신부가 가입자 댁내의 여러 개의 set-top box와 데이터를 주고받는 점 대 다점 (point-to-multipoint) 구조로 이루어져 있으며, 따라서 역 방향 (upstream) 채널 데이터 전송을 위한 QPSK 전송시스템은 네트워크쪽의 QPSK 수신부가 가입자 댁내의 여러개의 QPSK 송신부를 서비스할 수 있게끔 시분할 다중접속 방식인 burst-mode TDMA전송방식으로 구현되었다. FTTC/VDSL 전송시스템은 DAVIC의 시스템 성능 요구조건을 만족하게 설계되었으며, 모든 기능은 디지털로 구현되었고 칩 구현을 위하여 각 기능의 VLSI 시스템 파라메타 들을 추출하고 성능 시험을 실시하였다.

• 한국통신학회논문지
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• 제32권4C호
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• pp.355-361
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• 2007

본 논문에서 정규화 포락선 검파 기법(NED ; Normalized Envelop Detection)과 얼리-레이트 필터(ELF ; Early-Late Filter)가 적용된 새로운 홉 타이밍 예측기를 제안하였다. 제안한 구조의 성능 검증을 위해 컴퓨터 시뮬레이션으로 제안한 시스템과 기존 시스템의 동기 오차 측정 결과를 비교하였다. 시뮬레이션 결과를 통해서 부분 대역 재밍 환경에서 제안 구조가 기존 구조보다 정확하게 동기오차를 예측하는 것을 확인할 수 있었으며, 이러한 경향은 $E_b/N_j$와 재밍점유대역비(rho)가 낮을수록 더욱 뚜렷하였다.