• Title/Summary/Keyword: 코드시스

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CDMA 이동통신을 위한 PN 코드의 성능분석

  • Kim, Seon-Yeong;Seong, Jin-Suk;Jeong, Jong-Tae;Kim, Jin-Eop;Lee, Sang-Cheon;Kim, Yeong-Sik;Lee, Yeong-Gyu
    • Electronics and Telecommunications Trends
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    • v.7 no.2
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    • pp.32-50
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    • 1992
  • CDMA시스팀은 차세대 디지틀 셀룰라 시스팀을 위해 개발중인 방식이다. CDMA 이동통신에 있어서 PN 코드 발생기는 대역확산, 시스팀 동기, 변복조 등의 중요한 역할을 한다. 본 고에서는 CDMA 이동통신용 PN 코드 발생기의 특성, 구성원리, 실현 방법 및 Qualcomm사의 CDMA 시스팀에 이용되고 있는 PN 코드 발생기의 성능분석 결과 및 기능에 대하여 살펴본다.

Performance Analysis of Common Spreading Code CDMA Packet Radio Systems with Multiple Capture Capability (다중캡쳐 특성의 단일확산코드 CDMA 패킷 라디오 시스팀들의 성능 분석)

  • 김동인
    • The Journal of Korean Institute of Communications and Information Sciences
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    • v.16 no.12
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    • pp.1286-1299
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    • 1991
  • In this paper we present a multiple capture model for common spreading code CDMA packet radio systems with star topology. Basic equations for the collision free, header detection. and multiple capture probabilities are derived at the central receiver. Link performances. including the average number of packet captures, allowable number of simultaneous transmission, and system throughput are theoretically evaluated for a hybrid system. combining envelope header detection and differential data detection, Using the Block Oriented Systems Simulator(BOSS), simulations were carried out for the central receivers with envelope or differential geader detection, It is shown that for a threshold approx-imation to the probability of data packet success, the mulyiple capture model significantly improves system throughput.

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An efficient method and performance analysis for burst synchronization/error detection using cyclic codes (순환코드를 이용한 효율적인 동기/에러 검출 방법 및 성능분석)

  • 최양호
    • The Journal of Korean Institute of Communications and Information Sciences
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    • v.21 no.8
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    • pp.2013-2022
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    • 1996
  • Cyclic Codes can be used for burs(or time slot) synchronization as well as error detection as that the overhead bits of the burst, which would be nessary to seperate burst synchronization and error detection systems, may be eliminated. In this paper a new method for combined burst synchronization and error detection is proposed which requires CRC decoding once only, while the previous method which inspects channel error after searching for burst synchronization requeires CRC decoding twice. The proposed method has the advantage of simple implementation and reducing processing time over the previous one, still showing the same detection perfdormance. It may occur that a burst different from the actually transmitted one is falsely accepted in the presence of channel errors. The exact expression for the false acceptance probability is newly presented through a simple derivation basied on the fact that it is determined by channel errors but not by detection methods.

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Secure JPEG2000 Steganography by the Minimization of Code-block Noise Variance Changes (코드블록 노이즈 분산의 변화를 최소화하는 안전한 JPEG2000 스테가노그라피)

  • Yoon, Sang-Moon;Lee, Hae-Yeoun;Joo, Jeong-Chun;Bui, Cong-Nguyen;Lee, Heung-Kyu
    • The KIPS Transactions:PartC
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    • v.15C no.3
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    • pp.149-156
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    • 2008
  • JPEG2000 is the upcoming image coding standard that provides better compression rate and image quality compared with JPEG. Lazy-mode steganography guarantees the safe communication under the two information loss stages in JPEG2000. However, it causes the severe changes of the code-block noise variance sequence after embedding and that is detectable under the steganalysis using the Hilbert-Huang transform (HHT) based sequential analysis. In this paper, a JPEG2000 lazy-mode steganography method is presented. The code blocks which produce the sudden variation of the noise variance after embedding are estimated by calculating low precision code-block variance (LPV) and low precision code-block noise variance (LPNV). By avoiding those code-blocks from embedding, our algorithm preserves the sequence and makes stego images secure under the HHT-based steganalytic detection. In addition, it prevents a severe degradation of image quality by using JPEG2000 quality layer information. On various 2048 images, experiments are performed to show the effective reduction of the noise variation after message embedding and the stable performance against HHT-based steganalysis.

Improvement of Performance in the DS-CDMA / DPSK Cellular Mobile Communication System using CCI Canceller and MRC Diversity (DS-CDMA/DPSK 셀룰라 이동통신 시스템에서 간섭 제거기와 최대비 합성 다이버시티에 의한 성능의 개선)

  • 우병훈;오창헌;조성준
    • The Proceeding of the Korean Institute of Electromagnetic Engineering and Science
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    • v.5 no.1
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    • pp.22-30
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    • 1994
  • The error probability of the DS-CDMA / DPSK cellular mobile communication system with CCI canceller and MRC diversity reception technique has been analyzed in the cellular radio channel which is characterized by AWGN, Multi-User Interference(MUI) and m-distribution fading. System capacity i. e., number of user per cell has been derived and the evaluated results are shown in figures as a function of PN code sequence length, fading index, BER, number of diversity branches and $E_b/N_o$, Here, the voice activity factor is assumed to be 3/8, the number of sectors in a cell 3 and Multi-User Iner- ference is modeled as Gaussian process.

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Reducing the Peak-to-Average Power Ratio of MC-CDMA System Using Phase Offset (MC-CDMA 시스테메에서 위상 오프셋을 이용한 최대전력 대 평균전력 비의 감소 방안)

  • 김성필;김명진이재혁
    • Proceedings of the IEEK Conference
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    • 1998.10a
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    • pp.63-66
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    • 1998
  • MC-CDMA(Multi-Carrier Code Division Multiple Access) 시스템에서 전송 신호의 피크 전력 대 평균 전력(Peak-to-Average Power: PAP)율을 낮추는 방안을 제시한다. 확산 코드에 의해 결정된 각 부 캐리어의 위상 오프셋은 전송 신호의 복소 포락선 형성에 영향을 주게 되어 전송 신호의 PAP 율을 결정하게 된다. 따라서 각 부 캐리어의 위상 오프셋을 적절히 조정함으로써 PAP율을 낮출수 있다. 본 논문에서는 PAP 율을 감소시키는 부 캐리어 위상 오프셋 코드의 한 예를 제시하며, 모의 실험을 통하여 전송신호의 크기 분포 특성과 PAP 율의 감소를 확인한다.

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Hangul Porting and Display Method Comparison for an LN2440SBC System (LN2440SBC 시스템을 위한 한글 포팅 및 출력 방식 비교)

  • Kim, Byoung Kuk;Park, Geun Duk;Oh, Sam Kweon
    • Proceedings of the Korea Information Processing Society Conference
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    • 2009.04a
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    • pp.635-638
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    • 2009
  • 컴퓨터 디스플레이를 위한 한글 표현 방법에는 한글 음절의 초성, 중성, 종성 각각에 코드를 부여하고, 이를 조합하여 1 음절을 2 바이트로 처리하는 표준 조합형 코드와 각 음절마다 2 바이트 코드를 부여하는 표준 완성형 코드, 그리고 모든 국가의 언어를 표현하기 위한 만국 공통의 문자부호 체계인 유니코드 방식이 있다. 일반적으로 임베디드 시스템은 PC에 비해 상대적으로 속도가 느리고 저장공간 또한 제한되어 있으나 그 용도에 따라 PC에 필적하는 성능을 가지는 경우도 있다. 따라서 화면에 한글을 출력할 경우, 임베디드 시스템의 자원 환경에 맞는 적합한 방식을 채택해야 한다. 본 논문은 시랩시스(CLabSys)사의 3.5" TFT LCD 키트인 LP35가 부착된 LN2440SBC 임베디드 보드(S3C2440A CPU, 400MHz)의 TFT LCD 드라이버 제작을 위한 초기화 방법과 픽셀 디스플레이 함수를 소개한다. 또한 픽셀 디스플레이 함수와 비트맵 폰트를 사용하여 표준 조합형, 표준 완성형, 유니코드 방식의 3가지 방식에 대한 한글 출력 처리 속도와 필요 메모리 용량을 비교한다. 시험 결과에 따르면, 표준 조합형은 적은 메모리 공간을 차지하지만 초성, 중성, 종성을 조합하는데 시간이 소요되고, 완성형은 조합형에 비해 출력 처리 속도는 빠르나 모든 음절의 저장을 위해 비트맵 폰트의 용량이 크며, 유니코드는 비트맵 폰트의 용량은 가장 크지만, 국가 간 언어의 호환성을 보장하고 출력 속도 또한 세 가지 방식 중 가장 빠른 것으로 나타났다.

Low-Complexity Deeply Embedded CPU and SoC Implementation (낮은 복잡도의 Deeply Embedded 중앙처리장치 및 시스템온칩 구현)

  • Park, Chester Sungchung;Park, Sungkyung
    • Journal of the Korea Academia-Industrial cooperation Society
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    • v.17 no.3
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    • pp.699-707
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    • 2016
  • This paper proposes a low-complexity central processing unit (CPU) that is suitable for deeply embedded systems, including Internet of things (IoT) applications. The core features a 16-bit instruction set architecture (ISA) that leads to high code density, as well as a multicycle architecture with a counter-based control unit and adder sharing that lead to a small hardware area. A co-processor, instruction cache, AMBA bus, internal SRAM, external memory, on-chip debugger (OCD), and peripheral I/Os are placed around the core to make a system-on-a-chip (SoC) platform. This platform is based on a modified Harvard architecture to facilitate memory access by reducing the number of access clock cycles. The SoC platform and CPU were simulated and verified at the C and the assembly levels, and FPGA prototyping with integrated logic analysis was carried out. The CPU was synthesized at the ASIC front-end gate netlist level using a $0.18{\mu}m$ digital CMOS technology with 1.8V supply, resulting in a gate count of merely 7700 at a 50MHz clock speed. The SoC platform was embedded in an FPGA on a miniature board and applied to deeply embedded IoT applications.

비동기식 PC통신 프로그래밍

  • Heo, Jae-Du;Kim, Dae-Ung;Yun, Byeong-Nam
    • Electronics and Telecommunications Trends
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    • v.7 no.2
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    • pp.79-97
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    • 1992
  • 본 고에서는 통신 시스팀 개발자의 입장에서 본 PC통신의 현황과 문제점을 설명하고자 한다. PC에 의한 데이터 통신은 비동기식을 따른 것이 대부분이기 때문에 문자 코드의 처리와 자동 다이얼링의 문제점을 지적하고, 통신 S/W가 겸비하여야 하는 Intelligency에 대해서 언급하고자 한다

Performance Analysis of Multicode DS/CDMA-BPSK Signal in Nakagami fading Channel (임펄스 잡음과 폐이딩 채널 환경에서 멀티코드 DS-CDMA 시스뎀의 성능 분석)

  • 김지웅;이양선;조성언;강희조
    • Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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    • 2001.10a
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    • pp.697-700
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    • 2001
  • 본 논문에서는 이미 구축된 CDMA 망을 활용하여 임펄스 잡음과 실내 무선 페이딩, 그리고 다중 사용자 간섭 환경에서 고속 무선 멀티미디어 전송을 위한 방안을 연구하였다. 분석 결과 멀티코드의 수가 증가함에 따라서 하나의 사용자에게 점유되는 채널의 수가 증가하여 시스템의 성능은 열화되나 반면에 시스템에서 제공한 수 있는 서비스의 속도는 멀티코드의 수에 비례하여 증가함을 알 수 있었다. 또한, 성능개선기법으로 다이버시티 기법을 적용함으로써 전력선에서 방출되는 임펄스 잡음 파라 미터인 A=0.2, $\Gamma$'=0.22에서 신호전력 12dB 이상에서 10$_{-3}$이하의 BER 성능을 얻을 수 있었다.

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