본 논문에서는 음성과 영상신호를 실시간 처리해야하는 멀티미디어 시스템에 이용 가능한 광대역 아날로그 소자를 설계하였다. 제안된 소자는 저 전압(2V) 동작이 가능하도록 완전차동 구조에 전압조절을 위한 튜닝회로를 추가한 형태로 설계되었으며, 이득특성에 영향을 주는 트랜스컨덕턴스값을 증가시키기 위해 상보형 캐스코드 방식을 이용하여 구성되었다. 0.25$\mu\textrm{m}$ CMOS n-well 공정 파라미터를 이용한 시뮬레이션 결과, 제안된 아날로그 능동소자는 비우성극점의 제거로 안정성이 향상되었으며, 2V 공급전압하에서 42dB의 이득값과 200MHz의 단위 이득주파수 특성을 나타내었다. 소비전력값은 0.32mW를 나타내었다.
장시간 운전을 하는 동안 운전자는 외부상황을 계속해서 주시하고 경계하게 하므로 운전자에게는 정신적 부하로 작용하게 되며 이로 인해 발생하는 운전피로는 자동차 사고의 원인이 될 수 있다. 본 연구에서는 심박변동신호를 분석하여 운전시간의 증가에 따른 발생하는 운전피로도를 알아보았다. 심박변동신호의 분석방법에는 이전 연구들에서 널리 사용되어져 왔던 선형분석방법들과 함께 ApEn, Poincare Plot등을 이용한 비선형 분석방법들을 이용하였다. 3년 이상의 운전경력을 가진 5명의 실험자가 참가하였으며 모든 실험자는 4대의 승용차를 2번씩 운전하여 총 40회의 실험을 실시하였다. 운전구간은 고속도로 300km구간을 왕복해서 주행하도록 하였으며 약 3시간 정도가 소요되었다. 운전하는 동안 30분 간격으로 심전도 데이터를 측정하였다. 측정된 심전도 신호로부터 유도된 심박변동신호(HRV : heart rate variability)로부터 시간영역 변수, 주파수 영역변수, 비선형 특성 등을 구한다음, 안정 상태의 데이터라 비교하여 통계석 유의성을 살펴보았다. 분석결과 시간영역의 변수인 평균심박동수는 운전시간의 증가에 따라 계속적으로 감소하였으며 심박동율의 표준편차와 연속적인 RR간격의 차이는 90분 이후로는 일정 수준을 유지하였다. 주파수 영역에서 구한 L $F_{norm}$, LF/HF는 운전시간에 따라 증가함을 보였다. 비선형 특성을 알아보기 위해서 ApEn, Poincare plot을 이용하였는데 모두 시간에 따라 감소함을 나타내었다. 대부분의 변수에서 통계적 유의성은 1시간 이후부터 나타남을 볼 수 있었다.
본 논문에서는 근전의수용 소형 근전위 센서를 제안한다. 근전의수용 근전위 센서를 의수 소켓에 내장시키기 위해서는 소형이어야 한다. 제안된 근전위 센서는 피부와 접촉하는 전극과 신호처리를 위한 회로부가 일체화된 형태로 소형화 하였다. 기준 전극은 두 입력전극의 가운데에 나란히 배치되고, 입력전극은 막대형, 기준전극은 막대형과 원형의 두 가지 형상으로 설계하였다. 두 입력전극 사이의 간격은 근섬유의 근전위 신호의 전도속도와 중심주파수를 고려하여 18mm, 20mm, 22mm 의 세 개의 서로 다른 간격을 가진 전극을 제작하였다. 사용된 전극의 재료는 땀이나 습기에 강한 SUS440 금속을 사용하였다. 신호처리 회로부는 대역통과 필터를 갖는 차동 증폭기, 전원노이즈를 제거하기 위한 대역저지 필터, 교류결합증폭기, 절대평균값 회로로 구성되어 있다. 실험에서는 정상인의 전완에서 근전위 신호를 취득하여 주파수 분석하고, 입력전극 사이의 간격과 기준전극의 형상에 따른 출력특성 평가하였다. 본 논문에서는 실험의 결과로부터 두 입력전극간의 거리가 18mm 이면서, 입력전극의 형상과 기준전극의 형상이 모두 막대형인 표면 근전위 센서가 근전의수에 최적임을 보인다.
본 논문에서는 전류 모드 동작에 기반한 IEEE 802.15.4 규격을 만족하는 2.4GHz 저전력 직접 변환 송신기를 제안하고 $0.13{\mu}m$ CMOS 공정을 이용하여 구현하였다. 제안된 송신기는 디지털-아날로그 변환기, 저역통과 필터, 가변 이득 I/Q 상향 혼합기, 구동 증폭기 및 LO 버퍼를 포함하는 주파수 나누기 2회로로 구성되어 있다. 디지털-아날로그 변환기와 저역통과 필터(LPF), 가변이득 I/Q 상향 혼합기의 트랜스컨덕터 단을 하나의 전류 미러 회로로 합친 간단한 구조를 제안하여 전력 소모를 줄이면서 선형성을 향상할 수 있도록 하였다. 구동 증폭기는 캐스코드 타입의 증폭기로 제어 신호를 이용하여 이득을 조절할 수 있게 하였고, 외부 4.8GHz 신호를 받아 주파수 나누기 2 전류 모드 로직 (CML) 회로를 사용하여 2.4GHz I/Q 차동 LO 신호를 생성하도록 설계하였다. 구현한 송신기는 30dB의 이득 조정 범위를 가지면서 0dBm의 최대 출력 신호에서 33dBc의 LO 누설 성분, 40dBc의 3차 하모닉 성분의 특성을 보이며, 구현한 칩의 면적은 $1.76mm{\times}1.26mm$으로 전력소모는 1.2V 단일 전원 전압으로부터 10.2mW이다.
본 논문은 IEEE 802.15.4g SUN (Smart utility network)을 지원하는 920 MHz 대역 RF 송수신단 통합회로 구조를 제안한다. 제안하는 통합회로는 920 MHz에서 동작하고 구동증폭기, RF 스위치, 그리고 저잡음 증폭기로 구성되어 있다. 송신모드에서는 구동 증폭기가 동작하는데 싱글 구조로 설계되어 트랜스퍼머에 의한 출력 신호 손실을 제거 하였고 또한 RF 스위치의 위치를 수신단에 적용하여 출력 신호 손실을 제거 하였다. 수신모드에서는 RF 스위치와 저잡음 증폭기가 동작되는데 싱글 입력 신호에 대해 차동 출력 신호를 제공할 수 있다. 구동증폭기의 부하와 저잡음 증폭기의 입력 정합회로는 한 개의 LC 공진회로를 공유하여 칩 면적을 최소화 할 수 있다. 본 논문에서 제안하는 통합회로는 $0.18-{\mu}m$ CMOS 공정을 사용하여 설계하였고, 1.8 V 공급 전압에서 구동증폭기는 3.6 mA, 저잡음 증폭기는 3.1 mA의 전류를 소모한다.
디지털 신호에 의해 이득이 조절되는 CMOS VGA의 구조로는 degenerated 차동쌍 구조가 많이 사용되고 있다. 이 구조에서 가변 degeneration 저항을 구현하기 위해 기존해 사용되던 방법으로는 MOSFET 스위치와 함께 저항열 구조를 사용하는 방법과 R-2R ladder 구조를 사용하는 방법이 있다. 그러나 이 방법들을 이용하는 경우에는 degeneration 저항에서의 dc 전압 강하에 의해 저전압 동작이 어려우며, 높은 이득 설정시 대역폭이 크게 제한되기 때문에 고속의 VGA 구현이 어렵다. 따라서, 본 논문에서는 이러한 문제점들을 해결하기 위해 degeneration 저항에서의 dc 전압 강하를 제거한 새로운 가변 degeneration 저항을 제안하였다. 제안된 이득조절 방법을 사용하여, 저전압에서 동작하는 고속의 CMOS VGA를 설계하였다. 0.2㎛ CMOS 공정변수를 사용하여 HSPICE 모의실험을 한 결과, 설계된 VGA는 360MHz의 대역폭과 80dB의 이득조절 범위를 갖는다. 이득오차는 200MHz에서 0.4dB보다 작으며 300MHz에서는 1.4dB보다 작다. 설계된 회로는 2.5V의 전원전압에서 10.8mA의 전류를 소모하며, 칩 면적은 1190㎛×360㎛이다.
본 논문에서는 다수의 병렬 입.출력 환경을 위한 높은 노이즈 마진을 갖고 있는 LVDS I/O 회로를 소개한다. 제안된 LVDS I/O회로는 송신단과 수신단으로 구성되어 있으며 송신단 회로는 차동위상 분할기와 공통모드 피드백(common mode feedback)을 가지고 있는 출력단으로 이루어져 있다. 차동위상 분할기는 SSO(simultaneous switching output) 노이즈에 의해 공급전압이 변하더라도 안정된 듀티 싸이클(duty cycle)과 $180^{\circ}$의 위상차를 가진 두 개의 신호를 생성한다. 공통모드 피로백을 가지고 있는 출력단 회로는 공급전압의 변화에 상관없이 일정한 출력전류를 생성하고 공통모드 전압(common mode voltage)을 ${\pm}$0.1V 이내로 유지한다. LVDS 수신단 회로는 VCDA(very wide common mode input range differential amplifier)구조를 사용하여 넓은 공통 입력전압 범위를 확보하고 SSO 노이즈에 의한 공급 전압의 변화에도 안정된 듀티 싸이클(50% ${\pm}$ 3%)을 유지하여 정확한 데이터 복원이 가능하다. 본 논문에서 제안한 LVDS I/O 회로는 0.18um TSMC 라이브러리를 기본으로 하여 설계 되었으며 H-SPICE를 이용하여 시뮬레이션 하였다.
디지털 신호에 의해 이득이 조절되는 CMOS VGA의 구조로는 축퇴된 차동쌍 구조가 많이 사용되고 있다. 이 구조에서 가변 축퇴 저항을 구현하기 위해 기존해 사용되던 방법으로는 MOSFET 스위치와 함께 저항열 구조를 사용하는 방법과 R-2R 사다리 구조를 사용하는 방법이 있다. 그러나 이 방법들을 이용하는 경우에는 축퇴 저항에서의 dc 전압 강하에 의해 저전압 동작이 어려우며, 높은 이득 설정시 대역폭이 크게 제한되기 때문에 고속의 VGA 구현이 어렵다. 따라서, 본 논문에서는 이러한 문제점들을 해결하기 위해 축퇴 저항에서의 dc 전압 강하를 제거한 새로운 가변 축퇴 저항을 제안하였다. 제안된 이득조절 방법을 사용하면, 저전압에서 고속의 VGA 구현이 용이해 진다. 기존의 이득조절 방법들의 문제점과 제안된 이득조절 방법의 원리 및 장점 그리고 기존의 방법들과 성능 비교에 대해 자세히 언급하였다. 또한, 제안된 축퇴 저항을 사용하여 VGA 셀을 설계한 결과 -12dB에서 +12dB까지 6dB 단계의 이득 조절 범위에서 3dB 대역폭은 650㎒ 보다 크고, 이득오차는 0.3dB 보다 작으며, 2.5V 전원에서 3.1㎃의 전류소모 특성을 보였다.
본 논문에서는 다양한 모바일 TV 규격을 지원할 수 있는 모바일 TV 튜너용 VHF 및 UHF 대역 가변 이득 저잡음 증폭기를 제안한다. 제안한 VHF 대역 가변 이득 증폭기는 외부 매칭 소자를 제거하기 위해 저항 피드백을 이용하여 저잡음 증폭기와 저주파수 잡음 특성을 개선하기 위해 PMOS 입력을 사용하는 싱글-차동 증폭기, 이득 범위를 제어하기 위해 저항 피드백 부분과 감쇄기로 구성된다. 제안한 UHF 대역 가변 이득 증폭기는 잡음 특성과 외부 간섭 신호 제거 특성을 향상시키기 위해 협대역 저잡음 증폭기와 $g_m$ 가변 방식을 이용하여 이득을 제어할 수 있는 싱글-차동 증폭기와 감쇄기로 구성된다. 제안한 VHF 및 UHF 대역 가변 이득 저잡음 증폭기는 $0.18{\mu}m$ CMOS 공정을 사용하여 설계하였고, 전원 전압 1.8 V에서 각각 22 mA와 17 mA 의 전류를 소모하면서 약 27 dB와 27 dB의 전압 이득, 1.6-1.7 dB와 1.3-1.7 dB의 잡음 지수, 13.5 dBm와 16 dBm의 OIP3의 성능을 보인다.
본 논문은 정지궤도위성을 이용한 고정밀 표준 시각/주파수 방송 서비스를 위해 요구되는 정지궤도위성 궤도추적 정확도를 개선할 수 있도록 기존의 무선 지점결정 기술인 trilateration에 확장칼만필터(EKF extended Kalman filter)를 결합한 EKF-trilateration 방식을 제안하고 차동보정 방식, 국내 및 국외 보정국을 이용한 trilateration 방식과 시각 정확도를 비교 분석하였다. EKF-trilateration 방식은 ECF-좌표계상의 각 축별 오타를 수백 m이내로 줄임으로써 위성궤도 추적 정확도를 10배 개선할 수 있었다. 한국과 같이 영토가 작은 국가의 경우 위성궤도 결정에 참여하는 국내 보정 국들이 형성하는 기하학적 조건 (GDOP)이 매우 열악함에도 불구하고 국내 보정 국만을 이용한 EKF-trilateration 방식을 사용하여 수 ns 이내(주파수 안정도 : $10^{-14}$[7일이상]의 시각 정확도로 표준 시각 방송 서비스를 한반도 전역에 제공할 수 있다.
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[게시일 2004년 10월 1일]
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