OFDM(Orthogonal Frequency Division Multiplexing) 시스템은 주파수 선택적 페이딩 채널에서 무선 고속 데이터 전송에 적합한 통신 방식이다. 본 논문에서는 기계 제어에 많이 사용되는 Fuzzy 이론을 이용하여 OFDM 시스템에서 문제가 되는 PAPR(Peak to Average Power Ratio)을 감소시키는 방법을 제안한다. PAPR을 줄이는데 Fuzzy 이론을 사용함으로써 경험적 실험과 반복에 의한 데이터를 사용하기 쉬우며, 하드웨어적인 측면에서 구현이 쉽고, 또한 보다 적은 연산량으로 쉽게 PAPR을 감소시킬 수 있다. 먼저 입력 신호를 부블록으로 나누고, Fuzzy를 이용하여 부블록의 PAPR을 낮추어 전체의 PAPR을 낮추어 전송하여 이를 수신단에서 복원하는 비교적 쉽고 간단한 알고리즘을 제안한다. 제안한 방식이 기존의 OFDM 시스템에 비하여 시스템의 연산량이 다소 증가하고 Fuzzy에 관한 정보를 따로 보내야 하는 단점이 있지만, PAPR 감소 측면에서 성능이 개선됨을 확인하였다. 제안하는 알고리즘의 성능을 평가하기 위해 CCDF(Complementary Cumulative Distribution Function)을 통하여 비교한다. 이 알고리즘에 따르면 QPSK와 16QAM 변조를 사용하여 시뮬레이션을 한 결과, Fuzzy 이론을 이용한 방법이 FFT 크기(N)=512, Oversampling=4인 경우 PR이 $10^{-5}$을 기준으로 각각 최대 약 2.3 dB와 3.1 dB의 PAPR 감소됨을 확인할 수 있었다.
본 연구에서는 초전도 전원장치의 비선형적인 충전특성을 이론적으로 해석하기 위해서 Radial Basis Function 뉴럴 네트워크를 적용하였으며 이를 바탕으로 초전도 부하 마그넷에 따른 충전특성의 경향을 해석하였다. 본 논문에서는 안정적인 충전전류를 발생시키고 충전전류를 쉽게 제어할 수 있는 리니어형 초전도 전원장치를 개발하였고, 극저온 시스템에서 충전전류 특성을 실험적으로 수행하였다. 이를 통해 초전도 전원장치는 초전도 선재(초전도 Nb 박막)를 사용하기 때문에 비선형적인 충전전류 특성을 가짐을 알 수 있었다. 일반적으로, 극저온에서의 실질적인 실험에 있어서 주변 환경에 따른 냉각 비용 문제 등이 대두되기 때문에 다양한 실험을 수행하는데 연구의 어려움이 있다. 따라서 본 논문에서는 개발된 초전도 전원장치의 주파수에 대한 비선형적인 충전 특성을 기반으로 지능형 알고리즘인 RBF 뉴럴 네트워크를 통해서 그 결과를 예측하고 이에 대해서 지능 모델을 구현하였다. 본 논문에서 사용된 RBF 뉴럴 네트워크에서는 효율적인 데이터 처리를 위해서 은닉층에 FCM 클러스터링 알고리즘을 사용하였으며, 클러스터의 수가 모델의 은닉층에서의 노드의 수가 되도록 설계하였다.
본 논문에서는 H.264/AVC CAVLC 부호기의 성능 향상을 위해 변환계수의 재정렬 과정이 필요 없는 탐색기법을 제안한다. 기존의 CAVLC 부호기는 변환계수의 재정렬 과정이 포함되어 변환계수를 저장해야 할 버퍼와 버퍼제어를 위한 추가적인 사이클이 필요하므로 하드웨어 면적이 증가하고 불필요한 사이클이 수행된다. 제안한 탐색기법은 CAVLC의 파라미터 중에 Level을 역방향 탐색기법으로 계산하고 그 외 파라미터들은 순방향 탐색기법으로 계산하여 변환계수의 재정렬 과정을 수행하지 않는다. 또한, 제안한 CAVLC 부호기에 조기 종료 모드를 적용하고 3단 파이프라인 구조를 사용하여 CAVLC의 수행 사이클 수를 감소시켰다. 제안한 CAVLC의 하드웨어 구조를 매그나칩 공정 $0.18{\mu}m$ 셀라이브러리로 합성한 결과, 최대동작 주파수는 125MHz이며 게이트 수는 15.6k이다. 제안한 CAVLC의 하드웨어 구조를 H.264/AVC 표준 참조 소프트웨어 JM13.2에서 추출한 데이터를 이용하여 테스트한 결과, $16{\times}16$ 매크로블록을 처리하는데 평균적으로 66.6사이클이 소요되어 기존의 CAVLC 부호기보다 성능이 13.8% 향상됨을 확인하였다.
본 논문에서는 마이크로셀이나 피코셀과 같은 아주 작은 규모의 셀 영역 범위를 사용하는 차세대 무선 ATM 환경에서 효과적으로 이용될 수 있는 호제어절차 방식을 제시하고 개방형 큐잉 네트워크를 사용해 이의 성능분석을 행한다. 셀집단화 방식이라고 불리는 이 호제어절차는 단말의 이동성을 고려하여 새로운 호가 망 내로 수락될 때 단말이 이동할 확률이 높은 이웃한 물리적인 마이크로셀이나 피코셀들을 집합으로 모아서 지역적으로 매크로셀 정도로 넓은 영역을 담당하는 가상셀을 만들어 주는 방식으로, 높은 주파수 재사용 효율을 보장받으면서도 핸드오버에 따른 호제어절차의 개입을 줄일 수 있다는 장점을 지니고 있다. 그러나 셀집단화 방식에서는 일단 새로운 호가 가상셀 내의 영역으로 수락되고나면 제약없이 기지국 사이를 핸드오버하여 셀집단 내의 한 기지국에 집중하여 과부화 현상을 초래한다는 문제점이 있다. 따라서 본 논문에서는 셀집단화 방식이 사용하는 호수락제어의 판별기준으로서 기지국의 과부하 확률과 기지국이 과부하 상태에 머무르는 평균시간을 정의하고, 셀 집단 내에 존재할 수 있는 전체 통화호의 수를 일정한 값 이하로 제한할 경우와 그렇지 않을 경우를 비교하여 성능분석을 행하고 수치 결과를 보임으로써 셀집단화 방식의 효율성을 살펴본다.
최근 들어 전 세계적으로 무선전력전송이 많이 연구되고 있다. 무선 전력전송이란 전기기기가 전선이 없어도 무선으로 전력을 공급하는 기술이다. 본 논문에서는 ICT 기반의 무선전력전송 시스템을 설계, 제작하였다. 제안된 시스템은 기존 시스템보다 픽업코일에 접촉는 면적을 증대하여 같은 L값과 C값을 사용해도 효율이 높아질 수 있도록 설계하였다. 무선 전송의 송 수신부와 고효율의 코일부로 구성되어 있으며, 시스템의 전송 효율을 높이는 방법을 제안하였다. 특히 무선 송 수신부는 ICT 기술과 연동이 가능하도록 설계하여 실시간 원격 모니터링이 가능하도록 제작하였고, 대기전력을 절감하는 효과를 연구하였다. 이를 위하여 기업에서 무선전력전송 시스템에 사용된 IGBT소자의 최대 주파수 20[KHz]를 사용하여 이에 가장 적절한 L, C값을 찾기 위해 많은 필드실험을 통하여 가장 효율적인 L값 $23.9[{\mu}H]$, C값 $2.64[{\mu}F]$을 선정하여 시스템을 구성하였다. 또한 대기전력을 감소하기 위해 출력전류를 제어하는 알고리즘을 설계하여 적용하였다. 이 결과 기존의 장비보다 무선전력전송용량과 효율이 75[%]에서 80[%]로 전력전송 유효거리를 10[%] 증가하여 대기전력의 감소 및 유지보수 비용이 절감하였고, ICT 기술을 이용한 무선 송수신부 와 프로그램을 개발하여 사용자가 취득된 데이터로 시스템의 고장 검출을 쉽게 할 수 있게 하였다.
부분 응답 신호 기법은 데이터 전송 및 저장 채널에서 신호간 간섭을 효율적으로 제어함으로써 주파수 대역폭 감축의 목적을 달성할 수 있어 많이 채택하고 있는 기법이다. 본 논문에서는 부분 응답 채널 시스템에서의 채널 등화의 문제를 연구하였다. 부분 응답 모델의 대상으로 자기 기록 채널을 고려하였는데 적응 등화기 설계를 위한 기준 신호의 서로 다른 선택이 등화기 성능에 미치는 영향을 연구하였다. 먼저 각각의 등화기에 대해서 기존의 등화기 설계에서 사용하고 있는 등화기 출력 단에서의 평균제곱오차를 이론적으로 분석하였다. 한편 등화기 출력 단에서의 평균제곱오차는 등화기 자체 분석에 있어서는 유용하지만 서로 다른 등화기법의 비료에는 미흡하기 때문에 이를 보완하기 위한 성능 평가 요소로서 최종 데이터 검출 직전에서의 데이터 평균제곱오차를 이론적으로 유도하였다. 이 결과를 통해 부분 응답 시스템에서 서로 다른 신호 배치를 갖는 적응 등화 기법들의 성능 비교가 가능하다. 또한 이러한 성능 평가 기준에 적합한 등화기 설계 방법도 고려하였다. 마지막으로 컴퓨터 시뮬레이션 결과를 통해 이론적으로 분석된 연구 결과의 타당성을 입증하였다.
본 연구에서는 스위치, 위상변위기, 감쇄기등 전파제어회로를 설계 및 제작할 수 있는 pHEMT스위치 소자에 적합한 에피구조를 설계하였다. 고성능의 스위치 소자를 위한 pHEMT 채널층 구조는 이중 면도핑층을 가지며 사용 중 게이트 전극의 전계강도가 약한 깊은 쪽 채널층의 Si 면농도가 상층부보다 약 1/4정도 낮을 경우 격리도등 우수한 특성을 보였다. 설계된 에피구조와 ETRI의 $0.5\mu$m pHEMT MMIC 공정을 이용하여 2.4GHz 및 5GHz 대역 표준 무선랜 단말기에 활용 가능한 SPDT Tx/Rx MMIC 스위치를 설계 및 제작하였다. 제작된 SPDT형 스위치는 주파수 6.0 GHz, 동작전압 0/-3V에서 삽입손실 0.849 dB, 격리도 32.638 dB, 그리고 반사손실 11.006 dB의 특성을 보였으며, 전력전송능력인 $P\_{1dB}$는 약 25dBm, 그리고 선형성의 척도인 IIP3는 42 dBm 이상으로 평가되었다. 이와 같은 칩의 성능은 본 연구에서 개발된 SPDT 단일고주파집적회로 스위치가 2.4GHz뿐만 아니라 SGHB 대역 무선랜 단말기에 활용이 충분히 가능함을 말해준다.
본 논문은 소형 가전기기를 위한 AC DC 파워모듈 설계를 제시하고 효율과 신뢰성 및 안정성 특성을 나타낸다. 제안하는 파워모듈은 PCB 테스트보드에서 PWM 제어 IC 칩, 파워모스 소자, 트랜스포머, 각종 수동소자 (저항, 커패시터, 인덕터)를 사용하여 제작하였다. 본 논문에서 제시한 AC DC 파워모듈 회로 시뮬레이션 결과를 토대로 측정한 실험에서 입력전압은 상용전원 전압 220 V (RMS), 주파수 60 HZ의 교류전압(VAC : Voltage alternating current)을 사용 하였으며, 출력전압, OCP (over current protection), EMI(electromagnetic interference), PWM 신호 펄스, 효율 측정, 패키징 여부에 따른 발열측정 등을 실시하였다. 또한 파워모듈의 온도에 따른 특성변화와 트랜스포머 기준으로 1차측의 회로와 2차측 회로의 절연상태 확인을 하기 위한 내전압 테스트 등의 신뢰성테스트를 실시하였다. 효율 및 신뢰성 측정결과, AC DC 파워 모듈이 5 V의 출력전압, 200 mV의 리플, 약 73 %의 효율, 온도 약 $80^{\circ}C$ 까지 안정적으로 동작함을 확인하였으며, 4.2 kV의 크기로 60초 동안 견디는 내압 성능을 보였다.
본 논문에서는 합성 음성파형의 일그러짐을 제어하기 위하여 V/UV/S(Voiced / Unvoiced / Silence)의 스위칭을 사용하고, 피치구간마다 멀티펄스를 보정하며, 무성자음(Unvoiced)의 근사합성에 특정주파수를 이용하는 ACFBD-MPC(Amplitude Compensation Frequency Band Division - Multi Pulse Coding)와 LMS-MPC(Least Mean Square - Multi Pulse Coding)를 통합한 8kbps ACLMS-MPC(Amplitude Compensation and Least Mean Square - Multi Pulse Coding) 부호화 방식을 제안하고자 한다. 여러 방식을 통합하는데 있어서, 음성파형의 일그러짐을 줄이면서 유성음과 무성음의 비트율을 8kbps로 조정하는 것이 중요하다. 유성음과 무성음의 비트율을 8kbps로 조정함에 있어서, 개별피치를 이용하여 대표구간의 멀티펄스를 피치구간마다 복원함으로서 음성파형을 효율적으로 합성할 수 있다. 8kbps의 부호화 조건에서 ACLMS-MPC 방식을 구현하고 SNR를 평가한 결과, ACLMS-MPC의 SNR는 남자음성에서 15.0dB, 여자음성에서 14.3dB 임을 확인할 수 있었다. 따라서 ACLMS-MPC가 기존의 MPC, ACFBD-MPC, LMS-MPC에 비하여 남자음성에서 0.3dB~1.8dB, 여자음성에서 0.3dB~1.6dB 정도 개선된 것을 알 수 있었다. 이러한 방법들은 셀룰러폰이나 인터넷폰과 같이 낮은 비트율의 음원을 사용하여 음성신호를 부호화하는 방식에 활용할 수 있을 것으로 기대된다. 향후 멀티펄스 음원의 진폭과 위치를 동시에 보정하는 6.9kbps 음성부호화 방식의 음질평가를 수행하고자 한다.
본 논문은 로컬 클록 왜곡을 보상하는 낮은 지터 성능의 지연 고정 루프를 제시한다. 제안된 DLL은 위상 스플리터, 위상 검출기(PD), 차지 펌프, 바이어스 생성기, 전압 제어 지연 라인(Voltage Controlled Delay Line) 및 레벨 변환기로 구성된다. VCDL(: Voltage Controlled Delay Line)은 CML(: Current Mode Logic)을 사용하는 자체 바이어스 지연 셀을 사용하여 온도에 민감하지 않고 잡음을 공급한다. 위상 스플리터는 VCDL의 차동 입력으로 사용되는 두 개의 기준 클록을 생성한다. 제안된 회로의 PD는 CML에 비해 적은 전력을 소비하는 CMOS 로직을 사용하기 때문에 PD는 위상 스플리터의 유일한 단일 클록을 사용한다. 따라서 VCDL의 출력은 로컬 클록 분배 회로뿐만 아니라 PD에 사용되므로 레벨 변환기에 의해 레일-투-레일 신호로 변환된다. 제안된 회로는 $0.13{\mu}m\;CMOS$ 공정으로 설계되었으며, 주파수가 1GHz인 클록이 외부에서 인가된다. 약 19 사이클 후에 제안된 DLL은 잠금이 되며, 클록의 지터는 1.05ps이다.
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[게시일 2004년 10월 1일]
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