보청기와 같은 청력 보장구는 자가 이득 조절을 통한 미세 조절이 가능 할 수 있다. 0.25 kHz ~ 8 kHz 옥타브 주파수 밴드의 대상자 선호 이득 측정을 위해 두 종류의 자가 이득 처방 절차가 개발 되었다. 이들 절차는 일차원 사용자 조절 인터페이스(프로그램된 다이얼)를 이용하여 다차원 변수를 빠르게 획득 할 수 있도록 디자인 되었다. 두 종류의 자가 이득 처방 절차는 사용자 인터페이스가 6개 주파수 밴드의 이득을 동시에 조절 하는지(Procedure A) 혹은 각 주파수 밴드를 개별적으로 조절 하는지(Procedure B) 에 따라 구분 된다. Monte-Carlo 시뮬레이션은 두 종류의 자가 이득 처방 절차에서 첫 20번의 반복된 시도동안 가상의 실제 선호이득값에 빠르게 수렴 할 수 있음을 보여 줬다. 20명의 젊은 정상 청력인을 대상으로 두 종류의 자가이득 처방 절차에 대한 행동 데이터 평가가(실험-재실험에 관한 신뢰도) 이뤄졌다. 선호 이득 측정은 20 min 미만의 시간이 소요 되었다. 최소 일주일 이상 간격을 두고 측정된 두 번의 사용자 선호 이득의 평균 제곱근 편차는 대략 10 dB ~ 15 dB 수준이었다.
본 논문에서는 시스템 구현에 직접적으로 사용될 수 있는 직교 주파수 분할 다중화 (OFDM : Orthogonal Frequency Division Multiplexing) 통신 시스템을 위한 여러 가지 자동 이득 제어 (AGC : Automatic Gain Control) 알고리듬을 제안하고자 한다. 본 논문에서는 고속 패킷 전송을 위하여 비교적 많은 샘플 수를 갖고 긴 길이의 프리앰블을 반복적으로 사용하는 초 광대역 통신 (UWB : Ultra-Wideband)과 같은 OFDM 시스템의 디지털 수신 신호를 가정한다. 이러한 OFDM 시스템에서는 프리앰블 신호를 아날로그-디지털 변환기 (ADC : Analog-to-Digital Converter)를 통해 디지털 수신 신호로 변환한 후 최대 샘플 값 계수기내 버퍼의 길이만큼 디지털 수신 신호를 저장한다. 이 후 버퍼에 저장된 디지털 수신 신호 중 최대 샘플의 개수를 계산하고 이득 조절 신호 발생기에 저장된 이득 조절 테이블에 따라 이득을 조절하여 ADC 입력단의 전력 레벨을 자동으로 조절한다.
디지털 신호에 의해 이득이 조절되는 CMOS VGA의 구조로는 축퇴된 차동쌍 구조가 많이 사용되고 있다. 이 구조에서 가변 축퇴 저항을 구현하기 위해 기존해 사용되던 방법으로는 MOSFET 스위치와 함께 저항열 구조를 사용하는 방법과 R-2R 사다리 구조를 사용하는 방법이 있다. 그러나 이 방법들을 이용하는 경우에는 축퇴 저항에서의 dc 전압 강하에 의해 저전압 동작이 어려우며, 높은 이득 설정시 대역폭이 크게 제한되기 때문에 고속의 VGA 구현이 어렵다. 따라서, 본 논문에서는 이러한 문제점들을 해결하기 위해 축퇴 저항에서의 dc 전압 강하를 제거한 새로운 가변 축퇴 저항을 제안하였다. 제안된 이득조절 방법을 사용하면, 저전압에서 고속의 VGA 구현이 용이해 진다. 기존의 이득조절 방법들의 문제점과 제안된 이득조절 방법의 원리 및 장점 그리고 기존의 방법들과 성능 비교에 대해 자세히 언급하였다. 또한, 제안된 축퇴 저항을 사용하여 VGA 셀을 설계한 결과 -12dB에서 +12dB까지 6dB 단계의 이득 조절 범위에서 3dB 대역폭은 650㎒ 보다 크고, 이득오차는 0.3dB 보다 작으며, 2.5V 전원에서 3.1㎃의 전류소모 특성을 보였다.
본 논문은 통신방송위성 중계기용 Ku-대역 채널증폭기 시험모델의 설계와 제작과정을 요약하였다. 채널증폭기의 구조는 고정이득제어 모드에서는 전압제어형 감쇄기를 이용한 아날로그 이득 조절 방식을 사용하였으며 자동레벨조절 모드에서는 루프제어방식을 이용한 출력레벨 제한회로를 사용하였다. 설계된 채널증폭기는 전압제어형 PEN-다이오드 감쇄기와 온도보상회로 등의 최신 기술 등을 이용하였다. 측정된 특성은 설계치와 동일하게 28 dB의 이득조절 및 16 dB의 자동이득조절 범위를 갖는 것을 확인하였다. 설계된 시험모델은 인증을 거치면 Ku-대역 통신방송 위성중계기용 채널증폭기로 사용되어질 수 있다.
본 논문에서는 강판 결함 검출 시스템의 아날로그 신호처리를 하기 위해 저전력 이득 조절 증폭기(PGA)를 설계하였다. 설계된 PGA는 홀 센서에서 나오는 신호를 검출 하려는 결함의 종류에 따라 그 이득을 6dB에서 60dB까지 7가지 단계로 조절 가능하다. PGA이득은 선형성 및 칩 크기를 고려하여 스위치의 온-저항과 수동소자 크기에 의해서 조절 되도록 설계하였다. 이득오차는 0.2dB 보다 작으며 소비전력은 0.47mW이다. 전원전압 1.8V에 $0.18{\mu}m$ CMOS 공정을 이용하여 PGA를 설계하였다.
피드포워드 방식을 이용하여 광대역, 선형 이득 제어 특성을 갖는 SiGe HBT 가변 이득 증폭기를 설계 및 제작하였다. 가변 이득 증폭기는 능동 발룬, 차동형 주 증폭기, 피드포워드 블록, 전압 조절부로 구성 되었으며, 주 증폭기와 피드포워드 블록의 신호가 역위상으로 상쇄되어 광대역의 선형 이득 제어가 가능하도록 각 부분을 최적화 시켰다. 설계된 가변 이득 증폭기는 STMicroelectronics사(社)의 0.35 ${\mu}m$ Si-BiCMOS 공정을 이용하여 제작하였다. 제작 및 측정 결과, 피드포워드 방식의 가변 이득 증폭기는 4 GHz($4\;GHZ{\sim}8\;GHz$)의 광대역 특성을 나타내었다. 또한, 제작된 가변 이득 증폭기는 6 GHz에서 9.3 dB의 최대 이득과 0.6 - 2.6 V의 조절 전압 인가시 19.6 dB의 이득 조절 범위 특성을 나타내었으며, 8 GHz에서 -3 dBm의 출력 전력 특성을 각각 나타내었다.
본 논문에서는 CMOS 스위치를 이용한 디지털 이득 제어 구조를 가진 이득 조절 증폭기 (PGA, Programmable Gain Amplifier)를 제안한다. 기존의 아날로그 이득 제어 방식에서는 가변적인 트랜스 컨덕턴스를 활용하는 과정에서 바이어스 전류나 전압에 의해 이득이 변하게 되어 순간적으로 구성회로의 바이어스 포인트가 변하기 때문에 왜곡이 발생하게 되는 문제점이 있다. 본 논문에서는 이러한 문제점을 해결하기 위해 기존의 gm-boosting 증폭기를 변형한 디지털 이득 제어 방식으로 설계되어 있기 때문에 우수한 선형성을 가지며 특수 목적에 맞도록 그 이득을 6dB에서 60dB까지 7가지 단계로 조절 가능하다. 제안한 PGA는 기존 회로에 비해 0.2dB 보다 작은 이득오차와 0.47mW의 낮은 소비전력 특성을 보였다.
본 논문에서는 표면 부착형 영구자석형 동기 전동기(SPMSM)의 가감속과 부하 변동에 따른 속도 특성 향상을 위해 실제 속도와 부하 토크 관측기를 통한 부하 토크를 입력 변수로 설정하여 가변 이득 조절 알고리즘을 제안한다. 제안된 알고리즘을 증명하기 위해 여러 운전 조건에서 기존의 이득 시스템과 가변 이득 조절 시스템을 비교하여 제안된 알고리즘의 효용성을 검증하였다.
본 논문에서는 저전압 동작이 가능하도록 완전차동 구조의 적분기에 전압조절을 위한 튜닝회로를 추가하여 새로운 적분기를 제안하였다. 제안된 적분기는 이득과 주파수 더 나아가 응용회로의 특성에 영향을 주는 트랜스컨덕턴스값을 증가시키기 위해 전류미러 방식을 이용하여 구성되었다. HSPICE 시뮬레이션 결과, 제안된 적분기는 기존의 완전자동 구조의 적분기에 비해 그 이득값이 두 배 이상 향상되었으며, 간단한 전압조절을 통한 이득 및 주파수 조절이 가능하였다.
본 논문에서는 IMT-2000용 고전력 중폭기에 사용할수 있근 전치 왜곡기를 feedback 방식을 이용하여 설계하였다. 여기서 feedback 방식을 사용함으로써 기존의 전치 왜곡기와는 달리 증폭기의 이득을 조절하기 위해 감쇄기를 사용하지 않고 feedback에 사용한 저항값을 사용하여 이득을 조절하도록 설계하였다.
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[게시일 2004년 10월 1일]
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