본 논문에서는 TP 케이블을 이용하여 100Mbps의 전송 속도를 지원하는 100Base-TX Ethernet 수신기의 디지털 신호 처리부를 제안하였다. 제안하는 디지털 신호 처리부는 자동 이득 조절기, 심볼 동기 복원기, 적응 등화기, BLW 보정기로 구성되어 있으며 초기 위상에 상관없이 150m까지 $10^{-12}BER$이하의 성능을 보였다. 제안하는 신호 처리부는 일부 블록을 제외한 모든 부분을 디지털로 구현하였으며 적응 등화기와 BLW 보정기 연동 구조는 기존의 적응 등화기 에러 값을 이용하는 구조에 비하여 MSE가 약 1dB정도의 성능 향상을 가져왔다. 설계한 디지털 신호 처리부는 Verilog-HDL로 구현되었으며 삼성 $0.18{\mu}m$ 라이브러리를 사용하여 합성 결과 동작 속도는 7.01ns 이며 총 게이트 수는 128.528 게이트였다.
태양으로부터 날아오는 고에너지 하전 입자들은 인공위성이나 지구의 통신장비에 심각한 고장을 일으킬 수 있다. 이런 사고를 방지하기 위해서는 사전에 태양풍의 물리량을 알아내는 것이 중요하다. 이를 위해 inter planetary scintillation 현상을 이용하여 태양풍의 운동을 예보하는 시스템을 전파연구소와 협력하여 개발할 예정이다. 그 첫 단계로 이 시스템보다 작은 규모의 시제품을 만들어 동작을 입증하고자 한다. 이 시제품은 각각 16개의 다이폴 안테나로 구성된 타일 3개로 이루어져 있다. 다이폴 안테나들의 중심주파수는 350MHz이고, 대역폭은 약10MHz이다. 48개의 다이폴 안테나들의 총 집광면적은 약 30m2이고, 타일 내의 다이폴 안테나들을 나선형으로 배열해 grating lobe의 크기를 감소시켰다. 각 안테나에서 나오는 신호는 저 잡음의 LNA를 이용해 증폭하여 beam former로 인가된다. Beam former는 안테나에서 나오는 신호의 위상을 조절하고 합쳐서 약 15도 크기의 빔을 만들고 전자적으로 천체를 추적한다. Beam former에서 나온 신호는 수신기에서 저주파의 신호로 변환되는데, 국부발진기를 조절하여 radio frequency interference에 능동적으로 대처할 수 있도록 하였다. 수신기에서 나오는 아날로그 신호는 digitizer를 최대 107sps의 빠르기로 2바이트의 디지털 신호로 전환된다. Labview 프로그램을 사용하여 3개의 타일에서 나온 신호를 합성해서 태양 근처의 전파원을 추적하도록 하였다.
본 논문에서는 finite-extent backed conductor를 가지는 CPW(Coplanar waveguide) 방향성 결합기에서, 방향성의 향상을 위해 접지면과 전송선 사이의 slot 폭을 확장하는 보상구조를 제안하였다. 제안된 구조는 적절한 slot의 길이와 폭을 가질 경우, 결합기에서의 변화되는 정전용량과 추가된 인덕턴스로 인해 각모드의 위상속도 차이가 없어지므로 우수한 방향성 특성을 갖게 한다. 제안된 보상구조를 이용하여 1 ㎓를 중심주파수로 하는 finite-extent backed conductor를 가지는 CPW 방향성 결합기를 보통의 결합도를 갖는 6 ㏈ 결합기와 높은 결합도를 갖는 3 ㏈ 결합기 형태로 구현하였다 설계된 CPW 방향성 결합기는 MoM(Method of Moments) 방식의 EM solver 계산 결과, 중심주파수에서 목적하는 결합도를 가지면서 각각 55 ㏈와 58 ㏈의 우수한 방향성을 가지며, 정합특성 역시 우수하다. 측정결과는 계산결과와 매우 유사하며, 이를 통하여 제안된 보상구조의 유용성을 확인하였다.
본 논문에서는 varactor-loaded split-ring resonator (VLSRR)를 기반으로 한 가변 metamaterial 전송 선로를 이용한 광대역 전압 제어 발진기를 제안하였다. 우선, 마이크로스트립 라인에 결합된 VLSRR이 주파수 조절 특성을 갖는 metamaterial 전송선로를 만들 수 있음을 증명하였다. 음의 유효 투자율은 VLSRR에 의해 공진 주파수 상에서 협대역으로 얻어지는데, 버랙터 다이오드들의 연결을 통해 주파수가 조절될 수 있다. 1.8 V의 공급 전압을 갖는 전압 제어 발진기는 주파수 조절 범위 $5.407\;{\sim}\;5.84\;GHz$에서 $-108.84\;{\sim}\;-105.5\;dBc/Hz$ @ 100 kHz의 위상 잡음 특성을 얻는다. Power-frequency-tuning-normalized (PFTN)이라고 불리우는 figure of merit (FOM)은 20.144 dB이다.
DTV수신기에서 송신신호를 완벽하게 복원하기 위해서는 채널의 영향으로 인해 파일롯의 위치가 바뀌고 위상이 틀어지는 것을 보상해주는 반송파 주파수 동기와 샘플링 클락 주파수와의 위상오차로 인해 발생하는 샘플링 타이밍 오차를 보상하는 심볼 타이밍 동기가 모두 획득되어야 한다. 심볼 타이밍 동기부는 일반적으로 다중레벨을 가지는 신호에 사용되는 가드너(Gardner)방법을 사용한다. 가드너 방법은 매 심볼마다 타이밍 에러성분을 추출하므로 다중경로 채널에서 타이밍동기를 추적하면서 유지하는데 유리한 방식이다. 본 논문에서는 가드너 방법에서 에러를 검출하기 위해 사용되는 가드너 타이밍 에러 검출기(Timing Error Detector)가 수신파워레벨이 기준 파워레벨에서 크게 벗어날 경우 동기를 획득할 수 없는 문제점을 해결하기 위해 1단계로 가드너 타이밍 에러 검출기 블록 앞에 수신파워레벨을 계산하여 보정하는 블록을 추가하여 수신파워레벨을 보정한다. 2단계로 반송파 주파수동기와 심볼타이밍동기에 사용되는 PLL(Phase Locked Loop)회로의 빠른 동기 획득과 동기 획득 후 지터량을 줄이기 위하여 루프필터의 출력 값의 평균을 이용하여 옵셋량을 추정하여 추정된 옵셋의 변화율에 따라 단계적 대역폭을 가지는 적응적인 루프필터를 반송파 주파수 동기 회로와 심볼 타이밍동기 회로에 적용함으로써 최적의 동기성능을 얻는다.
본 연구에서는 디지털 셀룰러용 IF Frequency Synthesizer의 설계, 시뮬레이션 결과 및 측정 결과를 기술하였으며, 공정 및 소자 라이브러리는 AMS사의 0.8 $\mu\textrm{m}$ BiCMOS를 사용하였다. IF Frequency Synthesizer부는 IF 전압제어발진기, 위상검파기, 8분배기, 차지 펌프 및 루프 필터(Loop Filter) 등을 포함하고 있다. 공급전원은 2.7에서 3.6 V이며, IF VCO의 조절전압은 0.5~2.7V이고, 소비전류는 11 mA로 설계결과와 측정결과가 유사한 결과를 보였다.
본 논문에서는 복잡한 하이퍼카오스 신호를 발생시키는 HVPM (Hyperchaotic Volume Preserving Maps) 모델의 회로를 제안하고, 보드상에서 구현하고자 한다. 제안한 HVPM 모델은 3차원 이산시간(discrete-time) 연립차분방정식으로 구성되어 있으며, 비선형 사상(maps)과 모듈러(modulus) 함수를 사용하여 랜덤한 카오스 어트랙터(attractor)를 발생시킨다. 이러한 HVPM 모델을 하드웨로 구현하기 위하여 연산 부분은 연산증폭기를 사용하고, 매핑(mapping) 부분은 N형 함수와 비교기를 사용하여 설계한다. 특히, N형의 비선형 함수는 CMOS 전달특성과 선형증폭기의 출력특성을 조합하여 독특하게 구현하였다. 구현한 보드상의 실험에서 카오스 시스템 파라미터 값에 대응하는 가변저항기를 조절하여 비주기적인 하이퍼카오스 신호를 발생시킴을 입증하였다. 또한 출력된 카오스 신호들간의 오실로스코프 사진에서 위상공간(phase space)의 동적응답은 랜덤한 어트랙터를 발생시킴을 확인할 수 있었다.
기지국 섹터 배열안테나의 하향 빔틸트 각도를 조절하기 위해 전압제어 이상기를 사용하였다. 틸트 각도에 따른 각 안테나의 위상각을 도출하였으며 이때 생성되는 패턴의 수직과 수평 방향 성능을 분석 평가하였다. 이러한 분석을 통해 이동통신 기지국안테나의 셀커버리지 확보와 통화율 증대, 간섭 저감을 이룰 수 있어 최적의 기지국안테나 설계에 적용 가능할 것이다.
정밀한 작업 공정을 요구하는 산업 현장의 전압 새그 보상이나 각종 장비의 전력 품질 시험을 하기 위해서는 전압 새그 발생의 환경 요건이 필요하다. 그러나 3상 계통 전압은 사용자가 임의로 전압 새그를 발생시킬 수 없기 때문에 장비의 성능 검사 및 각종 시험을 하기가 어렵다. 현재, 여러 가지 전압 새그 보상장치가 개발되고 있으며 이러한 장비의 성능을 검증하기 위해서는 가격이나 품질 면에서 우수한 전압 새그 발생기가 필요하다. 전압 새그 발생기를 통한 시험으로 전압 새그 보상장치의 신뢰도 향상과 예기치 못한 상황에 대한 대책을 강구할 수 있다. 본 논문에서는 전압 새그의 크기와 위상, 그리고 발생하는 구간을 조절할 수 있는 3상 전압 새그 발생장치를 설계하고 그 동작을 3kVA 프로토타입을 제작하여 확인하였다.
본 논문에서는 전자기파 장애(EMI)의 감소를 위한 위상 보간기 기반의 새로운 스프레드 스펙트럼 클락 발생기(SSCG)를 제시한다. 제안하는 SSCG는 낮은 설계 복잡도와 저전력 및 작은 칩면적을 갖으며 삼각 주파수 변조를 이루기 위해 디지털적으로 조절 가능한 위상 보간 방식을 사용하였다. 이 새로운 SSCG는 듀티 싸이클 왜곡 없이 200MHz에서 ${\pm}2%$의 센터-스프레드 스펙트럼 범위를 갖는 시스템 클락을 발생시킬 수 있다. 이 위상 보간기 기반의 SSCG 회로는 200MHz에서 약 5.0 mW의 전력을 소모하고, 0.18-um 1.8-V CMOS 공정을 사용하여 설계하여 검증하였으며 $0.092mm^2$의 칩 면적을 차지한다.
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[게시일 2004년 10월 1일]
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