• Title/Summary/Keyword: 연마패턴

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Comparison of Characteristics of Texture and Groove Precision Lapping Plate by Measuring Frictional Forces (마찰력 측정을 이용한 홈(Groove) 및 임의패턴 초정밀 연마판의 특성 비교)

  • Loh, Byoung-Gook
    • Journal of the Korean Society of Manufacturing Process Engineers
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    • v.5 no.4
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    • pp.21-26
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    • 2006
  • Characteristics of texture and groove precision lapping plate are experimentally investigated by Measuring frictional forces. It is found that the frictional coefficient decreases as the embedding of diamond particles progresses. The groove precision lapping plate with concentric micro-channels indicates superior capability in embedding micrometer-sized diamond particles and uniformity in diamond embedding compared with the texture precision lapping plate with a series of circular micro-channels.

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A Study on the Effect of Pattern Density and it`s Modeling for ILD CMP (패턴 웨이퍼의 화학기계적 연마시 패턴 밀도의 영향과 모델링에 관한 연구)

  • Hong, Gi-Sik;Kim, Hyung-Jae;Jeong, Hae-Do
    • Journal of the Korean Society for Precision Engineering
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    • v.19 no.1
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    • pp.196-203
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    • 2002
  • Generally, non-uniformity and removal rate are important factors on measurements of both wafer and die scale. In this study, we verify the effects of the pressure and relative velocity on the results of the chemical mechanical polishing and the effect of pattern density on inter layer dielectric chemical mechanical polishing of patterned wafer. We suggest an appropriate modeling equation, transformed from Preston\`s equations which was used in glass polishing, and simulate the removal rate of patterned wafer in chemical mechanical polishing. Results indicate that the pressure and relative velocity are dominant factors for the chemical mechanical polishing and pattern density effects on removal rate of pattern wafers in die scale. The modeling is well agreed to middle and low density structures of the die. Actually, the die used in Fab. was designed to have an appropriate density, therefore the modeling will be suitable for estimating the results of ILD CMP.

CMP 컨디셔닝 공정에서의 부식방지를 위한 자기조립 단분자막의 적용과 표면특성 평가

  • Jo, Byeong-Jun;Gwon, Tae-Yeong;Venkatesh, R. Prasanna;Kim, Hyeok-Min;Park, Jin-Gu
    • Proceedings of the Materials Research Society of Korea Conference
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    • 2011.05a
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    • pp.33.2-33.2
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    • 2011
  • CMP (Chemical-Mechanical Planarization) 공정이란 화학적 반응과 기계적 힘을 동시에 이용하여 표면을 평탄화하는 공정으로, 반도체 산업에서 회로의 고집적화와 다층구조를 형성하기 위해 CMP 공정이 도입되었으며 반도체 패턴의 미세화와 다층화에 따라 CMP 공정의 중요성은 더욱 강조되고 있다. CMP 공정은 압력, 속도 등의 공정조건과, 화학적 반응을 유도하는 슬러리, 기계적 힘을 위한 패드 등에 의해 복합적으로 영향을 받는다. CMP 공정에서, 폴리우레탄 패드는 많은 기공들을 포함한 그루브(groove)를 형성하고 있어 웨이퍼와 직접적으로 접촉을 하며 공정 중 유입된 슬러리가 효과적으로 연마를 할 수 있도록 도와주는 역할을 한다. 하지만, 공정이 진행 될수록 그루브는 손상이 되어 제 역할을 하지 못하게 된다. 패드 컨디셔닝이란 컨디셔너가 CMP 공정 중에 지속적으로 패드 표면을 연마하여 패드의 손상된 부분을 제거하고 새로운 표면을 노출시켜 패드의 상태를 일정하게 유지시키는 것을 말한다. 한편, 금속박막의 CMP 공정에 사용되는 슬러리는 금속박막과 산화반응을 하기 위하여 산화제를 포함하는데, 산화제는 금속 컨디셔너 표면을 산화시켜 부식을 야기한다. 컨디셔너의 표면부식은 반도체 수율에 직접적인 영향을 줄 수 있는 scratch 등을 발생시킬 뿐만 아니라, 컨디셔너의 수명도 저하시키게 되므로 이를 방지하기 위한 노력이 매우 중요하다. 본 연구에서는 컨디셔너 표면에 연마 잔여물 흡착을 억제하고, 슬러리와 컨디셔너 표면 간에 일어나는 표면부식을 방지하기 위하여 소수성 자기조립 단분자막(SAM: Self-assembled monolayer)을 증착하여 특성을 평가하였다. SAM은 2가지 전구체(FOTS, Dodecanethiol를 사용하여 Vapor SAM 방법으로 증착하였고, 접촉각 측정을 통하여 단분자막의 증착 여부를 평가하였다. 또한 표면부식 특성은 Potentiodynamic polarization와 Electrochemical Impedance Spectroscopy (EIS) 등의 전기화학 분석법을 사용하여 평가되었다. SAM 표면은 정접촉각 측정기(Phoenix 300, SEO)를 사용하여 $90^{\circ}$ 이상의 소수성 접촉각으로써 증착여부를 확인하였다. 또한, 표면에너지 감소로 인하여 슬러리 내의 연마입자 및 연마잔여물 흡착이 감소하는 것을 확인 하였다. Potentiodynamic polarization과 EIS의 결과 분석으로부터 SAM이 증착된 표면의 부식전위와 부식전류밀도가 감소하며, 임피던스 값이 증가하는 것을 확인하였다. 본 연구에서는 컨디셔너 표면에 SAM을 증착 하였고, CMP 공정 중 발생하는 오염물의 흡착을 감소시킴으로써 CMP 연마 효율을 증가하는 동시에 컨디셔너 금속표면의 부식을 방지함으로써 내구성이 증가될 수 있음을 확인 하였다.

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A Study of Data correction method when in-situ end point detection in Chemical-Mechanical Polishing of Copper Overlay (구리 박막 CMP의 실시간 end point detection을 위한 데이터 정밀도 개선 방법에 관한 연구)

  • Kim, Nam-Woo;Hur, Chang-Wu
    • Journal of the Korea Institute of Information and Communication Engineering
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    • v.18 no.6
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    • pp.1401-1406
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    • 2014
  • Knowledge of the manufacturing process of semiconductor devices in order to obtain a copper pattern using chemical mechanical polishing (CMP) planarization using a Wafer polishing process is applied with a thickness of the copper measured in real time, which need to be precisely controlled by, where the acquisition the actual thickness of the sensor value with the calculated value in terms of error can occur in the process. Approximated the actual measurement values so as to obtain a method using a simple average, moving average, compared to the results using filters onggo Strom real-time measurements of the thickness of the units of the control system to reduce the variation in the implementation of the method described for the.

The study of data correction method comparison on wafer coating thickness measurement systems improving. (웨이퍼 박막두께측정 시스템의 정밀도 개선을 위한 데이터 보정방법 비교에 관한 연구)

  • Kim, Nam-woo;Hur, Chang-Wu
    • Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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    • 2014.05a
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    • pp.759-762
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    • 2014
  • 반도체소자의 제조 공정 기술 중 구리패턴을 얻기 위해서 사용하는 화학.기계적 연마(CMP)를 이용한 평탄화와 연마 공정에서 Wafer에 도포된 구리의 두께를 실시간으로 측정하여 정밀하게 제어할 필요가 있는데, 이때 획득되는 센서값을 실제 두께 값으로 환산하는 계산과정에서 오차가 발생할 수 있다. 실제 측정 값에 근사한 값을 얻도록 단순평균을 이용한 방법, 이동 평균, 필터 들을 사용하여 결과를 비교하여 옹고스트롬 단위의 두께를 실시간으로 측정하는 제어 시스템의 편차를 줄이도록 하는 방법의 구현에 대해 기술한다.

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Electrical Properties of Fabrication PZT Capacitors by Chemical Mechanical Polishing Process (화학적 기계적 연마 공정으로 제조한 PZT 캐패시터의 전기적 특성)

  • Ko, Pil-Ju;Kim, Nam-Hoon;Lee, Woo-Sun
    • Proceedings of the Korean Institute of Electrical and Electronic Material Engineers Conference
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    • 2006.11a
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    • pp.370-371
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    • 2006
  • 본 연구에서는 PZT박막의 강 유전 캐패시터 제작을 위한 연구로, 4-inch크기의 $SiO_2$/Pt/Ti/Si가 증착된 웨이퍼를 습식 식각하여 $SiO_2$ 패턴(0.8um)을 형성하였고, PZT박막의 캐패시터 제작을 위해 패턴 웨이퍼에 $Pb_{1.1}$($Zr_{0.52}Ti_{0.48}$)$O_3$조성을 갖는 PZT를 증착하였다. $600^{\circ}C$에서 열처리 후 페로브스카이트 구조를 가지는 PZT 박막의 CMP(chemical mechanical polishing) 공정에 따른 전기적 특성을 연구하였다. 강유전체 소자 적용을 위한 CMP 공정으로 제조된 PZT 박막 캐패시터의 P-E특성, I-V특성, 피로특성 등의 전기적 특성을 측정하였다.

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The fabrication of micro- size conductor lines on alumina patterned by laser ablation (레이저 직접 묘화법에 의한 알루미나 기판위의 미세 전도성 패턴 제작)

  • 김혜원;이제훈;신동식;강성군
    • Proceedings of the Korean Society of Precision Engineering Conference
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    • 2003.06a
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    • pp.1889-1892
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    • 2003
  • The fabrication of micro-size patterning on alumina substrate is generated by laser direct writing, which has high precision and selectivity of various laser beam energies. The depth and width of patterns is affected by laser parameter such as laser power, scan rate. Through the chemical and mechanical polishing Pd seeds was effectively got rid of alumina substrate for selectivity electroless Ni plating. Thermal treatment is good method for changing electrical property of conductor line, because the treatment can control of the grain size.

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