• 제목/요약/키워드: 스칼라 3

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음향인텐시티법에 의한 원형 톱날에서의 이동소음원 규명 (Identification of the Moving Noise Source in a Circular Sawblade by the Experimental Acoustic Intensity Technique)

  • 오재응;김동규;하범성;원선희
    • 한국음향학회지
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    • 제10권6호
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    • pp.82-100
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    • 1991
  • 본 연구에서는 회전톱날에서 발생하는 공기소음원 규명의 실현가능성을 검토하였다. 음향인텐시 티법은 3차원 선도, 인벤시티 벡터에너지선도, 동고선도 등의 표현에 유용한 장점을 갖고 있다. 근거리 음장 거동에 대한 추정, 주파수영역에서의 벡터 또는 스칼라 음향인텐시티는 소음원규명의목적으로 사 용되는 측정기법이다. 결과에 따르면 난류는 원형톱날의 이 부근에 나타나며, 톱날의 변동압력 측정에서 와류구조의 영향에 대한 근거는 측정된 음향인텐시티에 의해 도출된다. 도한 회전속도가 증가함에 딸k, 상호작용은 도플러현상을 일으키는 중요한 소음메타니즘이 될 수 있다.

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64비트 4-way 수퍼스칼라 마이크로프로세서의 효율적인 분기 예측을 수행하는 프리페치 구조 (A Prefetch Architecture with Efficient Branch Prediction for a 64-bit 4-way Superscalar Microprocessor)

  • 문상국;문병인;이용환;이용석
    • 한국통신학회논문지
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    • 제25권11B호
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    • pp.1939-1947
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    • 2000
  • 본 논문에서는 명령어의 효율적인 페치를 위해 분기 타겟 주소 전체를 사용하지 않고 캐쉬 메모리(cache memory) 내의 적은 비트 수로 인덱싱 하여 한 클럭 사이클 안에 최대 4개의 명령어를 다음 파이프라인으로 보내줄 수 있는 방법을 제시한다. 본 프리페치 유닛은 크게 나누어 3개의 영역으로 나눌 수 있는데, 분기에 관련하여 미리 부분적으로 명령어를 디코드 하는 프리디코드(predecode) 블록, 타겟 주소(NTA : Next Target Address) 테이블 영역을 추가시킨 명령어 캐쉬(instruction cache) 블록, 전체 유닛을 제어하고 가상 주소를 관리하는 프리페치(prefetch) 블록으로 나누어진다. 사용된 명령어들은 SPARC(Scalable Processor ARChitecture) V9에 기준 하였고 구현은 Verilog-HDL(Hardwave Description Language)을 사용하여 기능 수준으로 기술되고 검증되었다. 구현된 프리페치 유닛은 명령어 흐름에 분기가 존재하더라도 단일 사이클 안에 4개까지의 명령어들을 정확한 예측 하에 다음 파이프라인으로 보내줄 수 있다. 또한 NTA를 사용한 방법은 같은 수의 레지스터 비트를 사용하였을 때 BTB(Branch Target Buffer)를 사용하는 방법과 비교하여 2배정도 많은 개수의 분기 명령 주소를 저장할 수 있는 장점이 있다.

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유도 전동기의 매개변수 측정 및 동정 (Parameter Measurement and Identification for Induction Motors)

  • 김규식;김춘환
    • 전력전자학회논문지
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    • 제6권3호
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    • pp.282-290
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    • 2001
  • 유도전동기의 고성능 응답을 얻기 위해서는 전동기 매개변수의 정확한 추정이 필수적이다. 본 논문에서는 고정자(회전자)저항, 고정자(회전자)누설 인덕턴스, 상호 인덕턴스, 관성 모멘트와 같은 매개변수들을 오프라인으로 측정하였다. 고정자(회전자) 저항과 고정자(회전자) 누설 인덕턴스는 정지좌표계의 방정식들로부터 측정한 반면, 상호 인덕턴스는 스칼라 제어 상태에서 측정되었다. 마지막으로, 확장 칼만필터를 이용하여 회전자 역시 상수를 온라인 상에서 동정하였다. 본 논문에서 언급하는 추정알고리즘들의 유용성을 보이기 위해 실험결과들을 제시하였다.

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다중 공유 자원을 위한 프로세스 대수 (Process Algebra for Multiple Shared Resources)

  • 유희준;이기흔;최진영
    • 한국정보과학회논문지:시스템및이론
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    • 제27권3호
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    • pp.337-344
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    • 2000
  • 본 논문에서는 다중자원(multiple resource)을 사용하는 시스템의 명세와 검증을 위한 프로세스 대수 ACSMR(Algebra of Communicating Shared Multiple Resources)을 정의한다. ACSMR은 프로세스 대수 기반의 정형기법(formal methods)인 ACSR에 다중자원의 개념을 확장한 것이다. 명세와 검증의 예로 실시간 시스템의 스케줄링 기법의 하나인 Earliest-Deadline-First(EDF)를 멀티프로세서하에서의 시스템의 행동 명세와 다중 포트를 가진 레지스터를 이용한 수퍼스칼라 프로세서의 타이밍 특성과 자원 제한을 묘사하기 위한 명세방법을 제시한다.

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비정질 칼코게나이드에서 광유기 스칼라 현상의 가역성에 관한 연구 (A Study on the Reversibility Scalar Phenomena in Amorphous Chalcogenides)

  • 박수호;정진만;이현용;정홍배
    • 한국전기전자재료학회:학술대회논문집
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    • 한국전기전자재료학회 1997년도 춘계학술대회 논문집
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    • pp.31-34
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    • 1997
  • A reversible scalar phenomena in amorphous As$_{40}$ Ge$_{10}$ Se$_{15}$ S$_{35}$ have been investigated by blue-pass-filtered Hg lamp and He-Ne laser. Annealing causes the shift of the absorption edge to shelter wavelengths approximately 0.17ev, also illumination moves it to longer wavelengths about 0.05 ~ 0.07eV and it increases the refractive index maximum 0.3. Therefore the thermalbleaching(TB) and photodarkening(PD) effects have been understood by the results related to optical absorption characteristics. TB could be estimated as increasing the stabilization of amorphous chalcogenide films since absorption slope of extended regions(U) was not changed by annealing. On the other hand, PD could be understood as due to the enhancement of disorder since the slope of Urbach’s tail(1/F) around an absorption edge were decreased by illumination.ion.n.

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표면 삼각형 전개함수에 대한 수치적분식의 유도 (Derivation of Numerical Integral Equations for Surface Triangular Basis Functions)

  • 정백호;김채영
    • 대한전기학회:학술대회논문집
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    • 대한전기학회 1996년도 하계학술대회 논문집 C
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    • pp.1750-1752
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    • 1996
  • 모멘트법을 적용한 임의 형태 구조의 전자파 수치해석시 Rao에 의해 제시된 삼각형 표면 벡터 전개함수가 많이 사용된다. 이 경우 스칼라 적분식과 벡터 적분식이 나타나는데, 면적 좌표계가 도입되기 때문에 적분과정이 복잡해진다. 또한 구현시는 삼각형의 절점 정보 뿐만 아니라 쌍을 이루는 삼각형 번호의 데이터를 미리 입력하여야 하는 번거로움이 뒤따른다. 이를 극복하고자 본 논문에서는 삼각형 영역 자체에서 적분을 수행함으로써 적분식의 수를 2/3로 줄였으며, 삼각형의 쌍을 이루는 절점 정보로부터 적을 수행할 수 있도록 하였다.

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슈퍼스칼라 프로세서에서 정적 및 동적 분류를 사용한 혼합형 결과 간 예측기 (A Hybrid Value Predictor Using Static and Dynamic Classification in Superscalar Processors)

  • 김주익;박홍준;고광현;조영일
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2002년도 가을 학술발표논문집 Vol.29 No.2 (1)
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    • pp.682-684
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    • 2002
  • 최근 여러 논문에서 실 데이터 종속을 제거하기 위하여 결과 값 예상 기법을 제안하였다. 결과 값 예상 기법 중 혼합형 결과 값 예측기는 다양한 패턴을 갖는 명령어를 모두 예측함으로써 높은 예상 정확도를 얻을 수 있지만 하나의 명령어가 여러 개의 예측기 테이블에 중복 저장되어 높은 하드웨어 비용을 요구한다는 단점이 있다. 본 논문에서는 이러한 단점을 극복하기 위하여 프로파일링으로 얻어진 정적 분류 정보를 사용하여, 명령어률 예상 정확도가 높은 예측기에만 할당하여 예상 테이블 크기를 감소 시켰다. 또한 동적으로 적절한 예측기를 선택하도록 함으로써 예상 정확도를 더욱 향상 시켰다. 본 논문에서는 SPECint95 벤치마크 프로그램에 대해 SimpleScalar/PISA 3.0 툴셋을 사용하여 실험하였다. 정적-동적 분류 정보를 모두 사용하였을 경우 87.9%, VHT 크기를 4K로 축소한 경우 87.5%로 비슷한 예상정확도를 얻으면서 예상 테이블의 크기는 50%로 감소하였다. 또한 실행 패턴의 유형 비율에 따라 각 예측기의 VHT를 구성한 경우 예상 테이블 크기를 25%로 줄일 수 있었다.

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3-way Toom-Cook 곱셈 알고리듬과 고속 축약 알고리듬을 이용한 256-비트 모듈러 곱셈기 설계 (A Design of 256-bit Modular Multiplier using 3-way Toom-Cook Multiplication Algorithm and Fast Reduction Algorithm)

  • 양현준;신경욱
    • 한국정보통신학회:학술대회논문집
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    • 한국정보통신학회 2021년도 추계학술대회
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    • pp.223-225
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    • 2021
  • 모듈러 곱셈은 ECC의 점 스칼라 곱셈을 위한 핵심 연산이며, ECC 프로세서의 성능에 영향을 미치는 가장 중요한 요소이다. 본 논문에서는 3-way Toom-Cook 곱셈 알고리듬과 수정된 고속 축약 알고리듬을 적용한 256-비트 모듈러 곱셈기 설계에 대해 기술한다. 90-비트 곱셈기 1개와 264-비트 가산기 3개가 사용되었으며, 하드웨어 크기와 소요 클록 사이클 수 사이의 최적화를 이루었다. Zynq UltraScale+ MPSoC 디바이스에 구현하여 모듈러 곱셈기를 검증하였으며, 모듈러 곱셈 연산에 15 클록 사이클이 소요된다.

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3차원 스캔 데이터로부터의 인체 팔, 다리 형상 복원 (Human Limbs Modeling from 3D Scan Data)

  • 현대은;윤승현;김명수
    • 한국컴퓨터그래픽스학회논문지
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    • 제8권4호
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    • pp.1-7
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    • 2002
  • 본 논문에서는 3차원 인체 형상 스캔 데이터로부터 팔, 다리형상을 복원하는 방법을 제시한다. 이 방법에서는 팔, 다리 스캔 데이터의 대략적인 형상을 나타내는 기반 곡면과 자세한 세부 현상을 나타내는 displacement 맵의 이중구조로 형상을 복원한다. 팔, 다리 부분의 스캔 데이터 형상은 골격을 따라 스윕하는 타원체로 근사되며, 이 타원체 스윕을 부드럽게 감싸는 envelope 곡면으로 기반 곡면을 생성한다. 타원체 스윕의 envelope 곡면은 빠른 계산을 위해 골격을 따라 추출되는 타원의 스윕 곡면으로 근사된다. 기반 곡면에 대한 스캔 데이터 점들의 displacement는 각 단면 타원으로의 매핑을 통해 스칼라 값으로 구해지며, 다단계 스플라인 함수를 이용하여 매개화된 displacement 맵을 구성한다. 이 과정에서 복원된 형상 위의 점들은 해당하는 타원체 상으로 매핑된다. 본 방법을 통하여 팔, 다리의 간결한 형상 표현을 추출할 수 있으며, 매핑된 타원체를 이용하여 형상을 빠르고 사실적으로 변형할 수 있다.

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멀티코어 프로세서의 명령어 자취형 모의실험에 대한 연구 (A Study of Trace-driven Simulation for Multi-core Processor Architectures)

  • 이종복
    • 한국인터넷방송통신학회논문지
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    • 제12권3호
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    • pp.9-13
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    • 2012
  • 최근에 이르러, 과거 수퍼스칼라 프로세서의 하드웨어 복잡도와 전력소모 문제를 극복하기 위하여 멀티코어 프로세서가 상용화 되어 널리 이용되고 있다. 이러한 멀티코어 프로세서의 설계 초기 단계에서는 광범위한 모의실험을 수행하는 것이 매우 중요하다. 그러나 기존의 실행 위주(execution-driven)의 멀티코어 프로세서 모의실험기는 속도가 느리다는 단점이 있다. 본 논문에서는 이것을 극복하기 위하여 빠른 속도를 갖는 명령어 자취형 (trace-driven) 멀티코어 프로세서 모의실험기를 개발하였으며, 이것을 이용하여 2 개에서 16 개까지의 멀티코어 프로세서에 대하여 SPEC 2000 벤치마크를 입력으로하여 모의실험을 수행하였다. 모의실험 결과, 16개의 코어를 이용하는 멀티코어 프로세서에서 평균 4.1 IPC의 성능과 단일코어 대비 13.3 배의 성능 향상을 기록하였다.