The Journal of Korean Institute of Communications and Information Sciences
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v.23
no.8
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pp.1907-1914
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1998
This paper proposes the adaptive connection admission cotrol using the variale MRR(measurement reflection ratio) and the distribution of the number of cells arriving during the fixed interval. This distribution is estimated from the measured number of cells arriving at the output buffer during the fixed interval and traffic parameters specified by user. MRR is varied by the difference of estimated distribution and measurement distribution. As MRR is adaptively varied by estimated distribution error of accepted connections, it quickly reduces estimation error. Also, the scheduling scheme is proposed for multiplexed traffic with various traffic characteristics. For each traffic class, this scheme estimates adaptively equivalent bandwidth and schedules according to equivalent bandwidth ratio of each traffic class, so it improves cell loss rate and link utilization.
We have observed the nonlinear magneto-optic effect(NMOE) based on atomic coherence in $^{87}$ Rb D$_1$-line using the Rb vapor cell containing 50 Torr of Ne. The width of the NMOE signal was measured to be 2$\pi$${\times}$464 Hz, when the peak-to-peak B-field variation was 1 mGauss. The result of this work may be applied to a high-sensitivity magnetometer.
This paper analyzes the performance of an optical line termination system in ATM based Passive Optical Network(PON) using the operational analysis. We analyze it using system parameters such as utilization, throughput and routing frequency based on the buffer structure in each block of ATM-PON. Furthermore, we derive the mean response time and the visit ratio of each block, and then search the bottleneck block that hinders the system performance. We found that the 622Mbps 16x16 switching block is the bottleneck block for ATM-PON. In this bottleneck block, the loss probability increases rapidly when the cell arrival rate increases.
Proceedings of the Korean Vacuum Society Conference
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2010.08a
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pp.23-23
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2010
CIGS 박막태양전지는 박막태양전지 기술 중 가장 주목을 받고 있는 기술에 해당한다. 그 이유는 박막태양전지 기술 중 즉, CdTe, a-Si, CIGS 중 가장 셀 효율이 높게 구현되고 있으며, 특히 다양한 제조공정이 가능하기 때문이다. 현재 CIGS 박막태양전지 양산에 적용되고 있는 제조기술은 동시증발법과 스퍼터/셀렌화 공정이다. 동시증발법의 경우, CIGS 태양전지의 세계최고효율을 구현한 기술로서 다른 모든 제조기술의 기준이 되는 공정이나, 실제로는 스퍼터/셀렌화 공정을 이용한 양산 규모가 훨씬 크게 전개되고 있다. 본 논문에서는 동시증발법이 최고효율을 구사한 물질 및 공정 스펙에 대해 살펴보고, 스퍼터/셀렌화 공정에서 동시증발법에 의해 제조된 소자 스펙을 구현하기 위해 어떠한 노력을 기울여야 하는 지에 대해 기술하고자 한다. 먼저, 동시증발법이 적용된 양산기술 현황에 대해 살펴보고, 여러가지 스펙 중에서 Na 제어기술, 버퍼층 기술, 투명전극 측면에서 소자성능의 최적화를 논하고자 한다. Na의 경우, 널리 알려진 바와 같이 CIGS 내 0.1at% 정도의 함유량이 필요하다. 동시증발법과는 다른 공정온도와 이력이 사용되는 스퍼터/셀렌화의 경우, Na 함량의 제어를 위해 어떠한 노력이 필요한지 Na의 역할 측면에서 논하고자 한다. CBD 공정으로 제조되고 있는 CdS는 얇은 두께와 단순한 공정으로 인해 다소 소홀하기 쉬우나, CdS/CIGS 접합이 소자의 성능에 미치는 영향이 매우 크기 때문에 CIGS 표면 물성 제어 측면에서 CdS 제조공정을 살펴보고자 한다. 마지막으로 투명전극은 CIGS 제조공정과는 무관하게 공통으로 검토가 필요한 분야이나, 동시 증발법에 의한 CIGS 표면형상이 스퍼터/셀렌화에 의한 CIGS와는 크게 다르므로 후속 투명전극공정 또한 세부적인 검토가 필요하다고 판단되는 바, 투명전극이 갖춰야하는 물성을 중심으로 소자최적화를 논하고자 한다.
Proceedings of the Korean Institute of Information and Commucation Sciences Conference
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2011.10a
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pp.431-435
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2011
This paper presents optimized searching technique to improve the performance of H.264/AVC. The proposed CAVLC encoder uses forward and backward searching algorithm to compute the parameters. By zero-block skipping technique and pipelined scheduling, the proposed CAVLC encoder can obtain better performance. The experimental result shows that the proposed architecture needs only 66.6 cycles on average for each $16{\times}16$ macroblock encoding. The proposed architecture improves the performance by 13.8% than that of previous designs. The proposed CAVLC encoder was implemented using VerilogHDL and synthesized with Megnachip $0.18{\mu}m$ standard cell library. The synthesis result shows that the gate count is about 15.6K with 125Mhz clock frequency.
Journal of the Korean Association of Geographic Information Studies
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v.8
no.3
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pp.84-95
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2005
This paper presents solution heuristics to solving optimal multiple-viewpoint location problems that are based on topographic features. The visibility problem is to maximise the viewshed area for a set of viewpoints on digital elevation models (DEM). For this analysis, five areas are selected, and fundamental topographic features (peak, pass, and pit) are extracted from the DEMs of the study areas. To solve the visibility problem, at first, solution approaches based on the characteristics of the topographic features are explored, and then, a benchmark test is undertaken that solution performances of the solution methods, such as computing times, and visible area sizes, are compared with the performances of traditional spatial heuristics. The feasibility of the solution methods, then, are discussed with the benchmark test results. From the analysis, this paper can conclude that fundamental topographic features based solution methods suggest a new sight of visibility analysis approach which did not discuss in traditional algorithmic approaches. Finally, further research avenues are suggested such as exploring more sophisticated selection process of topographic features related to visibility analysis, exploiting systematic methods to extract topographic features, and robust spatial analytical techniques and optimization techniques that enable to use the topographic features effectively.
This paper describes an efficient design of the interpolation circuit to generate the luma and chroma sub-pixels for H.264 motion estimation. The circuit based on the proposed architecture does not require any input data buffering and processes the horizontal, vertical and diagonal sub-pixel interpolations in parallel. The performance of the circuit is further improved by simultaneously processing the 1/2-pixel and 1/4-pixel interpolations for luma components and the 1/8-pixel interpolations for chroma components. In order to reduce the circuit size, we store the intermediate data required to process all the interpolations in parallel in the internal SRAM's instead of registers. We described the proposed circuit at register transfer level and verified its operation on FPGA board. We also synthesized the gate-level circuit using 130nm CMOS standard cell library. It consists of 20,674 gates and has the maximum operating frequency of 244MHz. The total number of SPSRAM bits used in our circuit is 3,232. The size of our circuit (including logic gates and SRAM's) is smaller than others and the performance is still comparable to them.
The Journal of Korean Institute of Communications and Information Sciences
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v.33
no.4A
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pp.377-386
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2008
In this paper, a new handover management scheme has been proposed to reduce handover latency and to support fast handover without packet losses, so that it may be applicable to the wireless mobile Internet system such as IPv6-based WiBro system. To minimize the handover latency in processing of movement detection, we propose the handover management scheme which simplifies the handover message exchanging procedure between mobile subscriber station (MSS) and network by integrating layer 2 and layer 3 handovers efficiently based on the layer2 information. To reduce the processing delay from new care-of-address (NCoA) configuration during handover, we propose that NCoA is created, distributed and managed by new access control router (NACR). In addition, in order to minimize the packet transmission delay and eliminate the packet losses, the proposed scheme employs a crossover router (CR) which is upper network located over PACR and NACR and employs the packet buffering for MSS. The simulation study shows that the proposed scheme achieves loss-free packet delivery and low latency in the environment of narrow overlapped cell area or high velocity of the MSS, comparing the performance with the conventional schemes.
Journal of the Korean Institute of Telematics and Electronics S
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v.35S
no.8
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pp.12-20
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1998
All-optical networks(AON) are emerging as the next generation broadband networks for wide-area and local-area networks. Many optical switch architectures are currently proposed to realize AON. Specially, optical switches using WDM have a lot of advantages in point of the optical transparency and network topology for B-ISDN services in AON. In this paper, two kinds of Knockout Optical Switching Architectures(KOSA) are proposed for high speed optical ATM networks. We use WDM technologies for them to operate in all-optical area and they are called Architecture-Ⅰ, Architecture-Ⅱ respectively. Each one represents different characteristics according to the number of components and the kind of components, which make KOSA have different performance and system complextity. In order to verify and to compare the performance, these architectures were analyzed and simulated in terms of cell loss ratio, system complexity and buffering speed.
Journal of the Korean Institute of Telematics and Electronics S
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v.36S
no.6
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pp.87-95
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1999
We propose a simulation model of 3-dimensional MPEG data over Asynchronous transfer Mode(ATM) networks. The model is based on a slice level and is named to Projected Vector Autoregressive(PVAR) model. The PVAR model is modeled using the Autoregressive(AR) model in order to meet the autocorrelation condition and fit the histogram, and maps real data by a projection function. For the projection function, we use the Cumulative Distribution Probability Function (CDPF), and the procedure is performed at each slice level. Our proposed model shows good performance in meeting the autocorrelation condition and fitting the histogram, and is found important in analyzing the performance of networks. In addiotion, we apply a smoothing method by which a periodic mean value. In general. the Quality of Service(QoS) depends on the Cell Loss Rate(CLR), which is related to the cell loss and a maximum delay in a buffer. Hence the proposed smoothing method can be used to improve the QoS.
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[게시일 2004년 10월 1일]
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