• Title/Summary/Keyword: 설계순서

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Confidence Bounds following Adaptive Group Sequential Tests with Repeated Measures in Clinical Trials (반복측정자료를 가지는 적응적 집단축차검정에서의 신뢰구간 추정)

  • Joa, Sook Jung;Lee, Jae Won
    • The Korean Journal of Applied Statistics
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    • v.26 no.4
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    • pp.581-594
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    • 2013
  • A group sequential design can end a clinical trial early if a confirmed efficacy or a futility of study medication is found during clinical trials. Adaptation can adjust the design of clinical trials based on accumulated data. The key to this methodology is considered to control the overall type 1 error rate while maintaining the integrity of clinical trials. The estimation would be more complex and the sample size calculation will be more difficult if the clinical trials have repeated measurement data. Lee et al. (2002) suggested a repeated observation case by using the independent increments properties of the interim test statistics and investigated the properties of the proposed confidence interval based on the stage-wise ordering. This study extend Lee et al. (2002) to adaptive group sequential design. We suggest test statistics for the adaptation as redesigning the second stage of clinical trials and induce the stage-wise confidence interval of parameter of interests. The simulation will help to confirm the suggested method.

A Design of Time-based Anomaly Intrusion Detection Model (시간 기반의 비정상 행위 침입탐지 모델 설계)

  • Shin, Mi-Yea;Jeong, Yoon-Su;Lee, Sang-Ho
    • Journal of the Korea Institute of Information and Communication Engineering
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    • v.15 no.5
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    • pp.1066-1072
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    • 2011
  • In the method to analyze the relationship in the system call orders, the normal system call orders are divided into a certain size of system call orders to generates gene and use them as the detectors. In the method to consider the system call parameters, the mean and standard deviation of the parameter lengths are used as the detectors. The attack of which system call order is normal but the parameter values are changed, such as the format string attack, cannot be detected by the method that considers only the system call orders, whereas the model that considers only the system call parameters has the drawback of high positive defect rate because of the information obtained from the interval where the attack has not been initiated, since the parameters are considered individually. To solve these problems, it is necessary to develop a more efficient learning and detecting method that groups the continuous system call orders and parameters as the approach that considers various characteristics of system call related to attacking simultaneously. In this article, we detected the anomaly of the system call orders and parameters by applying the temporal concept to the system call orders and parameters in order to improve the rate of positive defect, that is, the misjudgment of anomaly as normality. The result of the experiment where the DARPA data set was employed showed that the proposed method improved the positive defect rate by 13% in the system call order model where time was considered in comparison with that of the model where time was not considered.

Design of Ternary Logic Circuits Based on Reed-Muller Expansions (Reed-Muller 전개식에 의한 3치 논리회로의 설계)

  • Seong, Hyeon-Kyeong
    • Journal of the Korea Institute of Information and Communication Engineering
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    • v.11 no.3
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    • pp.491-499
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    • 2007
  • In this paper, we present a design method of the ternary logic circuits based on Reed-Muller expansions. The design method of the presented ternary logic circuits checks the degree of each variable for the coefficients of Reed-Holler Expansions(RME) and determines the order of optimal control input variables that minimize the number of Reed-Muller Expansions modules. The order of optimal control input variables is utilized the computation of circuit cost matrix. The ternary logic circuits of the minimized tree structures to be constructed by RME modules based on Reed-Muller Expansions are realized using the computation results of its circuit cost matrix. This method is only performed under unit time in order to search for the optimal control input variables. Also, this method is able to be programmed by computer and the run time on programming is $3^n$.

Publish Queue based Message Transmission Techniques considering Performance Improvement in MQTT Protocol (MQTT 프로토콜에서 성능향상을 고려한 Publish Queue 기반 메시지 전송 기법)

  • Lim, Kwang Kyu;Park, JiSu;Shon, Jin Gon
    • Proceedings of the Korea Information Processing Society Conference
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    • 2018.05a
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    • pp.262-265
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    • 2018
  • MQTT 프로토콜은 저전력 대비 고성능으로 모바일 디바이스의 실시간 메시지 전송 시스템에 사용한다. 실시간 메시지 시스템을 구축하기 위해서는 신뢰적인 메시지 전송과 메시지간 순서 보장이 반드시 이루어져야 한다. 기존 연구에서는 MQTT 프로토콜의 QoS 2 레벨을 이용하여 메시지 순서를 보장하는 신뢰적인 메시지 시스템을 설계 및 구현하였으나, QoS 1 레벨보다 성능이 낮아진다. 따라서 본 논문에서는 MQTT 프로토콜의 QoS 1 레벨을 사용하고, Publish Queue를 이용하여 순서 보장과 함께 성능 향상을 고려한 메시지 전송 기법을 제안한다.

Design and Implementation of Event Analysis/Arrange Function for Mobile Device Simulator (모바일 디바이스 시뮬레이터용 이벤트 분석 및 배열 기능의 설계 및 구현)

  • Lee, Young-Seok
    • Journal of the Korea Institute of Information and Communication Engineering
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    • v.14 no.6
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    • pp.1429-1434
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    • 2010
  • Generally, the simulator for mobile device tests automatically an application software after instilling again the event, which is saved in log file according to an event generation sequence, into the application software of device. But, the simulator performance for mobile device can be different according to a extraction layer even if the events are same. And, the sequence of events extracted from an application is changeable in the environment that multiple applications are operated concurrently. Therefore, even though the same applications is executed to the same sequence, the generation sequence of events is revised in accordance with the state of mobile device system, and whether the errors occur according to circumstances or not. This kind of application software error is very difficult to perform a debugging operation. In this paper, the execution state of various applications is verifiable through the re-editing of events after analyzing the events which is generated in application, kernel, middleware layer, and the event arrange/editor is designed and implemented to understand efficiently the influence on application, kernel, and middleware layer for events.

A Development of Ship Block Leveling System based on the Axiomatic Design (공리적 설계 기반 선체 블록 레벨링 시스템 개발)

  • Noh, Jackyou;Lim, Nam-Won;Oh, Jung-Keun
    • Journal of the Korean Society of Marine Environment & Safety
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    • v.21 no.2
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    • pp.207-214
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    • 2015
  • In this paper the independence axiom, one of two principal axioms of axiomatic design theory, is applied to the leveling system development as an design criteria. After functional requirements and corresponding design parameters constitute an initial design matrix for the leveling system, sequence, which is compatible with the independence axiom, of the design parameters of the design matrix is determined and independent components of block leveling system are revealed. As a result of axiomatic design, system configuration related to the design sequence is developed. In order to verify and validate the developed block leveling system, test with real hull block leveling work in site by using total station which is used to acquire three dimensional coordinate of target point is performed. Comparison with measured data and output data from the block leveling system shows the system accuracy is under 1 mm so that the developed system is verified and validated to be used in site.

Design of Test Pattern Generator and Signature Analyzer for Built-In Pseudoexhaustive Test of Sequential Circuits (순서회로의 Built-In Pseudoexhaustive Test을 위한 테스트 패턴 생성기 및 응답 분석기의 설계)

  • Kim, Yeon-Suk
    • The Transactions of the Korea Information Processing Society
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    • v.1 no.2
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    • pp.272-278
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    • 1994
  • The paper proposes a test pattern generator and a signature analyzer for pseudoexhaustive testing of the combinational circuit part within a sequential circuit when performing built-in self test of the circuit. The test pattern generator can scan in the seed test pattern and generate exhaustive test patterns. The signature analyzer can perform the analysis of the circuit response and scan out the result. Such test pattern generator and signature analyzer have been developed using SRL(shift register latch) and LFSR(linear feedback shift register).

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Design of System for C Programming Language Education (C 프로그래밍 언어 교육을 위한 시스템 설계 - 웹 기반 실행 시각화와 순서도 자동화를 중심으로 -)

  • Baek, Kong-Hyun;Goh, Byung-Oh
    • 한국정보교육학회:학술대회논문집
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    • 2010.01a
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    • pp.347-352
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    • 2010
  • 현장에서 프로그래밍 교육은 교수 학습 방법 외에도 교육실습 환경을 위한 프로그래밍 교육용 시스템의 준비나 사용면에서도 어려움이 많다. 특히 C언어의 경우 적당한 교육용 시스템이 없어 일반 상업용 개발 툴을 이용하는데 그렇지 않아도 어렵다고 인식되는 C언어 교수 학습에 소프트웨어 도구마저 복잡하여 작지 않은 걸림돌이 되고 있다. 다양한 프로그래밍 언어가 있지만 현재는 구문 교육 및 논리 표현의 수월함과 결과 확인의 편리함에 우위를 가진 로고 계통의 언어 도구가 교육에서 많이 활용되고 있다. 이러한 점에 착안하여 본 연구에서는 기존 C언어 교육 환경을 개선하고 C언어를 효과적으로 교수 학습할 수 있도록 VPL요소로써 순서도 편집 및 자동 구현과 실행 시간 중 각종 흐름과 변수의 실시간 누적 시각화 시스템을 내포한 C언어 인터프리터와 학습 모듈 관리 및 사용자간 및 교수자와 교류하는 기능이 합쳐진 웹 기반 C 프로그래밍 언어 교육을 위한 시스템을 설계하였다.

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Design and Implementation of a Virtual Education System on the Web Environment (웹 환경에서의 가상교육 시스템 설계 및 구현)

  • 노진순;이용배;맹성현
    • Proceedings of the Korean Information Science Society Conference
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    • 2001.10b
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    • pp.595-597
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    • 2001
  • World-Wide Web으로 인하여 인터넷 상의 다양하고 고품질의 자료들을 교육 자료에 손쉽게 활용할 수 있는 시대가 도래하였다. 그러나 이러한 자료들은 교육적 효과를 극대화시키기 위해서 좀 더 정제되고, 교육과정에 맞는 흐름을 가질 필요가 있다. 이러한 과정의 흐름을 제공하기 위해서는 웹 상에서 분산되어 독립적으로 존재하는 디지털 문서들을 교육 목적에 맞게 새로운 순서, 즉 문맥화된 순서를 가진 자료로 재구성할 수 있어야 하며, 문서간의 부드러운 내용 전개를 위해서 부가적인 설명이나 기존 문서에 빠져 있는 내용들을 보완할 수 있어야 한다. 본 논문의 연구과정에서 개발된 가상교육 시스템은 교사가 교육용 지식문서를 작성하여 면대면(face to face) 교육에서는 직접 학생들을 교육할 수 있는 교육 자료로 사용될 수 있을 뿐만 아니라 웹을 통해서는 학생 스스로가 부족한 부분을 원하는 시간에 학습할 수 있는 능동적인 교육 환경을 제공할 수 있다. 또한, 가상교육 시스템에 가상문서 개념을 도입함으로써 인터넷 상의 수많은 리소스들을 인용하는 것에 대한 부하를 막을 수 있다. 본 논문에서는 인터넷 상의 디지털 컨텐츠를 전문적인 지식을 가진 교사가 교육과정에 맞게 쉽게 재구성해 줄 수 있도록 가상교육 시스템을 설계 및 구현한 내용에 대해 기술한다.

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Pipelined VLSI Architectures for the Hierarchical Block-Matching Algorithm (계층적 블록매칭 알고리즘을 위한 파이프라인식 VLSI 아키텍쳐)

  • Kim, Hyeong-Cheol;Maeng, Seung-Ryeol
    • The Transactions of the Korea Information Processing Society
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    • v.5 no.7
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    • pp.1691-1716
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    • 1998
  • 본 논문에서는 계층적 블록매칭 알고리즘(HBMA)을 위한 두 가지 병렬 VLSI 아키텍쳐를 제안한다. HBMA는 계층에 따른 반복수행과 공간 인터폴레이션을 기반으로 수행되며, 이러한 수행 특성은 병렬처리의 장애요소인 데이터 종속성을 내재하고 있다. 제안된 아키텍쳐는 HBMA의 계층간 데이터 종속성을 해결하기 위하여 기본적으로 파이프라인 구조를 채택하고 있으며, HBMA에서 주어진 매개변수에 따라 세 단계의 스테이지로 구성된다. 제안된 아키텍쳐는 입력 프레임 데이터의 흐름을 제어하는 방식에 따라 두 가지 종류로 구분된다. U-Architecture는 단방향 스캔 순서를 따르도록 설계되었으며, B-Architecture는 양방향 스캔 수서를 따르도록 설계되었다. 각 아키텍쳐의 내부 메모리와 인터폴레이션 모듈은 해당 스캔 순서에 따라 동기적으로 동작할 수 있는 구조를 가진다. 성능분석의 결과로서 본 논문에서 제안한 두 가지 아키텍쳐가 모두 방송용 비디오 포맷을 실시간으로 처리할 수 있음을 보이고, HDTV 포맷은 가까운 장래의 VLSI 기술로 실시간 성능을 얻을 수 있음을 보였다. 또한, B-Architecture는 공간 연결성 내부 메모리 구조를 채택함으로써 입력 데이터의 재활용도를 높이고, 이에 따라 Q-Architecture에 비해서 데이터 입출력 핀의 개수를 약 반정도 줄일 수 있는 특성을 보이고 있다.

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