• 제목/요약/키워드: 산술연산

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개선된 하드웨어 산술연산기 구성 (A Construction of the Improved Hardware Arithmetic Operation Unit)

  • 박춘명
    • 한국정보통신학회:학술대회논문집
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    • 한국정보통신학회 2015년도 추계학술대회
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    • pp.1023-1024
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    • 2015
  • 본 논문에서는 Galois체에 기초를 둔 고효율 산술연산기 구성에 관한 한가지 방법을 제안하였다. 제안한 연산기는 기존의 방법에 비해 좀 더 규칙적이고 확장성이 용이한 이점이 있으며, 또한, 각종 멀티미디어 하드웨어 구성시의 기본인 연산기로 적용 및 응용할 수 있다. 향 후 연구과제로는 좀 더 콤팩트하고 효과적인 산술연산 알고리즘의 도출이 필요하며, 이에 논리연산기를 접목하여 산술연산 및 논리연산을 수행하는 연산전용 프로세서의 개발이 필요하다.

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고효율 산술연산기시스템 구성에 관한 연구 (A Study on Construction the Highly Efficiency Arithmetic Operation Unit Systems)

  • 박춘명
    • 한국정보통신학회:학술대회논문집
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    • 한국해양정보통신학회 2005년도 추계종합학술대회
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    • pp.856-859
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    • 2005
  • 본 논문에서는 Galois체에 기초를 둔 고효율 산술연산기 구성에 관한 한가지 방법을 제안하였다. 제안한 연산기는 기존의 방법에 비해 좀 더 규칙적이고 확장성이 용이한 이점이 있으며, 또한, 각종 멀티미디어 하드웨어 구성시의 기본인 연산기로 적용 및 응용할 수 있다. 향 후 연구과제로는 좀 더 콤팩트하고 효과적인 산술연산 알고리즘의 도출이 필요하며, 이에 논리 연산기를 접목하여 산술연산 및 논리연산을 수행하는 연산전용 프로세서의 개발이 필요하다.

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프라이버시-인지 역할기반 접근 제어의 산술연산 구현 전략 (Implementation Strategy of Arithmetic Operations for Privacy-aware Role based Access Control)

  • 나현혜;이지윤;이하영;김윤정
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2011년도 한국컴퓨터종합학술대회논문집 Vol.38 No.1(D)
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    • pp.111-114
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    • 2011
  • PRBAC모델은 RBAC(Role Based Access Control) 모델에 조건(condition), 목적(purpose), 의무(obligation)개념을 포함시킴으로써 프라이버시를 강화한 모델이다. 그러나 조건 표현 내에 산술연산 기능을 지원하지 못한다고 알려져 있다. 본 논문에서는, 프라이버시를 보호하는 쇼핑몰 홈페이지를 구현하는 것을 목표로, 이 중 PRBAC모델을 XML로 구현하고 이를 Java와 연동함으로써 산술연산 기능을 지원하는 방안과, 홈페이지 코드와 데이터베이스를 연결하는 부분에 대한 연구결과를 소개한다.

고성능 H.264 인코더를 위한 CABAC 하드웨어 설계 (The Hardware Design of CABAC for High Performance H.264 Encoder)

  • 명제진;류광기
    • 한국정보통신학회논문지
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    • 제16권4호
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    • pp.771-777
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    • 2012
  • 본 논문에서는 공통 연산기(Common Operation Unit)를 이용한 CABAC의 이진 산술 부호화기를 제안한다. 제안한 공통 연산기는 모드에 상관없이 하나의 공통 연산기를 이용하여 산술 부호화 및 재정규화를 수행하는 이진 산술 부호화기의 하드웨어 구조를 단순하게 구현할 수 있다. 제안하는 CABAC의 이진 산술 부호화기는 Context RAM, Context Updater, Common Operation Unit, Bit-Gen으로 구성되며 매 클럭당 하나의 심볼이 부호화될 수 있는 4단 파이프라인으로 구성하였다. 제안한 CABAC의 이진 산술 부호화기는 기존 CABAC의 이진 산술 부호화기와 비교하여 게이트 수는 최대 47% 감소하였고, 동작 주파수는 최대 19% 성능이 향상됨을 확인하였다.

GCC 생성기를 이용한 C 컴파일러 개발 (Development of C Compiler using GCC generator)

  • 정삼진
    • 한국산학기술학회:학술대회논문집
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    • 한국산학기술학회 2010년도 추계학술발표논문집 1부
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    • pp.216-220
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    • 2010
  • 본 연구는 앞으로 개발될, 혹은 현재 개발이 진행중인 16 비트 CPU를 위한 C 컴파일러를 개발하고자 한다. 본 연구는 다양하고 특별한 용도의 새로운 CPU를 위한 새로운 C 컴파일러들을 보다 쉽게 개발할 수 있게 한다. 공개 소프트웨어인 GNU C 컴파일러 생성기를 사용하여 새로운 CPU의 기능들을 명세하고, 기계 의존 원시 파일들을 수정함으로서 새로운 컴파일러를 개발할 수 있다. 개발된 컴파일러는 16 비트 CPU가 지원하는 16 비트 산술 연산 뿐만 아니라, 16 비트 CPU가 지원하지 않는 16 비트 산술 연산, 32 비트 Data Movement 연산, 32 비트 산술 연산, 32 비트 floating point 연산까지 가능하다. 그러나, 배열, 포인터, 구조체 등과 같은 고급 기능들을 지원하기 위해서는 더 많은 연구가 필요하다.

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산술의 발전사 : 주판과 컴퓨터

  • 예홍진
    • 한국수학사학회지
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    • 제9권1호
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    • pp.12-31
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    • 1996
  • 주판은 지난 수천년동안 인류가 애용했던 산판(abacus)의 일종으로서, 휴대용 계산기(Calculator)가 보편화되기 전까지 덧셈이나 곱셈 등의의 사칙연산을 수행하는 데에 사용된 대표적인 산술도구이다. 한편, 자동화를 위한 단순한 계산기계로부터 발전되어 온 컴퓨터는 오늘날 디지털 시대를 주도하면서 불과 수십년만에 우리의 삶과 생각을 완전히 새로운 모습으로 바꾸어 놓은 또 하나의 산술도구인 것이다. 본 논문에서는 주판에 적용된 여러 가지 산술원리들을 역사적으로 살펴본뒤, 산술의 발전과 컴퓨터 사이에 어떠한 상관관계가 있는 지를 살펴보고자 한다. 이를 위하여, 새로운 산술원리를 컴퓨터에 도입하게 된 동기와 파급효과를 주판의 경우와 대비하여 설명하고, 현재 진행중인 컴퓨터 산술(computer arithmetic)분야의 연구동향을 토대로 미래의 컴퓨터를 전망한다.

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수와 연산 영역 부진 학생의 산술적 사고 수준에 관한 사례 연구 - 초등학교 6학년 한 학생을 대상으로 - (A Case Study on Levels of Arithmetical Thinking of an Underachiever in Number and Operation - Focusing on a 6th Grader -)

  • 임미인;장혜원
    • 대한수학교육학회지:수학교육학연구
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    • 제26권3호
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    • pp.489-508
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    • 2016
  • 수와 연산은 초등수학에서 가장 기본이고 핵심이면서도 학생들이 많은 어려움을 겪는 영역으로 알려져 왔다. 이와 같은 학습의 어려움은 계산 방법이나 계산 기능의 측면을 강조하는 것만으로는 근본적인 해결이 어렵고, 관련 사고의 측면에서 검토할 필요가 대두된다. 본 연구는 Guberman(2014)에 기초하여 수와 연산 영역 부진 학생의 산술적 사고 수준 및 산술에 대한 이해 정도를 분석하여 산술에 관한 어려움의 원인을 진단하고 그에 대한 처방 방안을 모색하는 것을 목적으로 한다. 이를 위해 수학 학습 중 유독 수와 연산 영역에서만 어려움을 보이는 한 초등학교 6학년 학생을 대상으로 두 차례에 걸쳐 산술적 사고 수준 및 산술 개념 이해 검사를 실시하고 학생의 반응을 분석하는 사례 연구를 실시하였다. 분석 결과, 연구 대상 학생의 산술적 사고는 Guberman의 1수준에 해당하며 몇 가지 산술 개념과 관련하여 이해에 어려움을 지니고 있음이 파악되었다. 분석 결과 및 그에 대한 논의로부터 구체적인 처방 방안을 제시하였다.

고속 연산을 위한 64bit 가산기의 설계 (Design of high speed 64bit adder)

  • 오재환;이영훈;김상수;상명희
    • 대한전자공학회:학술대회논문집
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    • 대한전자공학회 1998년도 하계종합학술대회논문집
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    • pp.843-846
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    • 1998
  • 산술연산을 수행하는 가산기는 ALU(arithmetic logic unit)의 성능을 좌우하는데 매우 중요한 역할을 하며, 어떠한 캐리 생성 방식을 사용하는냐에 따라 그 성능이 결정될 수 있다. RCA(Ripple carry adder)는 간단하고, 쉬운 설게로 널리 사용되자만, 캐리의 전파지연 문제로 인해 고속의 가산기 응용에의 부적합하다. 또한, CLA(carry lookahead adder)방식의 가산기는 캐리의 지연시간이 가산기의 단수와 무관하므로, 연산속도를 높일 수 있는 장점이 있지만 더하고자 하는 bit의 수가 클수록 회로가 매우 복잡해지는 큰 단점을 가지고 있다. 따라서, 본 논문에서는 간단하면서도 성능이 우수한 64bit 가산기를 설계하고 시뮬레이션을 통하여 설계된 회로의 우수성을 증명하였다.

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H.264/AVC를 위한 효율적인 이진 산술 부호화기 설계 (Design of an Efficient Binary Arithmetic Encoder for H.264/AVC)

  • 문전학;김윤섭;이성수
    • 대한전자공학회논문지SD
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    • 제46권12호
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    • pp.66-72
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    • 2009
  • 본 논문에서는 H.264/AVC에서 사용되는 엔트로피 부호화 방법 중 하나인 CABAC를 위한 효율적인 이진 산술 부호화기를 제안한다. 기존의 이진 산술 부호화 알고리즘은 연산의 복잡도와 각 단계간의 데이터 의존도가 매우 높기 때문에 빠른 연산이 어렵다. 따라서 연산 과정의 복잡도와 데이터 의존도를 줄이기 위하여 재정규화 과정을 효율적으로 처리할 수 있는 2단 파이프라인 구조를 사용한다. 하드웨어 면적을 줄이기 위해서 문맥 모델 갱신기는 transIdxMPS 표를 간단한 식으로 표현하고, transIdxLPS 표와 rangeTabLPS 표를 함께 구현한다. 산술 연산기는 입력 값의 발생 확률에 따라 일반 모드, 우회 모드, 종결 모드로 나누어 설계하여 각 모드마다 최대 속도로 동작할 수 있게 한다. 제안하는 이진 산술 부호화기는 0.18um 표준 셀 라이브러리에서 7282 게이트의 면적을 사용하며 입력 심벌 당 소요되는 사이클 수는 약 1을 갖는다.