고다층 배선 기판에 형성된 개방 스터브(open stub)를 제거한 후면드릴가공홀(Back-Drilled-Hole, BDH)과 일반적인 구조인 관통홀(Plated-Through-Hole, PTH) 구조의 전기적 특성에 대한 분석을 하였으며, 고속 선호를 부품 실장면으로부터 내층의 스트립라인으로 전송하기 위해 비아홀의 급전 길이가 가장 긴 전송층을 선택하였다. 10 GHz의 광대역 주파수 내에서 실험계획법(DOE, design of experiment)을 적용하여 비아홀 구조 내에 외층과 급전층 사이의 비아홀의 길이, 접지층에 형성된 천공(anti-pad)의 크기와 급전층에 형성된 패드 (pad)의 크기가 최대 반사 손실 반전력 주파수와 삽입 손실에 미치는 영향을 분석하였다. 이로 부터 거시적 모델(macro model)을 위한 회귀 실험식을 추출하여 실험 결과와 비교 평가하였고, 실험 영역 외에서도 측정 결과와 5% 이내의 오차를 보이고 있음을 확인하였다.
본 논문에서는 비아홀(via hole) 구조가 필요 없는 910MHz RFID 태그용 CPS(coplanar stripline) 형태의 마이크로스트립 패치 안테나를 HFSS 안테나 설계 시뮬레이션을 통해 최적 설계한 과정 및 그 결과를 나타내었다. 단순한 마이크로스트립 패치 안테나의 제작 구조를 얻기 위해서 비아홀 구조가 없고 대역통과(bandpass) 필터를 사용하지 않았으며, RFID 태그 칩과 안테나간의 임피던스 정합을 위해서만 임피던스 정합 네트워크 회로를 사용하였고, 안테나 크기를 조절해가며 최적 시뮬레이션을 수행하였다. 안테나 설계 시뮬레이션의 신뢰성을 확보하기 위하여 우선 기존에 발표된 5.8GHz에서의 안테나 결과를 이용해 최적화된 HFSS 시뮬레이션 파라미터를 결정하였다. 이를 토대로 비아홀 구조가 필요 없는 910MHz의 중심주파수를 갖는 CPS구조의 마이크로스트립 패치 안테나를 최적 설 계하였으며, 본 논문에서 제안된 CPS구조의 패치 안테나가 910MHz RFID 태그에 적용 가능함을 보였다.
3D 패키징 기술은 전기소자의 소형화, 고용량화, 저전력화, 높은 신뢰성등의 요구와 함께 그 중요성이 대두대고 있다. 이러한 3D 패키징의 연결방법은 와이어 본딩 또는 플립칩등의 기존의 방법에서 TSV(Through Silicon Via)를 이용하여 적층하는 방법이 주목받고 있다. TSV는 기존의 와이어 본딩과 비교하여 고집적도, 빠른 신호전달, 낮은 전력소비 등의 장점을 가지고 있어 많은 연구가 진행되고 있다. TSV의 세부 공정 중 비아필링(Via filling)기술은 I/O수 증가와 미세피치화에 따른 비아(Via) 직경의 감소 및 종횡비(Via Aspect Ratio)증가로 인해 기존 필링 공정으로는 한계가 있다. 기존의 비아 홀(Via hole)에 금속을 필링하기 위한 방법으로 전기도금법이 많이 사용되고 있으나, 전기도금법은 전기도금액 조성, 첨가제의 종류, 전류밀도, 전류모드 등에 따라 결과물에 큰 차이가 발생되어, 최적공정조건의 도출이 어렵다. 또한 20um이하의 비아직경과 높은 종횡비로 인하여 충진시 void형성등의 문제점이 발생하기도 한다. 본 연구에서는 용융솔더와 진공을 이용하여 비아를 필링시켰다. 이 방법은 관통된 비아가 형성된 웨이퍼 양단에 압력차를 주어, 작은 직경을 갖는 비아 홀의 표면장력을 극복하고, 용융상태의 솔더가 관통된 비아 홀 내부로 필링되는 방법이다. 관통 비아홀이 형성 된 웨이퍼 위에 솔더페이스트를 $250^{\circ}C$이상 온도를 가해 용융상태로 만든 후 웨이퍼 하부에 진공을 형성하여 필링하는 방법과 용융솔더를 노즐을 통하여 위쪽으로 유동시켜 그 위에 비아홀이 형성된 웨이퍼를 접촉하고 웨이퍼 상부에 진공을 형성하여 필링하는 방법으로 실험을 각각 실시하였다. 이 때, 웨이퍼 두께는 100um이하이며 홀 직경은 20, 30um, 웨이퍼 상부와 하부의 진공차는 약 0.02~0.08Mpa, 진공 유지시간은 1~3s로 실시하여 최적 조건을 고찰하였다. 각 조건에 따른 필링 후 단면을 전자현미경(FE-SEM)을 통해 관찰하였다. 실험 결과 0.04Mpa 이상에서 1s내의 시간에 모든 비아홀이 기공(Void)없이 완벽하게 필링되는 것을 관찰하였으며 이 결과는 기존의 방법에 비하여 공정시간을 감소시켜 생산성이 대폭 향상 될 수 있는 방법임을 확인하였다.
Micro via hole Fabrication is studied by means of minimizing method to circuit size as many electric products developed to portable and minimize. Most of currently micro via hole fabrication using laser is that fabricate insulator layer using CO2 Laser after Cu layer by etching, or fabricate insulator layer using IR after trepanning Cu by UV. In this paper, it was performed that a metal layer and insulator layer were worked upon only one UV laser, and increase to processing speed by experiment.
2007년 일본에서 지갑전화나 지상파 디지털TV 방송기능을 탑재한 휴대전화개발에 힘을 쏟고 있을 무렵, 해외에서 컴퓨터에 가까운 스마트폰이라는 다기능단말기 개발이 진행되고 있었다. 스마트폰은 젊은이를 중심으로 인기가 높아지고 있다. 휴대전화를 시작으로 정밀전자기기에는 인쇄배선판(이하, PWB: Printed Wiring Board)이 내장되어 있다. PWB는 향후 하이브리드차나 전기자동차의 발전과 함께, 차량탑재 수요도 높아질 것이다. 본고에서는 PWB를 지탱하는 동 도금 Via Hole메움에 대하여 기술하였다.
본 논문에서는 HDI(High Density Interconnection) 기판의 코어로 사용될 수 있는 카본 CCL(Copper Claded Layer)의 열거동 및 신뢰성 특성을 실험과 CAE를 이용한 수치해석을 통해 평가하였다. 카본 CCL의 특성평가를 위해 기존 FR-4 코어와 heavy cu 코어와 비교하였다. 연구결과에 의하면 pitch계열 카본코어가 적용된 PCB의 휨강도가 가장 높고 온도에 따른 변형량이 가장 낮았다. 또한, HDI 신뢰성평가 기준의 TC(Thermal Cycling), LLTS(Liquid-to-Liquid Thermal Shock), Humidity 실험을 통해 카본코어가 적용된 PCB는 신뢰성이 확보되었음을 확인하였다. 카본 파이버에 의한 불균일한 비아홀의 표면형상 여부와 드릴비트 마모 가능성을 분석하였는데 비아홀의 표면은 균일하고, 드릴비트의 표면도 매끄러워 카본 CCL의 우수한 드릴가공성도 확인하였다.
본 논문에서는 GPS/K-PCS 대역의 무선 이동 단말기 응용을 위한 LTCC 소형 칩 안테나의 모의실험과 제작, 측정 결과를 나타내었다. 설계된 LTCC 칩 안테나의 전체 크기는 $9mm\times15mm\times1.2mm$ 이다. 이중 대역 동작 특성을 위해 적층된 상부 미엔더 방사 패치는 하부 미엔더 방사 소자에 0.3mm의 높이를 갖는 비아홀을 통해 연결되었다. 하부의 미엔더 방사 소자는 GPS 대역에 중심 주파수가 일치하도록 설계되었으며, 상부의 미엔더 방사 페치는 K-PCS 중심 주파수에 일치하도록 설계 변수가 결정되었다. 제안된 안테나의 공진 주파수와 주파수 비는 미엔더 방사 패치의 실효 공진 길이와 비아홀의 높이 설계 변수에 의해 결정될 수 있었다. 제작된 안테나의 제반 특성으로부터 본 논문에서 제안된 안테나는 다중대역에서 동작하는 소형 칩 안테나로 응용될 수 있을 것이다.
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[게시일 2004년 10월 1일]
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