HEVC는 JCT-VC에 의해 개발된 최신 비디오 코딩 표준이다. HEVC는 H.264/AVC에 비해 약 2배의 주관적 코딩효율을 제공한다. HEVC 개발의 주요목표 중 하나는 UHD급 비디오를 효율적으로 코딩하는 것이기 때문에, HEVC는 UHD급 비디오를 코딩하는데 널리 사용될 것으로 예측된다. 이러한 고해상도 비디오의 복호화는 많은 양의 메모리 접근을 발생시키기 때문에 복호화 시스템은 고대역폭의 메모리 시스템 및 내부 통신 아키텍처가 필요하다. 이러한 요구사항을 파악하기 위해서 본 논문은 HEVC 복호화기의 메모리 접근 복잡도를 분석한다. 우리는 먼저 임베디드 프로세서와 데스크탑에서 동작하는 소프트웨어 HEVC 복호화기의 메모리 접근량을 측정하였다. 또한 우리는 HEVC 복호화기의 데이터흐름을 분석하여 HEVC 복호화기의 메모리 대역폭 모델을 만들었다. 측정결과, 소프트웨어 복호화기는 6.9~40.5GB/s의 DRAM 접근을 하였다. 또한 분석결과에 따르면 하드웨어 복호화기는 2.4GB/s의 DRAM 대역폭을 요구하는 것으로 파악된다.
마이크로스트립 안테나가 가지는 가장 큰 단점인 협대역 특성을 개선하기 위해 그 동안 수많은 연 구와 방법들이 제안되었는데 특히 원형편파 안테나는 임피던스 대역폭 외에 축비 대역폭까지도 고려 되어야 하므로 더욱 심화된 협대역의 특성을 가지게 되어 설계에 많은 어려움이 있었다. 일반적으로 원형편파 마이크로스트립 안테나를 설계하는 방법 중 급전 구조면에서는 크게 단일 급전 방식과 하이 브리드 형태의 급전방식이 있다. 단일 급전 방식의 원형편파 안테나는 구조가 간단하고y 제작이 간편 하며, 안테나의 물리적 크기를 줄일 수 있어 배열시 장점이 있으나 구조의 특성상 협대역의 축비 대역 폭을 가지며I 하이브리드 급전 원형편파 안테나는 구조가 복잡하고, 제작이 어려우며, 안테나의 물리적 크기가 커진다는 단점이 있으나 광대역의 축비 대역폭을 가진다. 따라서 원형편파 안테나의 설계시 축 비 대역폭과 안테나의 물리적 크기 간의 trade-off를 고려하여야한다. 최근에는 이를 고려한 단일 급전 을 이용하면서도 개선된 축비특성올 얻을 수 있도록 십자개구 개구를 통해 두 개의 직교 모드를 방사 패치에 급전하는 구조가 제안되기도 하였다. 하지만 이는 일반적인 단일 급전 방식보다 개선된 축비 대역폭을 얻을 수 있었으나 중심주파수에서 2.5%에 불과하였다. 본 논문에서는 단일 급전 십자개구 결합 방식이 가지는 협대역의 축비 대역폭을 개선하기 위해 단 일 급전으로 하이브리드 급전의 효과를 가져올 수 있는 직렬 급전 십자개구 결합 마이크로스트립 안 테나를 제안하였으며, 기존에 발표된 단일 급전 십자개구 결합 안테나와의 축비 대역폭, 이득, 방사패 턴, 그리고 임피던스 대역폭 둥과 비교하여 개선된 특성을 제시하고 제안된 안테나의 타당성을 보였 다. 실제로 2.4GHz의 주파수에서 제안한 직렬 급전 십자개구 결합 단일 마이크로스트립 안테나의 측 정결과 기존에 연구된 안테나보다 약 2배정도 증가된 4.6%의 축비 대역폭, 10%의 임피던스 대역폭 (VSWR<1.5), 그리고 8.2dBi의 최대이득 특성을 확인할 수 있었으며, 이를 바탕으로 시권셜 로테이션 기법올 사용한 $2\times2$ 배열 안테나는 17.5%의 축비 대역폭, 20.8%의 임피던스 대역폭(VSWR<1.5), 그리 고 12.5dBi의 최대이득을 얻을 수 있었다. 이에 해당하는 제안된 단일 안태나와 $2\times2$ 배열 안테나의 구조, 측정된 축비 대역폭 및 이득특성, 그리고 입력 반사손실을 그림 I, 2, 3에 각각 나타내었다.
본 논문에서는 슬롯-결합 선로를 이용한 개선된 쉬프만 위상천이기를 제안하고자 한다. 제안된 쉬프만 위상천이기는 일반적인 결합 선로와 결합 선로 바로 밑에 단순한 직사각형 모양의 슬롯으로 이루어졌다. 슬롯과 결합된 결합 선로의 두 독립적인 전송 모드인 우 모드와 기 모드의 임피던스와 위상 특성을 계산하여 제안된 쉬프만 위상천이기의 위상 특성을 해석하였다. 본 논문에서는 일반 결합 선로로는 구현이 어려운 높은 임피던스 비를 갖는 $90^{\circ}$ 쉬프만 위상천이기를 제작하였다. 동작 중심 주파수는 2.4 GHz로 하였다. 실험 결과, 대역폭은 위상 오차 ${\pm}5^{\circ}$의 위상천이기에서 약 74.2 %의 밴드폭을 얻었다. 또한, 측정 반사 특성은 동작 대역에서 15.0 dB 이하이며, 삽입 손실은 1.5 dB 이하로 측정되었다.
본 논문에서는 종단 정렬된 스트립 쌍 도파기를 가지는 직렬 급전 다이폴 쌍 (series-fed dipole pair; SDP) 안테나의 특성에 관하여 연구하였다. 제안된 SDP 안테나는 두 개의 서로 다른 길이의 스트립 다이폴 안테나와 접지 반사기가 코플래너 스트립 (coplanar strip; CPS) 선로로 연결되어 있다. 두 번째 다이폴 위쪽에 추가된 스트립 쌍 도파기는 두 개의 직사각형 모양의 스트립이며 두 번째 다이폴의 양팔의 종단에 정렬되어 있다. 종단 정렬된 스트립 쌍 도파기의 길이와 폭에 따른 안테나의 특성 변화를 분석하여 대역폭 향상을 위한 최적의 설계 변수를 얻었다. 최적화된 SDP 안테나를 FR4 기판 상에 제작하고 특성을 실험한 결과 전압 정재파비(voltage standing wave ratio; VSWR)가 2 이하인 대역은 1.65-2.93GHz이고, 대역폭이 기존 SDP 안테나에 비해 증가함을 확인하였다.
본 논문에서는 고주파 회로 모델링을 이용하여 전기자동차의 모터 구동 시스템으로부터 방출되는 전도성 전자파 노이즈를 시스템-레벨에서 분석하였다. 관련 전도 방출의 주요 원인은 모터 구동 시스템에서 사용하는 펄스폭 변조방식의 스위칭 동작에 기인하며, 이러한 전도 방출은 공통-임피던스 결합 및 유도성 결합을 통해 AM/FM 주파수 대역에서의 무선주파수 간섭을 유발한다. 이러한 문제를 분석하기 위해 모터 구동 시스템을 구성하고 있는 IGBT와 고압 커패시터, 인버터, 모터 및 고전압 케이블과 버스 바에 대한 기본 회로는 물론, 각 부분에서 존재하는 기생 성분 및 비선형 특성을 해석하여 모터 구동 시스템 전체를 포함한 시스템-레벨의 고주파 등가회로 모델을 제안하였다. 이러한 모델을 이용한 모터 구동시스템의 전도 방출 특성을 시뮬레이션하고, 측정하였으며, 비교적 큰 해석구조임에도 불구하고 두 결과가 비교적 잘 일치함을 확인하였다. 향후 이러한 접근방법이 전기자동차의 전자파 적합성 설계에 효과적으로 사용될 수 있을 것으로 기대한다.
초동발췌 방법과 이와 관련된 오차문제를 고찰하고 자료처리 전산화 측면에서 초동발췌 및 오차계산의 실용적 알고리즘을 제안하였다. 제안한 초동발췌 방법은 2단계로 구성된다. 1) 초동신호 중 트레이스 간 연속성이 양호한 최초의 피크(peak) 또는 트라프(trough)를 발췌한다. 2) 발췌시점 전방 일정구간의 기록을 직선으로 근사화 하고 이 직선의 시간 절편을 초동주시로 한다. 근사화 구간의 길이는 대략 초동 웨이브렛 폭의 1/4보다 다소 작게 설정한다. 초동발췌에 내재된 오차의 정량적인 척도는 기록의 특정시점에 초동의 도착 여부를 판단하는 데 필요한 기록의 길이로 정의한다. 기록의 길이를 나타내는 공식은 신호의 주파수대역과 신호대잡음비의 함수로 표시된다. 3개의 공대공 탄성파기록의 초동을 수동 및 제안한 방법으로 발췌하였고 각 트레이스의 오차한계를 계산하였다. 실험결과 제안한 근사직선 시간절편법의 우수한 성능과 발췌된 초동평가에 있어서 발췌오차의 유용성을 확인하였다.
본 논문에서는 휴대용 오디고 제품의 헤드폰 구동을 위한 델타-시그마 변조기법 기반의 D급 증폭기를 제안한다. 제안된 D급 증폭기는 고성능 단일 비트 4차 델타-시그마 변조기를 이용하여 펄스폭 변조 신호를 발생시킨다. 높은 신호 대 잡음비를 얻는 것과 동시에 시스템의 안정성 확보를 위하여 시뮬레이션을 통해 변조기 루프필터의 폴과 제로를 최적화하였다. 테스트 칩은 $0.18{\mu}m$ CMOS 공정으로 제작되었다. 칩 면적은 $1.6mm^2$ 이며, 20Hz 부터 20kHz까지의 신호대역을 대상으로 동작한다. 3V 전원전압과 32옴의 로드를 사용하여 측정된 출력은 0.03% 이하의 전고조파 왜율을 갖는다.
스마트 태그는 기존에 사용하고 있던 마그네트 카드의 사용이 확대되면서 나타난 여러 가지 문제점들을 보완하여 보다 안전하고 다양한 기능을 수행할 수 있는 대체 수단의 필요에 의하여 등장하였다. RFID 태그는 모든 사물에 ID를 부여하게 되어 사물의 자동인식이 가능해지며 이들 간의 상호 통신 네트워크가 형성됨으로써 유비쿼터스 센서 네트워크와 사물인터넷 기술로 발전해 가고 있다. 본 논문에서는 AVR 프로세서를 이용하여 RFID 태그와 리더로 구성되는 비접촉식 RFID 스마트 태그 리더를 개발하였다. 이 시스템은 13.56MHz의 저주파 대역을 가지며 통신 속도 26.48kbps의 PWM방식으로 디자인하였다. 개발된 RFID 스마트 태그 리더는 시뮬레이션 결과 일반적인 RFID 시스템보다 빠른 응답속도를 나타내었고, 실제 실험에서도 응답률의 개선이 나타났다.
본 논문에서는 기존의 접힌 도파관의 내부 구조물을 Y형으로 대체하여 도파관의 차단주파수를 낮춘 접힌 Ridge 도파관(FRWG)을 제안하였다. 제안된 FRWG는 역 Ridge 도파관으로 등가될 수 있는데, 측면의 높이를 줄였을 때 측면의 길이가 증가하여 동일한 크기의 도파관에 비해 차단주파수를 절반 이하로 줄일 수 있다. 논문에서는 길이 40mm, 높이 20mm의 도파관에 폭 2mm의 Y형 구조물을 넣어 1.996GHz의 차단주파수를 갖는 FRWG를 설계하였다. 또한, 제안된 도파관을 활용하기 위한 SMA 커넥터와의 트랜지션이 설계되었다. 트랜지션은 커넥터의 신호선과의 커패시턴스를 최적화하여 2.064 ~ 3.050GHz 대역에서 VSWR 2:1 이하의 특성을 나타내었다. 제안된 FRWG는 도파관 구조를 이용한 다양한 소자의 소형화에 응용할 수 있다.
본 논문은 현재 직접 위성수신용 안테나로 사용 중인 파라볼릭 안테나를 대체할 수 있는 마이크로스트립 어레이 안테나를 연구하였다. 마이크로스트립 어레이 안테나는 극히 제한적인 분야에서 사용되었으나 직접위성 수신용 안테나와 같이 우리 실생활에 직접 적용할 수 있다면 많은 분야에서 활용이 예상된다. 마이크로스트립 어레이 안테나가 직접 위성수신용 안테나로 활용되려면 우선적으로 광대역 특성이 요구된다. 따라서 본 논문의 목표를 직접 위성수신을 위한 광대역 주파수 대역이 보장되는 안테나 설계기술로 설정하였다. 본 논문에서 제안된 마이크로스트립 안테나는 사각형 패치에 직교하는 두 개의 급전선로에 의해서 급전되도록 하였으며 순차 회전 급전기술로 광대역에서 좋은 축비를 얻을 수 있도록 설계하였다. 사각형 패치는 위성수신 주파수 대역에서 설계되었으며 폭과 길이는 W=L=8.9 mm ($0.352{\lambda}o$)이며 전체 크기는 $250{\times}250mm$이다. 제안된 안테나는 기존 급전방식의 안테나에 비해서 1 dB 이상의 축비가 개선되는 것을 실험을 통하여 입증하였다. 안테나의 성능 입증을 위해서 두 개의 $8{\times}8$ 어레이 안테나를 제작하여 실험하였다. 안테나의 최대 이득은 20.8 dB, 사이드로브 레벨 -10 dB 이하를 확인하였다. 본 논문의 안테나를 국내 무궁화 위성수신 시스템에 적용한다면 C/N=6.7 dB의 수신성능이 확보됨을 링크버짓 계산을 통하여 입증하였다.
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[게시일 2004년 10월 1일]
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