80/128-비트의 마스터키를 지원하는 초경량 블록암호 PRESENT-80/128의 하드웨어 구현에 대해 기술한다. PRESENT 알고리듬은 SPN (substitution and permutation network)을 기반으로 하며 31번의 라운드 변환을 갖는다. 64-비트 데이터 패스를 갖는 단일 라운드 변환 회로를 이용하여 31번의 라운드가 반복처리 되도록 하였으며, 암호화/복호화 회로가 공유되도록 설계하였다. Verilog HDL로 설계된 PRESENT 프로세서를 Virtex5 XC5VSX-95T FPGA로 구현하여 정상 동작함을 확인하였다. 최대 275 Mhz 클록으로 동작하여 550 Mbps의 성능을 갖는 것으로 예측되었다.
무선 센서 네트워크는 방대한 응용분야와 유비쿼터스 환경 하에서 중요한 한 부분을 차지하며 그 유용성을 입증하고 있다. 이런 무선 센서 네트워크의 센서 노드는 작은 크기를 바탕으로 목표 장소에 임의로 배치되어 다양한 데이터를 수집하는 능력이 탁월하다 하지만 이런 장점은 센서 노드의 한정된 하드웨어 능력과 전원공급 문제, 물리적 노출 문제로 인해 스스로를 위험에 노출시키는 여지를 만들게 되었다. 즉 일반적으로 사용되어지는 네트워크 보안 방법을 무선 센서 네트워크에 적응하기에는 센서 노드 능력에 한계가 있으며, 환경적 요소로 인해 불가능하다. 따라서 무선 센서 네트워크의 특성을 감안한 효과적인 보안 방법이 필요하며, 이런 맥락에 본 논문은 무선 센서 네트워크의 하드웨어적인 한계를 감안한 대칭키(Symmetric key) 기반의 키 분배 기법을 제안하고자 한다. 제안하는 기법에서는 모든 노드가 공통으로 소유한 전체 마스터 키(master key)와 의사 난수 생성기(pseudo random number generator:PRNG), 그리고 특정 대상으로부터 분배되는 난수(random number)의 조합을 통해 임의의 키를 생성, 갱신함으로써 다양한 종류의 무선 센서 네트워크 모델에 유연하게 대처할 수 있도록 하였다. 또한 이를 위한 통신 회수를 최소화함으로써 효율성을 제공해 준다.
PCI 2.2 마스터 디바이스가 타겟 디바이스로부터 데이터를 읽어 오고자 할 때 타겟 디바이스는 내부적으로 데이터를 준비해야 함으로 인해 PCI 버스가 데이터 전송 없이 점유되는 상황이 발생한다. 이를 위해 PCI 2.2 사양에서는 지연전송을 제안하여 전송 효율을 향상시켰지만 이 역시 타겟 디바이스가 얼마의 데이터를 미리 준비 해둘지를 알 수 없어 버스 사용 및 데이터 전송 효율을 떨어뜨리는 원인을 제공한다. 이에 앞선 연구에서는 이를 해결하기 위한 프리페치 요구를 이용하는 새로운 방법을 제안하였다. 본 논문에서는 이 방법을 지원하는 PCI 타겟 컨트롤러와 로컬 디바이스를 설계하였다. 설계된 PCI 타겟 컨트롤러는 간단한 로컬 인터페이스를 가질 뿐 아니라 PCI 2.2를 전혀 모르는 사용자도 쉽게 PCI 인터페이스를 지원할 수 있도록 설계되었다. 또한 설계된 하드웨어를 효과적으로 검증하기 위한 방법으로 기본 동작 검증, 설계 기반검증, 그리고 랜덤 테스트 검증을 제안하였다 이러한 검증을 위해 테스트 벤치와 테스트 벤치를 동작시키는 위한 명령어를 제안하였다. 그리고 랜덤 테스트를 위해 참조 모델, 랜덤 발생기, 비교 엔진으로 구성된 테스트 환경을 구축하였으며 이를 이용해 코너 케이스를 효과적으로 검증할 수 있다. 또한 제안된 테스트 환경을 통해 시뮬레이션 한 결과, 프리페치 요구를 이용한 제안된 방법이 지연 전송에 비해 데이터 전송 효율이 평균 $9\%$ 향상되었다.
본 논문에서는 영상처리기술과 네트워크와 연동이 가능한 센서 기술을 활용하여 발빠른 첨단기술에 맞춘 사물 인터넷을 기반으로 한 가정 및 사업 환경을 구축하고자 하였다. OpenCV 라이브러리의 분석 알고리즘을 활용한 영상 처리 기술을 사용하여 객체를 탐지 및 추적하고 그에 대한 데이터로 객체를 추적하고 다양한 센서들을 제어한다. 또한, 마스터 싱글보드와 슬레이브 싱글보드를 통하여 다양한 센서들을 통제하고 센싱 네트워크 환경을 구축 및 연계하여 데이터를 수집하고 기록하여 다양한 서비스를 제공 할 수 있는 플랫폼을 구현하고자 한다.
저전력 블루투스(BLE) 기술을 IoT(Internet of Things) 응용에 적용하는 연구 개발이 이루어지고 있다. 이러한 응용 환경의 특징은 동일 공간에 많은 피코넷이 동작할 수 있다는 것이다. 따라서 동종 네트워크 간 간섭이 발생할 가능성이 크다. BLE 데이터 채널에서는 37 개의 주파수 채널 중에서 적응 주파수도약(AFH) 방식을 적용하여 주파수를 변경하면서 마스터와 슬레이브가 통신을 한다. 같은 공간에 다수의 BLE 피코넷이 동작하면 주파수 충돌이 발생할 위험이 있으며, 이로 인해 패킷오류가 발생한다. 본 논문에서는 동기가 맞추어지지 않은 다수의 BLE 피코넷 환경에서 데이터 채널에 대해 동일 주파수채널 간섭으로 인한 패킷충돌 확률을 분석하였다. Connection 주기 대 connection 이벤트 길이의 비율을 주요 파라미터로 하여 동시에 작동하는 BLE 피코넷의 수에 따른 패킷충돌 확률을 분석하였다. 분석 결과는 주어진 공간에서 BLE 기기를 소지한 사용자 수에 따라 원하는 패킷충돌 확률을 위한 connection 이벤트 관련 파라미터의 설정에 활용할 수 있다.
무선 개인 네트워크(Wireless Personal Area Network: WPAN)에서 보안은 최근 무선 환경이 가지고 있는 기본적인 단점들을 극복하기 위한 중요한 이슈 중 하나이다. IEEE 802.15 등 WPAN 표준들에는 몇몇 보안 관련 기본 메커니즘이 정의되어 있지만 아직 해결해야 할 문제들이 남아있다. 고속 WPAN 기술 중 하나인 Koinonia는 무선으로 근거리 디바이스들을 연결하여 10Mbps 정도의 고속 통신을 하기 위해 개발되었다. Koinonia WPAN의 피코넷(piconet)은 하나의 마스터(Master)와 하나 이상의 슬레이브(Slave)로 구성되며, 이와 같이 구성된 피코넷에서 기기 간 안전한 데이터 전송을 보장하기위한 보안 관련 내용은 정의되어 있지 않다. 따라서 본 연구에서는 Koinonia의 피코넷 내 기기 간 통신시 안전한 데이터 통신을 위한 대칭/비대칭 키 기반의 키 생성 및 분배, 인증 및 보안방법을 제안하고 성능을 분석한다. 보안 요구 분석을 기반으로 Koinonia WPAN의 보안 요구에 만족함을 알 수 있다.
경부고속열차(KTX) 제어시스템은 차량컴퓨터(OBCS), 차상신호제어장치(ATC), 견인제동추진장치(MBU), 운전자고장안내지원장치(TECA), 유무선통신장치(MDT), 보조전원제어장치(ABU), 공조장치(HVAC), 객차활주제어장치(TRAE), 도착지표시장치(PID), 객실안전및객실편의설비동작표시장치(FDTR) 등이 차량컴퓨터를 마스터로 그 외 하부제어장치들은 슬레이브로 다양한 시리얼라인을 매체로 상호 제어한다. 이런 다양한 시리얼링크라인의 물리적 구조와 상호 데이터 전송구조를 분석하기 위해, 시리얼라인 분석기를 다양한 방법으로 사용한다. 시리얼라인 분석기를 사용하기 위해서는 사전에 고속열차에 대한 전문 기술과 장비사용에 대한 경험이 필요하다. 공간과 환경이 어려운 여건에서, 고속열차정비에 근무하면서, 하부장치 시리얼라인 데이터 수집과정에서 얻은 물리적 접속방법과 통신데이타 분석에 대한 기본 구조를 제시하여, 관련 업무에 종사하는 분에게 도움이 되고자 한다. 또 한 향후 독자적으로 개발 된 고속열차 시운전과정에서 필요한 고속열차 진단업무에 도움이 되고자 한다.
새로운 정보기술 환경에 적합한 국가기본도용 데이터 및 DB 모델을 개발하고자 본 연구에서는 시공간지도구조, 정보연계용 프레임워크지도, 다중레이어 토폴로지구조 등을 주요 특징으로 하는 Hybrid 공간정보 모델을 개발하였다. 공간정보에 "시간"이라는 새로운 차원을 추가하여 공간객체의 시간에 따른 변화가 반영되는 DB 구조를 설계하였고, 다축척 융합지도 구조와 고유 ID 체계를 부여하여 타 정보와 연계 융합하여 활용할 수 있도록 하였다. 또한 기존 2차원 지도의 표현상 한계를 극복하고자 실내 및 지하정보를 포함하는 구조와 지형 지물에 대한 토폴로지 및 복합표현 구조를 설계하였다. 설계결과를 반영한 시범구축을 통해 개발된 모델의 성능을 평가한 결과 다양한 정보들과의 시공간 연계를 통해 활용도가 향상된 국가기본도용 데이터 및 DB 모델의 구현 가능성을 확인할 수 있었다.
아두이노 프로 미니, 가속도 및 자이로 센서, 블루투스 마스터 및 슬레이브 모듈을 이용하여 사물인터넷 기반의 소 행동 특성을 관찰할 수 있는 알고리듬을 제안하고 이의 실현을 위한 시스템을 설계하고 구현하였다. 구현된 시스템을 통해 소의 행동을 측정하였으며, 측정된 데이터를 센서를 부착한 블루투스 송신 모듈을 통해 컴퓨터에 연결된 수신 모듈로 전송하여 컴퓨터에서 실시간으로 소의 움직임 변화를 그래프를 통해 나타내었으며 이를 통해 발정 상태를 판단할 수 있는 알고리듬을 제시하였다. 이를 위한 블루투스 스캐터넷 적용방안을 제시하고, 제안한 알고리듬과 구현된 시스템에 의해 소의 발정 상태를 판단하며, 이는 소의 인공수정에 의한 번식력 향상에 도움을 줄 수 있다. 본 논문에서는 구현한 시스템을 소의 다리에 실제로 부착하여 데이터를 측정하고, 제안한 알고리듬에 의해 발정 유무를 판단하였다.
USB 버스는 편리하게 사용할 수 있고 빠르게 데이터를 전송하는 장점이 있어서, FPGA 개발보드와 PC 사이의 표준적인 인터페이스이다. 본 논문에서는 Cypress FX3 USB 3 브릿지 칩에 대한 slave FIFO 인터페이스를 사용하여 FPGA 검증 시스템을 구현하였다. slave FIFO 인터페이스 모듈은 FIFO 구조의 호스트 인터페이스 모듈과 마스터 버스 제어기와 명령 해독기로 구성되며, FX3 브릿지 칩에 대한 스트리밍 데이터 통신과 사용자 설계 회로에 대한 메모리 맵 형태의 입출력 인터페이스를 지원한다. 설계 검증 시스템에는 Cypress FX3 칩과 Xilinx Artix FPGA (XC7A35T-1C5G3241) 칩으로 구성된 ZestSC3 보드가 사용되었다. C++ DLL 라이브러리와 비주얼 C# 언어를 사용하여 개발한 GUI 소프트웨어를 사용하여, 사용자 설계 회로에 대한 FPGA 검증 시스템이 다양한 클록 주파수 환경에서 올바로 동작함을 확인하였다. 설계한 FPGA 검증 시스템의 slave FIFO 인터페이스 회로는 모듈화 구조를 갖고 있어서 메모리맵 인터페이스를 갖는 다른 사용자 설계 회로에도 응용이 가능하다.
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[게시일 2004년 10월 1일]
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