• 제목/요약/키워드: 레이아웃 설계

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씨마트론 다이 디자인을 활용한 브라켓의 스트립 레이아웃설계에 관한 연구 (Study on the Design of Bracket Strip Layout Utilizing Die Design of Cimatron)

  • 최계광;이동천
    • 한국산학기술학회:학술대회논문집
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    • 한국산학기술학회 2008년도 춘계학술발표논문집
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    • pp.35-39
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    • 2008
  • 프로그레시브금형에 있어서 스트립 레이아웃설계는 제품 양산을 결정하는 중요 요인이다. 본 논문에서는 자동차에 사용되는 브라켓의 스트립 레이아웃설계를 하였다. 3D모델링이 아닌 자동화 모듈인 씨마트론 다이 디자인을 활용하여 3D로 스트립 레이아웃설계를 하였다. 광폭 2열 2개 뽑기의 내측캐리어를 단 배열로 블랭크 레이아웃을 최적화하였다. 사용된 3D CAD/CAM 소프트웨어는 Cimatron Die Design이며 10개 공정으로 스트립 레이아웃설계를 완성하였다.

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VLSI 레이아웃 설계

  • 김정범;이현찬;이철동
    • 전자통신동향분석
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    • 제5권4호
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    • pp.134-144
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    • 1990
  • 칩의 다품종소량생산 경향과 대규모화 영향에 비례하여, 칩 전체 설계공정 중에서 자동화문제에 가장 민감한 레이아웃 설계에 있어서도 복잡도 및 난이도가 증가하고 있다. 따라서 레이아웃 설계에서는 다루어야 할 대량의 설계 데이터를 고속, 효율적으로 관리 처리하기 위한 고도의 자동설계기법이 절실히 요구되고 있는 실정이다. 본고에서는 이러한 칩 개발과제를 배경으로 하여 먼저 VLSI의 레이아웃 설계의 개요를 고찰하고, 설계에 있어서의 주 문제인 배치 및 배선에 대한 기본적인 설계기법, 각기법의 차이점, 그리고 연구현황에 대하여 기술하고 있다.

HEV UV단자의 스트립 레이아웃설계에 관한 연구 (Study on the Strip Layout Design of HEV UV Terminal)

  • 최계광;조윤호
    • 한국산학기술학회:학술대회논문집
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    • 한국산학기술학회 2010년도 춘계학술발표논문집 2부
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    • pp.1166-1168
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    • 2010
  • 본 논문에서는 HEV UV단자를 자동화 모듈인 씨마트론 다이 디자인을 활용하여 스트립 레이아웃설계를 3D로 하였다. 제품의 스탬핑을 원활하게 하기 위하여 스트립 레이아웃을 33.5도 경사지게 수정하여 광폭 1열 1개 뽑기의 내측캐리어를 단 배열로 블랭크 레이아웃을 최적화하였다. 1개의 금형에서 두개의 단자를 공용으로 양산하기 29개 공정으로 3D 스트립 레이아웃설계를 완성하였다.

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Ez5의 스트립 레이아웃 설계에 관한 연구 (Study on the Design of Strip Layout for Ez5)

  • 최계광;이동천
    • 한국산학기술학회:학술대회논문집
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    • 한국산학기술학회 2009년도 춘계학술발표논문집
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    • pp.252-254
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    • 2009
  • 프로그레시브 노칭과 포밍금형에 있어서 박판성형해석에 의한 사전 분석은 제품을 양산하는데 꼭 거쳐야 하는 필수과정이다. 본 논문에서 연구한 Ez5는 일본 S 자동차의 미국 현지 공장에서 발주한 수출 금형을 가지고 스트립 레이아웃 설계에 관한 것을 연구한 것이다. 광폭 1열 1개 뽑기의 편측캐리어를 단 배열로 블랭크 레이아웃을 최적화하였다. 사용된 3D CAD/CAM 소프트웨어는 Cimatron E Die Design이며 10개 공정으로 스트립 레이아웃설계를 완성하였다.

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트랜지스터 레이아웃 산포를 고려한 새로운 설계 기법 (The New Design Methodology Considering Transistor Layout Variation)

  • 도지성;조준동
    • 전자공학회논문지
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    • 제49권12호
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    • pp.234-241
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    • 2012
  • 본 논문에서는 소자의 레이아웃 파라미터로 인한 회로 특성 산포를 개선할 수 있는 새로운 설계 기법을 제안한다. 제안된 설계 기법은 회로 시뮬레이션을 수행하지 않고 칩 내에서 레이아웃에 의한 소자의 전기적 특성 분포를 추출하여 불량 소자를 개선하는 방법이다. 이 기법은 3가지 장점이 있다. 첫째, 현 설계 흐름도에 변화를 주지 않아도 된다. 둘째, 레이아웃 설계자가 고비용의 설계 시뮬레이션을 수행하지 않고 소자의 전기적 특성 산포를 추출할 수 있다. 셋째, 초기 레이아웃 설계단계에서 전기적 불량 소자를 찾아 개선하여 설계 기간 단축에 도움이 된다. 제안한 방법에 대한 효율성을 검증하기 위하여 30나노 DRAM 공정에서 총 9종류의 소자 레이아웃 파라미터에 대해서 모델링을 진행하였다. 레이아웃 설계자를 위한 eDRC 환경을 개발하여 Standard Cell Library 설계에 적용하여 초기 설계단계에서 불량 소자 17.8%를 찾아 2.9%로 줄였다.

HAN-LALA : 한양 레이아웃 언어 (HAN-LALA : Hanyang-Layout Language)

  • 김현곤;이병호;정정화
    • 대한전자공학회논문지
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    • 제27권3호
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    • pp.124-130
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    • 1990
  • 본 논문에서는 LSI/VLSI 레이아웃 설계 자동화를 위한 새로운 레이아웃 설계언어 HAN-LALA를 제안한다. HAN-LALA는 C언어를 확장하여 사용함으로써 레이아웃 기술이 용이하고 preprocessor없이 컴파일되므로 디버깅이 쉽고 설계 시간이 단축된다. 기술 독립적인 레이아웃 설계를 가능하게 하기 위하여 설계 규칙과 공정기술을 독립된 모듈로 구성한다. 또한 관련된 오브젝트들을 그룹으로 정의하여 그룹간 배치를 행하고, river routing, 금지 영역을 고려하여 배선 등의 다양한 배선 모듈을 제공하여 세부적인 레이아웃 기술이 없어도 오류 없는 설계가 가능하다.

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씨마트론 다이 디자인을 활용한 브라켓의 스트립 레이아웃설계에 관한 연구 (Study on the Design of Bracket Strip Layout Using Cimatron Die Design)

  • 최계광;이동천
    • 한국산학기술학회논문지
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    • 제9권5호
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    • pp.1113-1118
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    • 2008
  • 프로그레시브금형에 있어서 스트립 레이아웃석계는 제품 양산을 결정하는 중요 요인이다. 본 논문에서는 자동차에 사용되는 브라켓의 스트립 레이아웃설계를 하였다. 3D모델링이 아닌 자동화 모듈인 씨마트론 다이 디자인을 활용하여 3D로 스트립 레이아웃설계를 하였다. 광폭 2열 2개 뽑기의 내측캐리어를 단 배열로 블랭크 레이아웃을 최적화하였다. 사용된 3D CAD/CAM 소프트웨어는 Cimatron Die Design이며 10개 공정으로 스트립 레이아웃설계를 완성하였다.

제관물 제작 공장의 레이아웃 설계 및 시뮬레이션에 관한 연구 (A Study on Layout Design and Simulation of The Steel Fabrication)

  • 하승진;권봉재;류상훈;김종철
    • 한국경영과학회:학술대회논문집
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    • 대한산업공학회/한국경영과학회 2000년도 춘계공동학술대회 논문집
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    • pp.167-170
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    • 2000
  • 본 연구에서는 먼저, 신규 투자 공장에서 생산되는 제품의 공정 특징을 만족할 수 있는 레이 아웃을 설계하였으며, 시뮬레이션을 이용하여 설계된 레이아웃에서 제품 타입별로 요구되는 생산 물량을 처리할 수 있는가를 평가하였다. 이를 위해 여러 대안의 제시 및 시뮬레이션 평가를 수행하였다. 본 연구의 결과 경제성을 고려한 신규 공장의 적절한 레이아웃 설계 및 운영 방안을 제시하였다.

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C언어를 이용한 CMOS PLA의 설계 (Design of CMOS PLA Using C Language)

  • 차균현;케빈·카플러스
    • 대한전자공학회논문지
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    • 제21권5호
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    • pp.61-66
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    • 1984
  • C 언어로 만든 VLSI 레이아웃 언어를 사용하여 CMOS PLA를 설계한다. PLA cell의 library를 만들고 Protector 회로의 제어논리로 사용되는 PLA를 NCR 설계법칙을 이용하여 설계하고 레이아웃 프로그램을 만든다. 관련되는 프로그램 기법을 논의하고 레이아웃을 display할 수 있도록 한다.

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반도체 자동이식 알고리즘에 관한 연구 (Algorithms of the Yield Driven VLSI Layout Migration Software)

  • 이기중;신만철;김준영;이윤식
    • 한국정보과학회:학술대회논문집
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    • 한국정보과학회 2001년도 봄 학술발표논문집 Vol.28 No.1 (A)
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    • pp.25-27
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    • 2001
  • 설계 재활용을 위하여서는, 반도체 지적 소유권(Intellectual property)의 표준화와 더불어 레이아웃 자동 이식에 관한 연구와 상품화가 필수적이다. 본 논문은 반도체 설계 형식 중에서 생산 공정과 밀접한 레이아웃 형식의 회로도면 처리를 자동화하여 설계와 생산 시간을 혁신적으로 단축하기 위한 연구이다. 레이아웃 형식은 특성상 도형(폴리곤)으로 구성되어 있으며, 레이아웃 형태에서 다양한 도형의 중첩이 반도체의 트랜지스터, 저항, 캐피시터를 표현함으로써, 반도체 지적소유권의 한 형식으로 자주 활용되고 있다. 본 논문은 반도체 레이아웃 이식 소프트웨어 시스템의 내부 기능에 관한 설명과 처리 능력과 속도를 높이기 위한 알고리즘의 제안과 벤치마킹 결과를 보여 주고 있다. 비교 결과, 자원의 최적 활용(41%)으로 대용량의 처리 가능성을 보여 주고 있으며, 처리 속도는 평균 27배로써 이전의 벤치마킹 회로를 더욱 크게 하여 그 결과를 보여 주고 있다. 이러한 비교 우위는 본 논문에 포함된 소자 처리 알고리즘과 그래프를 이용한 컴팩션 알고리즘에 기인한다. 지면상의 연유로, 참고1에서는 기능 설명을, 본 논문은 알고리즘의 구현에 관한 설명을 중점적으로 기술한다.