• 제목/요약/키워드: 디지털 재설계

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항공용 인터콤의 백업 모드 운용을 위한 디지털 방식의 이중화 설계 (The Digital Redundancy Design for Back-up Mode Operation of Aviation Intercom)

  • 정성재;조경학;김동혁;이성우
    • 한국항행학회논문지
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    • 제26권5호
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    • pp.358-364
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    • 2022
  • 항공용 인터콤 시스템은 정/부조종사 간 내부 통화 및 조종사와 승무원 간 내부 통화, 초고주파 무전기(U/VHF)와 같은 통신 장비를 통한 외부 통화, 초단파전방향거리탐지기/계기착륙장치(VOR/ILS), 전술 항법 장치(TACAN)와 같은 항법 및 임무 장비 오디오 신호 모니터링, 비행 데이터기록장치(FDR) 및 자료전송 시스템(DTS)으로의 음성 녹음용 오디오 신호 출력, 항공기의 상태와 위협 등에 대한 오디오 경고음/경고 음성 발생 등 항공기 내의 모든 음성 신호에 대한 처리를 담당하는 장비이다. 이러한 항공용 인터콤은 아날로그 오디오 신호의 경우 노이즈에 민감하기 때문에 조종사 및 승무원의 임무 수행을 위해 항공기 내/외부의 전자파 노이즈로부터 오디오 신호를 보호할 수 있는 이중화 설계가 필요하다. 본 논문에서는 항공용 디지털 인터콤의 이중화를 위한 정상/백업 운용모드 및 디지털 방식의 이중화 설계 방안과 제작 및 검증 결과에 대하여 기술한다.

IP-Based Settop Box의 신뢰성 향상을 위한 구조 설계 (Reliability Design for an IP-Based Settop Box)

  • 김정우;김천성;정병달;조남석
    • 대한전자공학회:학술대회논문집
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    • 대한전자공학회 2003년도 하계종합학술대회 논문집 V
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    • pp.2653-2656
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    • 2003
  • 본 논문에서는 IP-Based 디지털 TV Settop box에서 발생할 수 있는 신뢰성의 문제점에 대해서 설명하고, 이를 향상, 보완할 수 있는 방법을 제안한다. IP-Based DTV Settop box 는 사용자에게 인터넷 검색이나 주문형 비디오와 같은 고부가가치의 서비스를 제공하기 위하여 범용 운영체제를 주로 사용한다. 하지만, 범용 운영체제의 사용에 따른 시스템의 불안정성과 운영체제 자체의 오류가 발생하였을 때는 Settop box의 기본기능 조차 사용하지 못하게 될 수도 있다. 본 논문에서는 이러한 문제를 해결하기 위하여 중앙 제어부를 모니터링하는 별도의 제어부를 따로 두어 중앙 제어부가 오 동작 하였는지 검사하도록 한다. 만약, 중앙 제어부가 비정상적인 상태이면 별도의 제어부가 Settop box의 기본 기능을 계속할 수 있도록 유도하고, 시스템이 재 부팅되어 정상동작을 하면 제어 권을 다시 중앙 제어부로 넘겨준다. 또한, 중앙 제어부의 시스템이 부팅하는 동안 제안된 구조를 이용해 Settop box의 기본 기능인 디지털 TV시청을 가능하도록 하는 방안에 대해서도 논한다.

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패킷 재조립 기능을 가진 IDS 우회공격 탐지 시스템 (IDS Evasion Detection System with Packet Reassemble Funtion)

  • 육상조;박명호;이극
    • 디지털콘텐츠학회 논문지
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    • 제4권1호
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    • pp.101-113
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    • 2003
  • 우회공격 기술이란 침입탐지 시스템의 취약점을 이용하여 정상적인 침입탐지를 회피하는 기술이다. 본 논문에서는 첫째, 침입탐지 시스템에 대한 우회공격 기술을 분류하고, 두 번째로 기존의 침입탐지 시스템에서 사용할 수 있는 우회공격 탐지 모델을 제시하고 마지막으로 우회공격 탐지 시스템을 설계 구현한다.

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Fuzzy PID 제어기 설계 및 구현 (Design and Implementation of Fuzzy PID Controller)

  • 정동화;김성일;이상훈;신위재
    • 한국지능시스템학회:학술대회논문집
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    • 한국퍼지및지능시스템학회 2004년도 추계학술대회 학술발표 논문집 제14권 제2호
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    • pp.457-460
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    • 2004
  • 본 논문에서는 새로운 방법의 Fuzzy PID 제어기를 제안한다 우선 절대형 디지털 PID 제어기에서 두 가지 문제점이 있다. 첫째는 매 제어 주기마다 많은 데이터의 합을 구해야 하므로 계산시간이 많이 소요되고, 둘째는 이 계산을 위해 이전의 모든 데이터를 보관하고 있어야 되기 때문에 메모리가 많이 필요한 문제점이 있다. 위의 문제점을 개선하기 위해 속도형 디지털 PID 제어기를 사용한다. 제안한 제어기에서는 PIB 제어기의 목표 값과 현재 출력 값의 차인 크리스퍼(crisp) 출력 오차를 그대로 사용하지 않고 퍼지추론의 단계는 가지면서 Rule Table은 갖지 않는 특징이 있으며 출력 소속 함수에 두 변수의 관계와 범위에 의해 도식화된 영역에서 삼각형 무게 중심법으로 비퍼지화된 비선형 출력 값을 PID 계수에 인가하는 새로운 Fuzzy PID 제어기를 제안한다.

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전사적 정보보호 아키텍처에 근거한 금융 정보보호 모델 설계 (Design of Financial Information Security Model based on Enterprise Information Security Architecture)

  • 김동수;전남재;김희완
    • 디지털산업정보학회논문지
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    • 제6권4호
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    • pp.307-317
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    • 2010
  • The majority of financial and general business organizations have had individual damage from hacking, worms, viruses, cyber attacks, internet fraud, technology and information leaks due to criminal damage. Therefore privacy has become an important issue in the community. This paper examines various elements of the information security management system and discuss about Information Security Management System Models by using the analysis of the financial statue and its level of information security assessment. These analyses were based on the Information Security Management System (ISMS) of Korea Information Security Agency, British's ISO27001, GMITS, ISO/IEC 17799/2005, and COBIT's information security architecture. This model will allow users to manage and secure information safely. Therefore, it is recommended for companies to use the security management plan to improve the companies' financial and information security and to prevent from any risk of exposing the companies' information.

시간제약 조건하에서 재사용 모듈 설계를 통한 CPLD 저전력 기술 매핑 (CPLD Low Power Technology Mapping for Reuse Module Design under the Time Constraint)

  • 강경식
    • 디지털산업정보학회논문지
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    • 제4권3호
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    • pp.77-83
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    • 2008
  • In this paper, CPLD low power technology mapping for reuse module design under the time constraint is proposed. Traditional high-level synthesis do not allow reuse of complex, realistic datapath component during the task of scheduling. On the other hand, the proposed algorithm is able to approach a productivity of the design the low power to reuse which given a library of user-defined datapath component and to share of resource sharing on the switching activity in a shared resource. Also, we are obtainable the optimal the scheduling result in experimental results of our using chaining and multi-cycling in the scheduling techniques. Low power circuit make using CPLD technology mapping algorithm for selection reuse module by scheduling.

케이블 HFC 네트워크의 효율적인 진화 방안 연구 (A Study on Efficient Evolution of Cable HFC Network)

  • 권호진;문준우
    • 한국방송∙미디어공학회:학술대회논문집
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    • 한국방송∙미디어공학회 2018년도 하계학술대회
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    • pp.31-34
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    • 2018
  • 최근 유무선 트래픽의 지속적인 증가에 대응하기 위해선 가입자 네트워크의 양적 확충은 물론, 새로운 인터넷 기술을 개발하고 그 구조를 재설계하는 등의 투자가 이루어지고 있다. 특히 차세대 미디어 서비스 등의 인터넷 수요 및 대역폭에 대한 요구가 증가로 인하여 가입자 망 진화의 필요성이 계속해서 이야기되고 있다. 정부에서는 10기가 인터넷 상용화를 목표로 '10기가 인터넷 상용화 촉진 선도 시범 사업'을 추진하고 있으며, KT와 SK브로드밴드 등 주요 통신사에서도 10Gbps 인터넷 상용화를 추진하고 있다. 이에 케이블 사업자도 인터넷 경쟁력 확보를 위해 HFC망 진화 방안에 대한 연구가 필요하다. 우선 상하향 10Gbps 전송이 가능한 DOCSIS 3.1 도입을 위해 망 장비 교체나 업그레이드 없이 주파수 확보가 이루어 져야 하며, 상향 전송 속도 확대를 위해 북미에서 표준화 진행중인 FDX(Full-Duplex) DOCSIS 도입을 위해 망 구조를 개선해야 한다.

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24 채널 정전 용량형 터치 검출 ASIC의 구현 (Implementation of 24-Channel Capacitive Touch Sensing ASIC)

  • 이경재;한표영;이현석;배진웅;김응수;남철
    • 대한전자공학회논문지SD
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    • 제48권5호
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    • pp.34-41
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    • 2011
  • 본 논문은 24 채널 정전 용량형 터치 검출 ASIC에 대한 것이다. 제안된 회로는 아날로그 회로부와 디지털 회로부로 구성되어 있다. 아날로그 회로부는 사용자의 접촉을 전기적인 신호로 변환시키며 디지털 회로부는 전기적인 신호의 변화를 디지털 데이터로 변환시키는 역할을 담당한다. 디지털 회로는 I2C가 내장되어 시스템 동작 계수들을 호스트 프로세서에서 변경해 줄 수 있도록 설계되었다. 따라서 온도 변화 등 외부환경 변화에도 안정적으로 동작할 수 있다. 본 ASIC은 0.18um CMOS 공정으로 구현되었으며 그 크기는 약 3 $mm^2$ 이고 소비전력은 5.3 mW이다. 설계에는 Cadence사와 Synopsys사의 상용 개발환경이 사용되었다.

다중 디지털 신호의 비교를 위한 병렬 기법의 VLSI 설계 (VLSI Design of Parallel Scheme for Comparison of Multiple Digital Signals)

  • 서영호;이용석;김동욱
    • 한국정보통신학회논문지
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    • 제21권4호
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    • pp.781-788
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    • 2017
  • 본 논문에서는 여러 디지털 신호의 크기를 비교하기 위한 알고리즘 및 디지털 회로를 제안한다. 제안하고자 하는 알고리즘은 여러 입력을 동시에 비교한 후에 간단한 디지털 논리 함수를 이용하여 그 입력들 중에서 가장 큰 값(혹은 가장 작은 값)을 검출하는 방법을 제공할 수 있다. 이 방식의 단점은 하드웨어 자원이 증가하는 것인데, 이를 위해 중복된 논리동작을 재사용하는 방법을 제안한다. 제안하고자 하는 방식은 회로 속도의 증가, 즉 지연시간의 감소에 초점을 맞추었다. 제안한 비교 알고리즘은 HDL로 구현한 후에 Altera사의 Cyclone III EP3C40F324A7 FPGA 환경에서 실험하였다. 4입력의 경우에 1.20배의 하드웨어 자원을 사용하면서 1.66배 만큼 동작 속도를 증가시킬 수 있다. 또한 8입력의 경우에는 2.15배의 하드웨어 자원을 사용하면서 2.29배로 동작 속도를 증가시킬 수 있다.

재난통신 체계에 따른 품질요건 재설계에 관한 연구 (A Study on Re-design of Quality Requirements for Disaster Communication Systems)

  • 양정모;김정호
    • 디지털융복합연구
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    • 제13권10호
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    • pp.327-335
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    • 2015
  • 재난통신망은 TETRA(TErrestrial Trunked RAdio)에서 대용량 데이터 통신이 가능한 광대역 이동통신 기술인 Public Safety-LTE(Long Term Evolution) 자가망을 활용하는 방향으로 발전하고 있다. 국내에서는 재난재해 대응기관 간의 일원화된 통신체계 유지를 위해 재난안전통신망 구축사업을 추진하고 있으나, 재난재해 현장에 위치한 피해당사자와의 통신을 고려하지 않고 재난재해 대응기관 간 지휘통제를 중심으로 통신망을 구축하고 있다. 본 연구에서는 국내 재난통신망 구축동향과 해외 선진사례를 해석하여 전 범위 재난통신망 구축을 위한 쟁점을 도출하고 통신주체와 목적에 따라 재난통신 영역을 새롭게 정의하여 재난통신 영역을 통제통신, 대응통신, 현장통신, 당사자통신, 경보통신으로 세분화하였다. 본 연구를 통하여 재정의 된 재난통신 영역의 특성을 분석하고 이에 따른 핵심 품질요건을 재설계하여 영역별 음영지역 없는 전 범위 재난통신 체계 구축방안을 수립하였다.