• The Journal of Korean Institute of Communications and Information Sciences
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• v.26 no.5A
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• pp.879-888
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• 2001

본 논문에서는 무선 LAN의 MAC 계층 프로토콜을 고속으로 처리하는 MAC 기능 칩을 개발하였다. 개발된 MAC 칩은 CPU와의 인터페이스를 위한 제어 레지스터들과 인터럽트 체계를 가지고 있으며, 프레임 단위로 송수신 데이터를 처리한다. 또한 PFDM 방식 물리계층 모뎀을 위한 직렬전송 인터페이스를 가지고 있다. 개발된 MAC 칩은 크게 프로토콜제어기능 블록, 송신기능 블록 및 수신기능 블록 등으로 구성되었으며, IEEE 802.11 규격에 제시된 대부분의 DCF 기능을 지원한다. 구현된 MAC 칩의 동작을 검증하기 위해 RTS-CTS 절차 기능, IFS(Inter Frame Space) 기능, 액세스 절차, 백오프 절차, 재전송 기능, 분할된(fragmented) 프레임 송수신 기능, 중복수신 프레임 검출 기능, 가상 캐리어 검출기능(NAV 기능), 수신에러 발생 경우 처리 기능, Broadcast 프레임 송수신 기능, Beacon 프레임 송수신 기능, 송수신 FIFO 동작 기능 등을 시뮬레이션을 통해 시험하였으며, 시험 결과 모두 정상적으로 동작함을 확인하였다. 본 논문을 통해 개발된 MAC 기능 칩을 이용할 경우 고속 무선 LAN 시스템의 CPU 부하(load)와 펌웨어의 크기를 크게 줄일 수 있을 것으로 기대된다.

• Journal of the Korean Society of Marine Environment & Safety
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• v.21 no.2
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• pp.207-214
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• 2015

In this paper the independence axiom, one of two principal axioms of axiomatic design theory, is applied to the leveling system development as an design criteria. After functional requirements and corresponding design parameters constitute an initial design matrix for the leveling system, sequence, which is compatible with the independence axiom, of the design parameters of the design matrix is determined and independent components of block leveling system are revealed. As a result of axiomatic design, system configuration related to the design sequence is developed. In order to verify and validate the developed block leveling system, test with real hull block leveling work in site by using total station which is used to acquire three dimensional coordinate of target point is performed. Comparison with measured data and output data from the block leveling system shows the system accuracy is under 1 mm so that the developed system is verified and validated to be used in site.

• Journal of KIISE:Software and Applications
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• v.34 no.3
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• pp.275-302
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• 2007

We propose a novel still image compression system which supports a high quality text compression function. The system segments the text from the image and compresses the text with a high quality. The system shows 48:1 high compression ratio using context-based adaptive binary arithmetic coding. The arithmetic coding performs the high compression by the codeblocks in the bitplane. The input of the system consists of a segmentation mode and a ROI(Region Of Interest) mode. In segmentation mode, the input image is segmented into a foreground consisting of text and a background consisting of the remaining region. In ROI mode, the input image is represented by the region of interest window. The high quality text compression function with a high compression ratio shows that the proposed system can be comparable with the JPEG2000 products. This system also uses gray coding to improve the compression ratio.

• Proceedings of the Korea Information Processing Society Conference
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• 2018.10a
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• pp.106-109
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• 2018

본 논문에서는 최근 혁신적인 거래시스템으로 각광받고있고 앞으로 다양한 응용 플랫폼이 개발 될 것으로 예상되는 블록체인 시스템의 안정적인 프로토콜 기능과 효율적 트래픽 운영을 제공하기 위한 하부 네트워크 구조로써 미래 네트워크의 필요 기능과 서비스에 대한 연구를 진행하였다. 이러한 하부 네트워크 구조로써 미래 네트워크의 필요 기능과 서비스에 대한 연구를 진행하였다. 이러한 하부 네트워크 구조는 현재 많이 사용되고 있는 인터넷 또는 OSI Reference 모델의 수정된 프로토콜 형태가 아니라 새로 표준화가 진행되고 있는 ISO/ISE JTC1 SC6의 미래 네트워크 구조에 필요한 서비스 기능을 위한 요구사항을 제시하고자 한다. 가까운 미래 블록체인이 대중화될 때 블록체인의 안정적인 동작과 효율적인 시스템 구성을 지원하기 위하여 하부 네트워크로 사용될 미래 네트워크의 요구사항들을 분석하고 분석된 내용을 바탕으로 앞으로 표준화가 진행될 미래 네트워크의 핵심 서비스 기능으로 제안하고자 한다.

• Journal of Industrial Convergence
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• v.18 no.6
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• pp.147-154
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• 2020

It is difficult to educate the overall operation of public and private blockchains with different characteristics. Recently, most education for blockchain is targeted at public blockchains such as Bitcoin and Ethereum. However, in an actual business environment, a private blockchain such as HyperLedger Fabric is used because access to corporate data is controlled through user authentication. In the case of HLF-based education, it is necessary to understand various components that are not in the public blockchain, such as peers, orderers, and channels. In this paper, a lab framework for HLF is designed for an efficient and systematic understanding of the functions and operations. The framework consists of HLF network, chaincode, and decentralized software control functions. Through the framework, the network configuration, distribution and activation of chaincode, and dApp execution process were checked step by step, and it was very easy to understand the overall flow for blockchain services. In addition, it is expected that a systematic understanding of the overall flow will be possible even in future network expansion.

• Proceedings of the Korean Institute of Navigation and Port Research Conference
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• v.2
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• pp.39-44
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• 2006

현재 조선산업은 선박의 대형화 추세에 맞추어 선체블록 규모가 대형화되고 있다. 따라서 대형 선체블록제작을 위한 블록전문업체가 증가하고 있으며, 그에 따른 블록조립 및 정도계측기술 개발이 절실히 요구되고 있다. 이에 본 연구에서는 그간 수행해온 블록계측과 관련된 각종 데이터베이스를 구축하고, 시스템 기능구현에 핵심 기술인 소프트웨어 개발 기법, 정보 가시화 기법을 제시하고 이를 이용한 인터페이스를 개발하여 본 시스템의 구성요소를 유기적으로 연결하여 사용하는 과정을 시연함으로써 블록조립 정도평가 시스템의 유용성과 기능을 검증하였다.

• Proceedings of the Korean Information Science Society Conference
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• 1999.10c
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• pp.36-38
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• 1999

하드웨어의 제품 사양에는 제품의 특징, FBD(Functional Block Diagram), 핀의 기능 및 배열, 프로그래밍 모드 및 각 블록의 기능 등이 함께 제시된다. 이 때 다른 사양과는 달리 설계 초기 단계부터 설정되는 가장 개념적인 FBD는 마이크로프로세서의 경우 메모리 인터페이스, 레지스터 파일, 데이터패스, 예외처리기, 각종 제어기, 타이머 등으로 구성된다. FBD의 각 블록들은 여러 명의 설계자들에게 분할되고 이 중 마이크로프로세서 설계의 대부분의 시간을 소비하게 되는 각종 제어기의 설계는 여러 블록이 공동으로 제어 신호를 공유하게 된다. 이 신호에 의해 전체 시스템의 정확성(correctness)이 결정되므로 제어기예서 각 블록에 공급하는 제어 신호는 적절할 타이밍에 정확한 값을 가져야만 한다. 따라서 본 논문은 마이크로프로세서에서의 각 블록에 공급하는 제어 신호는 적절한 타이밍에 정확한 값을 가져야만 한다. 따라서 본 논문은 마이크로프로세서의 FBD를 모델링할 수 있는 시각도구를 제안함으로써 제어 신호에 따른 전체 블록의 유기적인 데이터 흐름을 한 눈에 파악할 수 있도록 한다. 이는 설계초기부터 각 블록들을 설계하는 설계자들간의 공통의 다이어그램인 FBD를 중심으로 설계를 해나감으로써 대화 오류를 감소시키고 제어신호 디버깅을 용이하게 하여 설계시간을 단축시키는 것을 목표로 한다.

• Journal of KIISE:Computing Practices and Letters
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• v.5 no.3
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• pp.336-343
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• 1999

본 논문은 지능형 정보 제공 시스템(IP : Intelligent Peripheral)의 주요 소프트웨어 블록 중 하나인 자원 서비스 제어부의 구현 방법을 설명한 것이다. 본 연구의 자원 서비스 제어부는 ITU-T INCS-1에 정의된 특수자원 기능실체(SRF : Specialized Resource Function)의 상태모델을 실현시킨 소프트웨어 블록으로서 IP 하드웨어 구성요소의 하나인 특수자원교환기(SRS : Specialized Resource Switch) 의 CROS(Concurrent Realtime perating System)상에서 CHILL(CCITT High Level Programming Language)로 구현되었으며, 지능망서비스제어시스템(SCP : Service Control Point)이 보낸 지능망 응용프로토콜(INAP : Intelligent Network Application Protocol)오퍼레이션을 분석하여 IP가 보유한 자원 구동에 필요한 모든 절차를 제어한다. 또한 동시에 수신된 INAP오퍼레이션들에 대한 순서제어기능, 통계데이타 제공기능, 사용자 상호작용 종료 기능등을 제공한다. 제안된 구현기술은 자원서비스 제어부가 실제 자원을 동작시키는 IP 하드웨어 구성요소인 특수자원유닛(SRU : Specialized Resource Unit)을 클라이언트/서버형태로 유지하여 이들 자원의 상태를 관리함으로써 IP의 확장성을 보잔하여, 교환기 실시간 데이터베이스를 이용하여 IP가 생성하는 수만여개의 메시지를 효율적으로 관리할 수있다.

• Journal of the Korea Institute of Information and Communication Engineering
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• v.9 no.3
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• pp.493-497
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• 2005

This paper is about the research of the User Agent implementation under wireless embedded environment, using SIP which is one of protocol components construct the VoIP system. The User Agent is made of the User Agent configuration block, the device thread block to control devices and the SIP stack block to process SIP messages. The device thread consists of the RTP thread and the sound lard device processing block. Futhermore, the SIP stack consist of the worker thread to process proxy events, the SIP transceiver and SIP thread to transfer and receive SIP messages. The H/W platform is a board included the Intel's XScale PXA255 processor, flash memory, SDRAM, Audio CODEC module and wireless LAN threough PCMCIA socket, furthermore a microphone and headphone is used by the audio 1/0. The system has embedded linux kernel 2.4.19. For embedded environment, the function of User Agent and SIP method is diminished. Finally, the resource of system could be reduced about $12.9\%$, compared to overall system resource, by minimizing peripherals control and excepting TCP.

• The Journal of the Acoustical Society of Korea
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• v.20 no.1
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• pp.56-61
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• 2001

This paper presents the real-time implementation of an AMR (Adaptive Multi Rate) vocoder which is included in the asynchronous International Mobile Telecommunication (IMT)-2000 mobile ASIC. The implemented AMR vocoder is a multi-rate coder with 8 modes operating at bit rates from 12.2kbps down to 4.75kbps. Not only the encoder and the decoder as basic functions of the vocoder are implemented, but VAD (Voice Activity Detection), SCR (Source Controlled Rate) operation and frame structuring blocks for the system interface are also implemented in this vocoder. The DSP for AMR vocoder implementation is a 16bit fixed-point DSP which is based on the TeakLite core and consists of memory block, serial interface block, register files for the parallel interface with CPU, and interrupt control logic. Through the implementation, we reduce the maximum operating complexity to 24MIPS by efficiently managing the memory structure. The AMR vocoder is verified throughout all the test vectors provided by 3GPP, and stable operation in the real-time testing board is also proved.