임베디드 마이크로프로세서인 ARM Cortex-M3는 기존의 것들과는 달리 짧은 문맥교환을 제공하기 위해 Trap을 이용하여 문맥교환 과정을 일부 하드웨어적으로 처리하는 기능을 제공한다. 일반적으로 Trap (혹은 소프트웨어 인터럽트)은 그 자신만의 오버헤드를 갖고 있는 것으로 알려져 있다. 따라서 본 논문에서는 소프트웨어적으로 문맥교환을 하던 방식에 비해 어느 정도의 성능 향상이 있을지에 대한 정량적인 비교 평가를 수행하여 Cortex-M3를 기반으로 한 임베디드 시스템의 설계에 도움을 주도록 한다.
본 논문은 DCS(Dynamic Comprehension System) 정보확장 과정을 어휘 정보의 첨가를 통해 묘사하고자한다. 즉, 현존의 사전정보의 보완작용없이, 시스템을 확장하는 과정이 이 논문에서 보여진다. 새로운 언어정보에 유연하게 대처하기 위해 화자와 청자간의 새로운 지식의 학습과정이 나무구조 형식의 보조메뉴를 통해 상호 교환방식으로 나타내진다. 본 논문은 새로운 지식의 인지과정 중 현존의 정보망(network)에 각 단위망(nection)이 첨가될 때의 과정을 구현시키고자 시도된 것이다.
갑문을 통하여 유입되는 해수의 양을 산정하고, 1차원 수치모형을 적용하여 운하 속으로 해수의 확산 범위를 파악하였다. 복잡한 양상을 보이는 해수와 담수의 교환과정에서 조위, 갑식의 크기, 운하의 규모, 운영시간만을 고려한 개념적인 모형으로 표현하여 유입되는 해수의 양을 터미널로 배가 들오올 때와 나갈 때, 조위가 운하의 수위보다 높을 때와 낮을 때로 나누어 산정하였다. 본 연구에서 적용한 수치모형은 갑문을 통하여 유입되는 해수는 완전히 혼합된다고 가정하였으며, 또한 갑문을 열 때 갑실 속의 해수와 운하의 담수도 완전히 교환된다고 가정하였다. 서해 쪽 갑문을 통한 손실되는 물의 양을 한강 쪽의 갑문을 통하여 보충하는 경우와 그렇지 않은 경우로 나누어 고려하였다.
본 논문에서는 비터비 디코더의 디코딩과정에서 trace-forward 과정이후. trace-back 동작 없이 decision bit를 결정 가능한 구조로 설계하여 사용 메모리 크기와 동작 cycle에서 이득을 가지는 변형된 레지스터 교환(modified register exchange) 방식을 제안하였다. 제안된 구조는 시뮬레이션에 의해 trace-back이 있는 기존의 방식과 동일한 결과를 나타냄을 확인하였으며, 변형된 레지스터 교환 방식과 기존의 레지스터 교환 방식, 그리고 trace-back 방식과 비교하였다. 제안한 방식은 다른 방식들에 비해 메모리를 1/(5 x constraint length)로 줄일 수 있고, trace-back 방식에 비해 throughput을 2배 향상시켰다. 변형된 레지스터 교환 방식을 적용한 비터비 디코더의 동작을 검증하기 위해 code rate 2/,3, constraint length, K가 3인 디코더를 radix-4 구조의 1 bit 디코딩 방식으로 설계하여 FPGA(field programmable gate away)를 이용하여 구현하고 측정을 통해 오류 정정 작용을 확인하였다. 또한 블록 디코딩 방식에도 적용할 수 있음을 보였다.
이 글은 문화들 간의 바람직한 관계 정립을 모색하기 위해 리쾨르의 인정이론을 분석한다. 그는 헤겔에 의해서 체계화되고, 호네트에 의해 현대적으로 재구성된 인정 이론을 경유하여 자신의 이론을 정립한다. 이들의 이론에서 인정의 과정은 곧 투쟁의 과정인데, 인정에 내재된 투쟁의 계기로 인해 인정을 위한 투쟁이 악성 무한의 위험에 빠질 수 있다는 것이 리쾨르의 판단이다. 인정을 위한 투쟁이 무한히 계속되지 않도록 리쾨르는 선물의 교환을 통해 (상징적으로 이루어지는) 평화 상태를 상정한다. 즉 의례(儀禮)적 성격을 지닌 선물의 교환으로 인해 인정 투쟁은 상징적으로 종료된다. 그런데 이러한 상황에서 형성된 상호성은 현상학이 주목한 자기와 타자 사이의 근원적 비대칭성의 문제를 해소하지 않고서는 진정한 의미의 상호성이 될 수 없다. 진정한 상호성을 정립하기 위해 리쾨르는 선물을 교환하는 당사자들 간의 '사이'에 주목한다. 이 '사이'의 지점에서 주체와 타자는 선물의 교환으로 형성된 상호성 속에서도 여전히 각각의 자리를 유지한다. 정의로운 거리, 근접성 속에서도 거리를 확보함으로써 리쾨르는 주체와 타자 사이의 비대칭성과 상호성을 통합한다.
본 고는 한국전자통신연구소에서 개발한 TDX 와 TICOM 을 중심으로 이들을 개발하는 과정에서 사용하였던 개발체계들을 서로 비교해 본 것이다. 전전자 교환기와 컴퓨터는 서로 그 특성이 다르기는 하지만 이들을 개발하는 과정에서는 대규모 연구개발사업이라는 공통점 때문에 서로 조금은 다르지만 매우 유사한 개발체계를 적용한 것으로 판단된다.
소프트웨어 개발 시스템 (SDS)은 소프트웨어의 개발 및 유지.보수를 지원하는 종합적인지원체제이다. SDS는 specification, design, programming 과정을 제어하는 지침서, 이들 과정에서 생산된 document를 관리하는 database시스템, 그리고 이들 과정의 지원도구인 tool로 구성되어 있다. SDS는 매우 방대한 시스템으로, 모든 소프트웨어 개발에 적용할 수 있는일반적인 시스템의 구성은 매우 힘든 일이다. 본고에서는 시분할 교환기 개발에 관련된 개발시스템으로서의 SDS에 대하여 그방향을 기술한 후 각 구성 요소의 내용 및 SDS 시스템의 개발과정과 향후 목표를 종합적으로 기술하였다.
ACE2000 MPLS 시스템은 대용량 ATM 교환 시스템인 ACE2000 ATM 교환시스템에 MPLS 기능을 부가함으로써 사용자들에게 차별화 된 서비스를 제공할 수 있는 시스템이다 MPLS 시스템에서는 채널 사용의 유연성과 채널 자원의 효율적인 사용을 위해 VC 머징 기능을 요구하고 있다. 이를 위해 ACE2000 MPLS 시스템에서는 출력 방향 패킷 처리기에 VC머징 기능을 구현하여 적용하고 있다. 구현된 VC 머징 장치는 고성능 SAR 소자를 이용하였다. VC 머징 장치는 ATM 셀 구조로 입력되고, 입력된 ATM 셀은 고성능 SAR 소자에 의해 AAL-5 유형의 패킷으로 변환되어 VC 머징 제어기로 입력된다. VC 머징 제어기에서는 패킷 입력부로부터 패킷을 받아들여 채널 연결 설정 정보에 따른 VC 머징 기능을 수행하도록 패킷을 처리한다. 이 VC 머징 제어기에서의 패킷 처리 시 스위치 포트의 Full Mesh 연결로 인해 발생되는 채널 자원의 감소 문제를 해결하고, 채널 자원을 증대시키기 위해 2 단계의 룩업 과정을 거치는 패킷 제어 기능을 수행한다. 패킷 제어기에 의해 처리된패킷은 또 하나의 고성능 SAR 소자로 구성되어 있는 패킷 출력부로 전달되어 셀 분할(Segmentation) 과정을 거쳐 ATM 형태로 다음 레이블 스위치 라우터로 전달 되도록 물리층 보드로 전달된다. 본 논문에서는 ATM 교환 시스템을 기반으로 MPLS 시스템에서 채널자원의 증대를 위한 출력방향 패킷 처리장치에 대하여 제안한다.
Mobile IPv6(MIPv6)은 IETF에서 IP망의 이동성지원을 지원하기 위해 제안되었다. 기존의 MIPv6에서는 이동노드가 핸드오버 메시지 교환에 관여하여 핸드오버 지연이 발생하여 패킷을 손실하는 문제점을 가지고 있다. 이동노드의 핸드오버 메시지 교환과정을 제거하여 핸드오버 지연성능을 향상시키는 Proxy Mobile IPv6(PMIPv6)을 연구하였고, IETF MIPSHOP WG는 PMIPv6망에서 fast handover(PFMIPv6)를 제안하여 패킷의 손실을 최소화 하고자 하였다. 본 논문에서는 PFMIPv6에서 발생하는 핸드오버 과정 동안의 패킷손실을 줄이기 위해 이중 인터페이스 이동단말에 초점을 두고 패킷 bicasting을 적용하는 기법을 제안한다. 제안하는 기법의 성능을 수치적으로 분석하고, 시뮬레이션을 통하여 제안된 가법이 PFMIPv6에서의 핸드오버보다 패킷 손실과 신호비용의 관점에서 성능이 향상되었음을 확인하였다.
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[게시일 2004년 10월 1일]
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