• 전력전자학회논문지
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• 제15권3호
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• pp.199-206
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• 2010

매트릭스 컨버터는 3상의 입력 전원이 전력용 반도체 스위치의 제어를 통해 3상의 부하에 직접 연결되는 에너지 변환 장치이다. 에너지 저장을 위한 직류단이 없어 매트릭스 컨버터의 입력 전류는 부하 전류와 스위치 상태에 직접 의존한다. 그러므로 불평형 또는 왜곡된 입력 전압은 원치 않은 출력 고조파 전류의 원인이 된다. 본 논문에서는 매트릭스 컨버터의 입력 전원 외란 상황에서 출력 전류를 개선하는 신경회로망 기반 전류 보상기를 제안한다. 제안된 기법 타당성과 유효성을 시뮬레이션과 실험을 통해 증명한다.

• 한국전자파학회논문지
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• 제20권11호
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• pp.1178-1185
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• 2009

본 논문은 2.5 MHz 간격으로 광대역 주파수를 발생하며 응답 시간이 400 nsec 이하인 초고속 이산(discrete) 주파수 합성기를 제안한다. 제안한 주파수 합성기는 고정 주파수 위상 제어 루프(PLL)와 주파수 분배기를 이용해 16개의 기준 신호를 생성하고, 이들을 선택하여 주파수 혼합하는 방식으로 710~1,610 MHz내에서 2.5 MHz 간격의 이산 주파수 신호를 고속으로 생성한다. 제작된 주파수 합성기의 주파수 천이 응답 시간은 평균 350 nsec, 고조파를 비롯한 모든 불요파 신호는 -60 dBc 이하, 위상 잡음 특성은 -94 dBc/Hz @100 Hz, 출력 세기는 평균 21.5 dBm, 평탄도는 2.65 dB 이하로 측정되었다. 또한 주파수 천이 응답 속도를 측정하는 새로운 기법의 측정 방법이 제안되었다.

• 한국산학기술학회논문지
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• 제11권8호
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• pp.2968-2974
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• 2010

태양광 인버터는 계통과 태양광 시스템 사이의 공통 접속점에 고조파, 플리커, 고주파 노이즈가 없는 고품질 전력을 공급하는 핵심적인 역할을 한다. 일반적으로 비례-적분 (PI: Proportional Integral) 제어기는 정상상태 오차와 낮은 외란 제거 능력으로 인하여 교류 계통에서 만족할만한 성과를 얻지 못하나, 현장에서 이득 설정이 용이하므로 일반적으로 전압형 인버터 (VSI)에서 이용된다고 알려져 있다. 이 논문에서는 산업계에서 일반적으로 사용되는 비례-적분 제어기와 교류 계통의 상용주파수에서의 무한대의 이득 값을 가지며, 정상상태 에러 발생을 제거하며, 정지 좌표계에서 구현할 수 있는 비례-이득 (PR: Proportional Resonant) 제어기의 동작 원리, 설계 기법 등을 비교 분석하였다. PI와 PR 제어기의 분석 결과를 시뮬레이션과 실험을 통하여 그 타당성을 증명하였다. 두 제어기는 32-비트 고정소수점 연산을 하는 TMS320F2812 DSP 프로세서를 이용하여 구현하였고, 3kW 실험용 프로토타입 태양광 인버터를 제작하여 그 성능을 확인하였다.

• 전력전자학회논문지
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• 제16권5호
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• pp.457-465
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• 2011

본 논문에서는 3상 다이오드 정류기의 고장에 따른 해석 및 고장 판별 기법을 제안한다. 입력전원이나 다이오드소자에 고장이 발생하게 되면 출력 직류단 전압에 큰 맥동을 유발하며 이는 인버터 시스템의 제어 성능을 저하시킬 뿐만 아니라 커패시터의 수명 단축을 야기한다. 본 논문에서는 입력측의 지락 사고 및 다이오드 개방 사고 시의 직류단 전압 특성을 분석하고, 계통주파수의 6배에 주파수마다 측정된 직류단의 순시전압을 직류단 평균 전압과 비교함으로서 고장의 유무 및 종류를 판별하는 알고리즘을 제안하였다. 제안한 알고리즘은 직류단 전압 센서만을 이용하므로 구현이 간단하고 고장 진단을 위한 추가적인 하드웨어가 요구되지 않는다. 실험과 시뮬레이션을 통해 제안한 고장 진단 알고리즘의 타당성을 검증하였다.

• 한국전자파학회논문지
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• 제19권7호
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• pp.771-777
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• 2008

본 논문에서는 변형된 시간 지연 기법을 이용한 마이크로파 2차 주파수 체배기가 제안되었다. 제안된 주파수 체배기에서는 입력 신호와 지연된 신호 사이에 발생하는 군지연 시간 부정합을 전압 제어 지연 선로(VCDL)를 이용하여 보상하였다. 가변 슈미트 트리거를 이용한 군지연 시간 정합과 신호 파형의 성형(waveform shaping)으로 인해 원하지 않는 기본 주파수($f_0$)와 3, 4차 고조파 성분들이 충분히 제거할 수 있었다. 결과적으로 출력 단자에서는 오직 2 체배된 주파수 성분($2f_0$)만이 우세하게 나타난다 제안된 주파수 체배기는 1.15 GHz의 기본 주파수에서 설계되었고 TSMC 0.18 $\mu m$ 공정을 이용하여 제작되었다. 입력 신호 전력을 0 dBm 인가하였을 때, 2차 체배된 출력 주파수 성분의 측정된 전력은 2.57 dBm이었다. 2차 체배된 주파수 성분에 대해 $f_0,\;3f_0$, 그리고 $4f_0$ 성분의 제거율은 각각 43.65, 38.65, 그리고 35.59 dB이다.