• 한국전자통신학회논문지
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• 제9권6호
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• pp.703-709
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• 2014

단일 시스템에 코어별 운영체제를 사용하는 AMP(Asymmetric Multiprocessing) 기반 듀얼 코어에서 프로세서간 데이터를 전달하기 위해서 공유 메모리 기법을 사용한다. 서로 다른 운영체제에서 공유 메모리를 사용하기 위해서는 두 운영체제 사이의 메시지 통신 및 동기화 문제를 해결해 주어야 하는 문제점이 발생한다. 본 논문에서는 듀얼 코어 환경에서 서로 다른 프로세서 코어 사이에서 데이터 공유를 위해서 별도의 메모리 컨트롤러를 이용하였다. 이 컨트롤러는 두 프로세서에서 동시에 접근이 가능 하도록 두 개의 슬레이브 포트를 지정할 수 있으며, 두 프로세서에 의해서 동시에 데이터 처리를 수행할 경우 메모리 중재자에 의해서 슬레이브 포트의 우선 순위를 결정하게 된다. A에서 B 프로세서로 데이터를 전달 시, SRAM 영역을 논리적으로 8개의 페이지로 분리하였다. 여러 프로세스에서 메모리 영역을 사용 하도록 하였으며 페이지당 4KByte의 크기를 갖도록 하였으며, 현재 페이지가 사용 가능한지 아닌지를 판별하기 위해서 4바이트 크기의 컨트롤 레지스터를 이용하였다.

• 한국정보처리학회논문지
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• 제5권1호
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• pp.24-32
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• 1998

버스기반 공유메모리-다중프로세서는 공유버스의 사용으로 인한 병목 현상이 시스템의 성능을 제한하며, 특히 분리형 트랜잭션 환경 하에서 각 프로세서들로부터 생성되는 메모리 접근에 대한 요청의 일부가 불필요하게 메모리 입력 버퍼에 대기함으로써 시스템의 성능을 저하시킨다. 이와 같은 불필요한 메모리 입력버퍼에서의 대기는 각 블록에 대한 상태정보를 이용함으로써 제거될 수 있지만, 메모리의 각 블록에 대하여 상태정보가 완전 사상된 비트맵테이블을 저장하기 위한 SRAM에 대한 부담이 발생되었다. 본 연구에서는 이와 같은 문제점을 해결하기 위하여 비공유부분의 배제와 참조 국부성의 원리를 적용하여 상태정보를 저장하기 위한 SRAM의 용량을 줄이기를 제안한다. 시뮬레이션 결과에 의하면 시스템의 성능에는 거의 영향을 미치지 않으면서 상태정보의 저장 용량을 줄일 수 있어 가격-대-성능의 향상을 도모할 수 있다.

• 전자공학회논문지
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• 제50권4호
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• pp.108-116
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• 2013

최근 GPU 시스템과 같은 수백 개의 프로세서로 구성된 대규모 병렬 시스템을 이용하여 성능을 향상시키는 방법들이 많이 개발 되었다. 대표적으로 GPU에서 캐싱(Caching)과 유사한 개념으로 공유 메모리가 사용되었다. 출력 값을 얻기 위해서 이웃 값을 참조하는 이미지 필터와 같은 알고리즘들의 경우 이웃 값의 참조가 빈번하게 발생되므로 공유 메모리를 사용할 경우 성능이 향상되었다. 그러나 공유 메모리를 사용하기 위해서는 기존 코드를 재 구현해야만 하고 이는 코드의 복잡도를 증가시키는 원인이 된다. 최근 GPU 시스템에서는 공유 메모리 뿐 아니라 L1과 L2 캐시 메모리를 지원하도록 하였다. L1 캐시 메모리는 공유 메모리와 동일한 하드웨어에 위치하여 캐시의 사용이 성능향상을 도와줄 것으로 예측된다. 따라서 본 논문에서는 캐시 메모리와 공유 메모리의 성능을 비교하였다. 연구결과 성능 면에서 캐시 메모리를 사용한 알고리즘과 공유메모리를 사용한 알고리즘은 유사하였다. 특히 캐시 메모리를 사용하는 경우 공유메모리 사용 프로그래밍에서 나타나는 코드 복잡도의 증가 문제도 동시에 해결할 수 있었다.

• International Journal of Internet, Broadcasting and Communication
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• 제14권1호
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• pp.188-193
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• 2022

The energy efficiency of memory systems is an important task in designing future computer systems as memory capacity continues to increase to accommodate the growing big data. In this article, we present an energy-efficient last-level cache management policy for future mobile systems. The proposed policy makes use of low-power PCM (phase-change memory) as the main memory medium, and reduces the amount of data written to PCM, thereby saving memory energy consumptions. To do so, the policy keeps track of the modified cache lines within each cache block, and replaces the last-level cache block that incurs the smallest PCM writing upon cache replacement requests. Also, the policy considers the access bit of cache blocks along with the cache line modifications in order not to degrade the cache hit ratio. Simulation experiments using SPEC benchmarks show that the proposed policy reduces the power consumption of PCM memory by 22.7% on average without degrading performances.

• 한국산학기술학회논문지
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• 제7권2호
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• pp.126-130
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• 2006

PLC는 산업용 제어시스템에서 널리 사용되고 있으며, 중요한 역할을 하고 있다. PLC에서 사용되는 언어중 SFC는 이산 제어 프로그램에서 순차제어 논리의 기술에 적합한 그래픽 언어이며, SFC로 공정제어 시스템을 구현할 때는 분산제어 구조와 계층제어 구조로 구현하게 된다. 계층제어 구조에서는 서브시스템 간에 동기를 맞추기 위해서 서브시스템은 별도로 구성하고 동기신호만을 주고받게 된다. 그러면 메모리 효율 및 시스템 성능이 좋지 않게 된다. 본 논문에서는 계층제어 구조에서 메모리 효율을 향상시키는 방법을 제안하였고, 실례를 통해 그의 타당성을 확인하였다.

• 한국마이크로전자및패키징학회:학술대회논문집
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• 한국마이크로전자및패키징학회 2005년도 ISMP
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• pp.111-129
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• 2005

Pop provides OEMs and EMS with a platform to cost effectively expand options for logic + memory 3D integration - Expands device options by simplifying business logistics of stacking - Integration controlled at the system level to best match stacked combinations with system requirements - Eliminates margin stacking and expands technology reuse - Helps manage the huge cost impacts associated with increasing demand for multi media processing and memory. PoP is well timed to enable and leverage: - Mass customization of systems for different use (form, fit and function) requirements o Bband and apps processor + memory stack platforms - Logic transition to flip chip enables PoP size reduction o Area and height reduction. Industry standardization is progressing. Amkor provides full turn-key support for base package, memory package and full system integration.

• 대한전기학회논문지:시스템및제어부문D
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• 제51권8호
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• pp.344-351
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• 2002

The proposed immune algorithm has an uncomplicated structure and memory-cell mechanism as the optimization algorithm which imitates the principle of humoral immune response. We use the proposed algorithm to solve parameter optimization problems. Up to now, the applications of immune algorithm have been optimization problems with non-varying system parameters. Therefore the usefulness of memory-cell mechanism in immune algorithm is without. This paper proposes the immune algorithm using a memory-cell mechanism which can be the application of system with nonlinear varying parameters. To verified performance of the proposed immune algorithm, the speed control of nonlinear DC motor are performed. The results of Computer simulations represent that the proposed immune algorithm shows a fast convergence speed and a good control performances under the varying system parameters.

• 정보저장시스템학회논문집
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• 제2권4호
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• pp.214-218
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• 2006

The focus and tracking servo system has been designed and proposed for the holographic memory of one dimensional spatial light modulator(SLM). The general servo method of conventional ODD system was based and modified for new holographic memory. The pre-grooved disc pattern and special dichroic coating were also included for new design in this research and the final separated optics are expected to be applied to the future general holographic memory as well as the one dimensional SLM holographic memory.

• 조명전기설비학회논문지
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• 제24권5호
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• pp.55-61
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• 2010

PLC 제어 시스템은 SFC 언어를 사용하여 설계할 경우, SFC 언어를 사용하면 제어의 흐름을 이해하기 쉽고, 유지보수가 용이하며 프로그램의 기술성이 뛰어나다. SFC 언어는 단일 시퀀스, 선택 시퀀스, 병렬 시퀀스로 나누어지며, 선택 시퀀스로 프로그래밍 하면 단일 시퀀스로 프로그램할 때보다 메모리의 크기가 커져야 한다. 본 논문에서는 선택 시퀀스의 기능을 단일 시퀀스로 구현하여 메모리의 크기를 줄여서 메모리의 효율을 향상시키는 방법을 제시하고, 실례를 통해 타당성을 확인하였다.

• 인지과학
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• 제7권3호
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• pp.37-60
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• 1996

생물심리학적 관점에서,학습은 우리가 환경으로부터 얻은 정보를 뇌내 신경세표의 회로망으로 전이시키는 과정이라 할 수 있다. 학습과 기억의 생물할적 실체를 찾고자 하는 연구들에는,기억 또는 정보의 저장이 신경계내 시냅스수정의 방식으로 이루어진다는 가정하에,특정 유형의 학습과 관련된 신경회로를 규명하고 신경가소성의 기초를 밝히려는 노력들이 있었다.이와는 달리 신경계내 뉴련들로 연결된 복잡한 신경망의 형태들이 특정정보를 표상한다고 보고,학습과 기억에 관련된 신경구조물들의 상호작용 기초를 분석 하려는 노력들이 있었다.본 연구는,전자의 입장에서,학습과 기억에 필수적인 엔그램의 부위를 찾기 위하여 사용된느 연구방법과 주요 실험동물 모델체계들의 특성,그리고 이러한 모델체계들을 사용한 연구결과들을 개관하였다.즉,본 논고는 실험동물 모델체계를 사용하여 학습과 기억에 필수적으로 관여하는 기억흔적회로를 찾아내고,그 신경회로내에서 학습과 기억에 결정적인 신경의 가소적 변화가 일어나는 부위를 규명하며,학습과정중에 신경수준에서 일어나는 시냅스의 수정에 대한 신경생리적,생화학적 기제를 밝히고자 한 연구들을 개관하였다.