본 논문에서는 WLAN용 광대역 마이크로스트립 안테나를 설계 및 제작하였다. 광대역 특성을 얻기 위하여 기생 패치를 이용한 이중 공진 구조를 적용하였으며, 안테나의 사이즈를 줄이기 위하여 단락면을 사용하였다. 제작결과 return loss가 -10dB 이하인 대역폭으로 $4.41{\sim}6.15GHz$에 이르는 약 32.78%대의 광대역 특성을 얻을 수 있었다.
본 논문에서는 무선 근거리 지역 통신망(WLAN: Wireless Local Area Networks)용 광대역 2층 H-형 마이크로스트립 패치 안테나를 설계한다. 마이크로스트립 패치 안테나의 대역폭을 개선하기 위해서 기생패치를 부가하여 다층배열한다. 그리고 안테나의 크기를 줄이기 위해, 기본 방사소자와 기생패치는 10개의 단락봉으로 단락된 H-모양의 패치로 설계한다. 마이크로스트립 안테나는 모멘트법으로 작성된 ENSEMBLE ver 5.0의 소프트웨어를 사용하여 설계하고 실험치와 비교한다. 제작된 안테나의 대역폭은 5.46㎓에서 740㎒(13.5%)이며, 이것은 계산치 770㎒(13%)와 거의 근사하다. 또한 동일 주파수에서 동일 기판에 설계된 안테나 크기는 반파장 구형 마이크로스트립 패치 안테나에 비해 71.5%로 축소되었다.
본 논문에서는 WLAN용 끝인 개방된 원형 링 모노폴 안테나를 설계 및 제작 하였다. 제안된 안테나는 평면형 모노폴 설계를 기본으로 끝인 개방된 원형 링과 접지면으로 구성되어 있으며 이중대역 특성을 갖도록 설계하였다. 최적화된 파라메타을 얻기 위해 상용 도구(HFSS)을 사용하여 시뮬레이션 하였으며 안테나 성능에 민감하게 적용받는 파라메타를 찾아내서 최적화된 수치를 얻었다. 얻어진 최적화된 수치를 사용하여 제안된 안테나를 제작하였다. 제작된 안테나는 이중 무선랜 대역 (2.4-2.484 GHz, 5.15-5.825 GHz)에서 반사손실, 이득, 방사패턴의 특성을 측정하였다.
마이크로스트립으로 급전되는 슬롯 안테나를 소형화하기 위해 폴디드 슬롯과 T형 마이크로스트립 선로로 구성된 안테나 구조를 제안하였다. 전형적인 마이크로스트립으로 급전된 슬롯 안테나와 성능(안테나 크기, 슬롯 길이, 대역폭 등)을 비교하였으며, T형 마이크로스트립선로를 이용한 급전선로의 임피던스정합 방법에 대하여 설명하였다. 제안된 구조로 유전제기판상에 2.45GHz 대역 WLAN용 안테나를 설계 및 제작하였으며 특성 실험(반사손실, 부사패턴)을 통해 연구의 타당성을 확인하였다.
A SiGe HBT MMIC differential VCO has been developed for C-band wireless LAN applications. The VCO produces -6.4 dBm output power at 4.75 GHz. The VCO exhibits a 490 MHz tuning range with control voltage from 0.5 V to 2.5 V. The phase noise of the VCO exhibits -106.5 dBc/Hz at 1 MHz offset from the 4.75 GHz carrier. The total current consumption of the VCO is 10 mA at a supply voltage of 3 V.
본 논문에서는 저가의 FR4 칩의 전면과 후면을 이용하여 ISM대역을 만족하는 이중대역 특성의 평면 역F 칩 안테나(PIFcA)를 설계ㆍ분석하였다. 제안된 PIFcA의 크기는 21$\times$5$\times$1mm이고, 10㏈ 반사손실을 기준으로 하여 2.45㎓에 9.54%(2390~2630MHz), 5.775㎓에서 13.89%(5670~6520MHz)의 이중대역 특성을 갖는다. 안테나는 2.45㎓에서 2.2㏈i, 5.77㎓에서 5.2㏈i의 이득특성을 나타내며, 방사패턴은 일반적인 PIFA 방사패턴과 유사하다.
In this paper, a monolithic VCO has been designed for Wireless Local Area Network(WLAN) applications. The differential form VCO is constructed using positive feedback with capacitor and phase shift for low phase noise performance. The VCO shows the phase noise of -92.725 dBc/Hz at an offset frequency of 10KHz and the tunning range of 5.822~6.154GHz.
본 논문에서는 IEEE 802.113 무선 LAN 용 CODEC 회로를 설계하고, VHDL 코딩 과 FPGA에 의한 회로설계 검증에 관해 기술한다. IEEE 802.11a WLAN CODEC의 구조는 크게 데이터 보호를 위한 스크램블러/디스크램블러, 채널 에러에 대한 정보보호를 위한 Convolutional 부호기와 Viterbi 복호기로 구성된 채널 코덱, 그리고 연집에러를 랜덤 에러로 변화시키는 인터리버/디인터 리버로 구성된다. 본 논문에서는, 이와 같은 CODEC의 각 부분을 하드웨어로 구현하기 위한 새로운 회로구성을 제안하고, 그 성능을 VHDL 코딩에 의한 시뮬레이션과 FPGA에 의한 하드웨어 검증 결과를 제시한다.
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[게시일 2004년 10월 1일]
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