• KSII Transactions on Internet and Information Systems (TIIS)
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• 제6권6호
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• pp.1689-1706
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• 2012

The preservation of temporal dependencies among a group of processes that exchange continuous media at runtime is a key issue for emerging mobile distributed systems (MDS), such as monitoring of biosignals and interactive multiuser games. Although several works are oriented to satisfy temporal dependencies, most of them are not suitable for MDSs. In general, an MDS is characterized by the absence of global references (e.g. shared memory and wall clock), host mobility, limited processing and storage capabilities in mobile hosts, and limited bandwidth on wireless communication channels. This paper proposes an asymmetric synchronization protocol to be used at runtime in an MDS without using a common reference. One main aspect of our synchronization protocol is that it translates temporal constraints to causal dependencies of the continuous media data as seen by the mobile hosts. We simulate the protocol by considering a cellular network environment and by using MPEG-4 encoders. The simulation results show that our protocol is effective in reducing the synchronization error. In addition, the protocol is efficient in terms of processing and storage costs at the mobile devices, as well as in the overhead attached per message across the wired and wireless channels.

• ETRI Journal
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• 제34권2호
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• pp.175-183
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• 2012

Conventional synchronization algorithms for impulse radio require high-speed sampling and a precise local clock. Here, a phase-locked loop (PLL) scheme is introduced to acquire and track periodical impulses. The proposed impulse PLL (iPLL) is analyzed under an ideal Gaussian noise channel and multipath environment. The timing synchronization can be recovered directly from the locked frequency and phase. To make full use of the high harmonics of the received impulses efficiently in synchronization, the switching phase detector is applied in iPLL. It is capable of obtaining higher loop gain without a rise in timing errors. In different environments, simulations verify our analysis and show about one-tenth of the root mean square errors of conventional impulse synchronizations. The developed iPLL prototype applied in a high-speed ultra-wideband transceiver shows its feasibility, low complexity, and high precision.

• 한국정보과학회:학술대회논문집
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• 한국정보과학회 2010년도 한국컴퓨터종합학술대회논문집 Vol.37 No.1(A)
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• pp.228-229
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• 2010

• ETRI Journal
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• 제34권1호
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• pp.122-125
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• 2012

A video signal through a high-density optical link has been demonstrated to show the reliability of optical link for high-data-rate transmission. To reduce optical point-to-point links, an electrical link has been utilized for control and clock signaling. The latency and flicker with background noise occurred during the transferring of data across the optical link due to electrical-to-optical with optical-to-electrical conversions. The proposed synchronization technology combined with a flicker and denoising algorithm has given good results and can be applied in high-definition serial data interface (HD-SDI), ultra-HD-SDI, and HD multimedia interface transmission system applications.

• 한국항해항만학회:학술대회논문집
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• 한국항해항만학회 2006년도 International Symposium on GPS/GNSS Vol.1
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• pp.367-370
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• 2006

A GPS-based time synchronization technique employing a refined HW circuitry and SW algorithm is considered as fine time-management system for Low Earth Orbit (LEO) remote sensing satellites. By synchronizing the On-Board Time (OBT) within satellites to the GPS 1PPS, a very expensive, highly accurate on-board clock is not required to determine the precise on-board time management. Also, the satellite command generation in ground stations and postprocessing of earth observation data which a particular image is acquired. This paper analyses on-orbit verification of the existing satellite time sync architecture and presents a new time sync architecture, operation and relation between the OBT and the GPS time.

• 한국전자통신학회논문지
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• 제7권6호
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• pp.1301-1308
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• 2012

본 논문에서는 ADCL(adiabatic dynamic CMOS logic) buffer를 이용한 단열 논리회로용 AC 전원과 동기화된 저전력 클럭 발생기를 제안한다. CMOS 논리회로의 전력 손실을 줄이고 ADCL의 저전력 동작을 위해서, 논리회로의 clock 신호는 AC 전원 신호와 동기화 되어야 한다. 설계된 Schmitt trigger 회로와 ADCL buffer를 사용한 ADCL 주파수 분주기를 이용하여 AC 신호와 단열동작을 위한 clock 신호가 발생된다. 제안된 저전력 클럭 발생기의 소비전력은 3kHz와 10MHz에서 각각 1.181uW와 37.42uW으로 시뮬레이션에서 확인하였다.

• 한국정보통신학회논문지
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• 제16권6호
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• pp.1242-1249
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• 2012

본 논문에서는 미래의 온칩통신 구조로 각광받고 있는 NoC의 GALS 클럭 구조에서 불안정 상태를 제거하기 위한 위상차 동기방법과 위상차 동기회로를 제안한다. 제안된 방법은 송신부의 클럭을 입력 스트로브 신호로 사용하고, 송수신부 클럭의 위상차가 불안정 상태 영역에 존재하더라도 샘플링 결과 값에 따라 클럭의 상승 모서리 또는 하강 모서리 중의 하나를 선택하여 불안정 상태를 피할 수 있다. 고장을 삽입한 로직 시물레이션을 통하여 $0^{\circ}{\sim}360^{\circ}$ 위상차에서 불안정 상태에 관계없이 위상차 클럭 동기회로가 잘 동작함을 확인하였다. 그리고 제안된 위상차 클럭 동기회로는 위상 검출기가 필요하지 않아 제어가 간단하며, 모든 회로가 디지털 회로로 구성되어 NoC의 클럭 동기회로에 적합하다.

• 한국통신학회논문지
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• 제25권1A호
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• pp.27-33
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• 2000

Gardner 알고리즘 PAM 통신 방식에서 대표적인 NDD (Non-Decision Directed) 심볼동기방식으로 사용되고 있으나, Multi-level PAM의 경우 패턴 노이즈가 증가하는 단점이 있으며 이를 보상하기 위해서는 진처리 필터를 이용하여 타이밍 지터를 감소시킬수 있다는 것이 알려져 왔다. 본 논문에서는 완전 디지털 256-QAM 복조기의 심볼 동기회로에서 채널의 rolloff 값이 낮은 값으로 대역 제한된 경우, 타이밍 지터의 양을 줄이고 PLL의 locking을 개선시키기 위해 전처리 필터를 사용한 NDD 알고리즘의 통계적 특성을 분석하고 이를 컴퓨터 시뮬레이션으로 검증하고 전처리 필터의 최적 파라미터 값을 도출한다.

• 한국통신학회논문지
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• 제27권10C호
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• pp.951-962
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• 2002

DMT 방식의 송·수신기는 파일롯 채널의 페이즈 정보를 이용하여 샘플동기를 맞추게 된다. 파일롯 채널의 페이즈 값은 심볼 단위로 행해지는 FFT 결과에서 구할 수 있으므로, 심볼동기를 샘플동기 이전에 맞추어 주어야 한다. DMT VDSL시스템의 경우, 심볼 내의 반복되는 구간사이의 상관성을 통해서 심볼동기를 구할 수 있게 된다. 수신신호의 부호를 기본으로한 최우도 추정함수를 사용하여 심볼동기를 구하는 기법에 대해 제안하였으며, Tx 윈도우에 의해, 심볼동기의 추정값이 잡음에 민감해지는 것을 막기위해 가중합을 적용한 추정 방법을 제안하였다. 송·수신기 사이에 샘플링 클럭 옵셋이 존재할 경우, 샘플동기를 위해 디지털 영역에서 샘플링 클럭 옵셋을 보정해주는 기법을 제안하였다.

• 한국통신학회논문지
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• 제22권9호
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• pp.2062-2073
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• 1997

동기식 전송망과 장치를 설계할 때 고려해야 할 중요사항은 최대 노드수와 노드의 클럭특성이다. 이를 위해서는 클럭상태가 정상상태일 때 뿐 아니라 단기위상순서변위, 그리고 장기위상변위 등에 관한 클럭특성 연구가 필요하다. 따라서 본 논문에서는 국내 동기클럭 분배망의 구성을 바탕으로 최근 확정된 ITU-T 및 ANSI의 클럭규격을 적용하여 동기식 선형망에서 정상상태와 위상변위상태일 때의 망구성에 따른 MTIE 및 TDEV 특성을 살펴보았고, ITU-T와 ANSI규격을 동시에 만족하는 최대 노드수를 제시하였다. 또한 본 논문에서 얻은 결과를 AT&T의 것과 비교 분석하였다.