*In this paper, we propose a real-time face tracking system using an adaptive face detector and a tracking algorithm. An image is divided into the regions of background and face candidate by a real-time updated skin color identifying system in order to accurately detect facial features. The facial characteristics are extracted using the five types of simple Haar-like features. The extracted features are reinterpreted by Principal Component Analysis (PCA), and the interpreted principal components are processed by Support Vector Machine (SVM) that classifies into facial and non-facial areas. The movement of the face is traced by Kalman filter and Mean shift, which use the static information of the detected faces and the differences between previous and current frames. The proposed system identifies the initial skin color and updates it through a real-time color detecting system. A similar background color can be removed by updating the skin color. Also, the performance increases up to 20% when the background color is reduced in comparison to extracting features from the entire region. The increased detection rate and speed are acquired by the usage of Kalman filter and Mean shift.
광대역 무선 디지털 통신 시스템용 파이프라인 적응 결정귀환 등화기(pipelined adaptive decision-feedback equalizer; PADFE)를 0,25-${\mu}m$ CMOS 공정을 사용하여 full custom 단일 칩으로 설계하였다. ADFE의 동작속도를 향상시키기 위해 DLMS(delayed least-mean-square)을 적용한 2-stage 파이프라인 구조로 설계하였다. PADFE의 필터와 계수갱신 블록 등 모든 연산을 redundant binary(RB) 수치계로 처리하였으며, 2의 보수 수치계를 사용하는 기존의 방식에 비해 연산량의 감소와 동작속도의 향상이 얻어졌으며, 또한 전체적인 구조의 단순화에 의해 VLSI 구현이 용이하다는 장점을 갖는다. COSSAP을 이용한 알고리듬 레벨 시뮬레이션을 통해 파이프라인 stage 수, 필터 tap 수, 계수 및 내부 비트 수 등의 설계 파라메터 결정과 bit error rate(BER), 수렴속도 등을 분석하였다. 설계된 PADFE는 약 205,000개의 트랜지스터로 구성되며, 코어의 면적은 41.96\times1.35-mm^2$이다. 시뮬레이션 결과, 2.5-V 전원전압에서 200-MHz의 클록 주파수로 동작 가능할 것으로 예상되며, 평균 전력소모는 약 890-mW로 예측되었다. 제작된 칩의 테스트 결과로부터 기능이 정상적으로 동작함을 확인하였다.
이 논문에서는 적응 배열 안테나를 갖는 MC-CDMA를 위한 적응 빔 형성 알고리듬을 제안한다. 다중경로 페이딩에 robust하고 간단히 단일 탭 등화기를 사용하여 고속 데이터 전송에 적합한 것으로 알려진 MC-CDMA 시스템의 수신단에 안테나 배열을 사용함으로서 그 성능을 크게 개선할 수 있음을 보인다. 본 논문에서 제안된 MC-CDMA 시스템의 적응 빔 형성 알고리듬은 원하는 사용자의 파이롯 심벌(기준신호)과 수신된 파이롯 신호의 오차를 주파수 영역에서 계산하고, 그 주파수 영역 오차신호를 시간영역 오차 신호로 변환한 후, MSE가 최소가 되는 방향으로 적응 빔 형성기의 계수를 갱신하므로서 유도된다. 모의 실험과 해석적 방법을 통하여 MC-CDMA 시스템에 제안된 적응 빔 형성기법을 적용할 경우 수렴특성과 성능개선 효과를 확인한다.
A standard repetitive controller (RC) is theoretically able to replace a bank of resonant controllers in harmonic signals tracking applications. However, the traditional RC has some drawbacks such as a poor dynamic response and a complex structure to compensate grid frequency deviations for an effective unified power quality conditioner (UPQC) control scheme. In order to solve these problems, an improved RC with an outstanding dynamic response and a simplified grid frequency adaptive scheme is proposed for UPQC control systems in this paper. The control strategy developed for the UPQC has delay time, i.e., one-sixth of a fundamental period (Tp/6), repetitive controllers. As a result, the UPQC system can provide a fast dynamic response along with good compensation performance under both nonlinear and unbalanced loads. Furthermore, to guarantee the excellent performance of the UPQC under grid frequency deviations, a grid frequency adaptive scheme was developed for the RC using a simple first order Padé's approximation. When compared with other approaches, the proposed control method is simpler in structure and requires little computing time. Moreover, the entire control strategy can be easily implemented with a low-cost DSP. The effectiveness of the proposed control method is verified through various experimental tests.
We extend the sue of the method of least square to develop a recursive algorithm for the design of adaptive transversal filters such that, given the least-square estimate of this vector of the filter at iteration n-1, we may compute the updated estimate of this vector at iteration a upon the arrival of new data. We begin the development of the RLS algorithm by reviewing some basic relations that pertain to the method of least squares. Then, by exploiting a relation in matrix algebra known as the matrix inversion lemma, we develop the RLS algorithm. An important feature of the RLS algorithm is that it utilizes information contained in the input data, extending back to the instant of time when the algorithm is initiated. In this paper, we propose new tap weight updated RLS algorithm in adaptive transversal filter with data-recycling buffer structure. We prove that convergence speed of learning curve of RLS algorithm with data-recycling buffer is faster than it of exiting RL algorithm to mean square error versus iteration number. Also the resulting rate of convergence is typically an order of magnitude faster than the simple LMS algorithm. We show that the number of desired sample is portion to increase to converge the specified value from the three dimension simulation result of mean square error according to the degree of channel amplitude distortion and data-recycle buffer number. This improvement of convergence character in performance, is achieved at the (B+1)times of convergence speed of mean square error increase in data recycle buffer number with new proposed RLS algorithm.
제한된 계조를 사용하는 영상장치들은 연속계조 영상과 시각적으로 유사한 영상을 획득하기 위해 하프토닝(halftoning) 방법을 사용한다. 다양한 하프토닝 방법 중, 오차 확산법은 짧은 계산시간과 좋은 화질의 하프톤 영상(halftone image) 획득이 가능하여 다양한 응용 분야에 널리 사용되고 있다. 하지만 이 방법은 인접 픽셀에 오차를 확산하는 과정에서 경계선을 흩트리며, 이로 인해 경계선이 약화 되고, 영상의 선명도를 저하시킨다. 이러한 문제점을 개선하기 위해 본 논문에서 제안된 방법은 Floyd-Steinberg 오차확산법의 필터 가중치를 기반으로 처리 픽셀의 오차와 인접픽셀의 경계선 정보를 고려하여 오차 필터를 적응적으로 결정한다. 이 방법은 경계선 강화를 위한 기존 방법들과 비교해 처리절차가 간단하여 상대적으로 적은 양의 프로세스 자원을 사용한다. 그럼에도 불구하고, 제안된 방법은 하프톤 영상의 경계선을 상당히 개선할 수 있었다. 이와 함께 객관적인 화질 평가를 위해 경계 상관도와 국부 평균 일치도를 이용하여 제안된 방법과 기존방법의 성능을 비교한다.
블록기반의 하이브리드 부호화기는 비디오 신호의 압축방식으로 가장 널리 쓰이는 구조이지만 무선환경과 같은 저 비트율의 응용에 대해서는 양자화에 의한 고주파 성분의 손실로 인해 블록킹 현상이 두드러져 화질열화의 주된 원인으로 지적되고 있다. 블록킹 현상은 블록 경계에서 원영상에 없던 고주파 성분이 나타나는 현상이므로 경계주위에 저역통과 필터를 적용하면 제거할 수 있다. 그러나, 단순히 저역통과 필터를 적용하면 원영상에 존재하는 에지와 같은 고주파 성분도 제거되어 또 다른 화질열화 및 번짐 현상을 야기하게 된다. 본 논문에서는 이러한 현상에 대해 경계주변의 픽셀영역의 특성을 고려하여 모드를 정하고 각 모드에 따라 다른 필터를 적용하는 적응적 디블록킹 필터링 방법을 제안한다. 실험결과 기존의 MPEG-4에서 제시한 방법에 비해 객관적, 주관적 화질이 향상됨을 확인할 수 있다.
In this paper, we have proposed a new method to extract the fetal ECG from a pregnant woman's abdominal signal using least square acceleration (LSA) filter and adaptive impulse correlation (AIC) filter. To evaluate the performance, the proposed method and other fetal ECG extraction techniques were processed using the real ECG data and then the results were compared. According to comparative results, the proposed method is powerful and successful for extracting the fetal ECG. It was able to separate perfectly even though the fetal beats overlap with the QRS wave of the maternal beats and to extract fetal ECG using any single-channel abdominal signal measured from pregnant woman's abdominal surface. Also, it could be implemented easily by fast computation time and simple structure. It is sure that our method could be useful for portable fetal monitoring system.
A new method for estimating and eliminating electrocardiogram (ECG) artifacts from single channel scalp electroencephalogram (EEG) is proposed. The proposed method consists of emphasis of QRS complex from EEG using least squares acceleration (LSA) filter, generation of synchronized pulse with R-peak and ECG artifacts estimation and elimination using adaptive filter. The performance of the proposed method was evaluated using simulated and real EEG recordings, we found that the ECG artifacts were successfully estimated and eliminated in comparison with the conventional multi-channel techniques, which are independent component analysis (ICA) and ensemble average (EA) method. In conclusion, we can conclude that the proposed method is useful for the detecting and eliminating the ECG artifacts from single channel EEG and simple to use for ambulatory/portable EEG monitoring system.
광대역 무선 디지털 통신 시스템용 파이프라인 적응 결정귀환 등화기 (pipelined adaptive decision- feedback equalizer; PADFE)를 0.25-$\mu\textrm{m}$ CMOS 공정을 사용하여 full custom 단일 칩으로 설계하였다. ADFE의 동작속도를 향상시키기 위해 DLMS (delayed least-mean-square)을 적용한 2-stage 파이프라인 구조로 설계하였다. PADFE의 필터와 계수갱신 블록 등 모든 연산을 redundant binary (RB) 수치계로 처리하였으며, 2의 보수 수치계를 사용하는 기존의 방식에 비해 연산량의 감소와 동작속도의 향상이 얻어졌으며, 또한 전체적인 구조의 단순화에 의해 VLSI 구현이 용이하다는 장점을 갖는다. COSSAP을 이용한 알고리듬 레벨 시뮬레이션을 통해 파이프라인 stage 수, 필터 tap 수, 계수 및 내부 비트 수 등의 설계 파라메터 결정과 bit error rate (BER), 수렴속도 등을 분석하였다. 설계된 PADFE는 약 205,000개의 트랜지스터로 구성되며, 코어의 면적은 1.96$\times$1.35-mm$^{2}$이다. 시뮬레이션 결과, 2.5-V 전원전압에서 200-MHz의 클록 주파수로 안전하게 동작할 수 있을 것으로 예상되며, 평균 전력소모는 약 890-mW이다.
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[게시일 2004년 10월 1일]
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