RF(radio frequency) 시스템의 송신탄을 설계할 때 고려해야 할 중요한 요소 중의 하나인 EMI(Electro magnetic interference)의 규격시험에서 항상 문제시되는 것이 송신기의 출력 스펙트럼에서 나타나는 불요 신호(Spurious interference) 이다. 이 불요 성분들 중 특히 문제가 되고 있는 것이 국부발진기(LO; Local oscillator)로부터 누설되는 LOL(Local oscillator leakage) 성분이다. 이 LOL성분은 국부발진기에서 누설(leakage)되어 RF단의 증폭기를 통하여 증폭되어 최종 출력에서 매우 높은 선호의 크기로 나타난다. 일반적으로 LOL을 제거하기 위해 서 너치필터(Notch filter) 또는 대역통과필터 (Band pass filter)를 사용해왔다. 본 논문에서는 국부발진기로부터 누설되는 불요 성분, 즉 LOL성분을 제거하는 방법으로 LOL과 동일한 크기를 가지고 위상 차이가 $180^{\circ}$인 신호를 국부발전기의 출력에서 만들어 믹서( Mixer)의 출력단에 더함으로써 LOL성분을 효과적으로 제거한다. 본 방 식을 무선랜(WLAN; Wireless 1$\infty$al area network) 시스템에 적용한 결과. 기존의 방식보다 30 dB 이상 LO 누설선호플 감쇄시킬 수 있었다 또한 본 방식은 RF 시스댐을 소형화 및 MMIC(Monolithic microwave integrated C circuit)화 할 경우 종전의 방법보다 효과적일 것으로 기대된다.
본 논문에서는 이동위성통신용 광대역 수신단을 저잡음증폭기와 고이득증폭단으로 나누어서 구현 및 성능 평가를 하였다. 저잡음증폭기의 설계ㆍ제작에는 저잡음 GaAs FET인 ATF-10136파 내부정합된 MMIC인 VNA-25를 이용하였으며, 저잡음증폭기의 입력단 정합회로는 저항 결합회로, 전원회로는 자기 바이어스 회로를 사용하였다. INA-03184를 이용한 고이득증폭단은 양단 정합된 단일 증폭기 형태로 제작하였으며, 바이어스 안정화 저항을 사용하여 회로의 전압강하 및 전력손실을 가능한 줄이고 온도 안정성을 고려하여 능동 바이어스 회로를 사용하였으며, 스퓨리어스를 감쇠시키기 위해서 저잡음증폭기와 고이득증폭단 사이에 감쇠 특성이 우수한 대역통과 필터를 사용하였다. 측정 결과, 사용 주파수 대역내에서 55dB 이상의 이득, 50.83dBc의 스퓨리어스 특성 및 1.8. 1 이하의 입ㆍ출력 정재파비를 나타내었으며, 특히 1537.5 MHz에서 1 KHz 떨어진 점에서의 C/N비가 43.15 dB/Hz를 나타냄으로써 설계시 목표로 했던 사양을 모두 만족시켰다.
본 연구에서는 다중오동작을 포함하고 있는 화재안전정지분석 교육자료를 개발하기 위하여 가상원전에서의 화재안전정지분석을 결정론적 화재분석코드를 사용하여 수행하였다. 교육용 가상원전은 원자로건물과 보조건물로 이루어졌고, 총 22개의 방화지역으로 구성되었다. 교육용 가상원전의 각 방화지역에는 밸브, 펌프, 비상디젤발전기, 스위치기어, 모터제어반, 로직컨트롤러 등의 기기가 배치되었다. 교육용 가상원전 기기들은 두 개의 케이블로 연결되었으며, 각 케이블은 케이블 트레이를 따라서 방화지역을 지나간다고 가정했다. 방화지역분석을 위해 교육용 가상원전에 대한 기기 및 케이블 정보를 데이터베이스화하였고, 다중오동작 시나리오, 기기로직 및 케이블로직을 가정하여 방화지역분석을 수행하였다. 방화지역 분석결과 문제가 되는 케이블과 케이블 트레이에 대해서 3시간 내화성능으로 케이블을 래핑하는 완화조치를 적용하였다.
본 논문은 무선 센서분야를 위한 1MS/s rate의 저 전력 12-bit 2단계 저항 열 DAC를 제시하고 있다. 2단계 저항 열 구조를 채택함으로써 복잡함을 줄이고, 소비 전력을 최소화 하고 변환속도를 증가 시킬 수 있었다. 이 칩은 $0.18{\mu}m$ CMOS 공정에서 제작 되었으며, Die 면적은 $0.76{\mu}m{\times}0.56{\mu}m$ 이다. 1.8V의 공급 전압으로부터 측정된 전력 소비는 1.8 mW 이다. 샘플링 주파수가 1MHz 이하에서 측정된 동적 동작범위(Spurious-Free Dynamic Range: SFDR)은 70dB 이다.
본 논문에서는 광대역 코드분할 다원 접속 방식을 이용하여 무선 가입자 접속 망(WLL: Wireless Local Iρop)서비스를 위한 기지국용 RF 송수신기를 고찰하였다 제작된 송수신기는 크게 수신기, 송신기 및 RF 컨트 롤러띄 세 보드로 구성하였고,5 MHz의 RF 채널 대역폭을 이용하여 넓은 동작 범위와 고감도가 요구되는 RF 수신기 및 우수한 스퓨리어스 방사 억제 특성을 가지는 송선기의 설계 및 구현에 관하여 기술하였다. 전체 송수 선부플 상용화된 부품이나 주문 제작된 소자의 규격을 토대로 RF 시뮬레이션 소프트웨어를 이용하여 위에 언급된 수신기 및 송신기의 예상 성능을 평가하였고, 이를 토대로 송수신기를 제작하였다. 측정 결과 수신기는 2.86 d dB의 잡음 지수 및 60 dB이상의 동작 영역을 가졌고, 송선기의 스퓨리어스 방사는 34.3 dBm의 출력 전력에서 -49.46 dBc의 특성을 얻어 표준 안에 제시된 성능 규격을 만족하는 좋은 결과를 얻었다.
진폭 변조를 이용한 거리 측정 시스템은 반송파를 진폭 변조하여 송수신한 신호의 진폭 변조 신호의 위상차를 사용하여 거리를 측정하게 된다. 진폭 변조 거리 측정 시스템에서 문제가 되는 안테나 간의 누설 신호 및 불요 신호에 의한 측정 오차를 최소화하기 위해 능동반사기를 사용하여 주파수 대역을 바꾸어 송신하는 방식이 제안되었다. 본 논문에서는 모호성이 없는 측정 거리를 확장하면서도 정밀한 측정을 가능하게 하는 새로운 위상측정부의 구현에 대해 설명하고 있다. 즉, 8 MHz 및 1 MHz의 두 개의 변조 주파수를 교차적으로 선택하여 변조함으로써, 150 m까지의 거리를 2 cm 이하의 오차로서 측정할 수 있게 하였다. 위상측정부는 정밀한 위상 측정을 위하여 높은 변조 주파수는 JK 플립플롭 위상차 측정기를 사용하고, 낮은 변조 주파수일 경우는 XOR 위상차 측정기를 사용하였다.
본 연구에서는 자동차용 강압 DC-DC 컨버터 모듈 설계 방법 중 변조 스위칭 잡음과 전자파 방사의 감소방법에 대한 시뮬레이션 연구가 수행되었다. PMIC(Power Management Integrated Circuit) 칩을 이용한 4층 PCB 기본 회로가 제시되었고, 컨버터 모듈의 두 입력단자(+, -) 및 입력 필터와 PMIC 사이에서의 전자파 잡음과 전자기 방사 특성에 대한 시뮬레이션이 1.0~5.0MHz 대역과 100MHz 대역에서 수행되었다. 전도성 방사 특성은 3.0MHz와 104MHz에 대한 결과를 제시하였고, 입력포트로 되돌아오는 전도성 방사를 줄이기 위해 컨버터 출력 단자를 PCB의 3층 혹은 4층에 입력단의 전류 흐름과 반대되는 방향으로 배치하여 평균 10dB 이상의 개선효과가 나타났다. 본 연구 결과는 지금까지 제시된 불요 전자파 감소 방법에 비해 개선효과가 높아 향후 컨버터 모듈 설계에 유용하게 활용될 것으로 기대된다.
본 논문에서는 진행파형 전계흡수 변조기 (TW-EAM: traveling-wave electroabsorption modulator)의 선형성을 분석하기 위한 새로운 모델을 제시한다. TW-EAM은 소자의 길이, 마이크로파 손실 (microwave loss, ML), 그리고 임피던스 부정합에 의한 내부반사(internal reflection, IR) 등이 소자의 선형성에 영향을 미친다. 소자의 길이의 증가는 혼변조 왜곡 (intermodulation distortion, IMD)이 최소가 되는 전원전압의 크기를 감소시킨다. ML의 증가는 3차 혼변조 왜곡 (third-order IMD, IMD3)의 감소와 동시에 출력신호의 전력도 감소시킨다. IR은 입력주파수의 파장과 소자의 길이에 따라 각기 다른 IMD 특성을 나타낸다. ML 또는 IR에 의한 SFDR (spurious-free dynamic-range)의 변화는 거의 없었으며, TW-EAM의 IR을 이용하면 ML에 의한 신호 전력의 감쇄를 보상해 줄 수 있음도 알 수 있었다. 결과적으로 50 GHz 대역의 RF-광통신용 TW-EAM은 길이가 0.8 mm이고 출력단의 임피던스 부정합을 이용하면서 최소의 손실을 가지는 구조가 적당함을 알 수 있었다.
Studies were conducted to determine the efficiency of decondensation protocols. Sperm obtained from seven normal donors was immediately washed after liquefaction and then decondensed using the method of West et al. (1989) and my original protocol. My optimized protocol entailed mixing 1 ml aliquots of semen with 4 ml phosphate buffered saline (PBS). Following centrifugation, pellets were resuspended in 1 ml PBS containing 6 mM EDTA. After centrifugation, pellets were resuspended in 1 ml PBS containing 2 mM dithiothreitol at $37^{\circ}C$ for 45 min. Following mixing with 2 ml PBS and centrifugation, pellets were resuspended by vortexing. While vortexing, 5 ml of fixative were gently added. Slide preparation was accomplished using the smear method and it was stored at $4^{\circ}C$. When comparing these protocols, the degree of sperm decondensation and head swelling was monitored by measuring nuclear length, area, perimeter, and degree of roundness using FISH analysis software. Apparent copy number for chromosome 1 and, separately, for the sex chromosomes was determined by FISH using satellite DNA probes for loci DIZ1, DXZ1 and DYZ3. Sperm treated by my decondensation protocol showed significant increases (p<0.05) in length, area, perimeter, and degree of roundness. There was a significant decrease (p<0.05) in the frequency of nuclei displaying no signal but no change in the frequency of nuclei with two signals in samples decondensed by my protocol. My data suggested that decondensation using my original protocol may lower the frequency of cells with spurious "nullisomy" due to hybridization failure without inducing spurious "disomy" resulting from increased distances between split signals.
본 논문에서는 polymerase chain reaction (PCR) 응용에 적합한 저잡음 CMOS 이미지 센서에 사용되는 컬럼-패러럴 analog-to-digital converter (ADC) 어레이를 위한 cascaded-of-integrator feedforward (CIFF) 구조의 단일 비트 2차 델타-시그마 모듈레이터를 제안하였다. 제안된 모듈레이터는 CMOS 이미지 센서에 입사된 빛의 신호에 해당하는 픽셀 출력 전압을 디지털 신호로 변환시키는 컬럼-패러럴 ADC 어레이를 위해 하나의 픽셀 폭과 동일한 10㎛ 컬럼 폭 내에 2개의 스위치드 커패시터 적분기와 단일 비트 비교기로 구현하였다. 또한, 모든 컬럼의 모듈레이터를 동시에 구동하기 위한 주변 회로인 비중첩 클록 발생기 및 바이어스 회로를 구성하였다. 제안된 델타-시그마 모듈레이터는 110nm CMOS 공정으로 구현하였으며 12kHz 대역폭에 대해 418의 oversampling ratio (OSR)로 88.1dB의 signal-to-noise-and-distortion ratio (SNDR), 88.6dB의 spurious-free dynamic range (SFDR) 및 14.3비트의 effective-number-of-bits (ENOB)을 달성하였다. 델타 시그마 모듈레이터의 면적 및 전력 소비는 각각 970×10 ㎛2 및 248㎼이다.
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[게시일 2004년 10월 1일]
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