This paper has presented the design and fabrication of phase correlator for wideband digital frequency discriminator (DFD) operating over the 6.0 to 18.0 GHz frequency range. Fabricated DFD phase correlator has been measured I or Q output signal, and analyzed frequency discrimination error. The operation of the proposed mixer type correlator has been analyzed by deriving some analytic equations. To design the phase correlator, this paper has modeled and simulated IQ mixer and 8-way power divider by using RF simulation tool. Designed phase correlator has fabricated and measured. The phase error and frequency discrimination error have been presented using by measured I and Q output signal. Over the 6.0~18.0 GHz range, the root mean square(RMS) phase error is $4.81^{\circ}$, RMS and frequency discrimination error is 1.49 MHz, RMS.
Journal of the Institute of Electronics Engineers of Korea TC
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v.41
no.6
s.324
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pp.1-7
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2004
The development of direct receiver techniques is expected to be a solution for future wideband or multi-band wireless systems based on software defined radio. In this Paper, we study the regeneration of I and Q signals for the SDR based direct conversion receiver, so that we can handle a wide bandwidth and maintain maximal flexibility in system utilization. After modeling the basic system considering the real wireless communication environment, and studying the impact of imperfect phase imbalance on the performance of a direct conversion receiver, we propose a suboptimal I and Q signal regeneration algorithm for the system. The proposed algerian regenerates I and Q signals using a real time early-late compensator which effectively estimates phase imbalances and gives feedback in a directreceiver. The proposed algorithm is shown to mitigate the impact of AWGN and improves performance especially at low SNR channel condition. According to the computer simulation, the BER performance of the proposed system is at least about 4 dB better than conventional systems under $45{\~}55$ degrees random phase errors.
The Journal of Korean Institute of Electromagnetic Engineering and Science
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v.14
no.10
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pp.1104-1111
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2003
The paper presents an algorithm for the compensation of gain and phase imbalances to exist between I-phase and Q-phase signal at direct conversion receiver. We propose a gain and phase imbalances blind equalization compensation algorithm by using variable step-size adaptive loop at direct conversion receiver. The blind equalization schemes have trade-off between convergence speed and jitter effect for the compensation of gain and phase imbalance. We propose the variable step-size adaptive loop method, which varies the loop coefficients according to errors, for recovering these problem. By using variable step-size adaptive loops, we propose to speed up the convergence process and reduce the jitter effect and simulation results show that the algorithm compensates signal loss and speeds up convergence time.
In a wireless communication RF transmitter, the output of a quadrature modulator (QM) is distorted by not only the linear imperfection features such as in/quadrature-phase (I/Q) input gain imbalance, local phase imbalance, and local gain imbalance but also the nonlinear imperfection features such as direct current (DC) offset and mixer nonlinearity related to in-band spurious signal. In this paper, we propose the unified QM model to analyze the combined effects of the linear and nonlinear imperfection features on the performance of the QM. The unified QM model consists of two identical nonlinear systems and modified I/Q inputs based on the two-port nonlinear mixer model. The unified QM model shows that the output signals can be expressed by mixer circuit parameters such as intercept point and gain as well as the imperfection features. The proposed approach is validated by not only simulation but also measurement.
본 논문에서는 고속데이터 전송을 위한 CDMA 모뎀를 구현하였다. 데이터율 1Mbps의 트래픽 5채널에 직교부호를 곱하여 채널을 구분한 후 하나의 채널로 처리하였다. I,Q로 입력된 신호는 복소 곱셈기에서 칩 레이트 8Mcps로 OCQPSK(또는 HPSK) 변조하였다. 복조기는 I,Q의 신호를 역확산한 후 직교부호를 다시 곱하여 각 채널의 데이터를 분리한다. 변복조기의 구현은 클럭 속도 167MHz의 부동 소수점형 프로세서인 TI사의 TMS320C6701 DSP(Digital Signal Processor)를 사용하었고, long code 및 I,Q 채널 PN 코드는 IMT-2000 동기방식과 비동기방식의 규격에 정의된 2가지의 PN코드 발생기를 모두 구현하였다.
Kim, Joong-Pyo;Ryu, Sang-Burm;Lim, Won-Gyu;Lee, Sang-Kon
Journal of Satellite, Information and Communications
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v.8
no.2
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pp.88-93
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2013
The wideband chirp signal generator to enhance the resolution of synthetic aperture radar of obtaining the earth observation image is needed. This paper deals with designing, manufacturing and testing the wideband digital chirp signal generator having high resolution for LEO earth observation satellite. The wideband digital chirp signal generator is implemented with the memory-map based structure which is mostly applied in the satellite, and consists of the digital module to generate the digital chirp signal and the RF module to perform the quadrature modulation. The I/Q signals stored in the memory of the digital module are D/A converted and delivered to be quadrature modulated with the reference signal of 1275 MHz in the RF module. Furthermore, the test bench and GUI to validate the signal generator function are also developed. It is found that the requirement of 144 MHz bandwidth for the digital chirp signal generator is well met. Finally it is noteworthy that the distortion occurred in the chirp signal generator was compensated by the pre-distortion compensation.
Kim, Jinho;Park, Geon;Seok, Jul-Ki;Lee, Byongjun;Kang, Yong Cheol
Journal of Electrical Engineering and Technology
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v.10
no.2
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pp.504-510
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2015
Because wind generators (WGs) in a wind power plant (WPP) produce different active powers due to wake effects, the reactive power capability of each WG is different. This paper proposes a hierarchical voltage control scheme for a WPP that uses a WPP controller and WG controller. In the proposed scheme, the WPP controller determines a voltage error signal by using a PI controller and sends it to a doubly-fed induction generator (DFIG). Based on the reactive current-voltage ($I_Q-V$) characteristic of a DFIG, the DFIG injects an appropriate reactive power corresponding to the voltage error signal. To enhance the voltage recovery capability, the gains of the $I_Q-V$ characteristic of a DFIG are modified depending on its reactive current capability so that a DFIG with greater reactive current capability may inject more reactive power. The proposed scheme enables the WPP to recover the voltage at the point of common coupling (PCC) to the nominal value within a short time after a disturbance by using the adaptive $I_Q-V$ characteristics of a DFIG. The performance of the proposed scheme was investigated for a 100 MW WPP consisting of 20 units of 5 MW DFIGs for small and larger disturbances. The results show the proposed scheme successfully recovers the PCC voltage within a short time after a disturbance.
The Journal of Korean Institute of Electromagnetic Engineering and Science
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v.18
no.1
s.116
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pp.15-23
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2007
A simple six-port direct conversion QPSK receiver which is made up of a six-port phase correlator, a signal power detector, and I/Q channel signal de-modulator is designed and implemented in this paper. The output phase signals of six-port phase correlator are also analysed. On the basis of $90^{\circ}C$ phase relation among the six-port phase correlator output signals, the QPSK de-modulation circuit is designed by a simple circuit. The six-port phase correlator is made up of $90^{\circ}$ hybrid branch line and power detector. The six-port phase correlator, which is designed in frequency range of 11.7 to 12.0 GHz, gets the phase error characteristics less than $5^{\circ}$. By considering matching network and amplitude balance in the designed fiequency range, the designed six-port direct conversion QPSK receiver demodulates the I and Q signals with performance less than $5^{\circ}$ phase error.
This paper describes the effect of multiple signal regeneration in quadrature digital radio frequency memory(DRFM). Single channel DRFM have good reproducibility after storing a single signal. However, when reproduced after storing multiple signals, the spurious signal is large. The quadrature DRFM consists of I and Q channels, which can greatly reduce the spurious signal. The amplitude of the spurious signal depends on the number of bits of data stored in the DRFM. In this paper, we have obtained the number of bits of signal regeneration according to the application of radio frequency memory by obtaining the size of the spurious signal according to the number of bits of the stored data of the DRFM for multiple signals. As a result of this study, 4 bits quadrature DRFM can achieve a spurious output of less than -20dB, which is used for 4 signals. Those are expected to greatly contribute to the signal analysis of electronic warfare equipment and the development of jamming device.
Journal of the Korean Society for Aeronautical & Space Sciences
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v.35
no.4
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pp.347-352
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2007
This paper describes the design and implementation of PFM(Proto Flight Model, PFM) of DRE(Data Receiving Equipment, DRE) for Science and Technology Satellite 2(STSAT-2) and the results of integration performance test. DRE components are X-band receiver, DCE(Data Combine Equipment, DCE) and RAC(Receiving and Archiving Computer, RAC). DCE consists of I&Q data combiner and ECL signal distributor. RAC consists of DRC(Data Receiving Card) and ST2RAS(STSAT-2 Receiving and Archinving Software). X-band receiver receives 10Mbps QPSK I, Q satellite data and sends the data to DCE. DRC stores the I&Q combine data from DCE to RAID. The pre-processing program sorts and stores to satellite status data and payload data. The performance of DRE in the functional and space environments test satisfies the requirements of STSAT-2.
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[게시일 2004년 10월 1일]
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