Data Distribution Service(DDS) provides the communications service programmers need to distribute time-critical data between embedded and/or enterprise devices or nodes. In this paper, I propose efficient methods for transmitting and receiving messages of various characteristics in real-time using DDS middleware. For high-frequency characteristic data, I describe several DDS packet types and various default and extended DDS QoS policies. In particular, the batching method is probably the best solution when considering several performance aspects. For large-capacity characteristic data. I will show a method using extended DDS QoS policies, a segmentation and reassembly method, and transmitting and receiving a large-capacity data with low priority method considering network conditions. Finally, I simulate and compare the result of performance for each methods. This results will help determine efficient methods for transmitting and receiving messages of various characteristics using DDS middleware.
In this paper, we study on the reliability of Very High-rate Power Line Communication (VH-PLC) for Smart Grid, so that the resultant data rate is over 400Mbps at a physical layer. Firstly, reviewing the research trend of the PLC, we discuss the required techniques for supporting the Smart Grid. Considering a pre-specification with the value of several parameters, we investigate a multi-carrier modulation technique to overcome limitations of higher rate transmission under power line channel environments. Then, we propose a system specification of the VH-PLC in the sense of enhancing two features. One is resolving the problem of the co-existence of the deployed high-speed PLC according to the published standardization of KS X 4600-1 in Korea. The other is getting better performance on the grid adopting the diverse element techniques, such as multi-carrier modulation, a subcarrier utilization mode, a variable rate LDPC (Low Density Parity Check) code, and a time and frequency diversity technique. Further, a simulation tool, composed of an Event-Driven simulator and a Time-Driven simulator, is developed for the purpose of verifying the system performance and continuously cross-checking the test bench signal of the proposed VH-PLC system.
무선 이동 통신에서 여러 가지 멀티미디어 서비스를 제공하기 위해서는 더 높은 수준의 전송률을 필요로 하게 된다. DS-CDMA에서 전송률을 증가 시키는 방법으로 다중 확산 부호의 사용을 생각할 수 있다. 그러나 다중 경로 채널에서는 사용된 다중 확산 부호 간의 직교성이 파괴되어 코드 간 간섭을 일으키게 된다. 이 코드 간 간섭 현상은 다중 확산 부호를 사용한 DS-CDMA의 비트 오류 성능(BER)을 크게 떨어뜨린다. 일반적인 다중부호 DS-CDMA 시스템은 레이크(Rake) 수신기와 터보 디코더를 사용하는데, 이 방법으로는 코드 간 간섭 현상(ICI)으로 발생되는 오류 마루(error floor)를 극복 할 수 없다. 본 논문에서는 다중 확산 부호를 사용한 DS-CDMA 시스템에 대하여 최소 평균 제곱 오류(MMSE)를 기반으로 한 주파수 영역 터보 등화 기법(FDTE-MMSE)을 제안하고 컴퓨터 시뮬레이션을 통하여 성능을 확인하였다. 시뮬레이션 결과에 따르면 다중 경로 채널의 길이가 1보다 클 경우, 높은 $E_b/N_0$에서 FDTE-MMSE의 성능이 레이크 수신기와 터보 디코더를 결합하여 사용한 경우 보다 더욱 우수한 것으로 나타났다.
OFDMA 시스템에서 주파수축에서의 다중사용자 스케줄링의 성능은 채널의 주파수 선택적 특성과 상관이 있다. 채널이 주파수축에서 평탄하면 다중사용자 스케줄링의 이득이 줄어들 수 있으며 반대로 주파수 선택적 특성이 너무 커서 할당 대역폭 내에서 채널의 변화가 심하게 일어난다면 충분한 스케줄링 이득을 얻기 어려워진다. 다중 사용자 스케줄링 이득을 최대화하기 위해서는 순환지연 다이버시티를 적용하여 채널의 주파수 선택적 특성을 조절할 수 있다. 이 논문에서는 할당 대역폭과 채널 특성을 고려하여 순환지연 다이버시티를 적용할 때의 최적의 지연값을 결정하는 방법을 제안한다.
임펄스 기반의 초광대역 통신 기술은 이론적으로 근거리에서 고속의 데이터 전송과 고해상도의 거리 인지 및 무선 측위가 가능하다는 장점을 가지고 있지만 이러한 기능들을 수행하기 위해서는 우선적으로 고속의 ADC (Analog to Digital Convertor)가 요구되며 특히, 시간 기반의 무선 측위 기법을 적용할 경우 더욱 그러하다. 그러나 현실적으로 GHz 이상의 고속의 ADC는 매우 고가이기 때문에 본 논문에서 목표로 하는 저비용을 고려한 저속의 무선 개인 영역 네트워크 (Low Rate - Wireless Personal Area Network; LR-WPAN)에서는 부적합하다. 따라서 본 논문에서는 저속의 ADC로 고정밀의 무선 측위가 가능한 주파수 영역에서의 측위 기법을 소개하고 아날로그 단에서 주파수 변환을 위해 FM (Frequency Modulation) 방식을 접목시킨 새로운 형태의 non-coherent 기반의 수신 구조를 제안한다. 제안된 기법에 대한 성능을 검증하기 위해서 IEEE 802.15.4a TG에서 제시한 채널 모델을 적용하였으며 시뮬레이션 결과로부터 제안된 방안의 우수성을 검증하였다.
해면 상태의 변화는 수중 음향 통신 수신 신호에 전방 산란 및 도플러 확산을 야기하여 수신 신호의 진폭, 주파수 및 위상은 시간적으로 변화한다. 따라서 통신채널의 일관성 대역폭과 페이딩 변화에 의해 고속 동기식 디지털 통신 성능은 장애를 받게 된다. 본 논문에서는 2가지의 해면 상태에서 QPSK의 성능을 평가하였다. 해면 산란이 성능에 미치는 영향은 LFM 신호를 이용하여 구한 채널의 임펄스 응답과 시간 일관성을 기반으로 해석하였다. 잔잔한 해면보다 거친 해면 상태의 임펄스 응답은 불안정하고 일관성 시간은 짧다. 이러한 결과와 수신 신호의 포락선, 진폭 및 위상과의 관계를 해석하여 QPSK의 비트 오류율이 해면 상태와 직접적으로 관계되는 것을 확인하였다.
BLAST-OFDM 시스템은 미래 이동통신 시스템에서 고속의 멀티미디어 데이터 서비스를 위한 효율적인 전송기술이다. 본 논문에서는 BLAST-OFDM 시스템에 적용 가능한 선형 사전부호화 기법 및 전송 다이버시티를 극대화하기 위한 안테나-부채널 할당 알고리듬을 제안하였다. 제안된 알고리듬은 임의의 송수신 안테나 셋에 대하여, 최대한의 공간 다이버시티 이득과, 인터리빙 주파수 다이버시티 이득을 얻을 수 있다. 특히, 제안된 사전부호화 방식은 정보 심볼 서브셋을 과잉 없는 선형 성상 구조를 통하여 분산하고 있으므로 기존의 다른 부호화 기법과는 달리 데이터 전송률의 손실을 가져오지 않는다. 제안된 알고리듬을 적용할 경우 기존의 BLAST-OFDM 대비 4-5㏈ 이상의 성능 개선이 있음을 증명하였다.
CDMA 시스템은 이동통신 환경에서 매우 적합한 방식으로 증명이 되었지만 다중경로간섭에 취약하여 주파수 선택적 페이팅 환경에서 고속데이터 전송을 하기 어려운 단점을 가지고 있다. 이 논문에서는 차세대 이동통신 시스템에서 사용될 수 있는 하향링크 전송방법을 소개한다. 제안된 전송 방법은 3세대 이동통신 시스템과 호환성을 유지하면서 수신기에서 주파수 영역 등화의 사용을 가능하게 한다.
Intercarrier interference (ICI) in orthogonal frequency division multiplexing (OFDM) systems, which causes substantial performance degradation in time-varying fading channels, is analyzed. An equivalent spreading code formulation is derived based on the analogy of OFDM and code division multiple access (CDMA) systems. Techniques as linear multiuser detection in CDMA systems are applied to suppress the ICI in OFDM systems. The performance of linear detection, measured using multiuser efficiency and asymptotic multiuser efficiency, is analyzed given the assumption of perfect channel state information (CSI), which serves as an upper bound for the performance of practical systems. For systems without CSI, time domain and frequency domain channel estimation based linear detectors are proposed. The performance gains and robustness of a linear minimum mean square error (LMMSE) filter over a traditional filter (TF) and matched filter (MF) in the high signal-to-noise ratio (SNR) regime are demonstrated with numerical simulation results.
A 128/129 dual-modulus prescalar IC is designed for application to frequency synthesizers in high frequency communication systems. The FET logic used in this design is SCFL(Source Coupled FET Logic), employing depletion-mode 1.mu.m gate length GaAs MESFETs with the threshold voltage of -1.5V. This circuit consists of 8 flip-flops, 3 OR gates, 2 NOR gates, a modulus control buffer and I/O buffers, which are integrated with about 440 GaAs MESFETs on dimensions of 1.8mm. For $V_{DD}$ and $V_{SS}$ power supply voltages 5V and -3.3V Commonly used in TTL and ECL circuits are determined, respectively. The simulation results taking into account the threshold voltage variation of .+-.0.2V and the power supply variation of .+-.1V demonstrate that the designed prescalar can operate up to 2GHz. This prescalar is fabricated using the ETRI MMIC foundary process and the measured maximum operating frquency is 621MHz.
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[게시일 2004년 10월 1일]
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