• 제목/요약/키워드: Grid fault

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Enhanced Dynamic Response of SRF-PLL System for High Dynamic Performance during Voltage Disturbance

  • Choi, Hyeong-Jin;Song, Seung-Ho;Jeong, Seung-Gi;Choi, Ju-Yeop;Choy, Ick
    • Journal of Power Electronics
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    • 제11권3호
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    • pp.369-374
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    • 2011
  • Usually, a LPF (low pass filter) is used in the feedback loop of a SRF (synchronous reference frame) - PLL (phase locked loop) system because the measured grid voltage contains harmonic distortions and sensor noises. In this paper, it is shown that the cut-off frequency of the LPF should be designed to suppress the harmonic ripples contained in the measured voltage. Also, a new design method for the loop gain of the PI-type controller in the SRF-PLL is proposed with consideration of the dynamics of the LPF. As a result, a better transient response can be obtained with the proposed design method. The LPF frequency and the PI controller gain are designed in coordination according to the steady state and dynamic performance requirements. Furthermore, in the proposed method, the controller gain and the LPF cut-off frequency are changed from their normal value to a transient value when a voltage disturbance is detected. This paper shows the feasibility and usefulness of the proposed methods through the computer simulations and experimental results.

경계스캔이 적용된 보드에서의 고장 모델 및 전단 기법 (Fault Models and Diagonousis of Boundary Scan Board)

  • 문권우;송오영
    • 한국정보처리학회:학술대회논문집
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    • 한국정보처리학회 2002년도 춘계학술발표논문집 (하)
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    • pp.1619-1622
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    • 2002
  • 최근에 생산되는 디지털 VLSI칩들은 그 집적도가 계속 높아지고 있으며, 이러한 칩들을 장착한 보드의 경우도 그 복잡성이 점차 높아지고 있다. 이에 따라 칩 및 보드에 대한 철저한 테스트 과정이 요구된다. 지금까지 보드 테스트 방법으로 널리 쓰였던 ICT(In-Circuit Test)는 칩의 고집적화에 따른 핀 간격의 조밀화와 SMT(Surface Mount Technology), BGA(Ball Grid Array), MCM(Multi Chip Module) 등의 새로운 패키징 방식의 등장에 따라 테스트 방법으로의 한계성을 드러내고 있다. 이에 대한 대안으로 등장한 IEEE Std 1149.1 은 ICT의 한계성을 극복할 수 있는 기술일 뿐 아니라 여러 가지 장점을 가지고 있으며 그 활용 분야도 다양하다. 본 논문에서는 IEEE Std 1149.1에 따라 설계된 보드 상에서 발생 가능한 고장들에 대한 고장 모델을 제시한다. 또한 각 고장 모델들의 양상과 진단 기법을 제시한다. 이를 통해 IEEE Std 1149.1에 따라 설계된 보드 상에서 발생한 고장들을 검출할 수 있으며, 고장의 종류 및 성격, 그리고 고장의 발생 위치 등의 정보를 얻을 수 있다. IEEE Std 1149.1에 따른 보드 설계가 보드의 신뢰성 보장에 긴요함을 인식하는 계기가 되기를 기대하며 제시된 고장 모델 및 진단 기법이 기술적으로 중요한 참고자료가 되기를 기대한다.

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Resonance Investigation and Active Damping Method for VSC-HVDC Transmission Systems under Unbalanced Faults

  • Tang, Xin;Zhan, Ruoshui;Xi, Yanhui;Xu, Xianyong
    • Journal of Power Electronics
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    • 제19권6호
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    • pp.1467-1476
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    • 2019
  • Grid unbalanced faults can cause core saturation of power transformer and produce lower-order harmonics. These issues increase the electrical stress of power electronic devices and can cause a tripping of an entire HVDC system. In this paper, based on the positive-sequence and negative-sequence impedance model of a VSC-HVDC system as seen from the point of common connection (PCC), the resonance problem is analyzed and the factors determining the resonant frequency are obtained. Furthermore, to suppress over-voltage and over-current during resonance, a novel method using a virtual harmonic resistor is proposed. The virtual harmonic resistor emulates the role of a resistor connected in series with the commutating inductor without influencing the active and reactive power control. Simulation results in PSCAD/EMTDC show that the proposed control strategy can suppress resonant over-voltage and over-current. In addition, it can be seen that the proposed strategy improves the safety of the VSC-HVDC system under unbalanced faults.

속도 향상을 위한 서포트 벡터 머신의 파라미터 탐색 방법론 (Parameter search methodology of support vector machines for improving performance)

  • 이성보;김재영;김철홍;김종면
    • 예술인문사회 융합 멀티미디어 논문지
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    • 제7권3호
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    • pp.329-337
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    • 2017
  • 본 논문에서는 서포트 벡터 머신의 중요한 파라미터인 C와 σ값을 빠르고 정확하게 찾는 탐색 방법론을 제안한다. 기존에 알려진 격자 탐색 방식은 모든 경우를 비교하기 때문에 탐색속도가 느리다. 이러한 문제점을 개선하기 위해 본 논문에서는 탐색속도 향상을 위한 딥 서치 방식을 제안한다. 1단계에서는 C-σ 정확도지표를 4등분 한 뒤 각 영역의 중간 값을 탐색하여 가장 정확도 값이 높은 지점을 시작 지점으로 선택한다. 2단계에서는 선정된 시작지점을 다시 4등분한 뒤 정확도 값이 가장 큰 지점을 새로운 탐색지점으로 지정한다. 3단계에서는 탐색지점에 이웃한 8개의 지점들을 탐색하여 정확도 값이 가장 높은 곳을 새로운 시작 지점으로 선정한 뒤 해당 지점을 4등분하여 정확도 값을 계산한다. 마지막 단계에서는 이웃 지점의 값들보다 탐색지점의 정확도지표 값이 최댓값이 될 때까지 진행한다. 최댓값을 만족하지 않을시 2단계에서부터 반복하며 입력된 레벨 값만큼 반복을 진행한다. 베어링의 결함 및 정상 데이터를 사용하여 비교한 결과, 제안한 Deep search 알고리즘은 기존 알고리즘 보다 성능 및 탐색시간에서 우수성을 보였다.

터널 굴착에 따른 전기비저항 모니터링 기술 적용 (Application of resistivity monitoring with tunnel excavation area)

  • 안희윤;정재형;조인기;김정호;배규진
    • 한국터널지하공간학회 논문집
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    • 제10권4호
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    • pp.405-420
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    • 2008
  • 전기비저항 탐사법은 터널 주변 지반 혹은 암반의 안정성을 조사하기 위해 사용되는 물리탐사법 중의 하나이다. 다양한 물리탐사법 중에서도 전기비저항 탐사법은 터널설계 단계에서 미리 소사가 수행되어 시공비용을 절감하고 안정성을 확보하기 위한 중요한 자료로 이용되고 있다. 현재 전기비저항 탐사 자료의 해석은 주로 1회의 단일 측정 자료를 대상으로 이루어지고 있지만, 터널 굴착이나 기 굴착된 터널의 유지관리를 위해서는 터널 주변의 시간에 따른 지하수의 분포상황 변화 등이 관측되어야 한다. 이를 위해서는 모니터링 기법이 도입되어야 한다. 따라서 터널 굴착에 따른 전기비저항 변화 파악을 위하여 격자형 측선을 설치하여 총 6회의 전기비저항 모니터링을 수행하였다. 또한 모니터링 시스템을 통해 조사지역에 분포하는 단층대에 상세한 정보를 제공함으로써 안전시공에 예측 시스템으로 가능유무를 평가하고자 하였다.

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해양전력계통에서 한류 리액터 적용에 관한 연구 (A study on applications of current limiting reactor in marine electrical power systems)

  • 김철호;김현준;정현우;윤경국;김윤식;서동환
    • Journal of Advanced Marine Engineering and Technology
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    • 제38권1호
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    • pp.86-91
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    • 2014
  • 조선해양 및 플랜트 분야에서의 전력계통 구성은 분산 배치된 각각의 발전모선을 전기적으로 연결하여 사용한다. 이러한 방식은 다중화 된 모선이라기보다는 육상에서의 계통 연계와 동일한 개념으로 인식하는 것이 적합할 것이다. 이는 발전모선의 추가로 인하여 모선의 단락용량 또한 비례적으로 증대되기 때문이다. 단락용량의 증가는 관련 제반 비용의 상승을 초래하고 전기적 고장 발생 시에 물리적으로 연결된 모선들이 일시에 대정전(Blackout)을 발생시킬 가능성도 높아진다. 이러한 문제점을 해결하기 위하여 본 논문에서는 한류 리액터가 적용된 조선해양 전력계통에서 발전모선을 위상구조(Bus Topology)에 따라 분류하고 고장 종류 별로 단락전류 해석을 수행하였으며 그 결과를 상호 비교하여 장단점을 제시하였다.

Transient Multipath routing protocol for low power and lossy networks

  • Lodhi, Muhammad Ali;Rehman, Abdul;Khan, Meer Muhammad;Asfand-e-yar, Muhammad;Hussain, Faisal Bashir
    • KSII Transactions on Internet and Information Systems (TIIS)
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    • 제11권4호
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    • pp.2002-2019
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    • 2017
  • RPL routing protocol for low-power and lossy networks is an Internet Engineering Task Force (IETF) recommended IPv6 based protocol for routing over Low power Lossy Networks (LLNs). RPL is proposed for networks with characteristics like small packet size, low bandwidth, low data rate, lossy wireless links and low power. RPL is a proactive routing protocol that creates a Directed Acyclic Graph (DAG) of the network topology. RPL is increasingly used for Internet of Things (IoT) which comprises of heterogeneous networks and applications. RPL proposes a single path routing strategy. The forwarding technique of RPL does not support multiple paths between source and destination. Multipath routing is an important strategy used in both sensor and ad-hoc network for performance enhancement. Multipath routing is also used to achieve multi-fold objectives including higher reliability, increase in throughput, fault tolerance, congestion mitigation and hole avoidance. In this paper, M-RPL (Multi-path extension of RPL) is proposed, which aims to provide temporary multiple paths during congestion over a single routing path. Congestion is primarily detected using buffer size and packet delivery ratio at forwarding nodes. Congestion is mitigated by creating partially disjoint multiple paths and by avoiding forwarding of packets through the congested node. Detailed simulation analysis of M-RPL against RPL in both grid and random topologies shows that M-RPL successfully mitigates congestion and it enhances overall network throughput.

이중여자 유도형 풍력발전기 기반 풍력단지의 계통 연계점 전압제어 (Voltage Control for a Wind Power Plant Based on the Available Reactive Current of a DFIG and Its Impacts on the Point of Interconnection)

  • ;김진호;;강용철
    • 전기학회논문지
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    • 제65권1호
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    • pp.23-30
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    • 2016
  • Wake effects cause wind turbine generators (WTGs) within a wind power plant (WPP) to produce different levels of active power and subsequent reactive power capabilities. Further, the impedance between a WTG and the point of interconnection (POI)-which depends on the distance between them-impacts the WPP's reactive power injection capability at the POI. This paper proposes a voltage control scheme for a WPP based on the available reactive current of the doubly-fed induction generators (DFIGs) and its impacts on the POI to improve the reactive power injection capability of the WPP. In this paper, a design strategy for modifying the gain of DFIG controller is suggested and the comprehensive properties of these control gains are investigated. In the proposed scheme, the WPP controller, which operates in a voltage control mode, sends the command signal to the DFIGs based on the voltage difference at the POI. The DFIG controllers, which operate in a voltage control mode, employ a proportional controller with a limiter. The gain of the proportional controller is adjusted depending on the available reactive current of the DFIG and the series impedance between the DFIG and the POI. The performance of the proposed scheme is validated for various disturbances such as a reactive load connection and grid fault using an EMTP-RV simulator. Simulation results demonstrate that the proposed scheme promptly recovers the POI voltage by injecting more reactive power after a disturbance than the conventional scheme.

지형 단면을 이용한 의미점 추출에 관한 연구 (A Study On Extracting Surface-Specific Point Using The Cross Section of The Terrain)

  • 류승택;윤경현
    • 대한공간정보학회지
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    • 제6권2호
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    • pp.133-141
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    • 1998
  • 지형 모델링은 사각그리드에 의한 방법과 불규칙 삼각망을 이용한 방법으로 나눌 수 있다. 특히 불규칙 삼각망에 의한 방법은 적은 지형 데이터로써 지형의 특징을 잘 표현할 수 있고 렌더링시간을 단축시킬 수 있어 널리 사용되고 있다. 이러한 불규칙 삼각망을 만들기 위해서는 의미점 추출과정과 삼각형화 과정이 필요하다. 본 논문은 이러한 전처리 작업 중 의미점 추출과정의 개선에 중점을 두었다. 의미점을 추출하는 방법에는 8방향 이웃점 검사 방법과 이를 변형한 방법들이 많이 사용되고 있다. 또한 다각형 감소 기법을 응용하여 불필요한 점들을 제거하는 방법도 제안되고 있다. 그중 기본적으로 사용하는 8방향 이웃점 검사 방법을 이용한 의미점 추출 방법은 필요 없는 점들을 추출한다는 문제점을 가지고 있다. 이러한 문제점을 해결하기 위해서 지형 단면을 이용한 의미점 추출방법을 제안한다. 이 방법은 기존의 방법보다 의미점 추출 시간이 빠르고 적은 지형 자료로 보다 정확한 특징점을 추출할 수 없다.

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대기시간 데드라인 조건을 고려한(n, k)-way 시스템의 가용 성능 분석 (Analysis of Available Performance Satisfying Waiting Time Deadline for (n, k)-way Systems)

  • 박기진;김성수
    • 한국정보과학회논문지:시스템및이론
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    • 제30권9호
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    • pp.445-453
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    • 2003
  • 일정 수준의 시스템 성능을 제공하기 위해 다수의 서버를 클러스터로 연결하여 동시에 가동할 경우, 서버의 가동 대수가 증가함으로 인해 발생하는 가용도 저하 문제를 해결해야 하며, 이를 위해서는 시스템의 성능 변화를 반영할 수 있는 가용 성능에 대한 명확한 정의가 요구된다. 기존의 가용도에 관한 연구들은 시스템의 성능(대기시간, 응답시간 등)을 고려하지 않는 가용도 계산 모델이 주를 이루고 있으며, 또한 클러스터 시스템을 구성하는 주 서버의 결함 발생을 허용하기 위한 방안에 대한 연구가 부족하였다. 본 논문에서는 위와 같은 문제점들에 대한 해결 방안의 일환으로, 비용 효율적인 결함허용을 위해 n 대의 주 서버와 k 대의 여분서버로 구성된 클러스터 시스템에서 대기시간을 일정 수준이하로 만족시키는지에 근거한 새로운 가용도 척도를 제시하였으며, 다양한 시스템 운영 상태에 대한 실험을 통하여, 시스템의 대기 시간 데드라인 성능이 포함된 보다 현실적인 가용도 및 downtime을 계산하였다.